JPS62204955A - 文字画像発生回路 - Google Patents
文字画像発生回路Info
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- JPS62204955A JPS62204955A JP61049059A JP4905986A JPS62204955A JP S62204955 A JPS62204955 A JP S62204955A JP 61049059 A JP61049059 A JP 61049059A JP 4905986 A JP4905986 A JP 4905986A JP S62204955 A JPS62204955 A JP S62204955A
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- Japan
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- memory
- image
- character
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
- G06K15/02—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers
- G06K15/12—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers
- G06K15/128—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers using printers by photographic printing, e.g. by laser printers generating or processing printable items, e.g. characters
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/42—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of patterns using a display memory without fixed position correspondence between the display memory contents and the display position on the screen
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Optics & Photonics (AREA)
- General Engineering & Computer Science (AREA)
- Controls And Circuits For Display Device (AREA)
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は、ビットマツプ方式の文字画像発生回路に関す
る。
る。
(従来の技術)
ビットマツプ方式の文字画像発生回路においては、画像
は一旦ビットマップメモリに描画された後、この内容が
印字ドツトデータとして出力装置(プリンタ)に送られ
る。
は一旦ビットマップメモリに描画された後、この内容が
印字ドツトデータとして出力装置(プリンタ)に送られ
る。
第5図に、ビットマツプ方式の文字画像発生方式の概略
を示す。ワードプロセッサやコンピュータ等のホストコ
ンピュータ1は、ホストインターフェイス2を介して、
文字コード情報を文字発生器3に送る。なお、ここでい
う文字コードとは、アルファベットや数字等のいわゆる
文字の他に、通常の文章作成や数式等に用いる種々の記
号等に対応するコードも含む。文字コード情報は、テキ
ストバッファ4に記憶される。1ページ分の文字データ
が文字コード列としてテキストバッファ4に記憶される
と、これらの文字フード列は、フォントメモリ5を参照
してVットパターンデータに変換され、ビットイメージ
としてビットマツプメモリ6に一旦記憶される。ビット
マツプメモリに記憶されたデータは、パラレルシリアル
変換器7を介して、プリンタ(たとえば、レーザ光学系
8と電子写真系9とからなるレーザプリンタ)で印字さ
れる。このビットマツプ方式の文字画像発生方式では、
印字位置や印字方向の島め細かな制御が可能である。
を示す。ワードプロセッサやコンピュータ等のホストコ
ンピュータ1は、ホストインターフェイス2を介して、
文字コード情報を文字発生器3に送る。なお、ここでい
う文字コードとは、アルファベットや数字等のいわゆる
文字の他に、通常の文章作成や数式等に用いる種々の記
号等に対応するコードも含む。文字コード情報は、テキ
ストバッファ4に記憶される。1ページ分の文字データ
が文字コード列としてテキストバッファ4に記憶される
と、これらの文字フード列は、フォントメモリ5を参照
してVットパターンデータに変換され、ビットイメージ
としてビットマツプメモリ6に一旦記憶される。ビット
マツプメモリに記憶されたデータは、パラレルシリアル
変換器7を介して、プリンタ(たとえば、レーザ光学系
8と電子写真系9とからなるレーザプリンタ)で印字さ
れる。このビットマツプ方式の文字画像発生方式では、
印字位置や印字方向の島め細かな制御が可能である。
(発明の解決すべき問題点)
ビットマツプ方式の文字画像発生方式では、ビットマツ
プメモリは、通常1ページ分の画像データに対応する大
きな容量を持つ必要がある。たとえば、A3の紙に4
i30dpi(dots per 1nch )の解像
度で印字するには、約5.7メガバイトの容量のRAM
が必要となる。したがって、ビットマツプメモリのコス
トは高い。高解像度化またはページサイズの大型化(た
とえばA4からA3へ)に従って、容量がますます増加
する。
プメモリは、通常1ページ分の画像データに対応する大
きな容量を持つ必要がある。たとえば、A3の紙に4
i30dpi(dots per 1nch )の解像
度で印字するには、約5.7メガバイトの容量のRAM
が必要となる。したがって、ビットマツプメモリのコス
トは高い。高解像度化またはページサイズの大型化(た
とえばA4からA3へ)に従って、容量がますます増加
する。
本発明のl的は、フルページよりも少ない容量でフルペ
ージの場合と同等の機能を有するビットマツプメモリを
備えた文字画像発生回路を提供することである。
ージの場合と同等の機能を有するビットマツプメモリを
備えた文字画像発生回路を提供することである。
(問題点を解決するための手段)
本発明に係る文字画像発生回路は、文字コードをビット
イメージの文字画像に変換してメモリ上に描画し、その
データを画像出力装置に供給する文字画像発生回路にお
いて、文字画像のビットイメージを記憶するための、1
ページ分のビットイメージデータの容量より小さい所定
の容量を有するビット記憶手段と、ビット記憶手段にビ
ットイメージのデータを描画する描画手段と、ビット記
憶手段に格納されたデータを所定の方式で圧縮するデー
タ圧縮手段と、データ圧縮手段により圧縮された1ペー
ジ分のデータを格納できる容量を有する圧縮データ記憶
手段と、圧縮データ記憶手段に格納されたデータをビッ
トイメージに復元し、画像出力装置に供給する復元手段
と、1ページ分の文字フードのデータを複数の単位に分
割して、各単位ごとに順次描画手段とデータ圧縮手段と
により描画と圧縮を行わせて圧縮データ記憶手段に格納
させ、1ページ分のデータが格納されると、復元手段を
作動させる画像発生制御手段とを備えたことを特徴とす
る。
イメージの文字画像に変換してメモリ上に描画し、その
データを画像出力装置に供給する文字画像発生回路にお
いて、文字画像のビットイメージを記憶するための、1
ページ分のビットイメージデータの容量より小さい所定
の容量を有するビット記憶手段と、ビット記憶手段にビ
ットイメージのデータを描画する描画手段と、ビット記
憶手段に格納されたデータを所定の方式で圧縮するデー
タ圧縮手段と、データ圧縮手段により圧縮された1ペー
ジ分のデータを格納できる容量を有する圧縮データ記憶
手段と、圧縮データ記憶手段に格納されたデータをビッ
トイメージに復元し、画像出力装置に供給する復元手段
と、1ページ分の文字フードのデータを複数の単位に分
割して、各単位ごとに順次描画手段とデータ圧縮手段と
により描画と圧縮を行わせて圧縮データ記憶手段に格納
させ、1ページ分のデータが格納されると、復元手段を
作動させる画像発生制御手段とを備えたことを特徴とす
る。
(作 用)
ビットイメージデータを−Hビット記憶手段に格納し、
このデータを所定の方式で圧縮して圧縮データ記憶手段
に格納する。
このデータを所定の方式で圧縮して圧縮データ記憶手段
に格納する。
(実施例)
以下、添付の図面を参照して、本発明の詳細な説明する
。
。
第1図に、本発明の実施例の文字画像発生回路のブロッ
ク図を示す。ワードプロセッサやフンピユータ等のホス
トコンピュータ12は、ホストインターフェイス13を
介して、文字コード情報またはグラフィック情報を制御
回路11のマイクロプロセッサ(CPU)21に送る0
文字コード情報は、テキストバッファ22に記憶される
。1ページ分の文字データが文字フード列としてテキス
トバッフ722に記憶されると、CPU21は、描画制
御部23に信号を送る。この信号を受けると、描画制御
部23は、テキストバッフ722から文字コードを順次
読み出し、7オントメモリ24を参照してその文字コー
ドに対応するビットイメージを読出し、解像度に応じて
1対1で第1メモリ14に書き込む。所定量だけ第1メ
モリ14にデータが書き込まれると、描画制御部23は
、このデータを所定の方式で圧縮して第27モリ15に
書き込む。この過程を繰り返して、テキストバッフ72
2の全データがm2メモリ15に圧縮されると、描画制
御部23は、次に、復元信号を復元回路16に送る。二
の復元信号を受けると、復元回路16は、tjrJ2メ
モリ15の内容をCDATAO〜7のラインを介して順
次読出し、ドツトデータに復元し、プリンタ17がら人
力信号LDREQを受けると、このドツトデータをLD
ATO〜7としてプリンタ17に送る。
ク図を示す。ワードプロセッサやフンピユータ等のホス
トコンピュータ12は、ホストインターフェイス13を
介して、文字コード情報またはグラフィック情報を制御
回路11のマイクロプロセッサ(CPU)21に送る0
文字コード情報は、テキストバッファ22に記憶される
。1ページ分の文字データが文字フード列としてテキス
トバッフ722に記憶されると、CPU21は、描画制
御部23に信号を送る。この信号を受けると、描画制御
部23は、テキストバッフ722から文字コードを順次
読み出し、7オントメモリ24を参照してその文字コー
ドに対応するビットイメージを読出し、解像度に応じて
1対1で第1メモリ14に書き込む。所定量だけ第1メ
モリ14にデータが書き込まれると、描画制御部23は
、このデータを所定の方式で圧縮して第27モリ15に
書き込む。この過程を繰り返して、テキストバッフ72
2の全データがm2メモリ15に圧縮されると、描画制
御部23は、次に、復元信号を復元回路16に送る。二
の復元信号を受けると、復元回路16は、tjrJ2メ
モリ15の内容をCDATAO〜7のラインを介して順
次読出し、ドツトデータに復元し、プリンタ17がら人
力信号LDREQを受けると、このドツトデータをLD
ATO〜7としてプリンタ17に送る。
次に、CPU21のデータ処理を、第2図を用いてより
詳細に説明する。まず、テキストバッフ722にデータ
が記憶されていないことを判定する(ステップ#1)。
詳細に説明する。まず、テキストバッフ722にデータ
が記憶されていないことを判定する(ステップ#1)。
テキストバッファ22にデータがなければ、次に、ホス
トコンピュータ12から文字フード情報(たとえばアス
キーコードで送られる。)をテキストバッファ22に記
憶する(#2(以下、ステップを略する。))。1ペー
ジ分の文字フード情報がテキストバッファ22に記憶さ
れるまで(#3)、この手順を繰り返す。1ページ分の
データが記憶されると、描画制御部23に信号を送る。
トコンピュータ12から文字フード情報(たとえばアス
キーコードで送られる。)をテキストバッファ22に記
憶する(#2(以下、ステップを略する。))。1ペー
ジ分の文字フード情報がテキストバッファ22に記憶さ
れるまで(#3)、この手順を繰り返す。1ページ分の
データが記憶されると、描画制御部23に信号を送る。
そして、テキストバッフ722のデータが読出されるの
を待つ。描画制御部23は、データ圧縮の処理が終わっ
たとぎ、CPU21に信号を送る。この信号を受けると
(#5)、復元回路16に信号を送る(#6)。復元回
路16は、この信号を受けると、上に説明したように、
第27モリ15の内容を復元して、プリンタ17に送る
。
を待つ。描画制御部23は、データ圧縮の処理が終わっ
たとぎ、CPU21に信号を送る。この信号を受けると
(#5)、復元回路16に信号を送る(#6)。復元回
路16は、この信号を受けると、上に説明したように、
第27モリ15の内容を復元して、プリンタ17に送る
。
次に、描画制御部23による描画とデータ圧縮を第3図
を用いてより詳細に説明する。描画制御部23は、テキ
ストバッファ22に1ページ分の文字コード情報が書き
込まれると、CPU21から信号を受ける(#11)。
を用いてより詳細に説明する。描画制御部23は、テキ
ストバッファ22に1ページ分の文字コード情報が書き
込まれると、CPU21から信号を受ける(#11)。
描画制御部23は、第4図に示すように、テキストバッ
フ722を4つのブロックに分け、順次処理する。まず
、nを1としく#12)、ブロック1の文字コード列を
7オントメモリ24を参照して文字パターンに変換し、
第1メモリ14に書き込む(#13)。A3フルサイズ
では全文字パターンは約5.7メガバイトの容量を必要
とするので、第17モリ14の容量は5.77がバイト
を4等分した値より適当に大きな容量例えば2メガバイ
トとする。次に、描画制御部23は、第17モリ14の
内容を読み出し、ランレングス符号化法(たとえばMH
符号化法)によりデータを圧縮して、第27モリ15に
格納する(#14)。
フ722を4つのブロックに分け、順次処理する。まず
、nを1としく#12)、ブロック1の文字コード列を
7オントメモリ24を参照して文字パターンに変換し、
第1メモリ14に書き込む(#13)。A3フルサイズ
では全文字パターンは約5.7メガバイトの容量を必要
とするので、第17モリ14の容量は5.77がバイト
を4等分した値より適当に大きな容量例えば2メガバイ
トとする。次に、描画制御部23は、第17モリ14の
内容を読み出し、ランレングス符号化法(たとえばMH
符号化法)によりデータを圧縮して、第27モリ15に
格納する(#14)。
第17モリ14の内容がすべて圧縮されて第2メモリ1
5に書き込まれると、nを1つ増加しく#15)、nが
4より大きくない場合は(#16)、#13に戻り、次
のブロックの処理を行う。こうして、全ブロックが処理
されると、CPU21に信号を送る(#17)。
5に書き込まれると、nを1つ増加しく#15)、nが
4より大きくない場合は(#16)、#13に戻り、次
のブロックの処理を行う。こうして、全ブロックが処理
されると、CPU21に信号を送る(#17)。
この例では、tJt11メモリの容量を1ページ分のビ
ットマツプの約174とした。また、ランレングス法に
よる圧縮率は通常1/8程度となり、第2メモリの容量
は1ページ分のビットマツプの1/8とした。従って、
この方法によれば、1/4+1/8=3/8のメモリ容
量で、フルビットマツプと同様な機能を得ることができ
る。
ットマツプの約174とした。また、ランレングス法に
よる圧縮率は通常1/8程度となり、第2メモリの容量
は1ページ分のビットマツプの1/8とした。従って、
この方法によれば、1/4+1/8=3/8のメモリ容
量で、フルビットマツプと同様な機能を得ることができ
る。
(発明の効果)
ビットマツプ方式の文字画像発生方式において、文字パ
ターンを圧縮して格納する記憶手段を用いるので、この
記憶手段の容量を小さくでざる。したがって、記憶手段
のコストを低下できる。
ターンを圧縮して格納する記憶手段を用いるので、この
記憶手段の容量を小さくでざる。したがって、記憶手段
のコストを低下できる。
mi図は、文字画像発生回路のブロック図であ第2図と
第3図は、それぞれ、文字画像発生制御と描画制御の7
0−チャートである。 第4図は、データ圧縮を説明するための図である。 第5図は、従来のビットマツプ方式の文字画像発生方式
のブロック図である。 11・・・制御回路 14・・・第1メモリ、15
・・・第2メモリ 16・・・復元回路、21・・・
CPU、 22・・・テキストバッファ、23・
・・描画制御部、 24・・・7オントメモリ。
第3図は、それぞれ、文字画像発生制御と描画制御の7
0−チャートである。 第4図は、データ圧縮を説明するための図である。 第5図は、従来のビットマツプ方式の文字画像発生方式
のブロック図である。 11・・・制御回路 14・・・第1メモリ、15
・・・第2メモリ 16・・・復元回路、21・・・
CPU、 22・・・テキストバッファ、23・
・・描画制御部、 24・・・7オントメモリ。
Claims (1)
- (1)文字コードをビットイメージの文字画像に変換し
てメモリ上に描画し、そのデータを画像出力装置に供給
する文字画像発生回路において、文字画像のビットイメ
ージを記憶するための、1ページ分のビットイメージデ
ータの容量より小さい所定の容量を有するビット記憶手
段と、ビット記憶手段にビットイメージのデータを描画
する描画手段と、 ビット記憶手段に格納されたデータを所定の方式で圧縮
するデータ圧縮手段と、 データ圧縮手段により圧縮された1ページ分のデータを
格納できる容量を有する圧縮データ記憶手段と、 圧縮データ記憶手段に格納されたデータをビットイメー
ジに復元し、画像出力装置に供給する復元手段と、 1ページ分の文字コードのデータを複数の単位に分割し
て、各単位ごとに順次描画手段とデータ圧縮手段とによ
り描画と圧縮を行わせて圧縮データ記憶手段に格納させ
、1ページ分のデータが格納されると、復元手段を作動
させる画像発生制御手段とを備えたことを特徴とする文
字画像発生回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61049059A JPS62204955A (ja) | 1986-03-05 | 1986-03-05 | 文字画像発生回路 |
| US07/021,456 US4881180A (en) | 1986-03-05 | 1987-03-04 | Character image generating circuit |
| DE3707112A DE3707112C3 (de) | 1986-03-05 | 1987-03-05 | Zeichenbilderzeugungsschaltung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61049059A JPS62204955A (ja) | 1986-03-05 | 1986-03-05 | 文字画像発生回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62204955A true JPS62204955A (ja) | 1987-09-09 |
Family
ID=12820510
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61049059A Pending JPS62204955A (ja) | 1986-03-05 | 1986-03-05 | 文字画像発生回路 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4881180A (ja) |
| JP (1) | JPS62204955A (ja) |
| DE (1) | DE3707112C3 (ja) |
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