JPS6236253B2 - - Google Patents

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JPS6236253B2
JPS6236253B2 JP54113096A JP11309679A JPS6236253B2 JP S6236253 B2 JPS6236253 B2 JP S6236253B2 JP 54113096 A JP54113096 A JP 54113096A JP 11309679 A JP11309679 A JP 11309679A JP S6236253 B2 JPS6236253 B2 JP S6236253B2
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JP
Japan
Prior art keywords
data
input
shift register
guidance
contents
Prior art date
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Expired
Application number
JP54113096A
Other languages
Japanese (ja)
Other versions
JPS5636730A (en
Inventor
Toshio Ikeda
Toshiaki Yuasa
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Canon Inc
Original Assignee
Canon Inc
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Publication date
Application filed by Canon Inc filed Critical Canon Inc
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Publication of JPS5636730A publication Critical patent/JPS5636730A/en
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Description

【発明の詳細な説明】 本発明はデータ処理装置に関し、キー入力に対
するオペレーター・ガイダンス表示及びキー入力
データを同一列に表示するデータ処理装置に関す
るものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a data processing device, and more particularly to a data processing device that displays operator guidance for key input and key input data in the same column.

従来オペレータ・ガイダンス表示に対応して、
データ入力をするいわゆる対話型のオペレーシヨ
ンにおいては、ガイダンスに対応するデータを記
憶する先行入力バツフアをもつて入力方式にする
と、入力データとキー入力に対するオペレータ
ー・ガイダンスとの同期がとれず、入力データ表
示欄とガイダンス表示欄をわけて表示する為入力
に際して1欄のみを注視できる形にならない欠点
をもつていた。又、入力データ表示欄とガイダン
ス表示欄を一欄にまとめた方式だと、先行入力が
困難な入力装置になつてしまい使いずらいという
欠点をもつていた。
In response to the conventional operator guidance display,
In so-called interactive operations where data is input, if the input method has a pre-input buffer that stores data corresponding to guidance, the input data will not be synchronized with the operator guidance for key input, and the input data will not be synchronized with the operator guidance. Since the display field and the guidance display field are displayed separately, it has the disadvantage that it is not possible to focus on only one field during input. Furthermore, the system in which the input data display field and the guidance display field are combined into one field has the disadvantage that it becomes an input device in which advance input is difficult, making it difficult to use.

本発明は、上記の欠点を改善するデータ処理装
置を提供する。
The present invention provides a data processing device that improves the above-mentioned drawbacks.

本発明の他の目的はブラインドタツチで次々と
原紙伝票だけを見ながら入力する専任オペレー
タ、オペレートに関しては素人で入力ガイダンス
を見ながら、かつ、逐次入力データを確認しなが
ら入力するオペレータ、その両者の中間で多少操
作になれたが一応入力データを確認する事もある
オペレータ、のいずれのオペレータにとつても最
も使い易いデータ処理装置を提供する。
Another object of the present invention is to enable full-time operators who input data by blind touch while looking at only the original paper slips one after another, and amateur operators who input data while looking at input guidance and sequentially checking input data. To provide a data processing device that is most easy to use for any operator, including an intermediate operator who has become somewhat familiar with operations but sometimes needs to confirm input data.

即ちブラインドタツチの専任オペレータには先
行入力機能により入力スピードを落さずに入力で
きオペレートに関する混乱をきたさないよう同期
のずれた入力ガイダンス等を表示させずに、オペ
レート出来る機能を提供し、又素人の一般オペレ
ータには同一欄にオペレーター・ガイダンスと入
力データが一覧性をもたして逐次入力ガイダンス
を参照しながら入力できる機能を提給し、多少操
作になれたオペレータには上記両機能の使いわけ
と最低限入力したデータの確認が一点を注視して
いれば出来る機能を有するデータ処理装置を提供
する。
In other words, we provide full-time blind touch operators with a function that allows them to input data without slowing down their input speed using the advanced input function, and allows them to operate without displaying out-of-sync input guidance to avoid confusion regarding operation. General operators are provided with a function that allows them to view operator guidance and input data in the same column and input data while referring to the input guidance sequentially. To provide a data processing device having a function that allows confirmation of inputted data at a minimum by looking at one point.

本発明の一実施例を以下図面を参照して説明す
る。第1図は本発明の一実施例のブロツク図であ
る。KBはキーボードで、データ入力キーN及び
データエンドを入力するエントリキーENTを有
し、信号線KDを介してキーデータを送り、信号
線SLを介して入力ストローブ信号を送る。
An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is a block diagram of one embodiment of the present invention. KB is a keyboard, which has a data input key N and an entry key ENT for inputting data end, sends key data through a signal line KD, and sends an input strobe signal through a signal line SL.

CPUは演算装置でキー入力データを受けとり
ガイダンスデータを送出する為双方向のデータ転
送線DATALとコマンド伝達線CMNDLに接続さ
れている。SR1、SR2はシフトレジスタであ
り、シフトレジスタSR1はキーバツフアであり
置数されたキー信号がはいり、シフトレジスタ
SR2はガイダンス用のシフトレジスタであり、
演算装置CPUからのコマンド伝達線CMNDLによ
り選択されデータ転送線DATALによりガイダン
スデータがセツトされる。Dispは表示装置であ
る。ガイダンスのセツト命令と入力命令が出てい
てENTRYキーENT(入力項目のデータエンドを
示す)が入力されていないという条件によりシフ
トレジスタSR2はシフトレジスタSR1とマージ
され表示される。FF1,FF2,FF3,FF4は
フリツプフロツプで、フリツプフロツプFF1は
演算装置CPUからのガイダンスセツト命令GSに
よりセツトされて入力データ転送終了TEにより
リセツトされ、フリツプフロツプFF2は演算装
置CPUからの入力データ転送命令TCによりセツ
トされ、入力データ転送終了TEによりセツトさ
れる。フリツプフロツプFF3はエントリコード
検出回路DET1によりシフトレジスタSR1の中
にENTRYコードが検出されるとセツトされ入力
データ転送DTによりリセツトされる。
The CPU is connected to a bidirectional data transfer line DATAL and a command transfer line CMNDL in order to receive key input data and send guidance data in the arithmetic unit. SR1 and SR2 are shift registers, and shift register SR1 is a key buffer.
SR2 is a shift register for guidance,
Guidance data is selected by the command transmission line CMNDL from the arithmetic unit CPU and set by the data transfer line DATAL. Disp is a display device. Shift register SR2 is merged with shift register SR1 and displayed under the condition that the guidance set command and input command have been issued and the ENTRY key ENT (indicating the data end of the input item) has not been input. FF1, FF2, FF3, and FF4 are flip-flops. Flip-flop FF1 is set by the guidance set command GS from the arithmetic unit CPU and reset by the end of input data transfer TE, and flip-flop FF2 is set by the input data transfer command TC from the arithmetic unit CPU. It is set by the end of input data transfer TE. Flip-flop FF3 is set when the entry code detection circuit DET1 detects the ENTRY code in the shift register SR1, and is reset by the input data transfer DT.

フリツプフロツプFF4はシフトレジスタSR1
の中にENTRYコードが検出され、シフトレジス
タSR1の中のデータヘツドがデータヘツド検出
回路DET2により検出されるとセツトされ、デ
ータ転送の終了がENTRYコード検出回路DET3
により検出されるとリセツトされる。MP1,MP
2はマルチプレクサーであり、マルチプレクサー
MP1はシフトレジスタSR1へのキー入力からデ
ータ格納の為のものでありマルチプレクサーMP
2は表示装置Dispへの出力をシフトレジスタSR
1及びSR2の内容で選択する為のマルチプレク
サーである。G1,G2,G3はゲート回路であ
り、ゲートG1はシフトレジスタSR1の中のデ
ータヘツド検出回路DET2によりデータの始ま
りとENTRYコード検出回路DET1によりフリツ
プフロツプFF4を制御するゲートで、ゲートG
2はシフトレジスタSR1のデータとデータ転送
線とを制御し入力データの出力を制御する。ゲー
トG3は表示を制御する為のゲートでマルチプレ
クサーMP2を制御する。制御の為の入力はシフ
トレジスタSR2にガイダンスがCPUからセツト
されているというフリツプフロツプFF1の出
力、シフトレジスタSR2の中の有効データが有
効データ検出回路DET4により検出されたとい
う出力、シフトレジスタSR1の中にENTRYコー
ドが検出されないという出力、CPUからシフト
レジスタSR1の入力データ転送命令が出ている
という出力、以上の出力によりマルチプレクサー
SR2を制御する為のゲートである。
Flip-flop FF4 is shift register SR1
It is set when the ENTRY code is detected in the shift register SR1 and the data head in the shift register SR1 is detected by the data head detection circuit DET2, and the end of data transfer is detected by the ENTRY code detection circuit DET3.
It is reset when detected by. MP1, MP
2 is a multiplexer;
MP1 is for storing data from key input to shift register SR1, and multiplexer MP
2 is a shift register SR for the output to the display device Disp
This is a multiplexer for selecting based on the contents of SR1 and SR2. G1, G2, and G3 are gate circuits, and gate G1 is a gate that controls the start of data by the data head detection circuit DET2 in the shift register SR1 and the flip-flop FF4 by the ENTRY code detection circuit DET1.
2 controls the data of the shift register SR1 and the data transfer line, and controls the output of input data. Gate G3 is a gate for controlling display and controls multiplexer MP2. The inputs for control are the output of flip-flop FF1 indicating that guidance has been set by the CPU in shift register SR2, the output indicating that valid data in shift register SR2 has been detected by valid data detection circuit DET4, and the output in shift register SR1. The output that the ENTRY code is not detected, the output that the CPU has issued an input data transfer instruction for shift register SR1, and the multiplexer
This is a gate to control SR2.

従つて表示装置DispはマルチプレクサーSR2
とゲートG3によりシフトレジスタSR2にガイ
ダンスが演算装置CPUからセツトされ、かつシ
フトレジスタSR2の中の有効データが有り、ま
だ入力データを送出してなく、演算装置CPUか
らシフトレジスタSR1の入力データ転送命令が
出ているという条件の時だけシフトレジスタSR
2の内容を表示し他の時はシフトレジスタSR1
の内容を表示する。以下表示例を用いて実施例の
作動を説明する。第2図はデータ入力途中の状態
を示すもので、 aはシフトレジスタSR1の内容を示し、□Eは
ENTRYキーENTによるエントリリーコードを示
し、入力データの識別をしている。
Therefore, the display device Disp is multiplexer SR2
Guidance is set in shift register SR2 by gate G3 from the arithmetic unit CPU, and there is valid data in shift register SR2, and input data has not been sent yet, and an input data transfer command for shift register SR1 is issued from the arithmetic unit CPU. Shift register SR only under the condition that
Displays the contents of 2, and at other times shifts register SR1
Display the contents of. The operation of the embodiment will be explained below using display examples. Figure 2 shows the state in the middle of data input, where a shows the contents of shift register SR1, and □E shows the contents of shift register SR1.
ENTRY key ENT indicates the entry code and identifies input data.

bはシフトレジスタSR2の内容を示し、その
内容はシフトレジスタSR1の「123」の為のガイ
ダンスである。シフトレジスタSR1にはエント
リコードの後に「100」のデータが入つている
が、これは次のガイダンスに対するデータで、オ
ペレータが次の入力データが何であるかを知つて
いる場合の状態を示し、未だその入力は完了して
いない状態を示す。
b indicates the contents of the shift register SR2, and the contents are guidance for "123" of the shift register SR1. Shift register SR1 contains data "100" after the entry code, but this is data for the next guidance and indicates the state when the operator knows what the next input data is. The input indicates an incomplete state.

上述の状態において、すでにエントリコード
「E」が入力されているので、かかるエントリコ
ード「E」の検出がENTRYコード検出回路DET
1で行なわれ、フリツプフロツプFF3がセツト
され、ゲートG3が閉成し、シフトレジスタSR
1の内容が表示装置Dispに送られ、第2図cの
如く表示される。
In the above state, since the entry code "E" has already been input, the detection of the entry code "E" is performed by the ENTRY code detection circuit DET.
1, flip-flop FF3 is set, gate G3 is closed, and shift register SR
1 is sent to the display device Disp and displayed as shown in FIG. 2c.

これはオペレータは即に次の項目の置数になつ
ているので、入力と同期のとれないガイダンス表
示は禁止している。
This is because the operator is immediately set to the next item, so displaying guidance that is out of synchronization with input is prohibited.

データヘツドサーチ回路DET2により「123」
のヘツドが検知されると、フリツプフロツプFF
3のQ出力で開成しているゲートG1を介して検
知信号がフリツプフロツプFF4をセツトし、か
かるフリツプフロツプFF4の出力で、フリツプ
フロツプFF3がリセツトされ、ゲートG2を介
してシフトレジスタSR1の内容が信号線DATAL
を介して演算装置CPUに送られる。「123」が送
られ、次に「E」がゲートG2を通過すると、か
かるエントリコード「E」がENTRYコード検出
回路DET3で検出され、フリツプフロツプFF4
をリセツトし、ゲートG2を閉成し、データ転送
を終了させる。またフリツプフロツプFF1,FF
2がリセツトする。フリツプフロツプFF4の出
力QによつてシフトレジスタSR1の「123E」が
クリアされる。従つてフリツプフロツプFF2の
出力でアンドゲートG3は禁止され、シフトレジ
スタSR1の内容を表示する。第3図に上述の状
態を示す。上述のデータが演算装置CPUに送ら
れたデータ「123E」の「E」のコード判別し、
データのエンドを判別し、演算装置CPUはその
データに対する処理を行ない、次のガイダンスを
送出する。演算装置CPUの方から〓〓スウリ
ヨウ〓ニユウリヨク〓―4―のガイダンスセツ
ト命令によりシフトレジスタSR2に上記ガイダ
ンスを記憶させ、入力データ転送命令TCにより
フリツプフロツプFF2をセツトする。今シフト
レジスタSR1にはエントリコード「E」が入つ
ていないので、ゲートG3の開成は文字有効デー
タ検出回路DET4の出力によつて決まり、シフ
トレジスタSR2内のブランクコード「×」の処
が検出されたとき、マルチプレクサーMP2はシ
フトレジスタSR1を選び、それ以外の時、シフ
トレジスタSR1を選択する。
"123" by data head search circuit DET2
When the head of the flip-flop is detected, the flip-flop FF
The detection signal sets the flip-flop FF4 through the gate G1 which is opened by the Q output of 3, and the flip-flop FF3 is reset by the output of the flip-flop FF4, and the contents of the shift register SR1 are transferred to the signal line DATAL through the gate G2.
is sent to the arithmetic unit CPU via. When "123" is sent and then "E" passes through the gate G2, the entry code "E" is detected by the ENTRY code detection circuit DET3, and the flip-flop FF4 is detected.
is reset, gate G2 is closed, and data transfer is terminated. Also, flip-flop FF1, FF
2 is reset. "123E" of shift register SR1 is cleared by the output Q of flip-flop FF4. Therefore, the output of flip-flop FF2 inhibits AND gate G3 and displays the contents of shift register SR1. FIG. 3 shows the above state. The above data is sent to the arithmetic unit CPU, and the code of "E" in the data "123E" is determined,
The end of the data is determined, the arithmetic unit CPU processes the data, and sends out the next guidance. The arithmetic unit CPU stores the above-mentioned guidance in the shift register SR2 by a guidance set command of 〓〓〓SURRY〓NEW RYOK〓--4--4-, and the flip-flop FF2 is set by an input data transfer command TC. Since the entry code "E" is not currently in the shift register SR1, the opening of the gate G3 is determined by the output of the character valid data detection circuit DET4, and the blank code "x" in the shift register SR2 is detected. When this happens, multiplexer MP2 selects shift register SR1, and otherwise selects shift register SR1.

従つて第4図の如くシフトレジスタSR1とSR
2との内容が表示される。この状態は、一般の操
作になれないオペレータが、入力ガイダンスを参
照しながら逐次入力していく場合と同等である。
上述の如く構成しているので、シフトレジスタ
SR1にさらにデータを入力し、シフトレジスタ
SR1の内容がマルチプレクサーMP2の作用によ
り一部その表示を抑制される。
Therefore, as shown in Figure 4, shift registers SR1 and SR
2 is displayed. This state is equivalent to a case where an operator who is not familiar with general operations sequentially inputs data while referring to input guidance.
Since it is configured as described above, the shift register
Input more data to SR1 and shift register
The display of the contents of SR1 is partially suppressed by the action of multiplexer MP2.

例えば第5図に示す如くシフトレジスタSR
1,SR2にデータが入つているとき、第5図の
cに示す如く表示される。
For example, as shown in Figure 5, the shift register SR
1. When data is stored in SR2, it is displayed as shown in c of FIG.

以上説明した如く、本発明によれば、入力操作
に慣れた専任オペレータには、わづらわしいガイ
ダンスの表示をすることなく、逆に、入力操作に
慣れていないオペレータが入力操作に手間取つて
いるとき、つまり先行入力バツフアに処理すべき
データがないときは、ガイダンスを表示して入力
すべきデータの内容をオペレータは把握しながら
操作することができる。
As explained above, according to the present invention, there is no need to display troublesome guidance for full-time operators who are accustomed to input operations, and conversely, there is no need to display troublesome guidance for full-time operators who are accustomed to input operations. When there is no data to be processed in the advance input buffer, guidance is displayed so that the operator can operate while understanding the contents of the data to be input.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明によりデータ処理装置の一実施
例を示すブロツク図、第2図aはシフトレジスタ
SR1の内容を示す図、第2図bはシフトレジス
タSR2の内容を示す図、第2図cは表示内容を
示す図、第3図aはシフトレジスタSR1の内容
を示す図、第3図bはシフトレジスタSR2の内
容を示す図、第3図cは表示内容を示す図、第4
図aはシフトレジスタSR1の内容を示す図、第
4図bはシフトレジスタSR2の内容を示す図、
第4図cは表示内容を示す図、第5図aはシフト
レジスタSR1の内容を示す図、第5図bはシフ
トレジスタSR2の内容を示す図、第5図cは表
示内容を示す図である。 SR1,SR2…シフトレジスタ、MP1,MP2
…マルチプレクサー回路、FF1,FF2,FF
3,FF4…フリツプフロツプである。
FIG. 1 is a block diagram showing an embodiment of a data processing device according to the present invention, and FIG. 2a is a shift register.
Figure 2b shows the contents of shift register SR1; Figure 2c shows the displayed contents; Figure 3a shows the contents of shift register SR1; Figure 3b shows the contents of shift register SR1. is a diagram showing the contents of shift register SR2, FIG. 3c is a diagram showing the display contents, and FIG.
Figure a shows the contents of shift register SR1, Figure 4b shows the contents of shift register SR2,
Figure 4c is a diagram showing the display contents, Figure 5a is a diagram showing the contents of shift register SR1, Figure 5b is a diagram showing the contents of shift register SR2, and Figure 5c is a diagram showing the display contents. be. SR1, SR2...Shift register, MP1, MP2
...Multiplexer circuit, FF1, FF2, FF
3, FF4...Flip-flop.

Claims (1)

【特許請求の範囲】 1 データを入力する為のキーボードと、 前記キーボードから入力されたデータを順次記
憶する入力バツフアと、 前記入力バツフアに記憶されたデータを順次処
理する処理手段と、 データを表示することができる表示手段と、 前記処理手段が処理すべきデータが、前記入力
バツフアにあるか否かを判別する判別手段と、 前記判別手段によつて、前記処理手段が処理す
べきデータが前記入力バツフアにないと判別され
た場合、前記キーボードから入力すべきデータの
内容を指示するガイダンスデータを前記表示手段
に表示する制御手段と、 を有することを特徴とするデータ処理装置。
[Scope of Claims] 1. A keyboard for inputting data; an input buffer for sequentially storing data input from the keyboard; processing means for sequentially processing the data stored in the input buffer; and displaying data. display means capable of determining whether or not the data to be processed by the processing means is present in the input buffer; A data processing device comprising: control means for displaying guidance data on the display means for instructing the content of the data to be input from the keyboard when it is determined that the data is not in the input buffer.
JP11309679A 1979-09-04 1979-09-04 Data processor Granted JPS5636730A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP11309679A JPS5636730A (en) 1979-09-04 1979-09-04 Data processor

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JP11309679A JPS5636730A (en) 1979-09-04 1979-09-04 Data processor

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Publication Number Publication Date
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Publication number Priority date Publication date Assignee Title
GB2130837B (en) 1982-10-01 1987-04-23 Canon Kk Facsimile processing control
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