JPS6239568B2 - - Google Patents

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Publication number
JPS6239568B2
JPS6239568B2 JP5698580A JP5698580A JPS6239568B2 JP S6239568 B2 JPS6239568 B2 JP S6239568B2 JP 5698580 A JP5698580 A JP 5698580A JP 5698580 A JP5698580 A JP 5698580A JP S6239568 B2 JPS6239568 B2 JP S6239568B2
Authority
JP
Japan
Prior art keywords
output
circuit
counter
pulse generator
pulses
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP5698580A
Other languages
English (en)
Other versions
JPS56153843A (en
Inventor
Eiji Hata
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu General Ltd
Original Assignee
Fujitsu General Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu General Ltd filed Critical Fujitsu General Ltd
Priority to JP5698580A priority Critical patent/JPS56153843A/ja
Publication of JPS56153843A publication Critical patent/JPS56153843A/ja
Publication of JPS6239568B2 publication Critical patent/JPS6239568B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K23/00Pulse counters comprising counting chains; Frequency dividers comprising counting chains
    • H03K23/64Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two
    • H03K23/66Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two with a variable counting base, e.g. by presetting or by adding or suppressing pulses
    • H03K23/662Pulse counters comprising counting chains; Frequency dividers comprising counting chains with a base or radix other than a power of two with a variable counting base, e.g. by presetting or by adding or suppressing pulses by adding or suppressing pulses

Landscapes

  • Indication In Cameras, And Counting Of Exposures (AREA)
  • Electronic Switches (AREA)

Description

【発明の詳細な説明】 本発明は、カウンタの出力状態を所定の状態に
自動的に設定する装置に関する。
例えば最近のカメラは、フアインダ内に多くの
情報を表示するようにしてある。その情報の1つ
はシヤツタスピードであり、このシヤツタスピー
ドは、しぼり優先方式のもとにおいて、予め予知
される。これにより撮影者は、シヤツタのスピー
ドを予め知りうることになる。
一般にこの種のシヤツタスピードの表示手段は
トレーンパルス(連続パルス)のパルス数をカウ
ンタにより計数し、このカウンタの計数出力でマ
トリツクス回路を駆動し、このマトリツクス回路
の出力で所定の表示ランプを発光させ、この発光
でシヤツタスピードを表示するようにしてある。
ところがカメラの生産工程において、秒時特性
を検査するためにカウンタを所定の出力状態に設
定する必要がある。カウンタの出力状態は、カウ
ンタにトレーンパルスを所定のパルス数だけ入力
すれば得られるが、任意の位置でのパルス入力の
停止は、困難である。その理由は、パルス数の入
力が極めて高速であるからである。
ここに本発明は、所定のトレーンパルスのパル
ス数を入力したときにその状態を電気的に検出
し、トレーンパルスの入力状態を自動的に停止さ
せるような装置を提供する点にある。
上記目的のもとに本発明は、カウンタにトレー
ンパルスを連続的に入力させておき、カウンタの
出力状態を検出回路で検出し、所定の出力状態の
ときにトレーンパルスの入力状態を自動的に解除
するようにしている。
以下、本発明の実施例を図面にもとづいて具体
的に説明する。
本発明のカウンタの自動設定装置1は、カメラ
側に組込まれるカウンタ3、マトリツクス回路4
および表示ランプ5,5,…5n、測定器側
に組込まれるパルス発生回路2、検出回路6およ
び制御回路7により構成されている。
パルス発生回路2は、トレーンパルスを発生す
るものであり、第1パルスジエネレータ8と、こ
の第1パルスジエネレータ8の出力を1つの入力
とし、かつ制御回路7の制御出力を他の1つの入
力とするアンドゲート10と、このアンドゲート
10の出力側に接続された第2パルスジエネレー
タ9とで構成してあり、出力としてのトレーンパ
ルスは、カウンタ3のアツプ入力またはダウン入
力に入力されるようにしてある。カウンタ3は、
例えばアツプ・ダウン型のものであり、パルス発
生回路2のトレーンパルスのパルス数を計数し、
その計数値にもとづいて所定の符号化された計数
出力を発生する。マトリツクス回路4は、カウン
タ3の符号化出力を入力として所定の出力部分に
選択的に出力を発生するものであり、マトリツク
ス回路4の出力にもとづいて発光ダイオードなど
の表示ランプ5,5,…5nを択一的に点灯
し、その点灯位置でシヤツタスピードを表示す
る。また検出回路6は、上記表示ランプ5,5
,…,5nのうち所定のものの端子間に選択的
に接続され、上記マトリツクス回路4の出力の位
置を検出するもので、電源端子11と表示ランプ
,5,…,5nとしての発光ダイオードの
カソード端との間にトランジスタのコレクタ・エ
ミツタで接続され、かつトランジスタのベースを
例えば表示ランプ5のアノードに接続されたス
イツチング用のトランジスタ13を主要部とし、
これらに限流用または電圧調整用の抵抗器12,
14および出力用のインバータ15を組合せて構
成してある。また制御回路7は、上記検出回路6
の検出出力を受けたときに上記パルス発生回路2
にトレーンパルスの発生を禁止させるための制御
出力を送るものであり、フリツプ・フロツプ16
を有している。このフリツプ・フロツプ16のセ
ツト端子Sは、インバータ19、手動のスイツチ
18を経てアース17に接続され、また出力端子
Qはアンドゲート10の一端に接続され、また他
方の出力端子は確認表示ランプ20を経てアー
ス17に接続されている。そして上記検出回路6
は、そのインバータ15の出力をフリツプ・フロ
ツプ16のリセツト端子Rに接続されている。
次に動作を説明する。今、例えば表示ランプ5
の点灯状態にカウンタ3の出力状態を設定する
ものとして説明する。すべての回路に電源を投入
し、手動のスイツチ18をオンにすると、そのス
イツチ18からの「L」レベルの信号は、インバ
ータ19で反転されて「H」レベルとなり、フリ
ツプ・フロツプ16のセツト端子Sにセツト入力
として入力される。このためフリツプ・フロツプ
16は、その出力端子Qに「H」レベルの制御出
力を発生し、これをパルス発生回路2のアンドゲ
ート10の1つの入力端に送つている。このため
第1パルスジエネレータ8のトレーンパルスは、
アンドゲート10を経てカウンタ3のアツプ入力
端に連続的に入力される。ここでカウンタ3は、
そのパルス数を計数し、それを符号化してマトリ
ツクス回路4に送る。マトリツクス回路4は、そ
のカウンタ3の出力状態にもとづいて順次表示ラ
ンプ5,5,…5nを駆動すべく出力を発生
することになる。ここでマトリツクス回路4の出
力が表示ランプ5を駆動する出力状態になる
と、検出回路6のトランジスタ13のベースに
「H」レベルの信号が現われるため、トランジス
タ13は瞬時にオンに転じ、そのコレクタ側に
「L」レベルの信号が現われる。この「L」レベ
ルの信号は、インバータ15で反転し、「H」レ
ベルの検出出力として制御回路7のフリツプ・フ
ロツプ16のリセツト端子Rに入力される。この
ためフリツプ・フロツプ16はすぐにリセツトさ
れ、その出力端子Qの制御出力を「L」レベルに
設定する。したがつて第1パルスジエネレータ8
のトレーンパルスは、その検出の時点でアンドゲ
ート10を通過しなくなり、したがつてカウンタ
3は、表示ランプ5を駆動する状態で自動的に
停止することになる。そしてこの状態は、確認表
示ランプ20の点灯により確認できる。またこの
停止状態でカウンタ3の出力状態を所定の数例え
ば「2」だけ順次シフトしたい場合には、第2パ
ルスジエネレータ9を操作し、2つのパルス数の
トレーンパルスを直接カウンタ3に入力すればよ
い。このようにするとカウンタ3は、その都度2
つのパルス数を計数し、順次2づつ出力状態をシ
フトすることになる。もちろんこのパルス数は、
1以上任意の数でよく、したがつて第2パルスジ
エネレータ9の出力パルスは、1以上のパルス数
のものとして任意に選択できるように構成すると
よい。
このようにして所定のカウンタ出力状態を得た
後、それに合つた露出制御用の秒時回路を測定
し、その秒時を調整する操作が進められることに
なる。
なお、本発明は、カメラの秒時特性を検査し、
秒時設定回路を調整するために開発されたもので
あるが、このカウンタの自動設定装置1は、これ
に限定されず、その他のカウンタを有する回路に
も当然応用できる。
本発明によれば、カウンタの出力状態が所定の
位置に高速で設定できるため、表示ランプの発光
を確認しながら設定する操作に較べて、操作員の
目の疲労が無く、またその設定操作が高速で行え
るという利点がある。またカウンタが所定の出力
状態に達すると、装置が自動的に停止するため、
常に看視が必要とされず、作業性が単純化され
る。さらにパルス発生回路が手動操作により順次
送り出せる手段を有しているため、基準の設定位
置からの任意の順次設定が手動により簡単に行な
えるという特長もある。
【図面の簡単な説明】
図は本発明に係るカウンタの自動設定装置のブ
ロツク線図である。 1…カウンタの自動設定装置、2…パルス発生
回路、3…カウンタ、4…マトリツクス回路、5
,5,……,5n…表示ランプ、6…検出回
路、7…制御回路、8…第1パルスジエネレー
タ、9…第2パルスジエネレータ、10…アンド
ゲート、11…電源端子、12…スイツチング用
のトランジスタ、16…フリツプ・フロツプ、1
8…スイツチ、20…確認表示ランプ。

Claims (1)

  1. 【特許請求の範囲】 1 トレーンパルスを連続的に発生する第1パル
    スジエネレータと、手動操作によつて所定数のパ
    ルスを発生する第2パルスジエネレータと、上記
    第1パルスジエネレータの出力側に接続されたゲ
    ート回路と、上記第2パルスジエネレータおよび
    ゲート回路の出力側に現われたパルスのパルス数
    を計数するカウンタと、このカウンタの出力を入
    力として所定の出力部分に選択的に出力を発生す
    るマトリツクス回路と、このマトリツクス回路の
    出力で駆動される複数の表示ランプと、これらの
    表示ランプのうち所定の表示ランプの端子間に選
    択的に接続され上記マトリツクス回路の出力を検
    出する検出回路と、この検出回路の検出出力を受
    けたときに上記ゲート回路にトレーンパルスの通
    過を禁止させるための制御出力を送る制御回路と
    を具備することを特徴とするカウンタの自動設定
    装置。 2 特許請求の範囲第1項記載において、検出回
    路は、電源端子と表示ランプの一端との間にコレ
    クタ・エミツタで接続され、かつベースを表示ラ
    ンプの他の一端に接続可能なスイツチング用のト
    ランジスタを主要部として構成されていることを
    特徴とするカウンタの自動設定装置。 3 特許請求の範囲第1項または第2項記載にお
    いて、制御回路は、手動用のスイツチ操作でセツ
    トされ、検出回路の検出出力でリセツトされ、か
    つ一方の出力端に制御出力を発生するフリツプ・
    フロツプにより構成されていることを特徴とする
    カウンタの自動設定装置。 4 特許請求の範囲第3項記載において、制御回
    路は確認表示ランプを有し、この確認表示ランプ
    はフリツプ・フロツプの他方の出力端に接続され
    ていることを特徴とするカウンタの自動設定装
    置。
JP5698580A 1980-04-28 1980-04-28 Automatic setting device of counter Granted JPS56153843A (en)

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JP5698580A JPS56153843A (en) 1980-04-28 1980-04-28 Automatic setting device of counter

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JP5698580A JPS56153843A (en) 1980-04-28 1980-04-28 Automatic setting device of counter

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Publication Number Publication Date
JPS56153843A JPS56153843A (en) 1981-11-28
JPS6239568B2 true JPS6239568B2 (ja) 1987-08-24

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ID=13042781

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5698580A Granted JPS56153843A (en) 1980-04-28 1980-04-28 Automatic setting device of counter

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JP (1) JPS56153843A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0268764U (ja) * 1988-11-14 1990-05-24

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0268764U (ja) * 1988-11-14 1990-05-24

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JPS56153843A (en) 1981-11-28

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