JPS6257223B2 - - Google Patents
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- JPS6257223B2 JPS6257223B2 JP58193321A JP19332183A JPS6257223B2 JP S6257223 B2 JPS6257223 B2 JP S6257223B2 JP 58193321 A JP58193321 A JP 58193321A JP 19332183 A JP19332183 A JP 19332183A JP S6257223 B2 JPS6257223 B2 JP S6257223B2
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- JP
- Japan
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- memory
- signal
- display
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- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R13/00—Arrangements for displaying electric variables or waveforms
- G01R13/20—Cathode-ray oscilloscopes
- G01R13/22—Circuits therefor
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Controls And Circuits For Display Device (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Measurement Of Current Or Voltage (AREA)
Description
【発明の詳細な説明】
発明の技術分野
本発明はデジタル・オシロスコープ用の表示装
置、特に搬送波信号の如き複雑な信号の包絡線を
表示する装置に関する。
置、特に搬送波信号の如き複雑な信号の包絡線を
表示する装置に関する。
発明の背景及び従来技術の欠点
実時間のオシロスコープは電気現象の瞬時振幅
を連続した時間軸で表示できるので、例えば低周
波で変調された高周波の搬送波の如き複雑な波形
も正確に表示することができる。これらの波形及
びその他の波形は共に直視型二定電位蓄積管を有
する実時間オシロスコープを用いても表示でき
る。その理由は、信号処理回路及び記録媒体がい
ずれも連続であるからである。他方、デジタル・
オシロスコープにあつては、入力信号波形を内部
クロツク信号で決まる多数の時点に切りきざみ、
これら各時点における瞬時振幅を量子化（デジタ
ル変換）し、その結果得られたデジタル波形デー
タをデジタルメモリ内に記憶する。この入力波形
の再生表示は、メモリから記憶データを所定のク
ロツク周波数により読出して、アナログ変換等の
処理を行なつて一連の点又は連結した点（ベクト
ル）により行なう。ここで、入力信号はデジタ
ル・オシロスコープの内部クロツク信号と機能的
には何ら関連付けられていないので、クロツク信
号のエツジが生じる際の入力信号の瞬時値をサン
プリングして蓄積する。各時点間の情報は勿輪得
ることができないので、複雑な波形観測の場合に
は再現が例え不可能ではないとしても有意な波形
再現は困難である。
を連続した時間軸で表示できるので、例えば低周
波で変調された高周波の搬送波の如き複雑な波形
も正確に表示することができる。これらの波形及
びその他の波形は共に直視型二定電位蓄積管を有
する実時間オシロスコープを用いても表示でき
る。その理由は、信号処理回路及び記録媒体がい
ずれも連続であるからである。他方、デジタル・
オシロスコープにあつては、入力信号波形を内部
クロツク信号で決まる多数の時点に切りきざみ、
これら各時点における瞬時振幅を量子化（デジタ
ル変換）し、その結果得られたデジタル波形デー
タをデジタルメモリ内に記憶する。この入力波形
の再生表示は、メモリから記憶データを所定のク
ロツク周波数により読出して、アナログ変換等の
処理を行なつて一連の点又は連結した点（ベクト
ル）により行なう。ここで、入力信号はデジタ
ル・オシロスコープの内部クロツク信号と機能的
には何ら関連付けられていないので、クロツク信
号のエツジが生じる際の入力信号の瞬時値をサン
プリングして蓄積する。各時点間の情報は勿輪得
ることができないので、複雑な波形観測の場合に
は再現が例え不可能ではないとしても有意な波形
再現は困難である。
このような複雑な信号を観測するために、デジ
タル・オシロスコープ用の包絡線表示装置が提案
されており、この装置は本願出願人による米国特
許第4251815号（特開昭56−54366号に対応）公報
に開示されている。この従来装置によれば、繰返
し波形のある短かい時間区分における最大及び最
小振巾値を最大―最小値検出回路により検出して
いる。この検出器の一例は本願出願人による米国
特許第4271486号（特開昭56−21068号に対応）公
報に開示されている。この包絡線表示装置は、実
際のデータ取込み時点の瞬時値に代つて、ある短
かい時間区分毎に発生する波形の最大値（Ｍ）及
び最小値（ｍ）を取込みデータとして記憶する。
よつて、最大値及び最小値データをデジタル・メ
モリにＭ，ｍ，Ｍ，ｍ…の順序に交互に記憶す
る。即ち、最大値及び最小値データをメモリの偶
数アドレス及び奇数アドレス・ロケーシヨン（場
所）に夫々記憶する。記憶した波形の包絡線を表
示するには、まず第１サイクルにおいて、メモリ
の偶数及び奇数アドレスに記憶されたデータを順
次読出し、最大及び最小信号値を表わす読出しデ
ータを、ベクトル発生器により表示器に交互に表
示する。第２サイクルにおいて、メモリの偶数ア
ドレスに記憶されたデータのみを順次読出し、表
示器に最大値を表示する。第３サイクルにおい
て、奇数アドレスに記憶されたデータのみを読出
し、最小値を表示する。表示器がこれら３サイク
ルの表示を重畳するので、観測者には、複雑な波
形の包絡線内が埋められた単一の波形として見え
る。
タル・オシロスコープ用の包絡線表示装置が提案
されており、この装置は本願出願人による米国特
許第4251815号（特開昭56−54366号に対応）公報
に開示されている。この従来装置によれば、繰返
し波形のある短かい時間区分における最大及び最
小振巾値を最大―最小値検出回路により検出して
いる。この検出器の一例は本願出願人による米国
特許第4271486号（特開昭56−21068号に対応）公
報に開示されている。この包絡線表示装置は、実
際のデータ取込み時点の瞬時値に代つて、ある短
かい時間区分毎に発生する波形の最大値（Ｍ）及
び最小値（ｍ）を取込みデータとして記憶する。
よつて、最大値及び最小値データをデジタル・メ
モリにＭ，ｍ，Ｍ，ｍ…の順序に交互に記憶す
る。即ち、最大値及び最小値データをメモリの偶
数アドレス及び奇数アドレス・ロケーシヨン（場
所）に夫々記憶する。記憶した波形の包絡線を表
示するには、まず第１サイクルにおいて、メモリ
の偶数及び奇数アドレスに記憶されたデータを順
次読出し、最大及び最小信号値を表わす読出しデ
ータを、ベクトル発生器により表示器に交互に表
示する。第２サイクルにおいて、メモリの偶数ア
ドレスに記憶されたデータのみを順次読出し、表
示器に最大値を表示する。第３サイクルにおい
て、奇数アドレスに記憶されたデータのみを読出
し、最小値を表示する。表示器がこれら３サイク
ルの表示を重畳するので、観測者には、複雑な波
形の包絡線内が埋められた単一の波形として見え
る。
上述の従来装置は波形の包絡線を表示するため
に、メモリの異なる読出しを３サイクル行なわな
ければならず、構成及びその制御が複雑になると
共に、表示に長時間を要した。更に、この従来装
置は、最大値及び最小値間の準直線ベクトルを描
くために、複雑な平均化フイルタを必要とした。
に、メモリの異なる読出しを３サイクル行なわな
ければならず、構成及びその制御が複雑になると
共に、表示に長時間を要した。更に、この従来装
置は、最大値及び最小値間の準直線ベクトルを描
くために、複雑な平均化フイルタを必要とした。
発明の目的
したがつて、本発明の目的の１つは、改良した
デジタル・オシロスコープ用信号包絡線表示装置
の提供にある。
デジタル・オシロスコープ用信号包絡線表示装置
の提供にある。
本発明の他の目的は、構成が簡単かつ安価であ
り、包絡線を表示するのに２サイクルでよい信号
包絡線表示装置の提供にある。
り、包絡線を表示するのに２サイクルでよい信号
包絡線表示装置の提供にある。
本発明の更に他の目的は制御が簡単な改良した
信号包絡線表示装置の提供にある。
信号包絡線表示装置の提供にある。
発明の概要
本発明によれば、デジタル・オシロスコープ用
の簡単な信号包絡線表示装置が実現できる。上述
した従来装置と同様な手段を用いて、波形の各短
い時間区分に発生する最大及び最小信号振巾値を
検出し、これらの値をデジタル・メモリに交互に
記憶する。２進アドレス・カウンタをこのメモリ
に接続し、表示クロツク信号に応じて各記憶ロケ
ーシヨン（場所）を順次アドレス指定する。一
方、制御回路をアドレス・カウンタ及びメモリ間
に設け、アドレス信号の最下位ビツト（LSB）を
制御して、アドレス指定を２サイクルとする。メ
モリ読出しの第１サイクルにおいて、制御回路は
アドレス・カウンタからのアドレス信号のLSBを
制御しないので、アドレス信号は何ら処理される
ことなく、メモリのアドレス端子に供給される。
最大及び最小データが夫々偶数及び奇数アドレ
ス・ロケーシヨンに記憶されており、アドレス信
号が「0000 0000」（この場合、アドレス信号は８
ビツトである。）から開始すると仮定すれば、こ
の第１サイクルにおいて、メモリのデータ出力端
子には最大データ（Ｍ）及び最小データ（ｍ）の
順（Ｍ，ｍ，Ｍ，ｍ…の順）にデータが発生す
る。メモリ読出しの第２サイクルにおいて、制御
回路はアドレス信号のLSBのみを反転するので、
メモリから最小データ及び最大データの順（ｍ，
Ｍ，ｍ，Ｍ…の順）にデータが発生する。各サイ
クル毎に読出したデータをデジタル・アナログ変
換器、ロウパス・フイルタ及び表示用増巾器等の
表示信号発生手段に供給して、上側及び下側境界
が強調され、内部が埋められた対称な包絡線を表
示する。２つの重畳した波形は、接近しているの
で、これら波形はインタレエイスによるフリツカ
の生じない多重波形として表示できる。また、本
発明は、複雑な平均化フイルタの代りに簡単なロ
ウパス・フイルタを利用できる。
の簡単な信号包絡線表示装置が実現できる。上述
した従来装置と同様な手段を用いて、波形の各短
い時間区分に発生する最大及び最小信号振巾値を
検出し、これらの値をデジタル・メモリに交互に
記憶する。２進アドレス・カウンタをこのメモリ
に接続し、表示クロツク信号に応じて各記憶ロケ
ーシヨン（場所）を順次アドレス指定する。一
方、制御回路をアドレス・カウンタ及びメモリ間
に設け、アドレス信号の最下位ビツト（LSB）を
制御して、アドレス指定を２サイクルとする。メ
モリ読出しの第１サイクルにおいて、制御回路は
アドレス・カウンタからのアドレス信号のLSBを
制御しないので、アドレス信号は何ら処理される
ことなく、メモリのアドレス端子に供給される。
最大及び最小データが夫々偶数及び奇数アドレ
ス・ロケーシヨンに記憶されており、アドレス信
号が「0000 0000」（この場合、アドレス信号は８
ビツトである。）から開始すると仮定すれば、こ
の第１サイクルにおいて、メモリのデータ出力端
子には最大データ（Ｍ）及び最小データ（ｍ）の
順（Ｍ，ｍ，Ｍ，ｍ…の順）にデータが発生す
る。メモリ読出しの第２サイクルにおいて、制御
回路はアドレス信号のLSBのみを反転するので、
メモリから最小データ及び最大データの順（ｍ，
Ｍ，ｍ，Ｍ…の順）にデータが発生する。各サイ
クル毎に読出したデータをデジタル・アナログ変
換器、ロウパス・フイルタ及び表示用増巾器等の
表示信号発生手段に供給して、上側及び下側境界
が強調され、内部が埋められた対称な包絡線を表
示する。２つの重畳した波形は、接近しているの
で、これら波形はインタレエイスによるフリツカ
の生じない多重波形として表示できる。また、本
発明は、複雑な平均化フイルタの代りに簡単なロ
ウパス・フイルタを利用できる。
発明の実施例
以下、添付図を参照して、本発明の好適な実施
例を説明する。第１図は本発明の好適な一実施例
を用いたデジタル・オシロスコープのブロツク図
である。入力端子１０を介して、アナログ信号を
波形取込み回路１２に供給する。この回路１２は
従来のデジタル・オシロスコープが用いる周知の
サンプル・ホールド回路及びアナログ・デジタル
変換器（ADC）を含んでいる。入力信号の波形
に沿つて取込まれるデータ点の数は使用するメモ
リ容量に制限され、波形取込回路１２は上述した
米国特許第4271486号の開示する如く動作するも
のであつてもよく、ここで高速サンプリング装置
はADCが動作できる最高速度で波形データをサ
ンプリングする。このようにして得た波形データ
は最小―最大値検出回路１４に印加され、データ
点間の期間に対応する期間の最小及び最大信号値
を検出する。データ点の数は使用できるメモリ容
量により決まる。よつて、記憶されたデータ点は
サンプリング点における実際の瞬時値ではなく、
指定されたデータ点間において発生する最小及び
最大信号振幅より成る。表示メモリ１６は制御装
置（図示せず）からの書込み命令信号により書込
みモードとなり、アドレス端子Ａ０〜Ａ７に書込
みアドレス信号（書込みアドレス線は図示せず）
を受けるので、最小―最大値検出回路１４からの
最大及び最小値を、メモリ１６内の隣接するメモ
リ・ロケーシヨンに記憶する。即ち、例えば、最
大及び最小値をメモリ１６の偶数及び奇数アドレ
ス・ロケーシヨンに夫々記憶する。メモリ１６は
好適にはランダム・アクセス・メモリ（RAM）
である。
例を説明する。第１図は本発明の好適な一実施例
を用いたデジタル・オシロスコープのブロツク図
である。入力端子１０を介して、アナログ信号を
波形取込み回路１２に供給する。この回路１２は
従来のデジタル・オシロスコープが用いる周知の
サンプル・ホールド回路及びアナログ・デジタル
変換器（ADC）を含んでいる。入力信号の波形
に沿つて取込まれるデータ点の数は使用するメモ
リ容量に制限され、波形取込回路１２は上述した
米国特許第4271486号の開示する如く動作するも
のであつてもよく、ここで高速サンプリング装置
はADCが動作できる最高速度で波形データをサ
ンプリングする。このようにして得た波形データ
は最小―最大値検出回路１４に印加され、データ
点間の期間に対応する期間の最小及び最大信号値
を検出する。データ点の数は使用できるメモリ容
量により決まる。よつて、記憶されたデータ点は
サンプリング点における実際の瞬時値ではなく、
指定されたデータ点間において発生する最小及び
最大信号振幅より成る。表示メモリ１６は制御装
置（図示せず）からの書込み命令信号により書込
みモードとなり、アドレス端子Ａ０〜Ａ７に書込
みアドレス信号（書込みアドレス線は図示せず）
を受けるので、最小―最大値検出回路１４からの
最大及び最小値を、メモリ１６内の隣接するメモ
リ・ロケーシヨンに記憶する。即ち、例えば、最
大及び最小値をメモリ１６の偶数及び奇数アドレ
ス・ロケーシヨンに夫々記憶する。メモリ１６は
好適にはランダム・アクセス・メモリ（RAM）
である。
２進アドレス・カウンタ１８の計数出力端子Ｑ
０〜Ｑ７をメモリ１６のアドレス端子Ａ０〜Ａ７
に接続し、表示クロツク発生器２０からの表示ク
ロツク信号に応じて、各記憶ロケーシヨンを連続
的にアドレス指定する。従来形式と同様に、２進
アドレス・カウンタ１８は、各２進計数ビツト毎
に出力線を具えており、桁は最上位ビツト
（MSB：Ｑ７）から最下位ビツト（LSB：Ｑ０）
に減少していく。メモリ１６のアドレス端子Ａ７
及びＡ０は夫々MSB及びLSBに対応する。スイ
ツチ２２及び制御回路３０をカウンタ１８及びメ
モリ１６間のLSB線に挿入する。メモリ１６のア
ドレス端子Ａ０（LSB）に、接地電位、プル・ア
ツプ電圧（論理「高」のレベル）又は制御回路３
０の出力を選択的に供給して、３種類の表示モー
ドとする。制御回路３０はＴ（トグル）フリツ
プ・フロツプ３２及び３個の論理ゲート３４，３
６，３８から構成されており、フリツプ・フロツ
プ３２のＴ端子はカウンタ１８からのオーバ・フ
ロー（OF：桁あふれ）信号を受け、このフリツ
プ・フロツプのＱ出力信号をノア・ゲート３４及
びオア・ゲート３６の一方の入力端子に供給す
る。ゲート３４及び３６の他方の入力端子はカウ
ンタ１８からのLSBを受け、これらゲートの出力
信号をオア・ゲート３８に供給する。ゲート３８
の出力端子をスイツチ２２の接点２２Ｃに接続す
る。
０〜Ｑ７をメモリ１６のアドレス端子Ａ０〜Ａ７
に接続し、表示クロツク発生器２０からの表示ク
ロツク信号に応じて、各記憶ロケーシヨンを連続
的にアドレス指定する。従来形式と同様に、２進
アドレス・カウンタ１８は、各２進計数ビツト毎
に出力線を具えており、桁は最上位ビツト
（MSB：Ｑ７）から最下位ビツト（LSB：Ｑ０）
に減少していく。メモリ１６のアドレス端子Ａ７
及びＡ０は夫々MSB及びLSBに対応する。スイ
ツチ２２及び制御回路３０をカウンタ１８及びメ
モリ１６間のLSB線に挿入する。メモリ１６のア
ドレス端子Ａ０（LSB）に、接地電位、プル・ア
ツプ電圧（論理「高」のレベル）又は制御回路３
０の出力を選択的に供給して、３種類の表示モー
ドとする。制御回路３０はＴ（トグル）フリツ
プ・フロツプ３２及び３個の論理ゲート３４，３
６，３８から構成されており、フリツプ・フロツ
プ３２のＴ端子はカウンタ１８からのオーバ・フ
ロー（OF：桁あふれ）信号を受け、このフリツ
プ・フロツプのＱ出力信号をノア・ゲート３４及
びオア・ゲート３６の一方の入力端子に供給す
る。ゲート３４及び３６の他方の入力端子はカウ
ンタ１８からのLSBを受け、これらゲートの出力
信号をオア・ゲート３８に供給する。ゲート３８
の出力端子をスイツチ２２の接点２２Ｃに接続す
る。
表示モードにおいて、メモリ１６は制御装置か
ら読出し命令信号を受ける。第１表示モードで
は、メモリ１６のLSB入力線（Ａ０）はスイツチ
２２及び接点２２Ａを介して接地する。このモー
ドにおいて、一方のメモリ・ロケーシヨンの全
部、例えば最大値のみを記憶した偶数ロケーシヨ
ンを順次アドレス指定し、最大値の全部をクロツ
ク毎にメモリから連続的に読出す。デジタル・ア
ナログ変換器（DAC）２４及びロウパス（低
域）・フイルタ２６の表示信号発生手段は第２Ａ
図に示す如き最大値の連結点表示信号を表示器２
８に供給する。この表示器２８は好適には陰極線
管である。ロウパス・フイルタ２６を、演算増巾
器２６Ａと、入力抵抗器２６Ｂと、コンデンサ２
６Ｃ及び抵抗器２６Ｄから成る帰還回路とから構
成する。
ら読出し命令信号を受ける。第１表示モードで
は、メモリ１６のLSB入力線（Ａ０）はスイツチ
２２及び接点２２Ａを介して接地する。このモー
ドにおいて、一方のメモリ・ロケーシヨンの全
部、例えば最大値のみを記憶した偶数ロケーシヨ
ンを順次アドレス指定し、最大値の全部をクロツ
ク毎にメモリから連続的に読出す。デジタル・ア
ナログ変換器（DAC）２４及びロウパス（低
域）・フイルタ２６の表示信号発生手段は第２Ａ
図に示す如き最大値の連結点表示信号を表示器２
８に供給する。この表示器２８は好適には陰極線
管である。ロウパス・フイルタ２６を、演算増巾
器２６Ａと、入力抵抗器２６Ｂと、コンデンサ２
６Ｃ及び抵抗器２６Ｄから成る帰還回路とから構
成する。
第２表示モードでは、スイツチ２２及び接点２
２Ｂを介して、メモリ１６のLSB入力線Ａ０をプ
ル・アツプ電圧、例えば＋５ボルトに接続する。
このモードにおいて、すべての他方のメモリ・ロ
ケーシヨン、例えば最小値のみを記憶した奇数ロ
ケーシヨンを順次アドレス指定して、最小値のす
べてをクロツク毎にメモリ１６から連続的に読出
す。DAC２４及びローパス・フイルタ２６は第
２Ｂ図に示す如き最小値の連続点表示信号を発生
する。
２Ｂを介して、メモリ１６のLSB入力線Ａ０をプ
ル・アツプ電圧、例えば＋５ボルトに接続する。
このモードにおいて、すべての他方のメモリ・ロ
ケーシヨン、例えば最小値のみを記憶した奇数ロ
ケーシヨンを順次アドレス指定して、最小値のす
べてをクロツク毎にメモリ１６から連続的に読出
す。DAC２４及びローパス・フイルタ２６は第
２Ｂ図に示す如き最小値の連続点表示信号を発生
する。
これら第１及び第２表示モードは上述した米国
特許第4251815号にも開示されている。この米国
特許は、カウンタ１８のLSB（Ｑ０）をメモリ１
６のアドレス端子Ａ０に接続して各メモリ・ロケ
ーシヨンを順次アドレス指定することにより、第
２Ｃ図に示す如き連結した最大―最小値波形を表
示することも開示している。この連結した最大―
最小値波形を表示するには、ロウパス・フイルタ
２６の代りに複雑なベクトル発生器が必要なこと
に注意されたい。この従来装置は、これら３つの
表示波形（第２Ａ，第２Ｂ及び第２Ｃ図）を表示
器２８の表示スクリーン上で重畳する。この重畳
された表示は、第２Ｄ図に示す如く、複雑な波形
の内部を埋めた包絡線の単一表示として観測者に
は見える。この従来装置は上述した如き欠点を有
する。
特許第4251815号にも開示されている。この米国
特許は、カウンタ１８のLSB（Ｑ０）をメモリ１
６のアドレス端子Ａ０に接続して各メモリ・ロケ
ーシヨンを順次アドレス指定することにより、第
２Ｃ図に示す如き連結した最大―最小値波形を表
示することも開示している。この連結した最大―
最小値波形を表示するには、ロウパス・フイルタ
２６の代りに複雑なベクトル発生器が必要なこと
に注意されたい。この従来装置は、これら３つの
表示波形（第２Ａ，第２Ｂ及び第２Ｃ図）を表示
器２８の表示スクリーン上で重畳する。この重畳
された表示は、第２Ｄ図に示す如く、複雑な波形
の内部を埋めた包絡線の単一表示として観測者に
は見える。この従来装置は上述した如き欠点を有
する。
一方、本発明の第３表示モードによれば、スイ
ツチ２２を接点２２Ｃに接続する。第１サイクル
において、アドレス・カウンタ１８はオーバ・フ
ロー信号（OF）とまだ発生しないので、フリツ
プ・フロツプ３２のＱ出力は「０」（低）であ
る。カウンタ１８のLSBに関係なくアンド・ゲー
ト３６の出力は「０」なので、カウンタ１８の
LSB（Ｑ０）は制御回路３０内のノア・ゲート３
４により反転されて、オア・ゲート３８を介して
メモリ１６のLSB（Ａ０）に加わる。即ち、メモ
リ１６に加わるアドレス信号は、「0000 0001」，
「0000 0000」，「0000 0011」，「0000 0010」……
「1111 1111」，「1111 1110」の順序に発生する。
このサイクルにより、メモリの出力順序はｍ，
Ｍ，ｍ，Ｍ…（ｍ及びＭは夫々最小値及び最大値
を表わす）の順序になる。第１サイクルの最後、
即ちアドレス・カウンタ１８の出力が「1111
1111」のときに、このカウンタ１８がオーバ・フ
ロー信号を発生すると、フリツプ・フロツプ３２
のＱ出力は「１」（高）となり、カウンタ１８の
LSBに関係なくノア・ゲート３４の出力は「０」
になる。よつて、第２サイクルにおいて、制御回
路３０はゲート３６及び３８を介してカウンタ１
８のLSBをそのままメモリ１６に供給するので、
メモリ１６のLSB（Ａ０）とカウンタ１８のLSB
（Ｑ０）は等しくなる。メモリ１６のメモリ・ロ
ケーシヨンが順番にアドレス指定されるので、第
２サイクルにおいて、メモリの出力順序はＭ，
ｍ，Ｍ，ｍ…となる。第２サイクルの最後におい
て、カウンタ１８がオーバ・フロー信号を発生す
ると、制御回路３０は第１サイクルの状態に戻
る。以後、これら２サイクルを繰返す。これら２
サイクルの各サイクルを交互に繰返すと、DAC
２４及びロウパス・フイルタ２６は表示器２８上
に第2E図に示す如き上側及び下側境界が強調さ
れ内部が埋つた対称な包絡線を表示する。本発明
によれば、２サイクルで信号包絡線の表示ができ
ることに注意されたい。また、２つの重畳した波
形は接近しているので、これら波形はインタレエ
イスによるフリツカのない多重波形として表示で
きる。
ツチ２２を接点２２Ｃに接続する。第１サイクル
において、アドレス・カウンタ１８はオーバ・フ
ロー信号（OF）とまだ発生しないので、フリツ
プ・フロツプ３２のＱ出力は「０」（低）であ
る。カウンタ１８のLSBに関係なくアンド・ゲー
ト３６の出力は「０」なので、カウンタ１８の
LSB（Ｑ０）は制御回路３０内のノア・ゲート３
４により反転されて、オア・ゲート３８を介して
メモリ１６のLSB（Ａ０）に加わる。即ち、メモ
リ１６に加わるアドレス信号は、「0000 0001」，
「0000 0000」，「0000 0011」，「0000 0010」……
「1111 1111」，「1111 1110」の順序に発生する。
このサイクルにより、メモリの出力順序はｍ，
Ｍ，ｍ，Ｍ…（ｍ及びＭは夫々最小値及び最大値
を表わす）の順序になる。第１サイクルの最後、
即ちアドレス・カウンタ１８の出力が「1111
1111」のときに、このカウンタ１８がオーバ・フ
ロー信号を発生すると、フリツプ・フロツプ３２
のＱ出力は「１」（高）となり、カウンタ１８の
LSBに関係なくノア・ゲート３４の出力は「０」
になる。よつて、第２サイクルにおいて、制御回
路３０はゲート３６及び３８を介してカウンタ１
８のLSBをそのままメモリ１６に供給するので、
メモリ１６のLSB（Ａ０）とカウンタ１８のLSB
（Ｑ０）は等しくなる。メモリ１６のメモリ・ロ
ケーシヨンが順番にアドレス指定されるので、第
２サイクルにおいて、メモリの出力順序はＭ，
ｍ，Ｍ，ｍ…となる。第２サイクルの最後におい
て、カウンタ１８がオーバ・フロー信号を発生す
ると、制御回路３０は第１サイクルの状態に戻
る。以後、これら２サイクルを繰返す。これら２
サイクルの各サイクルを交互に繰返すと、DAC
２４及びロウパス・フイルタ２６は表示器２８上
に第2E図に示す如き上側及び下側境界が強調さ
れ内部が埋つた対称な包絡線を表示する。本発明
によれば、２サイクルで信号包絡線の表示ができ
ることに注意されたい。また、２つの重畳した波
形は接近しているので、これら波形はインタレエ
イスによるフリツカのない多重波形として表示で
きる。
第３図は本発明の第２実施例の部分的なブロツ
ク図である。この実施例は第１図の実施例と類似
しているので、同じブロツクには同じ参照番号を
符し、相違点のみを説明する。アドレス・カウン
タ１８として、８ビツト・カウンタの代りに９ビ
ツト・カウンタを用い、ゲート３４及び３６の一
方の入力端子にフリツプ・フロツプ３２のＱ出力
の代りにカウンタ１８のMSB（Ｑ８）を供給す
る。カウンタ１８の計数サイクルの一方の半サイ
クル期間中、MSB（Ｑ８）は「０」であり、他
方の半サイクル期間中、このMSBは「１」なの
で、制御回路３０は第１図の場合と同様な動作を
する。デジタル・マルチプレクサ（MUX）２３
はスイツチ２２として作用し、制御信号によりそ
の切換動作が制御される。各表示モード中におい
ては、MUX２３を切換える必要がないので、
MUX２３は低速素子でよい。
ク図である。この実施例は第１図の実施例と類似
しているので、同じブロツクには同じ参照番号を
符し、相違点のみを説明する。アドレス・カウン
タ１８として、８ビツト・カウンタの代りに９ビ
ツト・カウンタを用い、ゲート３４及び３６の一
方の入力端子にフリツプ・フロツプ３２のＱ出力
の代りにカウンタ１８のMSB（Ｑ８）を供給す
る。カウンタ１８の計数サイクルの一方の半サイ
クル期間中、MSB（Ｑ８）は「０」であり、他
方の半サイクル期間中、このMSBは「１」なの
で、制御回路３０は第１図の場合と同様な動作を
する。デジタル・マルチプレクサ（MUX）２３
はスイツチ２２として作用し、制御信号によりそ
の切換動作が制御される。各表示モード中におい
ては、MUX２３を切換える必要がないので、
MUX２３は低速素子でよい。
第４図は、本発明に用いる制御回路３０の他の
実施例のブロツク図である。インバータ４０は端
子４２を介して、アドレス・カウンタ１８からの
LSBを受ける。MUX４４は端子４６からの制御
信号に応じてインバータ４０の出力端子又は端子
４２を選択する。端子４６の制御信号は、第１図
のフリツプ・フロツプ３２のＱ出力信号又は第３
図のカウンタ１８のMSBでもよい。MUX４４の
選択した出力信号は端子４８を介して第１図の接
点２２Ｃ又は第３図のMUX２３に供給する。
実施例のブロツク図である。インバータ４０は端
子４２を介して、アドレス・カウンタ１８からの
LSBを受ける。MUX４４は端子４６からの制御
信号に応じてインバータ４０の出力端子又は端子
４２を選択する。端子４６の制御信号は、第１図
のフリツプ・フロツプ３２のＱ出力信号又は第３
図のカウンタ１８のMSBでもよい。MUX４４の
選択した出力信号は端子４８を介して第１図の接
点２２Ｃ又は第３図のMUX２３に供給する。
実施例の変形
上述は本発明の好適な実施例についてのみ説明
したが、当業者には本発明の要旨を逸脱すること
なく種々の変形が可能なことが理解できよう。例
えば、クロツク信号を第１図のフリツプ・フロツ
プ３２のＴ端子、第３図のゲート３４及び３６の
他方の入力端子（MSBが加わる端子）並びに第
４図の端子４６に供給して、表示クロツクの１サ
イクル中にアドレス・カウンタのLSBを交互に反
転及び非反転してもよい。また、ロウパス・フイ
ルタは受動フイルタでもよい。
したが、当業者には本発明の要旨を逸脱すること
なく種々の変形が可能なことが理解できよう。例
えば、クロツク信号を第１図のフリツプ・フロツ
プ３２のＴ端子、第３図のゲート３４及び３６の
他方の入力端子（MSBが加わる端子）並びに第
４図の端子４６に供給して、表示クロツクの１サ
イクル中にアドレス・カウンタのLSBを交互に反
転及び非反転してもよい。また、ロウパス・フイ
ルタは受動フイルタでもよい。
発明の効果
上述の如く、本発明によれば、２サイクルのメ
モリ読出し動作により信号包絡線が表示できるの
で、信号の処理時間が短縮できると共に、ちらつ
きもなくせる。また、構成が簡単になると共に、
制御も容易となる。
モリ読出し動作により信号包絡線が表示できるの
で、信号の処理時間が短縮できると共に、ちらつ
きもなくせる。また、構成が簡単になると共に、
制御も容易となる。
第１図は本発明の好適な一実施例を用いたデジ
タル・オシロスコープのブロツク図、第２Ａ図、
第２Ｂ図、第２Ｃ図、第２Ｄ図及び第２Ｅ図は本
発明を説明するための波形図、第３図は本発明の
好適な他の実施例の部分的なブロツク図、第４図
は本発明に用いる制御回路の他の実施例のブロツ
ク図である。 １６はメモリ、１８はアドレス・カウンタ、３
０は制御回路である。
タル・オシロスコープのブロツク図、第２Ａ図、
第２Ｂ図、第２Ｃ図、第２Ｄ図及び第２Ｅ図は本
発明を説明するための波形図、第３図は本発明の
好適な他の実施例の部分的なブロツク図、第４図
は本発明に用いる制御回路の他の実施例のブロツ
ク図である。 １６はメモリ、１８はアドレス・カウンタ、３
０は制御回路である。
Claims (1)
- １ 入力信号の一定区間毎の最小値及び最大値を
順次記憶しているメモリと、該メモリにアドレス
信号を供給して上記最小値及び最大値を選択的に
読出すアドレス・カウンタと、上記メモリに供給
される上記アドレス信号の最下位ビツトを選択的
に反転する制御回路と、上記メモリからの出力信
号により表示信号を発生する表示信号発生手段と
を具え、上記表示信号により上記入力信号の包絡
線を表示することを特徴とするデジタル・オシロ
スコープ用信号包絡線表示装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US434459 | 1982-10-15 | ||
| US06/434,459 US4536760A (en) | 1982-10-15 | 1982-10-15 | Signal-envelope display system for a digital oscilloscope |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59135371A JPS59135371A (ja) | 1984-08-03 |
| JPS6257223B2 true JPS6257223B2 (ja) | 1987-11-30 |
Family
ID=23724325
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58193321A Granted JPS59135371A (ja) | 1982-10-15 | 1983-10-15 | デジタル・オシロスコ−プ用信号包絡線表示装置 |
Country Status (7)
| Country | Link |
|---|---|
| US (1) | US4536760A (ja) |
| JP (1) | JPS59135371A (ja) |
| CA (1) | CA1213086A (ja) |
| DE (1) | DE3336570C2 (ja) |
| FR (1) | FR2534690B1 (ja) |
| GB (1) | GB2133956B (ja) |
| NL (1) | NL189685C (ja) |
Families Citing this family (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4647922A (en) * | 1984-02-13 | 1987-03-03 | Tektronix, Inc. | Digital oscilloscope display system employing interpolated information |
| US4673931A (en) * | 1985-03-18 | 1987-06-16 | Tektronix, Inc. | Waveform data display |
| US4644268A (en) * | 1985-04-08 | 1987-02-17 | Allied-Signal Corporation | Apparatus and method for determining the magnitude and phase of the fundamental component of a complex waveshape |
| US4848877A (en) * | 1987-09-29 | 1989-07-18 | Cambridge Research And Instrumentation, Inc. | Liquid crystal devices and systems using such devices |
| US4780755A (en) * | 1987-10-26 | 1988-10-25 | Tektronix, Inc. | Frame buffer self-test |
| US4772948A (en) * | 1987-10-26 | 1988-09-20 | Tektronix, Inc. | Method of low cost self-test in a video display system system |
| DE3744398A1 (de) * | 1987-12-29 | 1989-07-13 | Asea Brown Boveri | Verfahren und vorrichtung zur registrierung von signalkurven |
| US5028914A (en) * | 1988-06-23 | 1991-07-02 | Motorola, Inc. | Method and apparatus for waveform digitization |
| GB2237712B (en) * | 1989-11-02 | 1994-05-04 | Motorola Inc | Method and apparatus for waveform digitization |
| GB2266437A (en) * | 1992-04-21 | 1993-10-27 | Timothy Paul Vann Coates | Oscilloscope controlled digital storage adapter |
| GB2267201A (en) * | 1992-05-08 | 1993-11-24 | Marconi Instruments Ltd | Display Systems for displaying a Series of sequentially occurring Displays |
| US5488698A (en) * | 1992-11-05 | 1996-01-30 | Oliver; David C. | Rasterization of line segments using difference vectors |
| US5684507A (en) * | 1994-09-07 | 1997-11-04 | Fluke Corporation | Method of displaying continuously acquired data on a fixed length display |
| US5594765A (en) * | 1995-01-03 | 1997-01-14 | Hyundai Electronics America | Interleaved and sequential counter |
| US5949399A (en) * | 1996-02-12 | 1999-09-07 | Snap-On Technologies, Inc. | Electronic signal measurement apparatus for the acquisition and display of short-duration analog signal events |
| US6529068B1 (en) * | 1997-08-29 | 2003-03-04 | Stmicroelectronics S.R.L. | Area-efficient reconstruction filters, particularly for current-driven D/A converters |
| US6201527B1 (en) * | 1998-06-25 | 2001-03-13 | Textronix, Inc. | Technique for displaying enveloped waveform |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4039784A (en) * | 1976-01-30 | 1977-08-02 | Honeywell Inc. | Digital minimum/maximum vector crt display |
| US4271486A (en) * | 1979-07-30 | 1981-06-02 | Tektronix, Inc. | Waveform storage system |
| GB2059230B (en) * | 1979-09-18 | 1983-05-11 | Paterson A J | Electrical heater particularly for cooking |
| US4396912A (en) * | 1981-08-17 | 1983-08-02 | Hewlett-Packard Company | Method and means for point connecting with a differential integrator dot connector circuit |
-
1982
- 1982-10-15 US US06/434,459 patent/US4536760A/en not_active Expired - Lifetime
-
1983
- 1983-09-27 GB GB08325815A patent/GB2133956B/en not_active Expired
- 1983-10-07 DE DE3336570A patent/DE3336570C2/de not_active Expired
- 1983-10-13 FR FR8316258A patent/FR2534690B1/fr not_active Expired
- 1983-10-13 CA CA000438967A patent/CA1213086A/en not_active Expired
- 1983-10-14 NL NLAANVRAGE8303526,A patent/NL189685C/xx not_active IP Right Cessation
- 1983-10-15 JP JP58193321A patent/JPS59135371A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| DE3336570A1 (de) | 1984-04-19 |
| DE3336570C2 (de) | 1987-01-22 |
| GB8325815D0 (en) | 1983-10-26 |
| FR2534690B1 (fr) | 1986-08-08 |
| CA1213086A (en) | 1986-10-21 |
| US4536760A (en) | 1985-08-20 |
| JPS59135371A (ja) | 1984-08-03 |
| GB2133956B (en) | 1986-07-23 |
| FR2534690A1 (fr) | 1984-04-20 |
| NL189685C (nl) | 1993-06-16 |
| NL8303526A (nl) | 1984-05-01 |
| NL189685B (nl) | 1993-01-18 |
| GB2133956A (en) | 1984-08-01 |
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