JPS628072Y2 - - Google Patents
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- Publication number
- JPS628072Y2 JPS628072Y2 JP1859978U JP1859978U JPS628072Y2 JP S628072 Y2 JPS628072 Y2 JP S628072Y2 JP 1859978 U JP1859978 U JP 1859978U JP 1859978 U JP1859978 U JP 1859978U JP S628072 Y2 JPS628072 Y2 JP S628072Y2
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- JP
- Japan
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- data
- address
- counter
- digital
- group
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- 238000010586 diagram Methods 0.000 description 3
Description
【考案の詳細な説明】
本考案はマイクロプロセツサを用いて複数の電
圧制御型電子楽器を同時に制御する電子楽器用自
動演奏装置に関する。
圧制御型電子楽器を同時に制御する電子楽器用自
動演奏装置に関する。
本考案はメモリに記憶されているデータで電圧
制御型電子楽器に複数のゲート信号、コントロー
ル電圧を供給して自動演奏させる自動演奏装置
で、同時に複数の電圧制御型電子楽器を制御でき
るようにする目的でなされたものである。以下、
図面を参照しながら詳細に説明する。
制御型電子楽器に複数のゲート信号、コントロー
ル電圧を供給して自動演奏させる自動演奏装置
で、同時に複数の電圧制御型電子楽器を制御でき
るようにする目的でなされたものである。以下、
図面を参照しながら詳細に説明する。
第１図は本考案による自動演奏装置の一実施例
を示すブロツク図である。
を示すブロツク図である。
メモリＭに記憶されているデータは、譜面上の
音符の長さ等、間隔を確保するため、ステツプタ
イムカウンタST1〜ST8に供給するデータと、ミ
ユージツクシンセサイザー等電圧制御型電子楽器
のゲート信号として使用すれば楽音を発生する期
間を定めることができるゲートタイムカウンタ
GT1〜GT8に供給するデータと、コントロール電
圧値を決めるためデジタルーアナログ変換器（以
下Ｄ−Ａ変換器と称する）DA1〜DA8に供給する
データとである。
音符の長さ等、間隔を確保するため、ステツプタ
イムカウンタST1〜ST8に供給するデータと、ミ
ユージツクシンセサイザー等電圧制御型電子楽器
のゲート信号として使用すれば楽音を発生する期
間を定めることができるゲートタイムカウンタ
GT1〜GT8に供給するデータと、コントロール電
圧値を決めるためデジタルーアナログ変換器（以
下Ｄ−Ａ変換器と称する）DA1〜DA8に供給する
データとである。
アドレスカウンタCS1〜CS8、CG1〜CG8、CD1
〜CD8はメモリＭのアドレスを指定するもので、
該アドレスカウンタを示すメモリＭのアドレスの
データをそれぞれステツプタイムカウンタST1〜
ST8、ゲートタイムカウンタGT1〜GT8、Ｄ−Ａ
変換器DA1〜DA8に供給するのであるが、アドレ
スカウンタCS1、CG8、CD1で第１チヤンネル１
−CH、CS2、CG2、CD2で第２のチヤンネル２−
CHというように３つで１組となつている。な
お、本実施例では上記アドレスカウンタ群は８チ
ヤンネルとする。
〜CD8はメモリＭのアドレスを指定するもので、
該アドレスカウンタを示すメモリＭのアドレスの
データをそれぞれステツプタイムカウンタST1〜
ST8、ゲートタイムカウンタGT1〜GT8、Ｄ−Ａ
変換器DA1〜DA8に供給するのであるが、アドレ
スカウンタCS1、CG8、CD1で第１チヤンネル１
−CH、CS2、CG2、CD2で第２のチヤンネル２−
CHというように３つで１組となつている。な
お、本実施例では上記アドレスカウンタ群は８チ
ヤンネルとする。
上記アドレスカウンタCS1で示すメモリＭのア
ドレスのデータはステツプタイムカウンタST1
へ、CG1で示すメモリＭのアドレスのデータはゲ
ートタイムカウンタGT1へ、CD1で示すメモリＭ
のアドレスのデータはＤ−Ａ変換器DA1へ第１、
第２、第３のデータ分配器を介してそれぞれ対応
して送り込まれる。なお、これらの動作はコント
ローラＣで制御されている。
ドレスのデータはステツプタイムカウンタST1
へ、CG1で示すメモリＭのアドレスのデータはゲ
ートタイムカウンタGT1へ、CD1で示すメモリＭ
のアドレスのデータはＤ−Ａ変換器DA1へ第１、
第２、第３のデータ分配器を介してそれぞれ対応
して送り込まれる。なお、これらの動作はコント
ローラＣで制御されている。
第２図のようにメモリＭにはステツプタイムカ
ウンタ、ゲートタイムカウンタ、Ｄ−Ａ変換器用
の領域を持つており、最初の状態ではアドレスカ
ウンタCS1は０、CG1は30、CD1は60、CS2は90…
…CD8は690というように領域の最初のアドレス
を示している。
ウンタ、ゲートタイムカウンタ、Ｄ−Ａ変換器用
の領域を持つており、最初の状態ではアドレスカ
ウンタCS1は０、CG1は30、CD1は60、CS2は90…
…CD8は690というように領域の最初のアドレス
を示している。
先ず、アドレスセレクタASでアドレスカウン
タCS1〜CD8の示すアドレスを順次選択してメモ
リＭのデータを前記アドレスカウンタに対応した
ステツプタイムカウンタST1〜ST8、ゲートタイ
ムカウンタGT1〜GT8，Ｄ−Ａ変換器DA1〜DA8
に入力するように、コントローラＣで制御される
データ分配器D1〜D3で制御する。これらの時間
は演奏において無視できる程短時間である。
タCS1〜CD8の示すアドレスを順次選択してメモ
リＭのデータを前記アドレスカウンタに対応した
ステツプタイムカウンタST1〜ST8、ゲートタイ
ムカウンタGT1〜GT8，Ｄ−Ａ変換器DA1〜DA8
に入力するように、コントローラＣで制御される
データ分配器D1〜D3で制御する。これらの時間
は演奏において無視できる程短時間である。
フリツプフロツプ回路FF1はステツプタイムカ
ウンタST1にデータが入力されるときその出力で
セツトされ、ゲートタイムカウンタGT1の出力が
０のときリセツトされて出力端子GO1よりゲート
信号を出力するので、第２図によりステツプタイ
ムカウンタST1に４、ゲートタイムカウンタGT1
に２、Ｄ−Ａ変換器DA1に２０が入力されると、
該ステツプタイムカウンタST1の出力で上記フリ
ツプフロツプFF1はセツトされてゲート信号が立
ち上り、ステツプタイムカウンタST1とゲートタ
イムカウンタGT1はクロツク発振器CLのクロツ
ク信号によつてカウントダウンされて、ゲートタ
イムカウンタGT1が０になると該フリツプフロツ
プFF1はリセツトされて該ゲート信号は立ち下
る。
ウンタST1にデータが入力されるときその出力で
セツトされ、ゲートタイムカウンタGT1の出力が
０のときリセツトされて出力端子GO1よりゲート
信号を出力するので、第２図によりステツプタイ
ムカウンタST1に４、ゲートタイムカウンタGT1
に２、Ｄ−Ａ変換器DA1に２０が入力されると、
該ステツプタイムカウンタST1の出力で上記フリ
ツプフロツプFF1はセツトされてゲート信号が立
ち上り、ステツプタイムカウンタST1とゲートタ
イムカウンタGT1はクロツク発振器CLのクロツ
ク信号によつてカウントダウンされて、ゲートタ
イムカウンタGT1が０になると該フリツプフロツ
プFF1はリセツトされて該ゲート信号は立ち下
る。
次いで、ステツプタイムカウンタST1が０にな
る時点で、アドレスカウンタCS1、CG1、CD1は
ステツプタイムカウンタST1の出力端子１の出力
信号で１つカウントしてそれぞれ次のアドレスか
ら該カウンタST1には２、GT1には１、DA1には
５とデータをもつて来て該ゲート信号は再び立ち
上る。
る時点で、アドレスカウンタCS1、CG1、CD1は
ステツプタイムカウンタST1の出力端子１の出力
信号で１つカウントしてそれぞれ次のアドレスか
ら該カウンタST1には２、GT1には１、DA1には
５とデータをもつて来て該ゲート信号は再び立ち
上る。
以上の様子を第３図に示す。この間、出力端子
CV1よりＤ−Ａ変換器で変換した電圧が出力され
ている。
CV1よりＤ−Ａ変換器で変換した電圧が出力され
ている。
同時に他のチヤンネルも同様に第３図に示す
ST2、GT2、GO2のように動作をし、Ｄ−Ａ変換
器からはデータに従つて電圧が出力されている。
コントローラＣはマイクロプロセツサを使用する
とよい。
ST2、GT2、GO2のように動作をし、Ｄ−Ａ変換
器からはデータに従つて電圧が出力されている。
コントローラＣはマイクロプロセツサを使用する
とよい。
尚、上記では１つのゲート信号と１つの制御電
圧とで１組となるように述べてあるが、実際に使
用する場合は１つの制御電圧に１つのゲート信号
と限定する必要はなく、例えば２つの制御電圧と
１つのゲート信号でもよい。
圧とで１組となるように述べてあるが、実際に使
用する場合は１つの制御電圧に１つのゲート信号
と限定する必要はなく、例えば２つの制御電圧と
１つのゲート信号でもよい。
以上のように、本考案は複数組の制御電圧とゲ
ート信号とを同時に出力することができるため、
電圧制御型の電子楽器を同時に複数制御できる自
動演奏装置を提供するものである。
ート信号とを同時に出力することができるため、
電圧制御型の電子楽器を同時に複数制御できる自
動演奏装置を提供するものである。
第１図は本考案による自動演奏装置の一実施例
を示すブロツク図である。 Ｍ……メモリ、Ｃ……コントローラ、AS……
アドレスセレクタ、CS1〜CS8，CG1〜CG8，CD1
〜CD8……アドレスカウンタ、１−CH〜８−CH
……チヤンネル、D1，D2，D3……データ分配
器、ST1〜ST8……ステツプタイムカウンタ、
GT1〜GT8……ゲートタイムカウンタ、DA1〜
DA8……デジタルーアナログ変換器、FF1〜FF8
……フリツプフロツプ回路、CL……クロツク信
号発振器、GO1〜GO8，CV1〜CV8……出力端
子。 第２図はメモリＭの各領域と、該メモリＭに記
憶された各データとの対応を説明する図表であ
る。第３図はクロツク信号発信器とステツプタイ
ムカウンタ及びゲートタイムカウンタの動作と、
出力端子から出力されるゲート信号との対応を説
明する図である。
を示すブロツク図である。 Ｍ……メモリ、Ｃ……コントローラ、AS……
アドレスセレクタ、CS1〜CS8，CG1〜CG8，CD1
〜CD8……アドレスカウンタ、１−CH〜８−CH
……チヤンネル、D1，D2，D3……データ分配
器、ST1〜ST8……ステツプタイムカウンタ、
GT1〜GT8……ゲートタイムカウンタ、DA1〜
DA8……デジタルーアナログ変換器、FF1〜FF8
……フリツプフロツプ回路、CL……クロツク信
号発振器、GO1〜GO8，CV1〜CV8……出力端
子。 第２図はメモリＭの各領域と、該メモリＭに記
憶された各データとの対応を説明する図表であ
る。第３図はクロツク信号発信器とステツプタイ
ムカウンタ及びゲートタイムカウンタの動作と、
出力端子から出力されるゲート信号との対応を説
明する図である。
Claims (1)
- 【実用新案登録請求の範囲】 楽譜の音符記号をコード化したデータを記憶し
ておくメモリ、該メモリにおけるデータのアドレ
スを指定するアドレスカウンタ群、外部の電圧制
御型電子楽器制御用ゲート信号を得るための第
１、第２のカウンタ群、それらカウンタ群にクロ
ツク信号を供給するクロツク信号発振器、デジタ
ル信号をコントロール電圧に変換して外部の電圧
制御型電子楽器制御用電圧として出力するための
デジタルーアナログ変換器群、前記アドレスカウ
ンタ群から必要なアドレスを選択するアドレスセ
レクタ、前記メモリからのデータを第１のカウン
タ群に振り分ける第１のデータ分配器、同様にメ
モリからのデータを第２のカウンタ群に振り分け
る第２のデータ分配器、同じく前記デジタルーア
ナログ変換器群に振り分ける第３のデータ分配
器、以上の各回路装置を制御するコントローラと
から成り、 前記メモリには、第１、第２のカウンタ群及び
デジタルーアナログ変換器に入力するデータを記
憶しておき、前記アドレスカウンタは第１、第２
のカウンタ、デジタルーアナログ変換器のすべて
に対応して設けられ、メモリから取り出すべきデ
ータのアドレスが指定されるもの、 デジタルーアナログ変換器はメモリから伝送さ
れるデジタル信号を外部の電圧制御型電子楽器制
御用の電圧に変換して出力するもの、 アドレスセレクタは前記コントローラの制御を
受けて、必要なデータのアドレスが指定されてい
るアドレスカウンタをアドレスカウンタ群から選
択するもの、 第１のデータ分配器はコントローラの制御を受
けて第１のカウンタ群から必要なカウンタを選択
してデータを該カウンタに入力するもの、 第２のデータ分配器はコントローラの制御を受
けて第２のカウンタ群から必要なカウンタを選択
して該カウンタにデータを入力するもの、 第３のデータ分配器はコントローラの制御を受
けてデジタルーアナログ変換器群から必要なデジ
タルーアナログ変換器を選択して該デジタルーア
ナログ変換器にデータを入力するものであり、 前記第１、第２のカウンタ群の出力により外部
の電圧制御型電子楽器制御用ゲート信号を得るよ
うになし、複数の上記電子楽器を同時に制御する
ことを特徴とする電子楽器の自動演奏装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1859978U JPS628072Y2 (ja) | 1978-02-15 | 1978-02-15 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1859978U JPS628072Y2 (ja) | 1978-02-15 | 1978-02-15 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54123718U JPS54123718U (ja) | 1979-08-29 |
| JPS628072Y2 true JPS628072Y2 (ja) | 1987-02-25 |
Family
ID=28846144
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1859978U Expired JPS628072Y2 (ja) | 1978-02-15 | 1978-02-15 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS628072Y2 (ja) |
-
1978
- 1978-02-15 JP JP1859978U patent/JPS628072Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54123718U (ja) | 1979-08-29 |
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