JPS6281050A - 静電保護回路 - Google Patents

静電保護回路

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Publication number
JPS6281050A
JPS6281050A JP60222113A JP22211385A JPS6281050A JP S6281050 A JPS6281050 A JP S6281050A JP 60222113 A JP60222113 A JP 60222113A JP 22211385 A JP22211385 A JP 22211385A JP S6281050 A JPS6281050 A JP S6281050A
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JP
Japan
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discharge
electrostatic protection
protection circuit
gap
wiring
Prior art date
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Pending
Application number
JP60222113A
Other languages
English (en)
Inventor
Masakatsu Higake
樋掛　昌勝
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D89/00—Aspects of integrated devices not covered by groups H10D84/00 - H10D88/00
    • H10D89/60—Integrated devices comprising arrangements for electrical or thermal protection, e.g. protection circuits against electrostatic discharge [ESD]
    • H10D89/601—Integrated devices comprising arrangements for electrical or thermal protection, e.g. protection circuits against electrostatic discharge [ESD] for devices having insulated gate electrodes, e.g. for IGFETs or IGBTs

Landscapes

  • Protection Of Static Devices (AREA)
  • Electrodes Of Semiconductors (AREA)
  • Semiconductor Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は靜７保護回路に関し０、特に集積回路に適用さ
れる静電保護回路に関する。
〔従来の技術〕
従来、この種の静電保護回路は、第３図に示すように、
抵抗１１及びダイオード１２で構成され、抵抗による電
圧低減効果とダイオードによる電圧クランプ効果とによ
り静電保護を行っていた。
〔発明が解決しようとする問題点〕
上述した従来の静電保護回路は、入力端子に直列抵抗及
び並列容量が付加されるため入力信号の立上り時間ｔｒ
ｈ及び立下り時間ｔｆが大きくなり、もって出力遅延時
間ｔ、ａが増大する欠点がある。
本発明の目的は、出力遅延時間を増大させることなくし
かも静電破壊を防止する静電保護回路を提供することに
ある。
〔問題点を解決するための手段〕
に微小な間隙を有する放電ギャップを少くとも１個設け
ることによプ構成される。
〔実施例〕
次に１本発明の実施例について図面を参照して説明する
。
第１図は本発明の第１の実施例の平面図である。
集積回路の入出力パット２と電源配線３及び接地配線４
との間で、かつ互いに向い合う部分に放電ギャップ１を
設ける。放電ギャップエは、図示するように、とがった
先端を互いに微小間隙、例えばきクロン単位の間隙で向
い合わせて構成されル、放１′ギャップｌには破線で示
すようなカバー５は設けない、また、配線６は内部回路
に接続する配線である。
入出力パッド２に高電圧の静電気が印加され、放１ギャ
ップｌの放電開始電圧以上になると、入出力パッド２と
電源配線３との間の放電ギャップ、あるいけ入出力パッ
ド２と接地配線４との間で放電し、内部回路の破啼を防
止する。
第２図は本発明の第２の実施例の平面図である。
この第２の実施例は、入出力パッドと１１ｉ源配線３及
び接地配線４との間が広いときに適する形状に放電ギャ
ップｌを形成ｌまたものであり、それ以外は第１の実施
例と同じである。
放電ギャップ１が複数個ある場合は、１個のギャップが
放電により放電ギャップ間隙が大きくなり、放電開始電
圧が高くなって［、まっても他の放電ギャップで放電す
るので、静電保護効果は維持される。
〔発明の効果〕 以上説明したように本発明は、放電開始！圧の低い放電
ギャップを人出カパッドと電源配線及びあるいは接地配
線との間に設けたので、信号遅延を生じさせることなく
静電保護を行う効果がある。
【図面の簡単な説明】
第１図及び第２図はそねそれ本発明の第１及び第２の実
施例の平面図、第３図は従来の静電保護回路の一例の回
路図である。 ｌ・・・・・・放電ギャップ、２・・団・入出力パッド
、３・・・・・・電源配線、４・・・・・・接地配線、
５・・・・・・カバー、６・・・・・・配線、１０・・
・・・・入力端子、１１・旧・・抵抗。 】　２・・・・・・ダイオード。

Claims (1)

    【特許請求の範囲】
  1. 入出力パッドと電源配線及びあるいは接地配線との間で
    かつ向い合う部分に微小な間隙を有する放電ギャップを
    少くとも１個設けたことを特徴とする放電保護回路。
JP60222113A 1985-10-04 1985-10-04 静電保護回路 Pending JPS6281050A (ja)

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