JPS6283300U - - Google Patents
Info
- Publication number
- JPS6283300U JPS6283300U JP17635185U JP17635185U JPS6283300U JP S6283300 U JPS6283300 U JP S6283300U JP 17635185 U JP17635185 U JP 17635185U JP 17635185 U JP17635185 U JP 17635185U JP S6283300 U JPS6283300 U JP S6283300U
- Authority
- JP
- Japan
- Prior art keywords
- output terminal
- level
- memory cell
- data
- high level
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Static Random-Access Memory (AREA)
Description
第１図は本考案の一実施例の回路図である。
１……メモリセル群、２……基準レベル発生回
路、３……切換回路、４……センス増幅器、１１
……信号データ、２１……基準データ、３３……
第１の出力端子、３４……第２の出力端子、４１
……正入力端子、４２……負入力端子。
路、３……切換回路、４……センス増幅器、１１
……信号データ、２１……基準データ、３３……
第１の出力端子、３４……第２の出力端子、４１
……正入力端子、４２……負入力端子。
Claims (1)
- 予め設定されたデータ内容に応じてそれぞれの
メモリセルが高レベル又は低レベルの信号データ
を出力するメモリセル群と、前記高レベルと低ベ
レルとの中間レベルの基準データを出力する基準
レベル発生回路と、前記信号データと前記基準デ
ータとを入力としそれぞれの入力が予め設定する
ことにより切換え出力される第１及び第２の出力
端子を有する切換回路と、正入力端子が前記第１
の出力端子に接続され負入力端子が前記第２の出
力端子に接続されるセンス増幅器とを含むことを
特徴とする読出し専用メモリ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17635185U JPS6283300U (ja) | 1985-11-15 | 1985-11-15 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17635185U JPS6283300U (ja) | 1985-11-15 | 1985-11-15 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6283300U true JPS6283300U (ja) | 1987-05-27 |
Family
ID=31116512
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17635185U Pending JPS6283300U (ja) | 1985-11-15 | 1985-11-15 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6283300U (ja) |
-
1985
- 1985-11-15 JP JP17635185U patent/JPS6283300U/ja active Pending
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