JPS63113258U - - Google Patents
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- Publication number
- JPS63113258U JPS63113258U JP516687U JP516687U JPS63113258U JP S63113258 U JPS63113258 U JP S63113258U JP 516687 U JP516687 U JP 516687U JP 516687 U JP516687 U JP 516687U JP S63113258 U JPS63113258 U JP S63113258U
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- outputted
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- Pending
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- Signal Processing For Digital Recording And Reproducing (AREA)
Description
第１図は本考案のミユーテイング回路の構成を
示す図、第２図は同、各部の信号波形を示す図、
第３図は同、具体例の構成を示す図、第４図は従
来のミユーテイング動作を示す図である。 １……シフトレジスタ、２……制御回路。
示す図、第２図は同、各部の信号波形を示す図、
第３図は同、具体例の構成を示す図、第４図は従
来のミユーテイング動作を示す図である。 １……シフトレジスタ、２……制御回路。
Claims (1)
- 【実用新案登録請求の範囲】 オーデイオ信号に対応するデジタルデータがｎ
ビツトの２′コンプリメントデータ 〔Ｄｎ―１ Ｄｎ―２……Ｄ１ Ｄ０〕 で与えられるオーデイオ機器において、上記２′
コンプリメントデータの最上位ビツト〔Ｄｎ―１
〕を順次最下位ビツト側へシフトさせて、出力す
ることを特徴とするミユーテイング回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP516687U JPS63113258U (ja) | 1987-01-17 | 1987-01-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP516687U JPS63113258U (ja) | 1987-01-17 | 1987-01-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63113258U true JPS63113258U (ja) | 1988-07-21 |
Family
ID=30786499
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP516687U Pending JPS63113258U (ja) | 1987-01-17 | 1987-01-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63113258U (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59172104A (ja) * | 1983-03-22 | 1984-09-28 | Nec Corp | デイジタル・デ−タ・エンベロ−プ・コントロ−ル回路 |
-
1987
- 1987-01-17 JP JP516687U patent/JPS63113258U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59172104A (ja) * | 1983-03-22 | 1984-09-28 | Nec Corp | デイジタル・デ−タ・エンベロ−プ・コントロ−ル回路 |
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