JPS63122832U - - Google Patents

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JPS63122832U
JPS63122832U JP1144387U JP1144387U JPS63122832U JP S63122832 U JPS63122832 U JP S63122832U JP 1144387 U JP1144387 U JP 1144387U JP 1144387 U JP1144387 U JP 1144387U JP S63122832 U JPS63122832 U JP S63122832U
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JP
Japan
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circuit
gate
circuits
gate circuits
latch
Prior art date
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JP1144387U
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【図面の簡単な説明】
第１図は本考案の信号入力回路の一実施例を示
したブロツク図、第２図は従来の信号入力回路の
一例を示したブロツク図、第３図は従来の信号入
力回路の他の例を示したブロツク図である。 １１〜１５……ノンロツクスイツチ、２１〜２
５……チヤタリング防止回路、３１〜３５……３
ステートバツフア、４……マイクロコンピユータ
、６……アドレスデコーダ、８１〜８５……ラツ
チ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号をラツチする複数のラツチ回路と、対
    応するラツチ回路によりラツチされた信号を所定
    のタイミングで取り出す複数のゲート回路と、前
    記複数のゲート回路を通して前記ラツチされた信
    号を順次読み込むべく前記複数のゲート回路を順
    次アクテイブとする制御信号を出力する制御回路
    とを設け、前記ゲート回路の１つをアクテイブと
    すべく出力された制御信号で、このゲート回路が
    前回アクテイブとなつた際にこのゲート回路に信
    号を供給したラツチ回路をクリアするようにした
    ことを特徴とする信号入力回路。
JP1144387U 1987-01-30 1987-01-30 Pending JPS63122832U (ja)

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JP1144387U JPS63122832U (ja) 1987-01-30 1987-01-30

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JP1144387U JPS63122832U (ja) 1987-01-30 1987-01-30

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JPS63122832U true JPS63122832U (ja) 1988-08-10

Family

ID=30798666

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JP1144387U Pending JPS63122832U (ja) 1987-01-30 1987-01-30

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