JPS631249U - - Google Patents
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- Publication number
- JPS631249U JPS631249U JP9411886U JP9411886U JPS631249U JP S631249 U JPS631249 U JP S631249U JP 9411886 U JP9411886 U JP 9411886U JP 9411886 U JP9411886 U JP 9411886U JP S631249 U JPS631249 U JP S631249U
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- JP
- Japan
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- calculation
- complex number
- mode
- formula
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- Pending
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Description
第１図はこの考案の一実施例の回路構成を示す
ブロツク図、第２図、第３図は同実施例の動作を
説明するためのフローチヤートである。 １……キー入力部、３……制御部、４……記憶
部、５……演算部、６……表示部。
ブロツク図、第２図、第３図は同実施例の動作を
説明するためのフローチヤートである。 １……キー入力部、３……制御部、４……記憶
部、５……演算部、６……表示部。
Claims (1)
- 普通演算モードと複素数演算モードの切換手段
と、計算式に応じた数式データを入力する入力手
段と、普通モードでは独立メモリとして使用され
るとともに複素数モードでは複素数演算用レジス
タとして使用される記憶手段と、上記複素数モー
ドでの入力手段の入力データより上記計算式中の
フアンクシヨンの優先順位を判断し優先順位の低
い数式データを上記記憶手段に一時記憶して優先
順位の高い数式データをもとに演算を実行すると
ともに上記記憶手段に記憶された優先順位の低い
数式データを順に取出し演算を実行する演算手段
とを具備したことを特徴とする複素数演算機能を
有する小型電子式計算機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9411886U JPS631249U (ja) | 1986-06-20 | 1986-06-20 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9411886U JPS631249U (ja) | 1986-06-20 | 1986-06-20 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS631249U true JPS631249U (ja) | 1988-01-07 |
Family
ID=30957270
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9411886U Pending JPS631249U (ja) | 1986-06-20 | 1986-06-20 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS631249U (ja) |
-
1986
- 1986-06-20 JP JP9411886U patent/JPS631249U/ja active Pending
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