JPS63183648U - - Google Patents

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JPS63183648U
JPS63183648U JP7379987U JP7379987U JPS63183648U JP S63183648 U JPS63183648 U JP S63183648U JP 7379987 U JP7379987 U JP 7379987U JP 7379987 U JP7379987 U JP 7379987U JP S63183648 U JPS63183648 U JP S63183648U
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JP
Japan
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display
display memory
boundary area
writing
dot pattern
Prior art date
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JP7379987U
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Description

【図面の簡単な説明】
第１図は本考案の一実施例による小型電子式計
算機の構成図、第２図は第１図の全体処理の流れ
を示す図、第３図は第１図に特有の位取りマーク
表示処理の原理を説明するための図、第４図は第
２図の置数表示処理の流れを示す図、第５図は位
取りマークの書込処理の処理結果を示す図である
。 １……ＣＰＵ、２……電卓用キー入力部、５…
…表示バツフア、７……表示部、１１……ＲＯＭ
、１２……レジスタ、１３……演算回路、１４…
…命令デコーダ。

Claims (1)

  1. 【実用新案登録請求の範囲】 表示データをドツトパターンのデータ形式で一
    時的に記憶する表示メモリと、 この表示メモリに記憶された数値列対応のキヤ
    ラクタ・パターン・データ間の境界領域を所定桁
    おきに指定する指定手段と、 この指定手段により指定された境界領域上に所
    定の位取りマークを示すドツトパターンデータを
    書込む書込手段と、 前記表示メモリの内容を表示するドツトマトリ
    クス型の表示手段と、 を備えたことを特徴とする小型電子式計算機。
JP7379987U 1987-05-18 1987-05-18 Pending JPS63183648U (ja)

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JP7379987U JPS63183648U (ja) 1987-05-18 1987-05-18

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JP7379987U JPS63183648U (ja) 1987-05-18 1987-05-18

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JPS63183648U true JPS63183648U (ja) 1988-11-25

Family

ID=30918451

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7379987U Pending JPS63183648U (ja) 1987-05-18 1987-05-18

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JP (1) JPS63183648U (ja)

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