JPS63201731U - - Google Patents
Info
- Publication number
- JPS63201731U JPS63201731U JP9357287U JP9357287U JPS63201731U JP S63201731 U JPS63201731 U JP S63201731U JP 9357287 U JP9357287 U JP 9357287U JP 9357287 U JP9357287 U JP 9357287U JP S63201731 U JPS63201731 U JP S63201731U
- Authority
- JP
- Japan
- Prior art keywords
- parallel
- data
- interface circuit
- microprocessor
- printer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Dot-Matrix Printers And Others (AREA)
Description
第１図は本考案の一実施例を示すブロツク図、
第２図は従来のドツトシリアルプリンタを示すブ
ロツク図である。 １…マイクロプロセツサ、２…パラレルインタ
ーフエース回路、３…マイクロプロセツサ、４…
シリアルインターフエース回路、５…ＵＳＡＲＴ
、６…マイクロプロセツサ。
第２図は従来のドツトシリアルプリンタを示すブ
ロツク図である。 １…マイクロプロセツサ、２…パラレルインタ
ーフエース回路、３…マイクロプロセツサ、４…
シリアルインターフエース回路、５…ＵＳＡＲＴ
、６…マイクロプロセツサ。
Claims (1)
- シリアルインターフエース回路からシリアルデ
ータを受信しパラレルデータに変換し制御部へデ
ータ転送を行なう第一のマイクロプロセツサと、
前記第一のマイクロプロセツサからのパラレルデ
ータまたはプリンタ外部からのパラレルデータを
制御部へ転送するパラレルインターフエース回路
と、前記パラレルインターフエース回路からパラ
レルデータを受信しかつプリンタの制御を行なう
第二のマイクロプロセツサとを有することを特徴
とするドツトシリアルプリンタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9357287U JPS63201731U (ja) | 1987-06-17 | 1987-06-17 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9357287U JPS63201731U (ja) | 1987-06-17 | 1987-06-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63201731U true JPS63201731U (ja) | 1988-12-26 |
Family
ID=30956262
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9357287U Pending JPS63201731U (ja) | 1987-06-17 | 1987-06-17 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63201731U (ja) |
-
1987
- 1987-06-17 JP JP9357287U patent/JPS63201731U/ja active Pending
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