JPS63220667A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPS63220667A JPS63220667A JP62054827A JP5482787A JPS63220667A JP S63220667 A JPS63220667 A JP S63220667A JP 62054827 A JP62054827 A JP 62054827A JP 5482787 A JP5482787 A JP 5482787A JP S63220667 A JPS63220667 A JP S63220667A
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- JP
- Japan
- Prior art keywords
- pixel density
- signal
- image data
- circuit
- decoding
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野〕
本発明は画像データを処理する画像処理装置に関するも
のである。
のである。
従来、圧縮ツー１〜を符号化、復号化する装置はマイコ
ンＲＯＭ、ＲＡＭ等て構成されており画素密度変換もマ
イコンＲＯＭ、ＲＡＭ等で行ってきた。従って、圧縮処
理されている画像データの画素密度の変換処理もソフト
ウェア処理にてなされているため、高速処理か望めなか
った。
ンＲＯＭ、ＲＡＭ等て構成されており画素密度変換もマ
イコンＲＯＭ、ＲＡＭ等で行ってきた。従って、圧縮処
理されている画像データの画素密度の変換処理もソフト
ウェア処理にてなされているため、高速処理か望めなか
った。
（目 的）
本発明は以上の点に鑑みてなされたもので、高速な処理
速度で圧縮コードの画素密度変換可能な画像処理装置を
提供するものである。
速度で圧縮コードの画素密度変換可能な画像処理装置を
提供するものである。
木発明の詳細を図面を用いて説明する。
第１図は木発明を適用した画像処理装置の実施例の概要
を示すブロック図である。
を示すブロック図である。
Ａは記憶回路であり、圧縮コードか格納されている。実
時間で圧縮コードを復号する、特願昭６０−１７５３０
６号に示した如くの復号回路ＢはＲＯＭ、ＲＡＭマイコ
ン等からなる制御部Ｆより制御され、１ライン当りｎの
画素数として記憶回路Ａより圧縮コードを順次読み出し
、画像同期クロック信号であるＣＬＫＤに同期して復号
を実行する。
時間で圧縮コードを復号する、特願昭６０−１７５３０
６号に示した如くの復号回路ＢはＲＯＭ、ＲＡＭマイコ
ン等からなる制御部Ｆより制御され、１ライン当りｎの
画素数として記憶回路Ａより圧縮コードを順次読み出し
、画像同期クロック信号であるＣＬＫＤに同期して復号
を実行する。
復号回路Ｂはページ同期信号である
ＶＳＹＮＣ１１ラインの画像データか有効である範囲を
示ずＶＥＮ信号、そして復号した画像データであるＶＩ
ＤＥＯＩ信号を出力する。
示ずＶＥＮ信号、そして復号した画像データであるＶＩ
ＤＥＯＩ信号を出力する。
画素密度変換制御回路Ｃは制御回路Ｆより制御さね、変
換すべき割合に従って、入力するＶＳＹＮＣ，ＶＥＮ、
ＶＩＤＥＯｌ、画像同期クロッつてあるＣＬＫ信号より
ＣＬ Ｋ （８号をまひいたＣＬＫＥ信号とＶＥＮ信号
をまひいたＶＥＮＥ イ言−号 と ＶＩＤＥＯ２イ言
−号 （ＶＩＤＥＯＩ＝ＶＩＤＥＯ２）を出力する。
換すべき割合に従って、入力するＶＳＹＮＣ，ＶＥＮ、
ＶＩＤＥＯｌ、画像同期クロッつてあるＣＬＫ信号より
ＣＬ Ｋ （８号をまひいたＣＬＫＥ信号とＶＥＮ信号
をまひいたＶＥＮＥ イ言−号 と ＶＩＤＥＯ２イ言
−号 （ＶＩＤＥＯＩ＝ＶＩＤＥＯ２）を出力する。
実時間て圧縮コードを符号化する特願昭６０−１７０８
０３号に示した如くの符号回路りは制御回路ＦＪ：す１
ライン当りｍ （ｍ＜ｎ）の画素数としてＶＳＹＮＣ，
ＶＥＮＥ、ＶＩＤＥＯ２゜ＣＬ Ｋ Ｅ信−号より画像
データを符号化し、圧縮コードを記憶回路Ｅに出力する
。
０３号に示した如くの符号回路りは制御回路ＦＪ：す１
ライン当りｍ （ｍ＜ｎ）の画素数としてＶＳＹＮＣ，
ＶＥＮＥ、ＶＩＤＥＯ２゜ＣＬ Ｋ Ｅ信−号より画像
データを符号化し、圧縮コードを記憶回路Ｅに出力する
。
この様な第１図構成において、画像データを符号化した
圧縮コードを復号回路Ｂにより復号し、画像同期クロッ
クＣＬ Ｋと復−号回路ＢよりＦ１４力される１ライン
の画像データが有効な範囲を示ずラインイネーブル信号
ＶＥＮを、画素密度を減少させる割合に応じて画素密度
変換制御回路Ｃによりまびいて符号化回路りに入力する
ことにより、同一の画像データて画素密度をおいた圧縮
コードに符号化したデータを得るものである。
圧縮コードを復号回路Ｂにより復号し、画像同期クロッ
クＣＬ Ｋと復−号回路ＢよりＦ１４力される１ライン
の画像データが有効な範囲を示ずラインイネーブル信号
ＶＥＮを、画素密度を減少させる割合に応じて画素密度
変換制御回路Ｃによりまびいて符号化回路りに入力する
ことにより、同一の画像データて画素密度をおいた圧縮
コードに符号化したデータを得るものである。
次に、１例とし−Ｃ−Ｌ：」−（２＜、 ｎ ＜： ］
６ ） ＋７） 画素密度の変換か可能な画素密度変
換制御回路の具体的な回路である第２図と画素密度を１
におとす動作のタイミンクヂャ−１・である第３図を用
いてＣＬ ＫとＣＬＫＥ、ＶＥＮとＶＥＮＥの関係を詳
細に示す。
６ ） ＋７） 画素密度の変換か可能な画素密度変
換制御回路の具体的な回路である第２図と画素密度を１
におとす動作のタイミンクヂャ−１・である第３図を用
いてＣＬ ＫとＣＬＫＥ、ＶＥＮとＶＥＮＥの関係を詳
細に示す。
ま１−１画素密度を辷土におとす場合を考える℃
ど制御部よりＤ７〜Ｄｏ、ＷＰの信号を用いてレジスタ
２１．２２に対してでの２の補数か記憶される。ここて
ρ−３とすると３の２の補数であるＤか記憶される。カ
ウンタ（例えは米フェアヂャイル］・社製ＦＩ６３）２
３．２４は、第３図のようにＬＤ、ＣＬＫ入力に従いカ
ラン１〜動作を続りる。
２１．２２に対してでの２の補数か記憶される。ここて
ρ−３とすると３の２の補数であるＤか記憶される。カ
ウンタ（例えは米フェアヂャイル］・社製ＦＩ６３）２
３．２４は、第３図のようにＬＤ、ＣＬＫ入力に従いカ
ラン１〜動作を続りる。
さて、ここで、主走査方向を考えるとＶＥＮ信号かＨｉ
ｇ ｈ （ＤときＣＬＫＥ信号はＣＬＫ信号に対して
エツジの数が１になっているので、ＣＬ Ｋ Ｅ （ｍ
号か画像同期クロック信号どして入力される符号回路り
はＶＩＤＥＯ２信号を画素数で考えるど丁たけ符−量化
することになり、画素密度をおとずことかてぎる。同様
にして副走査方向もＶＥＮＥ信−号かＶＥＮ信号に比へ
てモたけになっているのて、ＶＥＮＥ信号に従って１ラ
インの符号化を実行する符号回路りは画像データのライ
ン数も丁たけおとして７〕号化することになり、副走査
方向にも画素密度をおとすことかできる。
ｇ ｈ （ＤときＣＬＫＥ信号はＣＬＫ信号に対して
エツジの数が１になっているので、ＣＬ Ｋ Ｅ （ｍ
号か画像同期クロック信号どして入力される符号回路り
はＶＩＤＥＯ２信号を画素数で考えるど丁たけ符−量化
することになり、画素密度をおとずことかてぎる。同様
にして副走査方向もＶＥＮＥ信−号かＶＥＮ信号に比へ
てモたけになっているのて、ＶＥＮＥ信号に従って１ラ
インの符号化を実行する符号回路りは画像データのライ
ン数も丁たけおとして７〕号化することになり、副走査
方向にも画素密度をおとすことかできる。
実施例では−７−（２≦ｘ ≦１６ ）の画素密度変換
か可能な回路を示したがカウンタを複数個つけることに
より１二Ｉｎ−２ｎ二３−−−−−の住居、の画素密度
変換か可能である。
か可能な回路を示したがカウンタを複数個つけることに
より１二Ｉｎ−２ｎ二３−−−−−の住居、の画素密度
変換か可能である。
この様に、画素密度の変換割合に応した値をカウンタ２
＋、２２にセットすることにより、任意の画素密度変換
かハードウェア構成により高速に実行ｉｉＪ能と１．ｆ
る。
＋、２２にセットすることにより、任意の画素密度変換
かハードウェア構成により高速に実行ｉｉＪ能と１．ｆ
る。
以上説明した様に、本発明によると圧縮処理されている
画像データの画素密度変換を高速に実行可能となる。
画像データの画素密度変換を高速に実行可能となる。
４ 図面の１１１１隼な説明
第１図は本発明を適用した画像処理装置のブロック図、
第２図は第１図示の画素密度変換制御回路の具体的な回
路図、 第３図は「に画素密度を変換する場合のタイミングチャ
ー１−図である。
路図、 第３図は「に画素密度を変換する場合のタイミングチャ
ー１−図である。
Ｂは復号回路、Ｃは画素密度変換制御回路、Ｄは符号回
路、Ｆは制御部である。
路、Ｆは制御部である。
Claims (1)
- 圧縮コードを復号化する復号手段と、画像データを符号
化する圧縮手段と、上記復号手段と圧縮手段の動作を制
御する制御手段とを有し、上記制御手段は画像同期クロ
ックと上記復号手段より出力される１ラインの画像デー
タが有効な範囲を示すラインイネーブル信号を画素密度
を減少させる割合に応じてまびいて、上記圧縮手段に入
力することにより同一の画像データで画素密度を変換す
ることを特徴とする画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62054827A JPS63220667A (ja) | 1987-03-10 | 1987-03-10 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62054827A JPS63220667A (ja) | 1987-03-10 | 1987-03-10 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63220667A true JPS63220667A (ja) | 1988-09-13 |
Family
ID=12981502
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62054827A Pending JPS63220667A (ja) | 1987-03-10 | 1987-03-10 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63220667A (ja) |
-
1987
- 1987-03-10 JP JP62054827A patent/JPS63220667A/ja active Pending
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