JPS6326883B2 - - Google Patents
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- JPS6326883B2 JPS6326883B2 JP4699281A JP4699281A JPS6326883B2 JP S6326883 B2 JPS6326883 B2 JP S6326883B2 JP 4699281 A JP4699281 A JP 4699281A JP 4699281 A JP4699281 A JP 4699281A JP S6326883 B2 JPS6326883 B2 JP S6326883B2
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- input terminal
- signal
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- flag
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B11/00—Automatic controllers
- G05B11/01—Automatic controllers electric
- G05B11/36—Automatic controllers electric with provision for obtaining particular characteristics, e.g. proportional, integral, differential
- G05B11/42—Automatic controllers electric with provision for obtaining particular characteristics, e.g. proportional, integral, differential for obtaining a characteristic which is both proportional and time-dependent, e.g. P. I., P. I. D.
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Feedback Control In General (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はプログラムにより位置形PID(比例・
積分・微分)演算出力を出力するプロセス調節計
に関するもので、さらに詳しくいえば、マイクロ
プロセツサを含んで構成され、プロセス変数信号
をサンプリングしてデイジタル量に変換し、その
デイジタル信号にP、I、D演算の1つないし全
部の演算処理を施した後、演算結果を操作機器に
与えてプロセスを制御するためのプロセス調節計
に関するものである。[Detailed Description of the Invention] [Industrial Application Field] The present invention provides positional PID (proportional and
This relates to a process controller that outputs calculation output (integral/differentiation).More specifically, it is configured to include a microprocessor, samples a process variable signal, converts it into a digital quantity, and adds P, I to the digital signal. This invention relates to a process controller for controlling a process by performing one or all of the arithmetic operations, .
従来のアナログ機器における計装では、ある一
定時間コントロールを行い、次に続くある一定時
間コントロール出力を保持し、これを1サイクル
として繰り返す制御である間欠形コントローラを
構成するには、それ用の調節計を準備しなければ
ならなかつた。また、調節計2台を用いてそのコ
ントロール出力の大きい方、または小さい方を選
択して出力する選択制御であるオーバーライド・
コントローラを構成するには、2台以上の調節計
と選択器(セレクタ)を準備し、さらにその調節
計とはその選択後の出力を外部帰還できる形のも
のでなければならなかつた。
In the instrumentation of conventional analog devices, in order to configure an intermittent controller, which performs control for a certain period of time, holds the control output for the next certain period of time, and repeats this as one cycle, it is necessary to make adjustments for it. I had to prepare a meter. In addition, override control is a selection control that uses two controllers to select and output the larger or smaller control output.
To configure a controller, two or more controllers and selectors must be prepared, and the controllers must be of a type that can feed back the selected output to the outside.
つまり、アナログ機器については上記間欠形と
オーバーライドの2種のコントローラを実現する
には、それ専用の機器を用意する必要があつた。
したがつて、構成が複雑になり経済的でないとい
う欠点があつた。
In other words, in order to realize the two types of controllers, intermittent type and override type, for analog equipment, it was necessary to prepare dedicated equipment.
Therefore, the structure is complicated and uneconomical.
これに対し、最近は計算機、特にマイクロ・コ
ンピユータを利用することにより、上述のアナロ
グ機器によるよりも、容易に、多種のコントロー
ラが形成されるようになつている。 In contrast, recently, by using computers, especially microcomputers, it has become easier to form various types of controllers than by using the above-mentioned analog devices.
しかし、それは通常のPID(比例−積分−微分)
演算式、サンプル(間欠形)PID演算式などがソ
フトウエアパツケージとして別々に用意されるも
のであり、したがつて、各場合に対応しようとす
る必要なメモリが膨大なものになるという欠点を
有している。 But it is normal PID (proportional-integral-derivative)
Arithmetic expressions, sample (intermittent type) PID arithmetic expressions, etc. are prepared separately as software packages, which has the disadvantage of requiring a huge amount of memory to accommodate each case. are doing.
本発明のプロセス調節計は、ROMに格納され
た演算プログラムにしたがい組立てられる演算パ
ツケージに、リモートの目標値が与えられる第1
の入力端子、プロセス変数信号が与えられる第2
の入力端子、操作機器に与えられている位置形制
御信号が与えられる第3の入力端子およびフラグ
形信号が与えられる第4の入力端子を設け、第4
の入力端子にフラグ形信号“オン”が与えられた
場合は、目標値とプロセス変数信号との偏差に対
して速度形比例および積分演算を行い、この演算
値に位置形制御信号を加算して今回の位置形制御
信号として出力するとともに、フラグ形信号“オ
フ”が与えられた場合は、前記偏差に対して速度
形比例・積分・微分演算を行い、この演算値に自
己の前回内部位置形制御出力値を加算して今回の
位置形制御信号として出力するようにしたもので
ある。
In the process controller of the present invention, a remote target value is given to a calculation package that is assembled according to a calculation program stored in a ROM.
the second input terminal to which the process variable signal is applied
a third input terminal to which a position type control signal applied to the operating device is applied, and a fourth input terminal to which a flag type signal is applied;
When the flag type signal "ON" is given to the input terminal of In addition to outputting the current position type control signal, if a flag type signal "off" is given, velocity type proportional, integral, and differential calculations are performed on the deviation, and this calculated value is used as the previous internal position type. The control output values are added together and output as the current position type control signal.
フラグ形信号“オフ”で通常の比例・積分・微
分演算を行う演算パツケージであるものが、フラ
グ形信号を“オン”とするのみで、間欠形コント
ローラあるいはオーバーライドコントローラとし
て必要な動作、つまり微分演算を消去しかつ外部
から前回の位置形制御出力値を取込んで、その値
に今回の速度形比例および積分演算値を付加して
出力する動作に自動的に移行する。
An arithmetic package that performs normal proportional, integral, and differential calculations when the flag signal is "off" can perform the necessary operations as an intermittent controller or override controller, that is, differential calculations, by simply turning the flag signal "on." , the previous position type control output value is taken in from the outside, the current speed type proportional and integral calculation values are added to that value, and the operation automatically shifts to outputting the added value.
第1図は本発明の一実施例を示すブロツク図で
ある。
FIG. 1 is a block diagram showing one embodiment of the present invention.
図において、PIDは比例・積分・微分の全部の
演算処理を施す装置で、1個の出力端子OUTと、
第1〜第4の入力端子H1,H2,P1,P2とを有す
るPID演算パツケージで構成され、このPID演算
パツケージはROMに格納された演算プログラム
にしたがい組立てられる。出力端子OUTは位置
形の制御信号を送出し、第1の入力端子H1には
リモートの目標値が与えられる。第2の入力端子
H2にはプロセス変数信号が与えられ、第3の入
力端子P1には操作機器に与えられている位置形
制御信号が与えられ、第4の入力端子P2にはフ
ラグ形信号が与えられる。RSPは第1の入力端
子H1に与えられる外部からの設定値、PVは第2
の入力端子H2に与えられるプロセス変数、LSP
はローカルに変更可能な設定値、CNは出力端子
OUTに得られるコントロール出力(位置形コン
トロール出力)、FLAGは第4の入力端子P2に与
えられるフラグ形信号である。なお、COは内部
前回の位置形出力値(前回内部位置形制御出力
値)を示す。 In the figure, PID is a device that performs all calculation processing of proportional, integral, and differential, and has one output terminal OUT,
It is composed of a PID calculation package having first to fourth input terminals H 1 , H 2 , P 1 , and P 2 , and this PID calculation package is assembled according to a calculation program stored in a ROM. The output terminal OUT delivers a position-type control signal, and the first input terminal H1 is provided with a remote setpoint value. Second input terminal
H 2 is supplied with a process variable signal, the third input terminal P 1 is supplied with a position-type control signal applied to the operating device, and the fourth input terminal P 2 is supplied with a flag-type signal. . RSP is the external setting value given to the first input terminal H1 , and PV is the second
The process variable, LSP, given to the input terminal H 2 of
is a locally changeable setting value, CN is an output terminal
The control output (position type control output) obtained at OUT, FLAG, is a flag type signal applied to the fourth input terminal P2 . Note that CO indicates the previous internal position type output value (previous internal position type control output value).
同図は、第4の入力端子P2にフラグ形信号
FLAG“オフ”が与えられているときの状態を示
しており、この場合、設定値SPとプロセス変数
PVの差出力(制御偏差)ENに対して速度形比
例(P)・積分(I)・微分(D)演算行い、この演算
値△CNに自己の前回内部位置形制御出力値COを
加算して今回の位置形の制御信号CNを出力端子
OUTに出力する。なお、図において、CN1はコ
ントロール出力変化分△CNに加算される内部前
回の位置形出力値(前回内部位置形制御出力値)
COに対応する内部前回値である。 The figure shows a flag type signal at the fourth input terminal P2 .
It shows the state when FLAG “off” is given, and in this case, the set value SP and the process variable
Perform velocity type proportional (P), integral (I), and differential (D) calculations on the PV difference output (control deviation) EN, and add the previous internal position type control output value CO to this calculated value △CN. outputs the control signal CN for the current position type.
Output to OUT. In the figure, CN 1 is the previous internal position type output value (previous internal position type control output value) that is added to the control output change △CN.
This is the internal previous value corresponding to CO.
これに対し、第4の入力端子P2にフラグ形信
号FLAG“オン”が与えられた場合は、前述の偏
差に対して速度形比例(P)および積分(I)演
算を行い、この演算値△CNに第3の入力端子P1
に与えられる位置形制御信号CN1を加算して今回
の位置形の制御信号CNを出力端子OUTに出力す
る。この場合の状態を第2図に示す。 On the other hand, when the flag type signal FLAG "ON" is applied to the fourth input terminal P2 , velocity type proportional (P) and integral (I) calculations are performed on the above-mentioned deviation, and the calculated value is △CN to third input terminal P 1
The position type control signal CN 1 given to is added to output the current position type control signal CN to the output terminal OUT. The state in this case is shown in FIG.
第2図において、PIは設定値SPとプロセス変
数PVの差出力(制御偏差)ENを入力とし、所
定の比例・積分演算を施す比例・積分ブロツク
で、その出力にはコントロール出力変化分△CN
が得られる。そして、このコントロール出力変化
分△CNに、CN1′、すなわち第3の入力端子P1か
らの位置形制御信号CN1のみを加算した出力が、
出力端子OUTに位置形の制御信号としてコント
ロール出力CN(位置形コントロール出力)が得
られる。 In Figure 2, PI is a proportional/integral block that takes the difference output (control deviation) EN between the set value SP and the process variable PV as input and performs predetermined proportional/integral calculations, and its output is the control output change △CN.
is obtained. Then, the output obtained by adding only CN 1 ′, that is, the position type control signal CN 1 from the third input terminal P 1 to this control output change ΔCN is,
Control output CN (positional control output) is obtained as a positional control signal at the output terminal OUT.
このような構成は、実際には第3図のフローチ
ヤートに示したような演算プログラムによつて実
現される。 Such a configuration is actually realized by an arithmetic program as shown in the flowchart of FIG.
第3図において、制御モードがカスケード
()モードであるか否かによつて(ステツプ
101)、自動()モードか手動()モードであ
る場合には、内部のローカルの目標値LSPと第2
の入力端子H2に与えられるプロセス変数信号PV
との偏差を(ステツプ102)、カスケードモードで
ある場合には第1の入力端子H1に与えられるリ
モートの目標値RSPとプロセス変数信号PVとの
偏差を(ステツプ103)それぞれ制御偏差ENと
して求める。次に、端子P2に入力するフラグ形
信号がオンであるかオフであるかによつて(ステ
ツプ104)、オフであればP・I・D演算を実行し
て△CNを求めた後、CN′=内部前回値としてCN
を求め(ステツプ105、106)、オンであればD演
算ブロツクをジヤンプし、P・I演算ブロツクの
みの実行により△CNを求めた後、端子P1のCN1
をCN′1としてCNを求める(ステツプ107、108)。 In Fig. 3, depending on whether the control mode is the cascade () mode or not (step
101), the internal local target value LSP and the second
The process variable signal PV applied to the input terminal H2 of
(Step 102), and in the case of cascade mode, the deviation between the remote target value RSP given to the first input terminal H1 and the process variable signal PV (Step 103) is determined as the control deviation EN. . Next, depending on whether the flag type signal input to terminal P2 is on or off (step 104), if it is off, P-I-D calculation is executed to obtain △CN. CN′ = CN as internal previous value
(Steps 105 and 106), and if it is on, jump the D operation block and execute only the P and I operation blocks to find △CN, and then set CN1 of terminal P1 .
Find CN with CN'1 as CN′ 1 (steps 107 and 108).
したがつて本実施例のプロセス調節計は、通常
のコントローラとして使用する場合には、フラグ
形入力信号をオフしておけばよい。 Therefore, when the process controller of this embodiment is used as a normal controller, it is sufficient to turn off the flag type input signal.
これに対し、前回値出力を外部から取込みたい
ときには、第4の入力端子P2に与えられる形信
号FLAGをオンとすれば、自動的に微分D動作は
消去され、その外部入力に今回の演算(速度形)
コントロール出力変化分△CNを付加して出力す
るため、間欠形コントローラおよびオーバーライ
ド・コントローラとしての使用が可能となる。 On the other hand, when you want to take in the previous value output from the outside, if you turn on the shape signal FLAG applied to the fourth input terminal P 2 , the differential D operation is automatically canceled and the current calculation is applied to the external input. (speed type)
Since the control output change amount ΔCN is added and output, it can be used as an intermittent controller and an override controller.
第4図は本発明を間欠形コントローラに適用し
た場合の実施例を示すブロツク図である。第4図
において第1図および第2図と同一符号のものは
相当部分を示し、SHはPID演算パツケージPID
の出力を図示の如きタイミングパルスTPによつ
てサンプリングした後ホールドするサンプリング
ホールド回路である。 FIG. 4 is a block diagram showing an embodiment in which the present invention is applied to an intermittent controller. In Figure 4, the same symbols as in Figures 1 and 2 indicate corresponding parts, and SH is the PID calculation package PID.
This is a sampling and holding circuit that samples the output of the output signal using a timing pulse TP as shown in the figure and then holds the output.
このように構成されたプロセス調節計におい
て、PID演算パツケージPIDは第1の入力端子H1
に与えられる設定値SPと第2の入力端子H2に与
えられるプロセス変数PVとを入力し、また、第
3の入力端子P1に与えられる外部よりの前回の
出力値CN1と第4の入力端子P2に与えられるフラ
ツグ形信号FLAG(オン)とを入力とし、所定の
PID(比例・積分・微分)演算を施した後、その
出力はサンプリングホールド回路SHによつて図
示の如きタイミングパルスTPによりサンプリン
グされた後ホールドされる。そして、このサンプ
リングホールド回路S/Hの出力は自動モードA
と手動モードMのモード切換スイツチによつて切
換えられ、出力端子OUTには所要の位置形の制
御信号が得られる。これと同時にモード切換スイ
ツチの出力は前回の出力値CN1として第3の入力
端子P1に与えられる。 In the process controller configured in this way, the PID calculation package PID is connected to the first input terminal H 1
Input the set value SP given to the input terminal H2 and the process variable PV given to the second input terminal H2 , and also input the previous output value CN1 given from the outside to the third input terminal P1 and the fourth output value CN1 given to the third input terminal P1. The flag type signal FLAG (on) given to input terminal P2 is input, and the specified
After PID (proportional, integral, differential) calculation is performed, the output is sampled by a timing pulse TP as shown in the figure and held by a sampling and holding circuit SH. The output of this sampling hold circuit S/H is automatic mode A.
and manual mode M by the mode changeover switch, and a desired position type control signal is obtained at the output terminal OUT. At the same time, the output of the mode changeover switch is applied to the third input terminal P1 as the previous output value CN1 .
第5図は本発明をオーバーライド・コントロー
ラに適用した場合の実施例を示すブロツク図であ
る。第5図において第4図と同一符号のものは相
当部分を示し、PID1は第1の入力端子H1に与え
られる設定値SP1と第2の入力端子H2に与えられ
るプロセス変数PV1とを入力とし、また、第3の
入力端子P1に与えられる外部よりの前回の出力
値CN1と第4の入力端子P2に与えられるフラグ形
信号FLAG(オン)とを入力とし、所定のPID(比
例・積分・微分)演算を施す第1のPID演算パツ
ケージ、PID2は第1の入力端子H1に与えられる
設定値SP2と第2の入力端子H2に与えられるプロ
セス変数PV2とを入力とし、また、第3の入力端
子P1に与えられる外部よりの前回の出力値CN1と
第4の入力端子P2に与えられるフラグ形信号
FLAG(オン)とを入力とし、所定のPID(比例・
積分・微分)演算を施す第2のPID演算パツケー
ジ、SELは第1のPID演算パツケージPID1の出力
と第2のPID演算パツケージPID2の出力を入力
とし、その出力の大きい方を選択するハイセレク
タである。 FIG. 5 is a block diagram showing an embodiment in which the present invention is applied to an override controller. In FIG. 5, the same numbers as in FIG. 4 indicate corresponding parts, and PID 1 is the set value SP 1 given to the first input terminal H 1 and the process variable PV 1 given to the second input terminal H 2 . In addition, the previous output value CN 1 from the outside applied to the third input terminal P 1 and the flag type signal FLAG (ON) applied to the fourth input terminal P 2 are input. The first PID calculation package performs PID (proportional, integral, differential) calculations, PID 2 is the set value SP 2 given to the first input terminal H 1 and the process variable PV given to the second input terminal H 2 . 2 is input, and the previous output value CN 1 from the outside is applied to the third input terminal P 1 and a flag type signal is applied to the fourth input terminal P 2 .
FLAG (on) is input, and the specified PID (proportional/
The second PID calculation package, SEL, which performs integral/differential calculations, receives the output of the first PID calculation package PID 1 and the output of the second PID calculation package PID 2 , and selects the larger output. It is a selector.
このようにPID演算パツケージPID1,PID2の
2台を用いて、ハイセレクタSELによりそのコン
トロール出力の大きい方を選択して出力するよう
に構成されている。なお、この第5図に示す実施
例においては、ハイセレクタSELを用い、コント
ロール出力の大きい方を選択して出力する場合を
例にとつて説明したが、本発明はこれに限定され
るものではなく、ローセレクタを用い、コントロ
ール出力の小さい方を選択して出力することがで
きることは勿論である。 In this way, two PID calculation packages PID 1 and PID 2 are used, and the high selector SEL selects and outputs the larger control output. In the embodiment shown in FIG. 5, the case where the high selector SEL is used to select and output the larger control output has been described as an example, but the present invention is not limited to this. Of course, it is possible to use a low selector to select and output the smaller control output.
以上説明したように、本発明によれば、マイク
ロプロセツサを含んで構成され、プロセス変数信
号をサンプリングしてデイジタル量に変換し、そ
のデイジタル信号に比例・積分・微分演算の1つ
ないし全部の演算処理を施す装置が、フラグ形信
号の有無に応じて簡単に間欠形コントローラおよ
びオーバーライド・コントローラとして動作させ
得るので、取扱いが容易となり、また、プロセス
調節計内に特別なコントローラ演算手段を用いる
ことなく、ソフトウエアパツケージが増えないの
でコスト安であり経済的に有効である。さらに、
フラグ形信号のオンのときは自動的(強制的)に
D(微分)−OFF(消去)するので、コントロール
ミスがなくなり、安全性を向上することができる
と共に、使い方によつてはフラグ形信号が与えら
れる第4の入力端子に外部接点を接続するだけ
で、簡単にPID/PIコントローラの切換が瞬時に
できるので、実用上の効果は極めて大である。
As explained above, according to the present invention, the processor is configured to include a microprocessor, samples a process variable signal, converts it into a digital quantity, and performs one or all of proportional, integral, and differential operations on the digital signal. The device that performs calculation processing can be easily operated as an intermittent controller or an override controller depending on the presence or absence of a flag signal, making it easy to handle and requiring special controller calculation means within the process controller. Since the number of software packages does not increase, the cost is low and it is economically effective. moreover,
When the flag type signal is on, it is automatically (forced) D (differential) - OFF (erased), which eliminates control errors and improves safety. Depending on how it is used, the flag type signal By simply connecting an external contact to the fourth input terminal, which is fed with , the PID/PI controller can be switched easily and instantaneously, so the practical effect is extremely large.
また、本発明によれば、プログラムメモリの増
大を極力少なくすることができると共に間欠形、
オーバーライド調節計としての使用が容易にでき
るという点においても極めて有効である。 Further, according to the present invention, it is possible to minimize the increase in program memory, and also to
It is also extremely effective in that it can be easily used as an override controller.
第1図および第2図は本発明の一実施例を示す
ブロツク図、第3図はその動作を説明するための
フローチヤート、第4図は本発明を間欠形コント
ローラに適用した場合の実施例を示すブロツク
図、第5図は本発明をオーバーライド・コントロ
ーラに適用した場合の実施例を示すブロツク図で
ある。
H1……第1の入力端子、H2……第2の入力端
子、P1……第3の入力端子、P2……第4の入力
端、OUT……出力端子、PI……比例・積分ブロ
ツク、PID……比例・積算・微分演算パツケー
ジ、RSP……外部からの目標値、LSP……ロー
カルに変更可能な目標値、SP……設定値、PV…
…プロセス変数、CN……コントロール出力(位
置形コントロール出力)、△CN……コントロー
ル出力変化分(速度形コントロール出力)、CN1
……コントロール出力前回値(位置形コントロー
ル出力)。
1 and 2 are block diagrams showing one embodiment of the present invention, FIG. 3 is a flowchart for explaining its operation, and FIG. 4 is an embodiment in which the present invention is applied to an intermittent controller. FIG. 5 is a block diagram showing an embodiment in which the present invention is applied to an override controller. H 1 ...First input terminal, H2 ...Second input terminal, P1...Third input terminal, P2 ...Fourth input terminal, OUT ...Output terminal, PI...Proportional・Integral block, PID...Proportional/integration/differential calculation package, RSP...External target value, LSP...Target value that can be changed locally, SP...Set value, PV...
...Process variable, CN...Control output (position type control output), △CN...Control output change (velocity type control output), CN 1
...Previous control output value (position type control output).
Claims (1)
ス変数信号をサンプリングしてデイジタル量に変
換し、そのデイジタル信号に比例・積分・微分演
算の1つないし全部の演算処理を施した後、演算
結果を操作機器に与えてプロセスを制御するため
のプロセス調節計において、前記演算処理を施す
装置は、位置形の制御信号を送出する1個の出力
端子と、リモートの目標値が与えられる第1の入
力端子と、プロセス変数信号が与えられる第2の
入力端子と、前記操作機器に与えられている位置
形制御信号が与えられる第3の入力端子と、フラ
グ形信号が与えられる第4の入力端子とを有する
比例・積分・微分演算パツケージで構成され、こ
の演算パツケージはROMに格納された演算プロ
グラムにしたがい組立てられると共に、前記第4
の入力端子にフラグ形信号“オン”が与えられた
場合は、前記第1の入力端子からのリモートの目
標値または内部のローカルの目標値と第2の入力
信号に与えられるプロセス変数信号との偏差に対
して速度形比例および積分演算を行い、この演算
値に前記第3の入力端子に与えられる位置形制御
信号を加算して今回の位置形の制御信号を前記の
出力端子に出力するように組立てられ、かつ前記
第4の入力端子にフラグ形信号“オフ”が与えら
れた場合には、前記偏差に対して速度形比例・積
分・微分演算を行い、この演算値に自己の前回内
部位置形制御出力値を加算して今回の位置形の制
御信号を前記の出力端子に出力するように組立て
られることを特徴とするプロセス調節計。1 Consists of a microprocessor that samples the process variable signal, converts it into a digital quantity, performs one or all of proportional, integral, and differential calculations on the digital signal, and then transmits the calculation result to the operating device. In a process controller for controlling a process by giving a signal to , has a second input terminal to which a process variable signal is applied, a third input terminal to which a position type control signal applied to the operating device is applied, and a fourth input terminal to which a flag type signal is applied. It is composed of a proportional, integral, and differential calculation package, and this calculation package is assembled according to the calculation program stored in the ROM.
If a flag-shaped signal “on” is applied to the input terminal of the input terminal, the remote target value or the internal local target value from the first input terminal and the process variable signal applied to the second input signal are Velocity-type proportional and integral calculations are performed on the deviation, a position-type control signal given to the third input terminal is added to this calculated value, and the current position-type control signal is output to the output terminal. When the fourth input terminal is assembled with a flag-type signal "off", speed-type proportional, integral, and differential calculations are performed on the deviation, and this calculation value is applied to the previous internal A process controller characterized in that it is assembled to add position type control output values and output a current position type control signal to the output terminal.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4699281A JPS57161902A (en) | 1981-03-30 | 1981-03-30 | Process controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4699281A JPS57161902A (en) | 1981-03-30 | 1981-03-30 | Process controller |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57161902A JPS57161902A (en) | 1982-10-05 |
| JPS6326883B2 true JPS6326883B2 (en) | 1988-06-01 |
Family
ID=12762687
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4699281A Granted JPS57161902A (en) | 1981-03-30 | 1981-03-30 | Process controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57161902A (en) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6189902U (en) * | 1984-11-16 | 1986-06-11 | ||
| JPS6345602A (en) * | 1986-08-12 | 1988-02-26 | Fujitsu Ten Ltd | Electronic engine controller |
-
1981
- 1981-03-30 JP JP4699281A patent/JPS57161902A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57161902A (en) | 1982-10-05 |
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