JPS6335140U - - Google Patents
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- Publication number
- JPS6335140U JPS6335140U JP11313187U JP11313187U JPS6335140U JP S6335140 U JPS6335140 U JP S6335140U JP 11313187 U JP11313187 U JP 11313187U JP 11313187 U JP11313187 U JP 11313187U JP S6335140 U JPS6335140 U JP S6335140U
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- JP
- Japan
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- Pending
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Description
図は本考案による擬似乱数発生装置の一実施例
構成を示す。 図中、１はＴＯＤタイマ、２はパラメータ・レ
ジスタ、３は乗算器を夫々表す。
構成を示す。 図中、１はＴＯＤタイマ、２はパラメータ・レ
ジスタ、３は乗算器を夫々表す。
Claims (1)
- 【実用新案登録請求の範囲】 ｛Ｘｎ＋１≡ａｘｎ（ｍｏｄ２３１）ｎ＝０
，１，２，…… Ｘ０＝１｝ なる合同式にもとづいて擬似乱数を発生する擬似
乱数発生装置において、最上位ビツト位置および
最下位ビツト位置に予め固定的に与えられたビツ
ト情報“１”を保持すると共に擬似乱数発生モー
ド時に既設のタイム・オブ・デイ・タイマの指示
内容を中間ビツト領域にセツトされて構成される
パラメータａ情報が作成されるパラメータ・レジ
スタをもうけると共に、該パラメータ・レジスタ
からの出力パラメータａ情報とフイード・バツク
された乗算出力情報ｘｎとを乗算処理し擬似乱数
情報Ｘｎ＋１を算出する乗算器をそなえて構成さ
れたことを特徴とする擬似乱数発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11313187U JPS6335140U (ja) | 1987-07-23 | 1987-07-23 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11313187U JPS6335140U (ja) | 1987-07-23 | 1987-07-23 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6335140U true JPS6335140U (ja) | 1988-03-07 |
Family
ID=30994637
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11313187U Pending JPS6335140U (ja) | 1987-07-23 | 1987-07-23 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6335140U (ja) |
-
1987
- 1987-07-23 JP JP11313187U patent/JPS6335140U/ja active Pending