JPS6337410B2 - - Google Patents
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- Publication number
- JPS6337410B2 JPS6337410B2 JP15479178A JP15479178A JPS6337410B2 JP S6337410 B2 JPS6337410 B2 JP S6337410B2 JP 15479178 A JP15479178 A JP 15479178A JP 15479178 A JP15479178 A JP 15479178A JP S6337410 B2 JPS6337410 B2 JP S6337410B2
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- JP
- Japan
- Prior art keywords
- screen
- display information
- display
- memory
- register
- Prior art date
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- Expired
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- Digital Computer Display Output (AREA)
Description
【発明の詳細な説明】
本発明はパターン情報を表示装置に画面表示す
るとともに画面表示とは無関係にかつ効率的に画
面を印刷する表示画面プリンタ制御方式に関する
ものである。
るとともに画面表示とは無関係にかつ効率的に画
面を印刷する表示画面プリンタ制御方式に関する
ものである。
従来、走査方式の表示装置はたとえば第１図に
示すように、表示情報を表示制御部１のパターン
メモリ２に画面と対応させて一旦格納しておき、
これを水平、垂直の走査信号にのせて陰極線管
（CRT）３に画面表示する。この場合、同時にメ
モリ情報をプリンタ４に送り表示画面を用紙上に
印刷することが行なわれている。このプリンタ４
はハードコピーと称し、第２図ａは印字部、同図
ｂはその制御部の１例を示す。このプリンタはピ
ン電極と対向電極を用いた静電記録方式のプリン
タである。すなわち同図ａに示すように、印字媒
体１０として静電記録紙が用いられ、この下面に
接して印字部１１と現像部１２が配置され、印字
媒体１０が同図ｂに示すパルスモータ（PM）２
５により駆動される。印字部１１の上面にはピン
電極１３と補助電極１３′の対より成るいわゆる
マルチスタイラス電極がたとえば１行1024ビツト
に対応して設けられ、パルスモータ（PM）２５
により送られる用紙の各行の画像に対応するアド
レスビツトの電極間に電圧が印加され、用紙上に
ドツトの潜像が形成される。これが現像部１２に
送られトナーを付着し画像が現出される。
示すように、表示情報を表示制御部１のパターン
メモリ２に画面と対応させて一旦格納しておき、
これを水平、垂直の走査信号にのせて陰極線管
（CRT）３に画面表示する。この場合、同時にメ
モリ情報をプリンタ４に送り表示画面を用紙上に
印刷することが行なわれている。このプリンタ４
はハードコピーと称し、第２図ａは印字部、同図
ｂはその制御部の１例を示す。このプリンタはピ
ン電極と対向電極を用いた静電記録方式のプリン
タである。すなわち同図ａに示すように、印字媒
体１０として静電記録紙が用いられ、この下面に
接して印字部１１と現像部１２が配置され、印字
媒体１０が同図ｂに示すパルスモータ（PM）２
５により駆動される。印字部１１の上面にはピン
電極１３と補助電極１３′の対より成るいわゆる
マルチスタイラス電極がたとえば１行1024ビツト
に対応して設けられ、パルスモータ（PM）２５
により送られる用紙の各行の画像に対応するアド
レスビツトの電極間に電圧が印加され、用紙上に
ドツトの潜像が形成される。これが現像部１２に
送られトナーを付着し画像が現出される。
同図面ｂの制御部２０では、パターンメモリ２
からのメモリ情報が制御回路２１に与えられ、記
録用マトリツクス２２，２２′によりそれぞれピ
ン電極１３、補助電極１３′のアドレスが読み出
されて駆動回路２３，２３′に入力され、このア
ドレスに対し電源２４よりピン電極１３には−
300V、補助電極１３′には＋300Vが駆動回路２
３，２３′を通して印加される。印字媒体１０の
タイミング制御はパルスモータ（PM）２５によ
り制御回路２１の制御を受け電源２４の電圧印加
と関連して行なわれる。
からのメモリ情報が制御回路２１に与えられ、記
録用マトリツクス２２，２２′によりそれぞれピ
ン電極１３、補助電極１３′のアドレスが読み出
されて駆動回路２３，２３′に入力され、このア
ドレスに対し電源２４よりピン電極１３には−
300V、補助電極１３′には＋300Vが駆動回路２
３，２３′を通して印加される。印字媒体１０の
タイミング制御はパルスモータ（PM）２５によ
り制御回路２１の制御を受け電源２４の電圧印加
と関連して行なわれる。
以上の用法における問題点としては、パターン
メモリ２の情報がCRT３とハードコピー４に同
時並列にアクセスできれば迅速な処理が行なわれ
効率的である。しかし、負荷の性質上CRT３は
電子管であるのに対し、ハードコピー４は印字媒
体を介在させた静電記録装置であるからそのアク
セスタイムの差が大きく、これらの並例処理は不
可能である。そこでCRT３の画面表示のアクセ
スに対しハードコピー４の印刷のアクセスを割込
ませることが考えられるが、この場合にはCRT
３の画面に間欠的にビツト抜けが起り、しかもこ
の抜け時間がかなり長い時にはチラツキが生じ見
にくい。このため、従来は表示制御部１で制御す
ることにより、CRT３の画面表示とハードコピ
ー４の印刷を別々に動作させているが、これでは
効率が悪いことは明らかである。
メモリ２の情報がCRT３とハードコピー４に同
時並列にアクセスできれば迅速な処理が行なわれ
効率的である。しかし、負荷の性質上CRT３は
電子管であるのに対し、ハードコピー４は印字媒
体を介在させた静電記録装置であるからそのアク
セスタイムの差が大きく、これらの並例処理は不
可能である。そこでCRT３の画面表示のアクセ
スに対しハードコピー４の印刷のアクセスを割込
ませることが考えられるが、この場合にはCRT
３の画面に間欠的にビツト抜けが起り、しかもこ
の抜け時間がかなり長い時にはチラツキが生じ見
にくい。このため、従来は表示制御部１で制御す
ることにより、CRT３の画面表示とハードコピ
ー４の印刷を別々に動作させているが、これでは
効率が悪いことは明らかである。
本発明の目的は表示装置の表示画面をプリンタ
に出力する時画面表示とは無関係にかつ効率的に
画面を印刷する表示画面プリンタ制御方式を提供
することである。
に出力する時画面表示とは無関係にかつ効率的に
画面を印刷する表示画面プリンタ制御方式を提供
することである。
前記目的を達成するため、本発明の表示画面プ
リンタ制御方式は一画面分の表示情報を記憶する
画面メモリと、その表示情報を読出すために画面
メモリにアドレスを与えるアドレスカウンタと、 水平帰線消去信号と垂直帰線消去信号との論理
和とメモリ読出し信号との論理積をとり、該論理
積出力を前記画面メモリと前記アドレスカウンタ
へ供給する手段と、 画面メモリから読出された一走査線に相当する
表示情報を記憶するレジスタと、 このレジスタに記憶された表示情報を印刷する
ハードコピー装置とを具え、 前記アドレスカウンタはいずれか一方の帰線消
去信号が入力している間、画面メモリに対して、
表示のための読出し順序と同じ順序で、前回の帰
線消去信号中に読出して前記レジスタに記憶され
ている表示情報の次の表示情報を読出すようにア
ドレスを歩進するとともに、 ハードコピー装置は前記レジスタに一走査線分
の表示情報が格納された時点で印刷を開始するこ
とを特徴とするものである。
リンタ制御方式は一画面分の表示情報を記憶する
画面メモリと、その表示情報を読出すために画面
メモリにアドレスを与えるアドレスカウンタと、 水平帰線消去信号と垂直帰線消去信号との論理
和とメモリ読出し信号との論理積をとり、該論理
積出力を前記画面メモリと前記アドレスカウンタ
へ供給する手段と、 画面メモリから読出された一走査線に相当する
表示情報を記憶するレジスタと、 このレジスタに記憶された表示情報を印刷する
ハードコピー装置とを具え、 前記アドレスカウンタはいずれか一方の帰線消
去信号が入力している間、画面メモリに対して、
表示のための読出し順序と同じ順序で、前回の帰
線消去信号中に読出して前記レジスタに記憶され
ている表示情報の次の表示情報を読出すようにア
ドレスを歩進するとともに、 ハードコピー装置は前記レジスタに一走査線分
の表示情報が格納された時点で印刷を開始するこ
とを特徴とするものである。
以下本発明の原理と実施例につき詳述する。
第３図は本発明の原理説明図である。
同図は第１図の表示制御部１におけるパターン
メモリ２の走査時間を示す説明図である。水平方
向の1024ビツトを走査する時間は23μs（マイクロ
秒）で、水平帰線消去（HBLK）時間は7μsで、
合計30μsで次のラスタに移行する。垂直方向は
1024ラスタの走査時間と48ラスタの垂直帰線消去
（VBLK）時間すなわち30μs×48＝1.4msをもつ
ている。本発明では、この各ラスタ毎の水平帰線
消去時間7μs×1024と垂直帰線消去時間30μs×48
をメモリ情報のハードコピー４による印刷に使用
するようにしたものである。この印刷はCRT３
への表示とは無関係に行なうものである。これに
より、CRT３への表示とハードコピー４による
印刷とは並列に実施することができるから、効率
的な運用が可能となる。
メモリ２の走査時間を示す説明図である。水平方
向の1024ビツトを走査する時間は23μs（マイクロ
秒）で、水平帰線消去（HBLK）時間は7μsで、
合計30μsで次のラスタに移行する。垂直方向は
1024ラスタの走査時間と48ラスタの垂直帰線消去
（VBLK）時間すなわち30μs×48＝1.4msをもつ
ている。本発明では、この各ラスタ毎の水平帰線
消去時間7μs×1024と垂直帰線消去時間30μs×48
をメモリ情報のハードコピー４による印刷に使用
するようにしたものである。この印刷はCRT３
への表示とは無関係に行なうものである。これに
より、CRT３への表示とハードコピー４による
印刷とは並列に実施することができるから、効率
的な運用が可能となる。
なお、CRT３の画面表示の走査速度とハード
コピー４の印刷速度とは非常に異なるから、ハー
ドコピー４の印刷が終了するまでにはCRT３の
画面表示は繰返し走査が行なわれる。
コピー４の印刷速度とは非常に異なるから、ハー
ドコピー４の印刷が終了するまでにはCRT３の
画面表示は繰返し走査が行なわれる。
第４図は本発明の実施例の構成を示す説明図で
ある。同図において、水平帰線消去（HBLK）
信号と垂直帰線消去（VBLK）信号をOR回路３
１を介した出力と画面メモリ２の情報を読出すた
めの読出し信号とをAND回路３２に入力する。
従つて、このAND回路３２により、水平帰線消
去時間あるいは垂直帰線消去時間の間におけると
きのみ、画面メモリ２をアクセスするようにして
いる。
ある。同図において、水平帰線消去（HBLK）
信号と垂直帰線消去（VBLK）信号をOR回路３
１を介した出力と画面メモリ２の情報を読出すた
めの読出し信号とをAND回路３２に入力する。
従つて、このAND回路３２により、水平帰線消
去時間あるいは垂直帰線消去時間の間におけると
きのみ、画面メモリ２をアクセスするようにして
いる。
次いで、AND回路３２の出力はアドレスカウ
ンタ３３に入力されているので、アドレスカウン
タ３３の値を歩進させる。また、このAND回路
３２の出力を、画面メモリ２に入力することによ
つて、アドレスカウンタ３３の示すアドレスに対
応する位置に格納された１ラスタ分の表示情報を
読出し、１ラスタ分1024ビツトのパターンをレジ
スタ３５に格納し、ハードコピー４により前述の
第２図ａ，ｂに示した方法により印刷が行なわれ
る。
ンタ３３に入力されているので、アドレスカウン
タ３３の値を歩進させる。また、このAND回路
３２の出力を、画面メモリ２に入力することによ
つて、アドレスカウンタ３３の示すアドレスに対
応する位置に格納された１ラスタ分の表示情報を
読出し、１ラスタ分1024ビツトのパターンをレジ
スタ３５に格納し、ハードコピー４により前述の
第２図ａ，ｂに示した方法により印刷が行なわれ
る。
以上説明したように、本発明によれば、パター
ンメモリ情報を走査線により表示装置に画面表示
するとともに、該走査線の帰線消去時間に画面表
示とは無関係に前記メモリ情報によりプリンタを
制御し前記画面を印刷するものである。このよう
にして、ハードコピーの印刷はCRTの走査に影
響を与えることなく、しかも並列動作とほぼ同様
の効率の良い動作を行なうことができる。すなわ
ち、アドレスカウンタの歩進が前述のように行な
われ、レジスタに１走査線分の表示情報が迅速に
記憶されるため、印刷速度を向上することができ
る。
ンメモリ情報を走査線により表示装置に画面表示
するとともに、該走査線の帰線消去時間に画面表
示とは無関係に前記メモリ情報によりプリンタを
制御し前記画面を印刷するものである。このよう
にして、ハードコピーの印刷はCRTの走査に影
響を与えることなく、しかも並列動作とほぼ同様
の効率の良い動作を行なうことができる。すなわ
ち、アドレスカウンタの歩進が前述のように行な
われ、レジスタに１走査線分の表示情報が迅速に
記憶されるため、印刷速度を向上することができ
る。
第１図は従来例の説明図、第２図ａ，ｂはハー
ドコピーの一般説明図、第３図は本発明の原理説
明図、第４図は本発明の実施例の構成を示す説明
図であり、図中、１は表示制御部、２はパターン
メモリ、３はCRT、４はハードコピー、１０は
静電記録紙、１１は印字部、１３はピン電極、１
３′は補助電極、２０は制御部、３１はOR回路、
３２はAND回路、３３はアドレスカウンタ、３
５はレジスタを示す。
ドコピーの一般説明図、第３図は本発明の原理説
明図、第４図は本発明の実施例の構成を示す説明
図であり、図中、１は表示制御部、２はパターン
メモリ、３はCRT、４はハードコピー、１０は
静電記録紙、１１は印字部、１３はピン電極、１
３′は補助電極、２０は制御部、３１はOR回路、
３２はAND回路、３３はアドレスカウンタ、３
５はレジスタを示す。
Claims (1)
- 【特許請求の範囲】 １ 一画面分の表示情報を記憶する画面メモリ
と、その表示情報を読出すために画面メモリにア
ドレスを与えるアドレスカウンタと、 水平帰線消去信号と垂直帰線消去信号との論理
和とメモリ読出し信号との論理積をとり、該論理
積出力を前記画面メモリと前記アドレスカウンタ
へ供給する手段と、 画面メモリから読出された一走査線に相当する
表示情報を記憶するレジスタと、 このレジスタに記憶された表示情報を印刷する
ハードコピー装置とを具え、 前記アドレスカウンタはいずれか一方の帰線消
去信号が入力している間、画面メモリに対して、
表示のための読出し順序と同じ順序で、前回の帰
線消去信号中に読出して前記レジスタに記憶され
ている表示情報の次の表示情報を読出すようにア
ドレスを歩進するとともに、 ハードコピー装置は前記レジスタに一走査線分
の表示情報が格納された時点で印刷を開始するこ
とを特徴とする表示画面プリンタ制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15479178A JPS5580192A (en) | 1978-12-13 | 1978-12-13 | Display screen printer control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15479178A JPS5580192A (en) | 1978-12-13 | 1978-12-13 | Display screen printer control system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5580192A JPS5580192A (en) | 1980-06-17 |
| JPS6337410B2 true JPS6337410B2 (ja) | 1988-07-25 |
Family
ID=15591967
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15479178A Granted JPS5580192A (en) | 1978-12-13 | 1978-12-13 | Display screen printer control system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5580192A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4386359A (en) * | 1982-01-04 | 1983-05-31 | International Business Machines Corporation | Line printer attachment |
-
1978
- 1978-12-13 JP JP15479178A patent/JPS5580192A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5580192A (en) | 1980-06-17 |
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