JPS6349959B2 - - Google Patents

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JPS6349959B2
JPS6349959B2 JP56064318A JP6431881A JPS6349959B2 JP S6349959 B2 JPS6349959 B2 JP S6349959B2 JP 56064318 A JP56064318 A JP 56064318A JP 6431881 A JP6431881 A JP 6431881A JP S6349959 B2 JPS6349959 B2 JP S6349959B2
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JP
Japan
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time division
division multiplex
switch
switch frame
time
Prior art date
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JP56064318A
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English (en)
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JPS573490A (en
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Anton Rutsutsu Kaaru
Kunorutsupu Eeberuharuto
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Siemens Corp
Original Assignee
Siemens Corp
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Publication date
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Publication of JPS6349959B2 publication Critical patent/JPS6349959B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q11/00Selecting arrangements for multiplex systems
    • H04Q11/04Selecting arrangements for multiplex systems for time-division multiplexing
    • H04Q11/08Time only switching

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)

Description

【発明の詳細な説明】 本発明は、入伝送方向用の時分割多重線路にお
いて使用される時間チヤネルから出伝送方向用の
時分割多重線路において使用される時間チヤネル
へ時間的および空間的に配列して割当てる、閉塞
の生じない時分割回路段として形成されている複
数個の交換機ユニツトから構成されている時分割
多重スイツチフレームであつて、該交換機ユニツ
トにはそれぞれ複数の時分割多重線路が接続され
ており、スイツチフレームには少くとも2つの、
1段の部分スイツチフレームが設けられており、
該部分スイツチフレームはそれと同数の交換機ユ
ニツトを有し、該交換機ユニツトにおいては交換
機ユニツトへ接続される入伝送方向用の時分割多
重線路が他の部分スイツチフレームの交換機ユニ
ツトの入力側とそれぞれ接続されている時分割多
重スイツチフレーム、例えばPCM−時分割多重
スイツチフレームに関する。
この種の時分割多重スイツチフレームは拡張な
いし補充可能の点で、前述の交換機ユニツトから
構成される多段スイツチフレームよりも、有利で
ある。何故ならばこの種の2段スイツチフレーム
は、一方では信号の導通接続の場合に比較的長い
走行時間を有し、他方では負荷がアンバランスに
なりやすくなる、即ち第1段の交換機ユニツトか
ら同時に優先的に複数個の接続を、第2段の同一
の交換装置ユニツトと接続されている時分割多重
線路へ形成すべき時に、中間線路の数が限られて
いるため閉塞が生ずることがある。3段スイツチ
フレームの場合はこの負荷のアンバランスの影響
はもはやなくなるが、その代りスイツチフレーム
における走行時間が一層大きくなり、さらに導通
接続完了のために一層多くの設定命令が必要とな
る。
上述の公知の時分割多重スイツチフレームにお
いては、交換機ユニツトの等順位の出力側は、
個々の部分スイツチフレーム内で相互に接続され
出伝送方向用の各時分割多重線路へ接続されてい
る。それ故入伝送方向用の時分割多重線路が上述
のように接続されているため、部分スイツチフレ
ームの故障の場合、このスイツチフレームを介し
て導びかれるトラヒツクは、閉塞が著しく僅かな
場合は、他の故障していない部分スイツチフレー
ムを介して接続される。
この場合交換機ユニツトの相互に接続される出
力側は、2進値1、0ならびに休止状態の3つの
異なる信号レベルをとる、所謂3状態出力側であ
る。通常の作動においては、相互に接続されてい
る2つの出力側は、1つの時間位置の間に同時に
作動状態をとらないことが保証されている。しか
し投入接続時相においては、一方の入力側から2
進値1が供給され他方の入力側から2進値0が供
給される時は、交換機ユニツトの出力側を構成す
る当該の部品が破損されることがある。同様に投
入接続時相において、閉塞が生じていない時に、
通常交換機ユニツトから送出される空きチヤネル
符号語の送信が正しく動作しないことがある。こ
の場合この空きチヤネル符号語によつて、これま
で当該の時間位置の間に形成されていた接続が解
除される。
それ故本発明の課題は、冒頭に述べた時分割多
重スイツチフレームを前提として、多段スイツチ
フレームの欠点を回避し、さらに個々の交換機ユ
ニツトの出力側の相互接続の前記問題点も回避し
た時分割多重スイツチフレームを提供することで
ある。
この課題は次のようにして解決されている、即
ち各部分スイツチフレーム毎に複数個の交換機ユ
ニツトおよびこれと同数の、該交換機ユニツトと
同一構成を有するがマルチプレクサとして作動さ
れるユニツトが設けられており、通常使用される
マルチプレクサ出力側の総数が、該各部分スイツ
チフレームにおいて1つの交換機ユニツトへ接続
されている入伝送方向用の時分割多重線路の数と
等しくなつており、該部分スイツチフレームに所
属するマルチプレクサの通常使用されない方の出
力側の少くとも一部が、他方の部分スイツチフレ
ームの故障の場合、通常は開かれているスイツチ
を介して他方の部分スイツチフレームの通常使用
される方の各1つのマルチプレクサ出力側と情報
伝送のために接続されるようにしたのである。
この種の構成を有する時分割多重スイツチフレ
ームの場合も冗長度が存在しその結果、部分スイ
ツチフレームの故障の場合、この部分スイツチフ
レームを介して導びかれたもとのトラヒツクは、
閉塞が最小の場合は別の部分スイツチフレームを
介して接続することができる。故障発生の場合に
はじめて、即ち1つの部分スイツチフレームが故
障した時にはじめて、マルチプレクサとして動作
されるユニツトの通常は使用されない出力側が、
当該の故障した部分スイツチフレームのユニツト
のマルチプレクサ出力側と相互に接続されるた
め、3状態出力側の接続の場合の前述の問題点が
除去される。
本発明の実施例によれば、個々の部分スイツチ
フレームは、電流供給およびクロツクパルス供給
に関しては、相互に別個に行なわれる。その結果
最も頻繁に生ずる故障の原因すなわち電流供給ま
たはクロツクパルス供給における故障はそれぞれ
一方の部分スイツチフレームだけに限定され、他
方の部分スイツチフレームにより閉塞のないトラ
ヒツクのトランスフアが可能となる。そのため、
故障の場合の全体の動作が極めて僅かしか損われ
なくなる。
次に本発明の実施例につき図面を用いて説明す
る。
第1図に示されている交換機ユニツトは、8つ
の時分割多重線路の接続に用いられる。そのため
図の左側には入伝送方向用の8つの線路心線対
Zk1〜Zk8が示されている。他方右側には所属
の出伝送方向用の線路心線対Zg1〜Zg8が示さ
れている。各時分割多重線路心線対Zk1〜Zk8
には、遅延時間補償に基いてパルスフレーム識別
に用いられる装置RL1〜RL8が配属されてい
る。入伝送方向用の個々の線路心線対から到来す
る情報は、装置RL走行した、マルチプレクサ
Muxを介して時間的に交錯配列され次にこの形
式で、入伝送方向用の超多重線路SMLkにより伝
送される。この超多重線路には、入伝送方向用の
各線路心線対に2048Mビツト/秒のビツトクロツ
クパルス周波数が存在しているとすれば、8×
2048Mビツト/秒のビツトクロツクパルス周波数
が存在する。
第1図に示されている交換機ユニツトの中心部
は、通話メモリSとこれを制御する保持メモリと
から構成される時分割スイツチフレーム段であ
る。この通話メモリSは、同時に行なえる接続の
各々に対して1つの記憶セルを有する。例えばそ
れぞれ32の時間チヤネルないしタイムスロツトの
設けられている時分割多重線路が8つある場合
は、それぞれ8ビツトから成る記憶セルが128設
けられている。各記憶セルはサンプリングパルス
フレームにより2回制御される、即ち1回は加入
者Aに所属する時間位置において、もう1回はこ
れと接続される加入者Bに所属する時間位置にお
いて、制御される。このため保持メモリHは、2
倍の数の記憶セルを有する。その結果通話メモリ
Sの記憶素子のアドレスは、2回記憶することが
できる。
超多重線路SMLkを介して到来した情報が通話
メモリSへ導びかれる。一時記憶の後にこの情報
は、出伝送方向用の超多重線路SMLaを介して取
り出されて、デマルチプレクサDemへ導びかれ
る。デマルチプレクサは情報を8つの線路心線対
Zg1〜Zg8へ配分する。
第1図に示されている交換機ユニツトの通話メ
モリSからの読み出しは次のように制御される、
即ち一時記憶により、入線の時分割多重線路にお
いて使用される時間チヤネルの時間位置と、出線
の時分割多重線路において使用する時間チヤネル
の時間位置との間の時間間隔だけが橋絡されるよ
うに制御されるだけでなく、時間の入れ替えない
しタイムスロツト入替も行なえるように制御され
る。即ち超時分割多重線路において時間チヤネル
の時間位置内で個々に接続される、入伝送方向の
線路と出伝送方向の線路に配属される時間間隔の
間の入れ替えが行なわれるように制御される。そ
れ故デマルチプレクサDemにより上述の時間間
隔の通話内容を出伝送方向の個々の時分割多重線
路へ周期的に配分することは、相応の空間的な交
換ともなる。
第2図に示されている本発明による時分割多重
スイツチフレームは2つの部分スイツチフレーム
から構成されており、各々は各2つの交換機ユニ
ツトVE1およびVE2ないしVE3およびVE4を
有する。この交換機ユニツトの場合は、 入伝送方向用の時分割多重線路に対する8つの
端子と、出伝送方向用の時分割多重線路に対する
8つの端子とを有する交換機ユニツトが、対象と
される。
この交換機ユニツトには全部で16の時分割多重
線路PCMa1〜PCMa16が接続されている。こ
の場合一方の8つの時分割多重線路PCMa1〜
PCMa8は、第1スイツチフレーム半部の交換機
ユニツトVE1の8つの入力側、および他方のス
イツチフレーム半部の交換機ユニツトVE3の8
つの入力側へ、接続されている。入伝送方向用の
他方の8つの時分割多重線路PCMa9〜PCMa1
6は、第2スイツチフレーム半部の交換機ユニツ
トVE4の入力側および第1スイツチフレーム半
部の交換機ユニツトVE2の8つの入力側と接続
されている。
上述の数の交換機ユニツトVE1〜VE4のほか
に、これと同数の、交換機ユニツトと同一構成の
マルチプレクサユニツトMux1〜Mux4が、こ
の時分割多重スイツチフレームを構成している。
これらのマルチプレクサユニツトの8つの入力
側のうちの各4つが、同じスイツチフレーム半部
の一方または他方の交換機ユニツトVEの出力側
と接続されている。すなわち例えばユニツト
Mux1の4つの入力側は交換機ユニツトVE1の
4つの出力側と接続され、このユニツトMux1
の他方の4つの入力側は交換機ユニツトVE2の
4つの出力側と接続されている。
ユニツトMux1〜Mux4の8つの出力側のう
ち、通常はそれぞれ4つだけが、時分割多重線路
PCMgの接続に対して使用される。その結果入伝
送方向用の時分割多重線路PCMaの数に相応し
て、全部で16の時分割多重線路PCMg1〜PCMg
16が、出伝送方向用に接続されている。
ユニツトMux1〜Mux4の他方の各4つの出
力側は、それぞれスイツチS1〜S16を介し
て、それぞれ他方のスイツチフレーム半部のユニ
ツトMuxの1つの出力側と接続可能にされてい
る。この場合この出力側には通常は出伝送方向用
の時分割多重線路が接続されている。そのため例
えば、第1スイツチフレーム半部に所属している
ユニツトMux1の他方の4つの出力側は、スイ
ツチS5〜S8を介して、第2スイツチフレーム
半部に所属するユニツトMux3の1つの出力側
と接続可能にされている。この場合この出力側に
は通常は、出伝送方向用の時分割多重線路PCMg
9〜PCMg12が接続されている。
スイツチS1〜S16は通常の場合は開放され
ており、後述の様に、一方のスイツチフレーム半
部の故障の場合にだけ閉成される。
マルチプレクサユニツトMux1〜Mux4の作
動により、その通常使用される各4つの出力側へ
の導通接続が、当該のスイツチフレーム半部の第
1交換機ユニツトVEの出力側と接続されている
マルチプレクサ入力側からと、第2交換機ユニツ
トVEの出力側と接続されているマルチプレクサ
入力側からだけ行なえるようにされる。この場合
導通接続は、周期的なタイムスロツトにより行な
われる。同様のことが、通常は使用されない出力
側に対してあてはまる。その結果ユニツトMux
は、2つの入力側で接続されている時分割多重線
路に現われるPCM−情報をそれぞれ接続する4
つのマルチプレクサの各2つの群を有する。
通常の動作の場合は、即ち両方の部分スイツチ
フレームが正常である時は、スイツチS1〜S1
6は開かれている。入伝送方向用の時分割多重線
路PCMa1〜PCMa16を介して伝送される情報
は、両方のスイツチフレーム半部へ配分される。
冒頭で示されているように交換機ユニツトVE1
〜VE4は完全に交換できるようにするため、即
ち接続される8つの入伝送方向用の時分割多重線
路のトラヒツクを交換するため、この通常の場合
はこれらの交換機ユニツトはトラヒツクが最大の
場合でも完全に利用されていない。
ところでスイツチフレーム半部が故障すると、
例えば交換機ユニツトVE3,VE4ならびにマル
チプレクサとして使用されるユニツトMux3,
Mux4を有するスイツチフレーム半部が故障す
ると、相応の制御命令によりスイツチS1〜S8
が閉成される。そのためこれらのスイツチによ
り、第1スイツチフレーム半部のユニツトMux
1およびMux2の通常は使用されない方の出力
側が、出伝送方向用の時分割多重線路PCMg9〜
PCMg16の接続されている第2スイツチフレー
ム半部の出力側と、接続される。
これまでは出伝送方向用の時分割多重線路
PCMg9〜PCMg16へ第2スイツチフレーム半
部を介して接続されていたトラヒツク部分が、第
1スイツチフレーム半部および相応のスイツチS
1〜S8だけを介して、出伝送方向に対するこれ
らの多重線路へ導びかれる。この場合、入伝送方
向用の時分割多重線路PCMa1〜PCMa8へ供給
されるPCM−情報だけでなく、時分割多重線路
PCMa9〜PCMa16を介して供給されるPCM
−情報も処理することができる。このスイツチフ
レーム半部の交換機ユニツトが通常の場合生ずる
トラヒツクに応じて過大に設計されているため、
場合により発生する閉塞は最小となる。
予備接続の場合だけにユニツトMux1〜Mux
4の出力側の相互接続が行なわれるので、冒頭に
述べた公知の時分割多重スイツチフレームにおけ
る。通常の動作時の出力側の相互接続に伴なう問
題が生じないようにすることができる。
第3図に示されている本発明による時分割多重
スイツチフレームの実施例は、4つの部分スイツ
チフレームから構成されている。これらの部分ス
イツチフレームは固有の4つの交換機ユニツト
VEならびにこの交換機ユニツトと同一構成のマ
ルチプレクサとして作動される同数のユニツト
Muxを有する。交換機ユニツトVEの入力側は、
第2図に示されている実施例の場合と同様に、入
伝送方向用の時分割多重線路PCMa1〜PCMa3
2と接続されている。即ち各時分割多重線路が、
各部分スイツチフレームの1つの交換機ユニツト
VEの一方の入力側とそれぞれ接続されている。
そのため例えば入伝送方向用の時分割多重線路
PCMa1〜PCMa8はそれぞれ第1部分スイツチ
フレームの交換機ユニツトVE1の8つの入力側
の1つと、および第2部分スイツチフレームの交
換機ユニツトVE5の8つの入力側の1つと、お
よび第3部分スイツチフレームの交換機ユニツト
VE9の8つの入力側の1つと、および第4部分
スイツチフレームの交換機ユニツトVE13の8
つの入力側の1つと、それぞれ接続されている。
個々の部分スイツチフレームにおける交換機ユ
ニツトVEの出力側と、マルチプレクサとして使
用されるユニツトMuxの入力側との間の接続は、
次のようにされている。即ち各交換機ユニツト
VEが各2つの中間線路を介して各ユニツトMux
と接続されている。
各ユニツトMuxにおいて通常の場合は、出伝
送方向用の32の時分割多重線路PCMg1〜PCMg
32の接続されている方の2つの出力側が使用さ
れる。
ユニツトMuxの通常は用いられない方の他方
の2つの出力側は、各1つのスイツチSを介し
て、他の部分スイツチフレームのユニツトMux
の等位出力側と接続されている。例えば第1部分
スイツチフレームにおけるユニツトMux1の他
方の2つの出力側は、スイツチSを介して、第2
部分スイツチフレームにおけるユニツトMux5
の、出伝送方向用の時分割多重線路PCMg9ない
しPCMg10の接続されている方の出力側と接続
されている。同様に、第1部分スイツチフレーム
におけるその他のユニツトの通常は使用されない
出力側が、第2部分スイツチフレームにおけるそ
の他のユニツトの出力側と接続され、第2部分ス
イツチフレームにおけるユニツトの通常は使用さ
れない出力側はスイツチSを介して、第1部分ス
イツチフレームにおけるユニツトの、出伝送方向
用の時分割多重線路PCMgと接続されている方の
出力側と、接続可能にされている。
同様のことが、第3および第4部分スイツチフ
レームに所属するユニツトMuxの出力側の相互
接続に対しても、あてはまる。
第3図に示されている実施例において、ユニツ
トMuxの他の4つの出力側は、すべての場合に
使用されない。
この場合も通常の動作においては、入伝送方向
用の時分割多重線路PCMa1〜32を介して供給
されるトラヒツクが4つの部分スイツチフレーム
へ、出伝送方向用のどの時分割多重線路PCMgへ
接続すべきかに応じて、配分される。部分スイツ
チフレーム故障の場合、この部分スイツチフレー
ムを介して交換されるはずのもとのトラヒツク
は、次の部分スイツチフレームにより引き受けら
れる。即ちユニツトMuxの出力側からスイツチ
Sを介して、故障している部分スイツチフレーム
の出力側へ達することのできる、出伝送方向用の
時分割多重線路の接続されている部分スイツチフ
レームにより、引き受けられる。
【図面の簡単な説明】
第1図は、本発明によるスイツチフレームを構
成する交換機ユニツトの実施例、第2図は2つの
部分スイツチフレームから構成される時分割多重
スイツチフレームの第1実施例、第3図は4つの
部分スイツチフレームから構成される本発明によ
る時分割多重スイツチフレームの第2実施例を示
す。 Zk1〜Zk8……入伝送方向用の線路心線対、
Zg1〜Zg8……出伝送方向用の線路心線対、
Mux……マルチプレクサ、SMLK……入伝送方
向用の超多重線路、S……通話メモリ、H……保
持メモリ、Dem……デマルチプレクサ、SMLa…
…超多重線路、VE1〜VE16……交換機ユニツ
ト、Mux1〜Mux16……マルチプレクサとし
て用いられるユニツト、PCMa1〜PCMa32…
…入伝送方向の時分割多重線路、PCMg1,2…
…出伝送方向の時分割多重線路。

Claims (1)

  1. 【特許請求の範囲】 1 入伝送方向用の時分割多重線路において使用
    される時間チヤネルから出伝送方向用の時分割多
    重線路において使用される時間チヤネルへ時間的
    および空間的に配列して割当てる、閉塞の生じな
    い時分割回路段として形成されている複数個の交
    換機ユニツトから構成されている時分割多重スイ
    ツチフレームであつて、該交換機ユニツトにはそ
    れぞれ複数の時分割多重線路が接続されており、
    スイツチフレームには少くとも2つの、1段の部
    分スイツチフレームが設けられており、該部分ス
    イツチフレームはそれと同数の交換機ユニツトを
    有し、該交換機ユニツトにおいては交換機ユニツ
    トへ接続される入伝送方向用の時分割多重線路が
    他の部分スイツチフレームの交換機ユニツトの入
    力側とそれぞれ接続されている時分割多重スイツ
    チフレームにおいて、各部分スイツチフレーム毎
    に複数個の交換機ユニツト(VE)およびこれと
    同数の、該交換機ユニツトと同一構成を有するが
    マルチプレクサとして作動されるユニツト
    (Mux)が設けられており、通常使用されるマル
    チプレクサ出力側の総数が、該各部分スイツチフ
    レームにおいて1つの交換機ユニツトへ接続され
    ている入伝送方向用の時分割多重線路(PCMa)
    の数と等しくなつており、該部分スイツチフレー
    ムに所属するマルチプレクサの通常使用されない
    方の出力側の少くとも一部が、他方の部分スイツ
    チフレームの故障の場合、通常は開かれているス
    イツチ(S)を介して他方の部分スイツチフレー
    ムの通常使用される方の各1つのマルチプレクサ
    出力側と情報伝送のために接続されるようにした
    ことを特徴とする時分割多重スイツチフレーム。 2 部分スイツチフレームが、電流供給およびク
    ロツクパルス供給に関して、相互に独立であるよ
    うにした特許請求の範囲第1項記載の時分割多重
    スイツチフレーム。
JP6431881A 1980-04-30 1981-04-30 Time division multiplex switch frame Granted JPS573490A (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
DE19803016706 DE3016706A1 (de) 1980-04-30 1980-04-30 Zeitmultiplexkoppelfeld

Publications (2)

Publication Number Publication Date
JPS573490A JPS573490A (en) 1982-01-08
JPS6349959B2 true JPS6349959B2 (ja) 1988-10-06

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ID=6101370

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JP6431881A Granted JPS573490A (en) 1980-04-30 1981-04-30 Time division multiplex switch frame

Country Status (4)

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US (1) US4398285A (ja)
EP (1) EP0039077B1 (ja)
JP (1) JPS573490A (ja)
DE (1) DE3016706A1 (ja)

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