JPS6399951U - - Google Patents
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- Publication number
- JPS6399951U JPS6399951U JP19568486U JP19568486U JPS6399951U JP S6399951 U JPS6399951 U JP S6399951U JP 19568486 U JP19568486 U JP 19568486U JP 19568486 U JP19568486 U JP 19568486U JP S6399951 U JPS6399951 U JP S6399951U
- Authority
- JP
- Japan
- Prior art keywords
- pair
- card edge
- peripheral board
- electrodes
- electrode
- Prior art date
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- Pending
Links
- 230000002093 peripheral effect Effects 0.000 claims 3
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Coupling Device And Connection With Printed Circuit (AREA)
Description
第１図は本考案の一実施例を示す図、第２図は
従来のシステム・バスを示す図、第３図は従来の
カードエツジコネクタとＩ／Ｏ装置基板との接続
を示す図（断面図）である。 １……Ｉ／Ｏ装置基板、２，３……対電極、４
……カードエツジコネクタ、５，６……対端子。
従来のシステム・バスを示す図、第３図は従来の
カードエツジコネクタとＩ／Ｏ装置基板との接続
を示す図（断面図）である。 １……Ｉ／Ｏ装置基板、２，３……対電極、４
……カードエツジコネクタ、５，６……対端子。
Claims (1)
- コンピユータ等の周辺基板ユニツトをデイジイ
チエーン方式によつてＣＰＵ等に接続するための
システム・バスにおいて、該周辺基板のカードエ
ツジ部の表裏同じ位置に対をなす電極を設け、該
電極の一方を入力電極、他方を出力電極とすると
共に、該対電極と夫々接続可能な入出力対端子を
有するカードエツジコネクタを設け、該対端子は
、前記周辺基板のカードエツジが上記コネクタか
ら抜かれた状態の時に接触するように設けられ、
これによりバスが始点から終点まで常に連結され
るようにしたことを特徴とするシステム・バス。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19568486U JPS6399951U (ja) | 1986-12-19 | 1986-12-19 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19568486U JPS6399951U (ja) | 1986-12-19 | 1986-12-19 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6399951U true JPS6399951U (ja) | 1988-06-29 |
Family
ID=31153796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19568486U Pending JPS6399951U (ja) | 1986-12-19 | 1986-12-19 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6399951U (ja) |
-
1986
- 1986-12-19 JP JP19568486U patent/JPS6399951U/ja active Pending
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