JPS6423114U - - Google Patents
Info
- Publication number
- JPS6423114U JPS6423114U JP11706887U JP11706887U JPS6423114U JP S6423114 U JPS6423114 U JP S6423114U JP 11706887 U JP11706887 U JP 11706887U JP 11706887 U JP11706887 U JP 11706887U JP S6423114 U JPS6423114 U JP S6423114U
- Authority
- JP
- Japan
- Prior art keywords
- oscillator
- signals
- output signals
- integrator
- multiplier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
第１図は本考案の実施例を示すブロツク回路図
、第２図は高周波リンクインバータのブロツク回
路図、第３図は第２図のインバータ装置の各部の
電圧波形図である。 ２１……高周波発振器、２２……低周波発振器
、３１，３２……乗算器、４１，４２……積分器
、５……加算器。
、第２図は高周波リンクインバータのブロツク回
路図、第３図は第２図のインバータ装置の各部の
電圧波形図である。 ２１……高周波発振器、２２……低周波発振器
、３１，３２……乗算器、４１，４２……積分器
、５……加算器。
Claims (1)
- 互いに異なる周波数の正弦波信号を出力する第
１の発振器及び第２の発振器と、これらの発振器
の出力信号を互いに乗算する第１の乗算器と、前
記第１の発振器及び第２の発振器の出力信号を夫
々積分する第１の積分器及び第２の積分器と、こ
れらの積分器の出力信号を互いに乗算する第２の
乗算器と、前記第１の乗算器及び第２の乗算器の
各出力信号を互いに加算する加算器とを有してな
ることを特徴とする差周波発振器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11706887U JPS6423114U (ja) | 1987-07-30 | 1987-07-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11706887U JPS6423114U (ja) | 1987-07-30 | 1987-07-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6423114U true JPS6423114U (ja) | 1989-02-07 |
Family
ID=31360183
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11706887U Pending JPS6423114U (ja) | 1987-07-30 | 1987-07-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6423114U (ja) |
-
1987
- 1987-07-30 JP JP11706887U patent/JPS6423114U/ja active Pending
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