JPS642462U - - Google Patents

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JPS642462U
JPS642462U JP9591987U JP9591987U JPS642462U JP S642462 U JPS642462 U JP S642462U JP 9591987 U JP9591987 U JP 9591987U JP 9591987 U JP9591987 U JP 9591987U JP S642462 U JPS642462 U JP S642462U
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JP
Japan
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memory
circuit board
multilayer wiring
wiring circuit
pattern
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Description

【図面の簡単な説明】
第1図A及びBはメモリーカード用多層配線回
路基板における表面の配線パターンおよび裏面の
配線パターンを示すものである。2のIC接合部
パターンは、表Aと裏Bで面対称となつており、
1のスルホール回路でつながつており、さらにこ
のスルホール回路が内層回路とつながつており、
主に内層回路で必要な配線が施されている。第2
図はメモリーIC搭載部の断面図である。5のI
Cが同方向に向いており、ICのそれぞれの側か
ら見るとICの上面と下面が見え、端子の順番が
互いに逆向きになつて接合されている。 図中1……スルホール、2……IC接合部、3
……ICピン番号、4……外部端子、5……IC
、6……多層回路基板、7……内層回路を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の面実装型メモリー集積回路チツプ(以下
    メモリーICという)を搭載してなるメモリーカ
    ードモジユールにおいて、回路基板が多層配線基
    板であつて、その表面のメモリーIC接合部パタ
    ーンと裏面のメモリーIC接合部パターンとが面
    対称、すなわち表裏の投影パターンが一致する配
    線回路パターンを有するものであつて、該多層配
    線回路基板表裏にメモリーICを側面から見て同
    方向に搭載してなるメモリーカードモジユール。
JP9591987U 1987-06-24 1987-06-24 Pending JPS642462U (ja)

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JP9591987U JPS642462U (ja) 1987-06-24 1987-06-24

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JP9591987U JPS642462U (ja) 1987-06-24 1987-06-24

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JPS642462U true JPS642462U (ja) 1989-01-09

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ID=31320680

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JP9591987U Pending JPS642462U (ja) 1987-06-24 1987-06-24

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JP (1) JPS642462U (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5939057A (ja) * 1982-08-27 1984-03-03 Hitachi Ltd 半導体記憶装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5939057A (ja) * 1982-08-27 1984-03-03 Hitachi Ltd 半導体記憶装置

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