JPS6433231U - - Google Patents
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- Publication number
- JPS6433231U JPS6433231U JP12826887U JP12826887U JPS6433231U JP S6433231 U JPS6433231 U JP S6433231U JP 12826887 U JP12826887 U JP 12826887U JP 12826887 U JP12826887 U JP 12826887U JP S6433231 U JPS6433231 U JP S6433231U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- parallel signal
- parallel
- modulation circuit
- phase
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
Landscapes
- Dc Digital Transmission (AREA)
Description
第１図は本考案の一実施例に係る位相変調回路
の構成図、第２図は第１図の回路の動作を説明す
るための波形図、第３図は従来の位相変調回路の
構成図、第４図は第３図の回路の動作を説明する
ための波形図である。 ２０ａ〜２４ｂ……シフトレジスタ、２５〜２
９……インバータ回路、３０……出力端子、３１
……タイミング信号発生回路。
の構成図、第２図は第１図の回路の動作を説明す
るための波形図、第３図は従来の位相変調回路の
構成図、第４図は第３図の回路の動作を説明する
ための波形図である。 ２０ａ〜２４ｂ……シフトレジスタ、２５〜２
９……インバータ回路、３０……出力端子、３１
……タイミング信号発生回路。
Claims (1)
- 並列信号を入力とし、該並列信号に対応した位
相に変調された直列信号を出力する位相変調回路
において、前記並列信号の各信号に対応させて、
縦続接続させた第１及び第２のシフトレジスタを
設け、第１のシフトレジスタには前記並列信号を
直接記憶させると共に、第２のシフトレジスタに
は前記並列信号の反転信号を記憶させ、これらシ
フトレジスタの記憶内容を順次シフトさせて、前
記並列信号に対応した位相に変調された直列信号
を得ることを特徴とする位相変調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12826887U JPS6433231U (ja) | 1987-08-24 | 1987-08-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12826887U JPS6433231U (ja) | 1987-08-24 | 1987-08-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6433231U true JPS6433231U (ja) | 1989-03-01 |
Family
ID=31381446
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12826887U Pending JPS6433231U (ja) | 1987-08-24 | 1987-08-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6433231U (ja) |
-
1987
- 1987-08-24 JP JP12826887U patent/JPS6433231U/ja active Pending
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