JPS643894U - - Google Patents

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JPS643894U
JPS643894U JP9300787U JP9300787U JPS643894U JP S643894 U JPS643894 U JP S643894U JP 9300787 U JP9300787 U JP 9300787U JP 9300787 U JP9300787 U JP 9300787U JP S643894 U JPS643894 U JP S643894U
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JP
Japan
Prior art keywords
display device
pixel memory
scan method
television scan
interpolating
Prior art date
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Pending
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JP9300787U
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Publication date
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Description

【図面の簡単な説明】
第１図は本考案の一実施例のブロツク図、第２
図は塗りつぶし画面の表示例を示す図、第３図は
本考案による第２図の表示例の塗りつぶし画素の
記憶例を示す図である。 主要部分の符号の説明、１０……画素メモリ、
２０……セツト／リセツト制御回路、３０……Ｄ
／Ａコンバータ、４０……ＣＲＴモニタ、５０…
…タイミング制御回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 表示画面に一対一に対応する画素メモリを有し
    てテレビジヨンスキヤン方式により読出して映像
    を表示する表示装置であつて、前記画素メモリに
    塗りつぶしの始点および終点を記憶し、前記テレ
    ビジヨンスキヤンによる読出しを行う時に塗りつ
    ぶし画素を補間することを特徴とする表示装置。
JP9300787U 1987-06-17 1987-06-17 Pending JPS643894U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP9300787U JPS643894U (ja) 1987-06-17 1987-06-17

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP9300787U JPS643894U (ja) 1987-06-17 1987-06-17

Publications (1)

Publication Number Publication Date
JPS643894U true JPS643894U (ja) 1989-01-11

Family

ID=31317455

Family Applications (1)

Application Number Title Priority Date Filing Date
JP9300787U Pending JPS643894U (ja) 1987-06-17 1987-06-17

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JP (1) JPS643894U (ja)

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