JPS643960U - - Google Patents
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- Publication number
- JPS643960U JPS643960U JP9742287U JP9742287U JPS643960U JP S643960 U JPS643960 U JP S643960U JP 9742287 U JP9742287 U JP 9742287U JP 9742287 U JP9742287 U JP 9742287U JP S643960 U JPS643960 U JP S643960U
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- JP
- Japan
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- pulse signal
- program
- microprocessor
- period
- progress
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 4
- 230000005856 abnormality Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Description
第１図はこの考案の実施例を示すブロツク図、
第２図は同実施例における単安定マルチバイブレ
ータの動作を説明するための波形図、第３図は従
来例を示すブロツク図である。 １１…マイクロプロセツサ、１５…タイマーＬ
ＳＩ（インターバルタイマー）、１６…Ｉ／ＯＬ
ＳＩ（パルス信号発生手段）、１８…単安定マル
チバイブレータ（異常検出回路）。
第２図は同実施例における単安定マルチバイブレ
ータの動作を説明するための波形図、第３図は従
来例を示すブロツク図である。 １１…マイクロプロセツサ、１５…タイマーＬ
ＳＩ（インターバルタイマー）、１６…Ｉ／ＯＬ
ＳＩ（パルス信号発生手段）、１８…単安定マル
チバイブレータ（異常検出回路）。
Claims (1)
- マイクロプロセツサに対してインターバルタイ
マーによつて割込みをかけ、割込みプログラムを
進行するマイクロコンピユータにおいて、マイク
ロプロセツサの割込みプログラムの進行に応じて
パルス信号を発生するパルス信号発生手段と、こ
のパルス信号発生手段からのパルス信号を入力し
、そのパルス信号の周期がプログラムの正常進行
時の周期Ｔ１よりも大きいＴ２以上になつたとき
異常検出信号を出力する異常検出回路を設けたこ
とを特徴とするマイクロコンピユータの異常検出
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9742287U JPS643960U (ja) | 1987-06-26 | 1987-06-26 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9742287U JPS643960U (ja) | 1987-06-26 | 1987-06-26 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS643960U true JPS643960U (ja) | 1989-01-11 |
Family
ID=31322879
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9742287U Pending JPS643960U (ja) | 1987-06-26 | 1987-06-26 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS643960U (ja) |
-
1987
- 1987-06-26 JP JP9742287U patent/JPS643960U/ja active Pending