JPS6452061U - - Google Patents
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- Publication number
- JPS6452061U JPS6452061U JP14422187U JP14422187U JPS6452061U JP S6452061 U JPS6452061 U JP S6452061U JP 14422187 U JP14422187 U JP 14422187U JP 14422187 U JP14422187 U JP 14422187U JP S6452061 U JPS6452061 U JP S6452061U
- Authority
- JP
- Japan
- Prior art keywords
- address
- instruction
- state
- internal state
- program counter
- Prior art date
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 2
- 238000006243 chemical reaction Methods 0.000 claims 1
- 238000005259 measurement Methods 0.000 claims 1
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- 230000004044 response Effects 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
Description
第１図はこの考案の一実施例を示す図、第２図
はこの考案における制御手順を示す図、第３図は
従来の計算機システムにおける内部状態制御計測
装置を示す図、第４図は従来の計算機システムに
おける内部状態制御計測装置における制御手順を
示す図である。 図において、１は計算機の主記憶装置、２は内
部状態を変更される被状態変更命令、３は内部状
態を変更するために必要な、内部状態を変更させ
るための内部状態変換用プログラム、４は内部状
態変換用プログラム３に制御され、内部状態変更
情報を入力する計測装置、５は実行中の命令のア
ドレスを表示するプログラムカウンタ、６は被状
態変更命令２の次に実行される次命令、７は内部
状態変換用プログラム３を起動する状態変更要求
命令、８は命令が格納されている主記憶装置内の
アドレスを状態変更用アドレスとして記憶してい
るサーチアドレスレジスタ、９は前記サーチアド
レスレジスタが指示するアドレスと前記プログラ
ムカウンタが指示するアドレスとが一致したとき
にアドレス一致割込みを発生するアドレス一致検
出部、１０はアドレス一致割込みが発生した場合
に実行されるアドレス一致割込み応答アドレスで
ある。なお、各図中同一符号は同一または相当部
分を示す。
はこの考案における制御手順を示す図、第３図は
従来の計算機システムにおける内部状態制御計測
装置を示す図、第４図は従来の計算機システムに
おける内部状態制御計測装置における制御手順を
示す図である。 図において、１は計算機の主記憶装置、２は内
部状態を変更される被状態変更命令、３は内部状
態を変更するために必要な、内部状態を変更させ
るための内部状態変換用プログラム、４は内部状
態変換用プログラム３に制御され、内部状態変更
情報を入力する計測装置、５は実行中の命令のア
ドレスを表示するプログラムカウンタ、６は被状
態変更命令２の次に実行される次命令、７は内部
状態変換用プログラム３を起動する状態変更要求
命令、８は命令が格納されている主記憶装置内の
アドレスを状態変更用アドレスとして記憶してい
るサーチアドレスレジスタ、９は前記サーチアド
レスレジスタが指示するアドレスと前記プログラ
ムカウンタが指示するアドレスとが一致したとき
にアドレス一致割込みを発生するアドレス一致検
出部、１０はアドレス一致割込みが発生した場合
に実行されるアドレス一致割込み応答アドレスで
ある。なお、各図中同一符号は同一または相当部
分を示す。
Claims (1)
- 計算機システムにおいて実行中の命令のアドレ
スを表示するプログラムカウンタと、命令実行後
の内部状態を変更するために、前記命令が格納さ
れている主記憶装置内のアドレスを状態変更用ア
ドレスとして記憶しているサーチアドレスレジス
タと、前記サーチアドレスレジスタが指示するア
ドレスと前記プログラムカウンタが指示するアド
レスとが一致したときにアドレス一致割込みを発
生するアドレス一致検出部と、前記状態変更用ア
ドレスの命令実行後に内部状態を変更するための
内部状態変換プログラムに制御される計測装置と
を備え、主記憶装置内の命令の書換えなしに、変
更したい状態変更用アドレスの命令実行時の内部
状態のリアルタイムな変換制御を可能にすること
を特徴とする計測装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14422187U JPS6452061U (ja) | 1987-09-21 | 1987-09-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14422187U JPS6452061U (ja) | 1987-09-21 | 1987-09-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6452061U true JPS6452061U (ja) | 1989-03-30 |
Family
ID=31411735
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14422187U Pending JPS6452061U (ja) | 1987-09-21 | 1987-09-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6452061U (ja) |
-
1987
- 1987-09-21 JP JP14422187U patent/JPS6452061U/ja active Pending