JPS6452364U - - Google Patents
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- Publication number
- JPS6452364U JPS6452364U JP1987147932U JP14793287U JPS6452364U JP S6452364 U JPS6452364 U JP S6452364U JP 1987147932 U JP1987147932 U JP 1987147932U JP 14793287 U JP14793287 U JP 14793287U JP S6452364 U JPS6452364 U JP S6452364U
- Authority
- JP
- Japan
- Prior art keywords
- output
- video
- screen
- signal
- sub
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Studio Circuits (AREA)
Description
第１図、第２図は本考案の実施例に係り、第１
図は要部を示すブロツク図、第２図はブロツク図
である。第３図〜第５図は従来例に係り、第３図
、第４図はブロツク図、第５図は波形図である。 ６……Ｄ型フリツプフロツプ、７……アナログ
スイツチ。
図は要部を示すブロツク図、第２図はブロツク図
である。第３図〜第５図は従来例に係り、第３図
、第４図はブロツク図、第５図は波形図である。 ６……Ｄ型フリツプフロツプ、７……アナログ
スイツチ。
Claims (1)
- 入力される子画面用の映像信号をフイールド種
別に応じて、異なつたメモリ領域に書き込むビデ
オメモリの制御回路において、Ｄ型フリツプフロ
ツプと、前記子画面用映像信号がビデオテープレ
コーダの特殊再生出力であるとき前記Ｄ型フリツ
プフロツプの一方の出力を選択し、特殊再生出力
でないとき前記子画面用映像信号の水平同期信号
を選択するアナログスイツチとを備え、前記Ｄ型
フリツプフロツプのデータ入力には前記アナログ
スイツチの出力が、クロツク入力には前記子画面
用映像信号の垂直同期信号が夫々印加されてなる
ことを特徴とするビデオメモリの制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987147932U JPS6452364U (ja) | 1987-09-28 | 1987-09-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987147932U JPS6452364U (ja) | 1987-09-28 | 1987-09-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6452364U true JPS6452364U (ja) | 1989-03-31 |
Family
ID=31418795
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1987147932U Pending JPS6452364U (ja) | 1987-09-28 | 1987-09-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6452364U (ja) |
-
1987
- 1987-09-28 JP JP1987147932U patent/JPS6452364U/ja active Pending
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