JPS6454467U - - Google Patents

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JPS6454467U
JPS6454467U JP14840487U JP14840487U JPS6454467U JP S6454467 U JPS6454467 U JP S6454467U JP 14840487 U JP14840487 U JP 14840487U JP 14840487 U JP14840487 U JP 14840487U JP S6454467 U JPS6454467 U JP S6454467U
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JP
Japan
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video signal
circuit
signal
synchronization
pulse
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JP14840487U
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【図面の簡単な説明】
第1図はこの考案に係るCRT表示装置のクラ
ンプパルス発生回路の一実施例を示す回路図、第
2図は従来のクランプパルス発生回路の一例を示
す回路図、第3図はクランプパルスと映像信号の
タイミングを示すタイムチヤートである。 11……映像入力端子、12……同期信号入力
端子、13……同期分離回路、14,15……単
安定マルチバイブレータ回路、16……積分回路
、17……オアゲート、D……ダイオード。

Claims (1)

  1. 【実用新案登録請求の範囲】 同期信号が複合した複合映像信号及び同期信号
    を別系統の線路によつて伴つているセパレート映
    像信号とが選択的に入力されるCRT表示装置に
    おいて、 前記複合映像信号及びセパレート映像信号が導
    かれる第1の端子と、 前記セパレート映像信号に伴つた同期信号が導
    かれる第2の端子と、 前記第1の端子からの複合映像信号が入力され
    この信号を同期分離して同期信号を出力する同期
    分離回路と、 前記同期分離回路からの同期信号が入力されこ
    の同期信号の水平周期のパルス成分でトリガされ
    て所定幅のクランプ用パルスを発生する第1の回
    路と、 前記第2の端子からの同期信号の水平同期パル
    ス成分によつてトリガされ所定幅のクランプ用パ
    ルスを発生する第2の回路と、 セパレート映像信号の入力時に前記第2の端子
    からの同期信号を利用して第1の回路の動作を禁
    止する第2回路とを具備し、 これら第1及び第2の回路からの各クランプパ
    ルスを複合映像信号入力時及びセパレート映像信
    号入力時の共通のクランプパルスとするようにし
    たことを特徴とするCRT表示装置のクランプパ
    ルス発生回路。
JP14840487U 1987-09-30 1987-09-30 Pending JPS6454467U (ja)

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JP14840487U JPS6454467U (ja) 1987-09-30 1987-09-30

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JP14840487U JPS6454467U (ja) 1987-09-30 1987-09-30

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JPS6454467U true JPS6454467U (ja) 1989-04-04

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ID=31419698

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JP14840487U Pending JPS6454467U (ja) 1987-09-30 1987-09-30

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