KR100856005B1 - 탄소-함유 실리콘 옥사이드 막을 에칭하는 방법 - Google Patents
탄소-함유 실리콘 옥사이드 막을 에칭하는 방법 Download PDFInfo
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Abstract
Description
| 공정 파라미터 | 바람직한 공정 조건 | 보다 바람직한 공정 조건 | 가장 바람직한 공정 조건 |
| NH3 유속(sccm) | 50 -150 | 75 - 125 | 75 - 100 |
| CxFy 유속(sccm) | 10 -30 | 15 - 25 | 18 - 25 |
| O2 유속(sccm) | 0 - 30 | 0 - 20 | 0 - 10 |
| Ar 유속(sccm) | 0 - 1000 | 0 - 800 | 0 - 500 |
| 플라즈마 소스 전력* - 외부(W) | 800 - 2000 | 800 - 1600 | 1000 - 1600 |
| 플라즈마 소스 전력* - 내부(W) | 0 - 1000 | 0 - 600 | 0 - 500 |
| 기판 바이어스 전력**(W) | 600 - 1800 | 600 - 1500 | 800 - 1200 |
| 기판 바이어스 전압(-V) | 200 - 1000 | 200 -800 | 400 - 700 |
| 공정 챔버 압력(mTorr) | 10 - 60 | 20 - 40 | 30 - 40 |
| 기판 온도(℃) | -15 - +15 | -15 - +15 | -15 - +15 |
| 순서 | 1 | 2 | 3 | 4 | 5 | 6 | 7 | 8 |
| NH3(sccm) | 100 | 100 | 100 | 70 | 70 | 70 | 70 | 70 |
| C4F8(sccm) | 25 | 25 | 25 | 25 | 18 | 25 | 28 | 25 |
| Ar(sccm) | -- | -- | 100 | -- | -- | -- | -- | -- |
| 공정챔버압력 (mTorr) | 60 | 40 | 40 | 40 | 40 | 40 | 40 | 30 |
| 소스전력 (W)* | 1600 | 1600 | 1600 | 1200 | 1200 | 1200 | 1200 | 1200 |
| 바이어스 전력(W) | 1200 | 1200 | 1200 | 1000 | 1000 | 850 | 1000 | 1000 |
| 기판온도 (℃)** | 60 | 60 | 60 | 60 | 60 | 60 | 60 | 60 |
| SiO2 에칭속도 (㎛/min) | 3.1 | 2.4 | 2.2 | 2.6 | 2.8 | 2.5 | 2.6 | 2.2 |
| SiO2:PR***에칭선택도 | 4.1:1 | 2.0:1 | 2.9:1 | 16:1 | 6.3:1 | 25:1 | 16:1 | 13:1 |
| 에칭 프로파일 | 끝이 뾰족 | 가는 홈 | 약간 휨 | 수직 | 수직 | 수직 | 수직 | 휨 |
Claims (21)
- 탄소-함유 실리콘 옥사이드 막의 에칭방법으로서,탄소-함유 실리콘 옥사이드 막 상부의 패터닝된 포토레지스트 층을 갖는 반도체 구조를 제공하는 단계; 및NH3 및 CxFy를 포함하는 소스 기체로부터 생성된 플라즈마에 상기 탄소-함유 실리콘 옥사이드 막을 노출시키는 단계를 포함하며,상기 소스 기체내의 탄소:질소 원자 비율은 0.3:1 내지 3:1의 범위이며, 이에 의해 상기 탄소-함유 실리콘 옥사이드 막은, 5:1 내지 25:1의 범위인 상기 탄소-함유 실리콘 옥사이드 막:상기 상부의 포토레지스트 층의 에칭 속도비로, 상기 상부의 포토레지스트 층에 대해 선택적으로 에칭되는 에칭방법.
- 제 1항에 있어서,상기 탄소-함유 실리콘 옥사이드 막은 8 내지 30 원자 퍼센트(atomic percent) 범위의 탄소를 포함하는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 탄소-함유 실리콘 옥사이드 막은 30 원자 퍼센트 내지 50 원자 퍼센트 범위의 농도인 수소를 더 포함하는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 소스 기체 내에서의 탄소:질소 원자 비율은 0.5:1 내지 1.4:1의 범위인 것을 특징으로 하는 에칭방법.
- 제 4항에 있어서,상기 소스 기체 내에서의 탄소:질소 원자 비율은 0.6:1 내지 1:1의 범위인 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 x의 범위는 1 내지 6 사이이며, 상기 y의 범위는 4 내지 8인 것을 특징으로 하는 에칭방법.
- 제 6항에 있어서,상기 x는 2 내지 5이며, 상기 y는 6 내지 8인 것을 특징으로 하는 에칭방법.
- 제 7항에 있어서,상기 CxFy 기체는 C2F6, C3F6, C4F6, C4F8, C5F8, 및 이것들의 혼합으로 이루어진 군으로부터 선택되는 것을 특징으로 하는 에칭방법.
- 제 8항에 있어서,상기 CxFy 기체는 C2F6 및 C4F8로 이루어진 군으로부터 선택되는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 소스 기체는 20 부피 퍼센트 내지 30 부피 퍼센트 범위의 농도인 O2를 더 포함하는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 소스 기체는 아르곤, 헬륨, 크세논, 크립톤 및 이것들의 혼합으로 이루어진 군으로부터 선택된 비-반응성 희석 기체를 더 포함하는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 탄소-함유 실리콘 옥사이드 막은 분당 0.8㎛ 내지 분당 3.1㎛의 속도로 에칭되는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 탄소-함유 실리콘 옥사이드 막의 에칭 속도 대 상기 상부 포토레지스트 층의 에칭 속도의 비율은 10:1 내지 25:1의 범위인 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,-200V 내지 -1000V 범위 내의 기판 바이어스 전압이 상기 방법의 수행동안에 인가되는 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 방법의 수행 동안에 기판 프로세싱 영역내의 플라즈마 밀도는 5×1011e-/cm3 내지 5×1012e-/cm3 범위 내인 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,상기 방법의 수행 동안에 인가된 전체 소스 전력은 800W 내지 2000W의 범위인 것을 특징으로 하는 에칭방법.
- 탄소-함유 실리콘 옥사이드 막을 에칭하는 방법으로서,NH3 및 CxFy를 포함하는 소스 기체로부터 생성된 플라즈마에 상기 탄소-함유 실리콘 옥사이드 막을 노출시키는 단계 - 상기 소스 기체내의 탄소:질소 원자 비율은 0.3:1 내지 3:1의 범위임 -; 및상기 반도체 구조에 -200V 내지 -1000V 범위 내에서 기판 바이어스를 인가하고, 상기 에칭이 실행되는 공정 챔버 외부에 있는 하나의 디바이스와 상기 공정 챔버 내부에 있는 하나의 디바이스를 이용하여 플라즈마 소스 전력을 인가하는 단계 - 이에 의해 상기 탄소-함유 실리콘 옥사이드 막은, 5:1 내지 25:1의 범위인 상기 탄소-함유 실리콘 옥사이드 막:상기 상부의 포토레지스트 층의 에칭 속도비로, 상기 상부의 포토레지스트 층에 대해 선택적으로 에칭됨 - ;를 포함하는 에칭방법.
- 제 17항에 있어서,상기 인가된 플라즈마 소스 전력의 합은 800W 내지 3,000W의 범위인 것을 특징으로 하는 에칭방법.
- 제 1항에 있어서,외부에 있는 상기 디바이스를 사용하여 인가되는 플라즈마 소스 전력 : 내부에 있는 상기 디바이스를 사용하여 인가되는 플라즈마 소스 전력의 비율은 2:1인 것을 특징으로 하는 에칭방법.
- 제1항, 제2항, 제3항, 또는 제17항 중 어느 한 항에 있어서, 상기 탄소-함유 실리콘 산화물 막이 실리콘 산화물 구조에 접합된 메틸기를 포함하는 것을 특징으로 하는 에칭 방법.
- 제20항에 있어서, 상기 탄소-함유 실리콘 옥사이드 막은 8 원자 퍼센트 내지 30 원자 퍼센트 범위의 탄소 함량을 나타내는 것을 특징으로 하는 에칭 방법.
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| US7311852B2 (en) * | 2001-03-30 | 2007-12-25 | Lam Research Corporation | Method of plasma etching low-k dielectric materials |
| US6905968B2 (en) * | 2001-12-12 | 2005-06-14 | Applied Materials, Inc. | Process for selectively etching dielectric layers |
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| EP1646083B1 (en) * | 2004-10-08 | 2016-08-31 | Imec | Alternative dual damascene patterning approach |
| US7659206B2 (en) * | 2005-01-18 | 2010-02-09 | Applied Materials, Inc. | Removal of silicon oxycarbide from substrates |
| US7208325B2 (en) * | 2005-01-18 | 2007-04-24 | Applied Materials, Inc. | Refreshing wafers having low-k dielectric materials |
| US7465670B2 (en) * | 2005-03-28 | 2008-12-16 | Tokyo Electron Limited | Plasma etching method, plasma etching apparatus, control program and computer storage medium with enhanced selectivity |
| US7393795B2 (en) * | 2006-02-01 | 2008-07-01 | Applied Materials, Inc. | Methods for post-etch deposition of a dielectric film |
| KR100788380B1 (ko) * | 2006-09-29 | 2008-01-02 | 동부일렉트로닉스 주식회사 | 반도체 소자 형성 방법 |
| US8083963B2 (en) * | 2007-02-08 | 2011-12-27 | Applied Materials, Inc. | Removal of process residues on the backside of a substrate |
| US7878054B2 (en) * | 2007-02-28 | 2011-02-01 | The Boeing Company | Barrier coatings for polymeric substrates |
| US8043981B2 (en) * | 2009-04-21 | 2011-10-25 | Applied Materials, Inc. | Dual frequency low temperature oxidation of a semiconductor device |
| JP7414593B2 (ja) * | 2020-03-10 | 2024-01-16 | 東京エレクトロン株式会社 | 基板処理方法及び基板処理装置 |
| US11487058B2 (en) * | 2020-08-13 | 2022-11-01 | Applied Materials, Inc. | Method for manufacturing optical device structures |
| US12674927B2 (en) | 2022-04-20 | 2026-07-07 | Applied Materials, Inc. | Method for roughness reduction in manufacturing optical device structures |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR930017110A (ko) * | 1992-01-29 | 1993-08-30 | 제임스 조셉 드롱 | 수소 라디칼을 포함하는 반응성 이온 부식 공정 |
| JPH09260350A (ja) * | 1996-03-19 | 1997-10-03 | Sony Corp | 酸化シリコン系絶縁膜のプラズマエッチング方法 |
Family Cites Families (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4427516A (en) * | 1981-08-24 | 1984-01-24 | Bell Telephone Laboratories, Incorporated | Apparatus and method for plasma-assisted etching of wafers |
| US4857140A (en) * | 1987-07-16 | 1989-08-15 | Texas Instruments Incorporated | Method for etching silicon nitride |
| JPH02280355A (ja) | 1989-04-20 | 1990-11-16 | Matsushita Electron Corp | 半導体装置 |
| JPH09237785A (ja) | 1995-12-28 | 1997-09-09 | Toshiba Corp | 半導体装置およびその製造方法 |
| US5814563A (en) * | 1996-04-29 | 1998-09-29 | Applied Materials, Inc. | Method for etching dielectric using fluorohydrocarbon gas, NH3 -generating gas, and carbon-oxygen gas |
| US6340435B1 (en) * | 1998-02-11 | 2002-01-22 | Applied Materials, Inc. | Integrated low K dielectrics and etch stops |
| US6217786B1 (en) | 1998-12-31 | 2001-04-17 | Lam Research Corporation | Mechanism for bow reduction and critical dimension control in etching silicon dioxide using hydrogen-containing additive gases in fluorocarbon gas chemistry |
| US6251770B1 (en) * | 1999-06-30 | 2001-06-26 | Lam Research Corp. | Dual-damascene dielectric structures and methods for making the same |
| US6114259A (en) | 1999-07-27 | 2000-09-05 | Lsi Logic Corporation | Process for treating exposed surfaces of a low dielectric constant carbon doped silicon oxide dielectric material to protect the material from damage |
| JP3400770B2 (ja) | 1999-11-16 | 2003-04-28 | 松下電器産業株式会社 | エッチング方法、半導体装置及びその製造方法 |
| US6165891A (en) * | 1999-11-22 | 2000-12-26 | Chartered Semiconductor Manufacturing Ltd. | Damascene structure with reduced capacitance using a carbon nitride, boron nitride, or boron carbon nitride passivation layer, etch stop layer, and/or cap layer |
| US6350670B1 (en) * | 1999-12-17 | 2002-02-26 | Intel Corporation | Method for making a semiconductor device having a carbon doped oxide insulating layer |
| US6284657B1 (en) * | 2000-02-25 | 2001-09-04 | Chartered Semiconductor Manufacturing Ltd. | Non-metallic barrier formation for copper damascene type interconnects |
| US6346490B1 (en) * | 2000-04-05 | 2002-02-12 | Lsi Logic Corporation | Process for treating damaged surfaces of low k carbon doped silicon oxide dielectric material after plasma etching and plasma cleaning steps |
| US6368979B1 (en) * | 2000-06-28 | 2002-04-09 | Lsi Logic Corporation | Process for forming trenches and vias in layers of low dielectric constant carbon-doped silicon oxide dielectric material of an integrated circuit structure |
-
2000
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-
2001
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Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR930017110A (ko) * | 1992-01-29 | 1993-08-30 | 제임스 조셉 드롱 | 수소 라디칼을 포함하는 반응성 이온 부식 공정 |
| KR100305508B1 (ko) | 1992-01-29 | 2001-11-30 | 조셉 제이. 스위니 | 수소라디칼을포함하는반응성이온에칭방법 |
| JPH09260350A (ja) * | 1996-03-19 | 1997-10-03 | Sony Corp | 酸化シリコン系絶縁膜のプラズマエッチング方法 |
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| Publication number | Publication date |
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