KR20170040384A - 배터리 팩용 인터커넥트 - Google Patents
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Abstract
Description
도 1a는 일부 실시예에 따른, 원통형 배터리 전지의 어레이의 예를 도시하는 평면 개략도이다.
도 1b는 일부 실시예에 따른, 절연 층의 예를 도시하는 평면 개략도이다.
도 1c는 배터리 전지의 단자에 대한 절연 층 내의 개구부의 정렬을 설명하기 위한, 원통형 배터리 전지의 어레이 위에 배치된 절연 층의 예를 도시한 가상의 평면 개략도이다.
도 1d는 일부 실시예에 따른, 전도성 층의 예를 도시하는 평면 개략도이다.
도 1e는 일부 실시예에 따른, 인터커넥트 회로의 예를 도시하는 평면 개략도이다.
도 1f는 일부 실시예에 따른, 2개의 인터커넥트 회로와 상호 연결된 배터리 전지를 포함하는 배터리 팩의 측면 개략도이다.
도 1g는 일부 실시예에 따른, 하나의 인터커넥트 회로가 배터리 전지의 양 세트에 연결되는 3개의 인터커넥트 회로를 이용하여 상호 연결된 배터리 전지의 2개의 세트를 포함하는 다른 배터리 팩의 측면 개략도이다.
도 2i의 (a)는 일부 실시예에 따른, 절연 층의 일부의 예를 도시하는 평면 개략도이다.
도 2i의 (b)는 일부 실시예에 따른, 접촉 패드를 포함하는 접촉 층의 일부의 예를 도시하는 평면 개략도이다.
도 2i의 (c) 및 도 2ii의 (d)는 일부 실시예에 따른, 상이한 인터커넥트 회로들의 평면 개략도이다.
도 2ii의 (e)는 일부 실시예에 따른, 절연 층에 의해서 지지되는 가용성 링크의 횡단면적 개략도이다.
도 2iii의 (f) 및 도 2iii의 (g)는 일부 실시예에 따른, 여러 제조 스테이지 중의 인터커넥트 회로의 평면 개략도이다.
도 2iii의 (h)는 일부 실시예에 따른, 접촉 패드의 가요성을 보여주는 도 2iii의 (g)에 또한 도시된 인터커넥트 회로의 횡단면적 개략도이다.
도 3a 및 도 3b는 일부 실시예에 따른, 전기 모니터링 및 제어 트레이스를 포함하는 인터커넥트 회로의 평면 개략도이다.
도 4a 내지 도 4c는 일부 실시예에 따른, 인터커넥트 회로를 가지는 배터리 팩의 측면 개략도이다.
도 5a는 일부 실시예에 따른, 각주형 배터리 전지의 어레이의 평면 개략도이다.
도 5b는 일부 실시예에 따른, 각주형 배터리 전지를 상호 연결하기에 적합한 인터커넥트 회로의 평면 개략도이다.
도 5c는 일부 실시예에 따른, 각주형 배터리 전지를 상호 연결하기에 적합한 인터커넥트 회로의 평면 개략도이다.
도 5d는 일부 실시예에 따른, 각주형 배터리 전지를 상호 연결하기에 적합한 인터커넥트 회로의 평면 개략도이다.
도 5e는 일부 실시예에 따른, 각주형 배터리 전지를 상호 연결하기에 적합한 인터커넥트 회로의 평면 개략도이다.
도 5i의 (f) 및 도 5i의 (g)는 일부 실시예에 따른, 회로를 제조하는 상이한 스테이지들에서 인터커넥트 회로를 이용한 각주형 배터리 전지의 단자의 상호 연결을 도시한 측면 개략도이다.
도 6a는 일부 실시예에 따른, 각주형 배터리 전지의 다른 어레이의 평면 개략도이다.
도 6b는 일부 실시예에 따른, 각주형 배터리 전지를 상호 연결하기에 적합한 인터커넥트 회로의 평면 개략도이다.
도 6c는 일부 실시예에 따른, 전기 모니터링 및 제어 트레이스를 포함하는 인터커넥트 회로의 평면 개략도이다.
도 6d는 일부 실시예에 따른, 전기 모니터링 및 제어 트레이스를 포함하는 2-층 인터커넥트 회로의 평면 개략도이다.
도 7a 내지 도 7d 각각은, 일부 실시예에 따른, 인터커넥트 회로를 가지는 각주형 배터리 전지의 단자의 상호 연결을 도시한, 측면, 평면, 측면 및 측면 개략도이다.
도 8a는 일부 실시예에 따른, 배터리 전지의 그룹의 예를 도시하는 평면 개략도이다.
도 8b는 배터리 전지의 단자에 대한 절연 층 내의 개구부의 정렬을 설명하기 위한, (도 8a에 도시된) 원통형 배터리 전지의 그룹 위에 배치된 절연 층의 예를 도시한 가상의 평면 개략도이다.
도 8c는 일부 실시예에 따른, 인터커넥트 회로의 예를 도시하는 평면 개략도이다.
도 8d는 일부 실시예에 따른, 인터커넥트 회로의 다른 예를 도시하는 평면 개략도이다.
도 8e 내지 도 8f는 일부 실시예에 따른, 적층된 배터리 전지의 어레이 및 인터커넥트 회로의 다양한 배열을 도시하는 측면 개략도이다.
도 8g는 일부 실시예에 따른, 배터리 전지에 대한 접촉의 근접부에서의 인터커넥트 회로의 평면(상부) 개략도이다.
도 8h는 일부 실시예에 따른, 배터리 팩의 예를 도시하는 분해 개략도이다.
도 9는 일부 실시예에 따른, 인터커넥트 회로를 형성하는 방법에 상응하는 프로세스 흐름도이다.
도 10a 내지 도 10c는 일부 실시예에 따른, 전도성 층의 여러 예를 도시하는 측면 개략도이다.
도 11i의 (a)는 일부 실시예에 따른, 접촉 패드를 가지는 전도성 층의 일부의 예를 도시하는 평면 개략도이다.
도 11i의 (b)는 일부 실시예에 따른, 지지 층의 일부의 예를 도시하는 평면 개략도이다.
도 11i의 (c)는 일부 실시예에 따른, 인터커넥트 회로의 평면 개략도이다.
도 11ii의 (d)는 일부 실시예에 따른, 접촉 패드를 가지는 전도성 층의 일부의 예를 도시하는 평면 개략도이다.
도 11ii의 (e)는 일부 실시예에 따른, 지지 층의 일부의 다른 예를 도시하는 평면 개략도이다.
도 11ii의 (f)는 일부 실시예에 따른, 다른 인터커넥트 회로의 평면 개략도이다.
도 12a 및 도 12b는 일부 실시예에 따른, 상이한 인터커넥트 회로들의 평면 개략도이다.
도 13a는 일부 실시예에 따른, 제2 절연 층의 예를 도시하는 평면적 개략도이다.
도 13b는 일부 실시예에 따른, 인터커넥트 회로의 평면 개략도이다.
도 13c는 일부 실시예에 따른, 도 13b의 인터커넥트 회로의 측면 개략도이다.
도 14a 내지 도 14c는 일부 실시예에 따른, 상이한 인터커넥트 회로들의 측면 개략도이다.
도 15a 내지 도 15c는 일부 실시예에 따른, 전도성 층 및 하나 이상의 절연 층을 각각 포함하는 상이한 적층체들의 측면 개략도이다.
여기에서 설명되는 기술의 일부 실시예에 관한 전술한 설명뿐만 아니라 전술한 요지는 첨부 도면과 함께 읽을 때 보다 잘 이해될 것이다. 여기에서 설명되는 기술을 설명하기 위한 목적으로, 일부 실시예를 도면에 도시하였다. 그러나, 여기에서 설명되는 기술은 첨부 도면에 도시된 배열 및 수단으로 제한되지 않는다는 것을 이해하여야 할 것이다. 또한, 도면의 구성요소는 실제 축척(scale)이 아니고, 하나의 구성요소의 다른 구성요소에 대한 상대적인 크기는 그러한 상대적인 크기를 요구하는 것으로 이해되거나 해석되지 않아야 한다는 것을 이해하여야 할 것이다.
Claims (20)
- 배터리 전지의 어레이를 상호 연결하기 위한 인터커넥트 회로를 형성하는 방법이며:
전도성 층 내에 전도성 층 개구부의 세트를 형성하는 단계로서,
상기 세트 내의 전도성 층 개구부가 둘 이상의 연결 탭에 의해서 서로로부터 분리되고,
상기 전도성 층 개구부의 세트 및 둘 이상의 연결 탭이 상기 전도성 층의 영역을 둘러싸고 형성하며, 그리고
상기 전도성 층 개구부의 세트를 형성한 후에, 상기 둘 이상의 연결 탭이, 상기 전도성 층의 다른 부분에 대해서 전도성 층의 영역을 기계적으로 지지하고 그 정합을 유지하는, 전도성 층 개구부의 세트를 형성하는 단계;
상기 전도성 층 개구부의 세트를 포함하는 상기 전도성 층을 지지 층에 적층하는 단계로서,
상기 전도성 층을 상기 지지 층에 적층한 이후에, 상기 지지 층은, 상기 전도성 층의 다른 부분에 대해서 전도성 층의 영역을 기계적으로 지지하고 그 정합을 유지하는, 전도성 층을 지지 층에 적층하는 단계; 및
상기 둘 이상의 연결 탭 중 적어도 하나를 제거하는 단계로서,
상기 전도성 층 개구부의 세트를, 상기 전도성 층의 영역을 적어도 부분적으로 둘러싸고 형성하는 연속적인 전도성 층 채널로 전환하는, 둘 이상의 연결 탭 중 적어도 하나를 제거하는 단계
를 포함하는, 방법. - 제1항에 있어서,
상기 둘 이상의 연결 탭 중 적어도 다른 하나를 보유하는 한편 상기 둘 이상의 연결 탭 중 적어도 하나를 제거하며, 상기 둘 이상의 연결 탭 중 보유되는 적어도 하나의 탭이 상기 전도성 층의 영역을 상기 전도성 층의 다른 부분과 상호 연결시키는, 방법. - 제2항에 있어서,
상기 둘 이상의 연결 탭 중 보유되는 적어도 하나의 탭이 가용성 링크로서 동작될 수 있고, 상기 전도성 층의 영역과 상기 전도성 층의 다른 부분 사이의 전류 레벨을 제한하는, 방법. - 제2항에 있어서,
상기 연속적인 전도성 채널이 상기 둘 이상의 연결 탭 중 보유되는 적어도 하나의 탭에서 종료되는, 방법. - 제4항에 있어서,
상기 연속적인 전도성 채널이 개방 링 형상을 가지는, 방법. - 제1항에 있어서,
상기 둘 이상의 연결 탭 중 적어도 하나를 제거하는 단계는 상기 둘 이상의 연결 탭의 전부를 제거하는 단계를 포함하는, 방법. - 제1항에 있어서,
상기 둘 이상의 연결 탭 중 적어도 하나를 제거하는 단계는 또한 상기 둘 이상의 연결 탭 중 적어도 하나에 적층된 상기 지지 층의 적어도 하나의 지지 층 부분을 제거하는, 방법. - 제1항에 있어서,
상기 지지 층이 제1 절연 층으로서 동작될 수 있고 상기 인터커넥트 회로의 일부를 유지하는, 방법. - 제8항에 있어서,
상기 둘 이상의 연결 탭 중 적어도 하나를 제거하는 동안, 상기 지지 층이 실질적으로 손상되지 않고 유지되는, 방법. - 제1항에 있어서,
상기 둘 이상의 연결 탭 중 적어도 하나를 제거하는 단계 이후에, 상기 전도성 층이 제1 절연 층과 상기 지지 층 사이에 배치되도록, 제1 절연 층을 상기 전도성 층에 적층하는 단계; 및
상기 제1 절연 층을 상기 전도성 층에 적층하는 단계 이후에, 상기 전도성 층으로부터 상기 지지 층을 제거하는 단계를 더 포함하는, 방법. - 제10항에 있어서,
상기 제1 절연 층은, 상기 제1 절연 층을 상기 전도성 층에 적층하는 단계에 앞서서, 제1 절연 층을 포함하고, 상기 전도성 층 개구부는, 상기 제1 절연 층을 상기 전도성 층에 적층하는 동안, 상기 제1 절연 층 개구부를 위한 정렬 피쳐를 제공하는, 방법. - 제10항에 있어서,
상기 제1 절연 층을 상기 전도성 층에 적층하는 단계에 앞서서, 상기 제1 절연 층은 제1 절연 층 슬릿을 포함하고, 그리고
상기 제1 절연 층을 상기 전도성 층에 적층하는 단계 이후에, 상기 제1 절연 층 슬릿이 상기 연속적인 전도성 층 채널의 경계 내에 배치되는, 방법. - 제10항에 있어서,
상기 제1 절연 층을 상기 전도성 층에 적층하는 단계 이전에, 상기 제1 절연 층이 제1 절연 층 개구부를 포함하고, 그리고
상기 제1 절연 층을 상기 전도성 층에 적층하는 단계 이후에, 상기 절연 층 개구부 중 적어도 하나가 상기 전도성 층의 영역과 중첩되는, 방법. - 제13항에 있어서,
상기 전도성 층의 영역의 연부가 상기 제1 절연 층에 의해서 지지되는, 방법. - 제10항에 있어서,
상기 지지 층을 상기 전도성 층으로부터 제거하는 단계 이후에, 상기 전도성 층이 상기 제1 절연 층과 제2 절연 층 사이에 배치되도록, 제2 절연 층을 상기 전도성 층에 적층시키는 단계를 더 포함하는, 방법. - 제15항에 있어서,
상기 제1 절연 층은 제1 절연 층 개구부를 포함하고, 상기 제2 절연 층은 상기 제1 층 개구부와 부분적으로 중첩되는 제2 절연 층 개구부를 포함하는, 방법. - 제1항에 있어서,
상기 인터커넥트 회로가 히트 싱크에 더 결합되는, 방법. - 제1항에 있어서,
상기 전도성 층을 상기 지지 층에 적층하는 단계 이전에, 기저부 하위층 및 표면 하위층을 가지는 전도성 층을 형성하는 단계를 더 포함하고,
상기 기저부 하위층은 상기 표면 하위층과 다른 조성을 가지며, 그리고
상기 전도성 층을 형성하는 단계는 상기 기저부 하위층 위에 상기 표면 하위층을 형성하는 단계를 포함하는, 방법. - 제18항에 있어서,
상기 전도성 층을 형성하는 단계는 상기 기저부 하위층 위에 그리고 상기 표면 하위층을 형성하는 단계 이전에 중간 하위층을 형성하는 단계를 더 포함하고, 상기 기저부 하위층 및 상기 표면 하위층의 각각의 조성이 상기 중간 하위층의 조성과 상이한, 방법. - 제18항에 있어서,
상기 표면 하위층은 상기 인터커넥트 회로 내의 제1 절연 층 또는 제2 절연 층 중 적어도 하나와 직접적으로 접촉되는, 방법.
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