KR20200078997A - 폴더블 디스플레이 - Google Patents

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    • G09G3/3233—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using electroluminescent panels semiconductive, e.g. using light-emitting diodes [LED] organic, e.g. using organic light-emitting diodes [OLED] using an active matrix with pixel circuitry controlling the current through the light-emitting element
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Abstract

본 발명은 폴더블 디스플레이에 관한 것으로, 제1 화면, 제2 화면, 상기 제1 화면과 상기 제2 화면 사이에 위치하고 폴딩 가능한 경계부를 포함하는 플렉시블 표시패널; 상기 제1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 데이터 라인들에 연결되어 상기 제1 화면과 상기 제1 경계부의 픽셀들을 구동하는 제1 드라이브 IC; 및 상기 제2 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 데이터 라인들에 연결되어 상기 제2 화면과 상기 제2 경계부의 픽셀들을 구동하는 제2 드라이브 IC를 포함한다.

Description

폴더블 디스플레이{FOLDABLE DISPLAY}
본 발명은 플렉시블 표시패널을 이용하여 화면이 접힐 수 있는 폴더블 디스플레이에 관한 것이다.
전계 발광 표시장치는 발광층의 재료에 따라 무기 발광 표시장치와 유기 발광 표시장치로 대별된다. 액티브 매트릭스 타입(active matrix type)의 유기 발광 표시장치는 스스로 발광하는 유기 발광 다이오드(Organic Light Emitting Diode: 이하, "OLED"라 함)를 포함하며, 응답속도가 빠르고 발광효율, 휘도 및 시야각이 큰 장점이 있다. 유기 발광 표시장치는 OLED(Organic Light Emitting Diode, OLED"라 함)가 픽셀들 각각에 형성된다. 유기 발광 표시장치는 응답속도가 빠르고 발광효율, 휘도, 시야각 등이 우수할 뿐 아니라, 블랙 계조를 완전한 블랙으로 표현할 수 있기 때문에 명암비(contrast ratio)와 색재현율이 우수하다.
유기 발광 표시장치는 액정과 백라이트 유닛(Backlight unit)이 없다. 유기 발광 표시장치의 픽셀들은 플렉시블(flexible) 소재인 플라스틱 기판, 박형 유리 기판, 금속 기판 상에 구현될 수 있다. 따라서, 유기 발광 표시 장치는 플렉시블 디스플레이에 적합하다.
플렉시블 디스플레이는 플렉시블 표시패널을 감거나 접고 구부리는 방법으로 화면의 크기가 가변될 수 있다. 플렉시블 디스플레이는 롤러블 디스플레이(rollable display), 벤더블(bendable) 디스플레이, 폴더블 디스플레이(foldable display), 슬라이더블 디스플레이(slidable display) 등으로 구현될 수 있다. 이러한 플렉시블 표시장치는 스마트폰과 태블릿 PC와 같은 모바일 기기뿐만 아니라 TV, 자동차 디스플레이, 웨어러블 기기 등에 적용될 수 있고 그 응용 분야가 확대되고 있다.
폴더블 디스플레이는 플렉시블 표시패널을 접거나 펴 화면 크기를 가변할 수 있다. 따라서, 폴더블 디스플레이는 휴대가 용이하면서도 화면을 크게 볼 수 있다.
본 발명은 화면 구동에 영향 없이 소비 전력을 줄일 수 있는 폴더블 디스플레이를 제공한다.
본 발명의 폴더블 디스플레이는 제1 화면, 제2 화면, 상기 제1 화면과 상기 제2 화면 사이에 위치하고 폴딩 가능한 경계부를 포함하는 플렉시블 표시패널; 상기 제1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 데이터 라인들에 연결되어 상기 제1 화면과 상기 제1 경계부의 픽셀들을 구동하는 제1 드라이브 IC; 및 상기 제2 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 데이터 라인들에 연결되어 상기 제2 화면과 상기 제2 경계부의 픽셀들을 구동하는 제2 드라이브 IC를 포함한다.
상기 제1 및 제2 화면들 중에서 상기 제1 화면만 구동될 때, 상기 제1 드라이브 IC에서 상기 제1 화면의 데이터 라인들에 연결된 채널들만 구동된다. 상기 제1 드라이브 IC에서 상기 제1 경계부에 연결된 채널들이 셧다운되고 상기 제2 드라이브 IC의 전체 채널들이 셧다운된다.
본 발명의 다른 실시예에 따른 폴더블 디스플레이는상기 제1 화면의 픽셀들과, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 픽셀들을 구동하는 제1 구동부; 및 상기 제2 화면의 픽셀들과, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 픽셀들을 구동하는 제2 구동부를 포함한다.
상기 제1 화면은 상기 경계부와 가까운 제1-1 화면과, 상기 제1-1 화면을 사이에 두고 상기 경계부로부터 분리된 제1-2 화면을 포함한다. 상기 제2 화면은 상기 경계부와 가까운 제2-1 화면과, 상기 제2-1 화면을 사이에 두고 상기 경계부로부터 분리된 제2-2 화면을 포함한다.
상기 제1 구동부는 상기 제1-1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 데이터 라인들에 연결되어 상기 제1 화면과 상기 제1 경계부의 픽셀들을 구동하는 제1-1 드라이브 IC; 및 상기 제1-2 화면의 데이터 라인들에 연결되어 상기 제1-2 화면을 구동하는 제1-2 드라이브 IC를 포함한다.
상기 제2 구동부는 상기 제2-1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 데이터 라인들에 연결되어 상기 제2 화면과 상기 제2 경계부의 픽셀들을 구동하는 제2-1 드라이브 IC; 및 상기 제2-2 화면의 데이터 라인들에 연결되어 상기 제2-2 화면을 구동하는 제2-2 드라이브 IC를 포함한다.
본 발명은 폴더블 디스플레이의 화면을 분할 구동하는 드라이브 IC들을 화면 구동 여부에 따라 선택적으로 셧다운할 뿐 아니라 폴더블 디스플레이에서 접혀지는 경계부에 연결된 드라이브 IC의 채널들을 선택적으로 셧다운한다. 그 결과, 본 발명은 경계부에 연결된 드라이브 IC의 채널들에서 소비 전류가 없고 셧다운된 드라이브 IC에서 소비 전류가 없기 때문에 화면 구동에 영향 없이 폴더블 디스플레이의 소비 전력을 줄일 수 있 수 있다.
나아가, 본 발명은 화면 구동 여부에 따라 게이트 구동부를 셧다운시켜 소비 전력을 게이트 구동부의 소비 전력을 줄일 수 있다.
도 1은 본 발명의 일 실시예에 따른 폴더블 디스플레이를 보여 주는 블록도이다.
도 2는 펜타일 픽셀 배치의 일 예를 보여 주는 도면이다.
도 3은 리얼 픽셀 배치의 일 예를 보여 주는 도면이다.
도 4는 플렉시블 표시패널이 접힌 예를 보여 주는 도면이다.
도 5는 플렉시블 표시패널의 화면 크기가 가변되는 예를 보여 주는 도면이다.
도 6a는 픽셀 회로의 일 예를 보여 주는 회로도이다.
도 6b는 도 6a에 도시된 픽셀 회로의 구동 방법을 보여 주는 도면이다.
도 7은 드라이브 IC의 출력 버퍼를 선택적으로 셧다운하는 방법을 보여 주는 도면이다.
도 8 내지 도 16은 제1 및 제2 드라이브 IC의 동작을 보여 주는 도면들이다.
도 17 내지 도 19는 게이트 구동부의 동작을 보여 주는 도면들이다.
도 20은 본 발명의 다른 실시예에 따른 폴더블 디스플레이를 보여 주는 도면이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나, 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
본 발명의 실시예를 설명하기 위한 도면에 개시된 형상, 크기, 비율, 각도, 개수 등은 예시적인 것이므로 본 발명이 도시된 사항에 한정되는 것은 아니다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다. 또한, 본 발명을 설명함에 있어서, 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명은 생략한다. 본 명세서 상에서 언급된 '포함한다', '갖는다', '이루어진다' 등이 사용되는 경우 ' ~ 만'이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별히 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함한다.
구성 요소를 해석함에 있어서, 별도의 명시적 기재가 없더라도 오차 범위를 포함하는 것으로 해석한다.
위치 관계에 대한 설명일 경우, 예를 들어, ' ~ 상에', ' ~ 상부에', ' ~ 하부에', ' ~ 옆에' 등으로 두 부분의 위치 관계가 설명되는 경우, '바로' 또는 '직접'이 사용되지 않는 이상 두 부분 사이에 하나 이상의 다른 부분이 위치할 수도 있다.
실시예 설명에서, 제1, 제2 등이 다양한 구성 요소들을 서술하기 위해서 사용되지만, 이들 구성 요소들은 이들 용어에 의해 제한되지 않는다. 이들 용어들은 단지 하나의 구성 요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성 요소는 본 발명의 기술적 사상 내에서 제2 구성요소일 수도 있다.
명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
본 발명의 여러 실시예들의 각각 특징들이 부분적으로 또는 전체적으로 서로 결합 또는 조합 가능하며, 기술적으로 다양한 연동 및 구동이 가능하며, 각 실시예들이 서로에 대하여 독립적으로 실시 가능할 수도 있고 연관 관계로 함께 실시 가능할 수도 있다.
본 발명의 폴더블 디스플레이에서 픽셀 회로와 게이트 구동부는 다수의 트랜지스터들을 포함할 수 있다. 트랜지스터들은 산화물 반도체를 포함한 Oxide TFT(Thin Film Transistor), 저온 폴리 실리콘(Low Temperature Poly Silicon, LTPS)을 포함한 LTPS TFT 등으로 로 구현될 수 있다. 트랜지스터들 각각은 p 채널 TFT 또는 n 채널 TFT로 구현될 수 있다. 실시예에서 픽셀 회로의 트랜지스터들이 p 채널 TFT로 구현된 예를 중심으로 설명되지만 본 발명은 이에 한정되지 않는다.
트랜지스터는 게이트(gate), 소스(source) 및 드레인(drain)을 포함한 3 전극 소자이다. 소스는 캐리어(carrier)를 트랜지스터에 공급하는 전극이다. 트랜지스터 내에서 캐리어는 소스로부터 흐르기 시작한다. 드레인은 트랜지스터에서 캐리어가 외부로 나가는 전극이다. 트랜지스터에서 캐리어의 흐름은 소스로부터 드레인으로 흐른다. n 채널 트랜지스터의 경우, 캐리어가 전자(electron)이기 때문에 소스로부터 드레인으로 전자가 흐를 수 있도록 소스 전압이 드레인 전압보다 낮은 전압을 가진다. n 채널 트랜지스터에서 전류의 방향은 드레인으로부터 소스 쪽으로 흐른다. p 채널 트랜지스터(PMOS)의 경우, 캐리어가 정공(hole)이기 때문에 소스로부터 드레인으로 정공이 흐를 수 있도록 소스 전압이 드레인 전압보다 높다. p 채널 트랜지스터에서 정공이 소스로부터 드레인 쪽으로 흐르기 때문에 전류가 소스로부터 드레인 쪽으로 흐른다. 트랜지스터의 소스와 드레인은 고정된 것이 아니라는 것에 주의하여야 한다. 예컨대, 소스와 드레인은 인가 전압에 따라 변경될 수 있다. 따라서, 트랜지스터의 소스와 드레인으로 인하여 발명이 제한되지 않는다. 이하의 설명에서 트랜지스터의 소스와 드레인을 제1 및 제2 전극으로 칭하기로 한다.
게이트 신호는 게이트 온 전압(Gate On Voltage)과 게이트 오프 전압(Gate Off Voltage) 사이에서 스윙(swing)한다. 게이트 온 전압은 트랜지스터의 문턱 전압 보다 높은 전압으로 설정되며, 게이트 오프 전압은 트랜지스터의 문턱 전압 보다 낮은 전압으로 설정된다. 트랜지스터는 게이트 온 전압에 응답하여 턴-온(turn-on)되는 반면, 게이트 오프 전압에 응답하여 턴-오프(turn-off)된다. n 채널 트랜지스터의 경우에, 게이트 온 전압은 게이트 하이 전압(Gate High Voltage, VGH)이고, 게이트 오프 전압은 게이트 로우 전압(Gate Low Voltage, VGL)일 수 있다. p 채널 트랜지스터의 경우에, 게이트 온 전압은 게이트 로우 전압(VGL)이고, 게이트 오프 전압은 게이트 하이 전압(VGH)일 수 있다.
이하, 첨부된 도면을 참조하여 본 발명의 다양한 실시예들을 상세히 설명한다.
도 1 내지 도 5를 참조하면, 본 발명의 폴더블 디스플레이는 플렉시블 표시패널(100), 플렉시블 표시패널(100)의 데이터 라인들(DL1~DL6)에 데이터 신호를 공급하는 드라이브 IC(Integrated Circuit)(300L, 300R), 플렉시블 표시패널(100)의 게이트 라인들(GL1~GL2)에 게이트 신호를 공급하는 게이트 구동부(120L, 120R)를 포함한다.
플렉시블 표시패널(100)에서 입력 영상이 재현되는 화면은 데이터 라인들(DL1~DL6), 데이터 라인들(DL1~DL6)과 교차되는 게이트 라인들(GL1, GL2), 및 픽셀들(P)이 매트릭스 형태로 배치된 픽셀 어레이를 포함한다. 화면은 제1 드라이브 IC(300L)에 의해 구동되는 제1 화면(L)과, 제2 드라이브 IC(300R)에 의해 구동되는 제2 화면(R)으로 나뉘어진다.
제1 화면(L)은 좌반부 화면이고, 제2 화면(R)은 우반부 화면일 수 있다. 제1 및 제2 화면(L, R)이 폴딩 경계부(EX)을 경계로 접힐 때(folding), 한 화면의 해상도는 X * Y이다. X는 제1 및 제2 화면(L, R) 각각의 X 축 방향 해상도이다. Y는 제1 및 제2 화면(L, R) 각각의 Y 축 방향 해상도이다. Y의 길이는 X/2 보다 길다.
제1 및 제2 화면(L, R)이 펼쳐진 상태에서(unfolding) 제1 및 제2 화면(L, R)이 모두 구동될 때 최대 해상도로 화면이 커지고, 최대 해상도는 (2X+α) * Y이다. α는 폴딩 경계부(EX)의 X축 방향 해상도이다. 폴딩 경계부(EX)에 픽셀들(P)이 배치되어 제1 및 제2 화면(L, R)이 펼쳐진 상태에서 제1 및 제2 화면 (L, R) 사이에서 영상이 끊기는 부분이 없다.
플렉시블 표시패널(100)이 도 4에 도시된 바와 같이 제1 화면(L)과 제2 화면(L) 사이에서 접힐 수 있고, 제1 및 제2 화면(L, R) 각각이 선택적으로 구동될 수 있다. 플렉시블 표시패널(100)이 접힐 때 화면(L, R)이 외부로 노출되는 아웃 폴딩(out folding) 방식으로 접혀질 수 있다.
도 5와 같이 제1 및 제2 화면(L, R) 중 어느 하나만 구동될 때 화면(L 또는 R)의 크기는 6 인치(6.x″)로 감소되고, 제1 및 제2 화면(L, R) 모두 구동되면 화면(L 및 R)의 크기는 7 인치(7.x″)로 확대된다.
픽셀들(P) 각각은 컬러 구현을 위하여 컬러가 다른 서브 픽셀들을 포함한다. 서브 픽셀들은 적색(Red, 이하 “R 서브 픽셀”이라 함), 녹색(Green, 이하 “G 서브 픽셀”이라 함), 및 청색(Blue, 이하 “B 서브 픽셀”이라 함)을 포함한다. 도시하지 않았으나 백색 서브 픽셀이 더 포함될 수 있다. 서브 픽셀들 각각은 내부 보상 회로를 포함한 픽셀 회로로 구현될 수 있다.
픽셀들(P)은 리얼(real) 컬러 픽셀과, 펜타일(pentile) 픽셀로 배치될 수 있다. 펜타일 픽셀은 미리 설정된 펜타일 픽셀 렌더링 알고리즘(pixel rendering algorithm)을 이용하여 도 2에 도시된 바와 같이 컬러가 다른 두 개의 서브 픽셀들을 하나의 픽셀(P)로 구동하여 리얼 컬러 픽셀 보다 높은 해상도를 구현한다. 펜타일 픽셀 렌더링 알고리즘은 픽셀들(P) 각각에서 부족한 컬러 표현을 인접한 픽셀에서 발광된 빛의 컬러로 보상한다. X * Y = 1440 * 2880 이고 폴딩 경계부(EX)의 X축 해상도가 40일 때, 펜타일 픽셀 구조에서 X * Y = 1440*4 * 2880이고, (2X+α) * Y = [(2880*4) + 40]*2880이다. 여기서, 4는 R, G, B, 및 G 서브 픽셀을 나타낸다. 폴딩 경계부(EX)의 폭 즉, X 축 길이는 폴딩 경계부(EX)의 곡률에 따라 결정된다. 폴딩 경계부(EX)의 해상도와 크기는 폴딩 경계부(EX)의 곡률 반경에 비례한다.
리얼 컬러 픽셀의 경우, 하나의 픽셀(P)이 도 3에 도시된 바와 같이 R, G 및 B 서브 픽셀로 구성된다.
플렉시블 표시패널(100)은 플라스틱 OLED 패널로 구현될 수 있다. 플라스틱 OLED 패널은 백 플레이트(Back plate) 상에 접착된 유기 박막 필름 상에 픽셀 어레이를 포함한다. 픽셀 어레이 위에 터치 센서 어레이가 형성될 수 있다. 백 플레이트는 PET(Polyethylene terephthalate) 기판일 수 있다. 백 플레이트는 픽셀 어레이가 습도에 노출되지 않도록 투습을 차단하고 픽셀 어레이가 형성된 유기 박막 필름을 지지한다. 유기 박막 필름은 얇은 PI(Polyimide) 필름 기판일 수 있다. 유기 박막 필름 상에 도시하지 않은 절연 물질로 다층의 버퍼막이 형성될 수 있다. 유기 박막 필름 상에 픽셀 어레이(103)와 터치 센서 어레이에 인가되는 전원이나 신호를 공급하기 위한 배선들이 형성될 수 있다. 플라스틱 OLED 패널에서 픽셀 회로는 도 6에 도시된 바와 같이 발광 소자로 이용되는 OLED, OLED를 구동하는 구동 소자, 구동 소자와 OLED의 전류 패스(current path)를 스위칭하는 다수의 스위치 소자, 구동 소자에 연결된 커패시터 등을 포함한다.
제1 드라이브 IC(300L)는 제1 화면(L)의 픽셀 어레이와 폴딩 경계부(EX)의 일부 픽셀들을 구동한다. 제1 드라이브 IC(300L)에 의해 구동되는 폴딩 경계부(EX)의 일부(이하, “제1 경계부”이라 함)은 폴딩 경계부(EX) 내에서 좌반부 픽셀들을 포함한다. 제2 드라이브 IC(300R)는 제2 화면(R)의 픽셀 어레이와 폴딩 경계부(EX)의 다른 일부 픽셀들을 구동한다. 제1 드라이브 IC(300L)에 의해 구동되는 폴딩 경계부(EX)의 다른 일부(이하, “제2 경계부”이라 함)는 폴딩 경계부(EX) 내에서 우반부 픽셀들을 포함한다.
플렉시블 표시패널(100)의 기판에는 픽셀 어레이와 함께 게이트 구동부(120L, 120R)가 실장될 수 있다. 게이트 구동부(120L, 120R)는 플렉시블 표시패널(100) 상에 직접 형성되는 GIP(Gate in panel) 회로로 구현될 수 있다.
게이트 구동부(120L, 120R)는 플렉시블 표시패널(100)의 좌우측 베젤(bezel) 중 일측 베젤에 배치되어 게이트 라인들(GL1, GL2)에 싱글 피딩(single feeding) 방식으로 게이트 신호를 공급할 수 있다. 이 경우, 도 1에서 두 개의 게이트 구동부(120L, 120R) 중 하나가 필요 없다.
게이트 구동부(120L, 120R)는 플렉시블 표시패널(100)의 좌우측 베젤들 각각에 배치되어 게이트 라인들(GL1, GL2)에 더블 피딩(single feeding) 방식으로 게이트 신호를 공급할 수 있다. 이 더블 피딩 방식에서, 하나의 게이트 라인의 양측 끝단에서 게이트 신호가 동시에 인가된다. 제1 게이트 구동부(120L)는 플렉시블 표시패널(100)의 좌측 베젤측에 배치되고, 제2 게이트 구동부(120R)는 플렉시블 표시패널(100)의 우측 베젤에 배치될 수 있다.
게이트 구동부(120L, 120R) 각각은 시프트 레지스터(Shift register)를 이용하여 드라이브 IC(300L, 300R)로부터 공급되는 게이트 제어 신호에 따라 구동되어 게이트 라인들(GL1, GL2)에 게이트 신호(GATE1, GATE2)를 순차적으로 공급한다. 시프트 레지스터는 게이트 신호(GATE1, GATE2)를 시프트시킴으로써 게이트 신호(GATE1, GATE2)를 게이트 라인들(GL1, GL2)에 순차적으로 공급할 수 있다. 게이트 신호(GATE1, GATE2)는 도 6에 도시된 스캔 신호[SCAN(N-1), SCAN(N)], EM 신호[EM(N)] 등을 포함할 수 있다. 게이트 신호(GATE1, GATE2)는 게이트 온 전압(VGL)과 게이트 오프 전압(VGH) 사이에서 스윙(swing)한다.
제1 및 제2 드라이브 IC들(300L, 300R) 중 하나 이상은 게이트 구동부(120L, 120R)를 구동하기 위한 게이트 제어 신호들을 발생한다. 게이트 제어 신호는 게이트 스타트 펄스(Gate start pulse, GSP), 게이트 시프트 클럭(Gate shift clock, GSC) 등의 게이트 타이밍 신호와, 게이트 온 전압(VGL) 및 게이트 오프 전압(VGH) 등의 게이트 전원을 포함한다.
제1 및 제2 드라이브 IC들(300L, 300R) 각각은 데이터 구동부(110), 감마 보상 전압 발생부(112), 타이밍 콘트롤러(130), 전원부(136), 제2 메모리(132), 레벨 시프터(Level shifter, 134) 등을 포함한다. 제1 및 제2 드라이브 IC들(300L, 300R)는 호스트 시스템(200), 제1 메모리(210), 및 플렉시블 표시패널(100)에 연결된다.
데이터 구동부(110)는 디지털-아날로그 변환기(Digital to Analog converter, 이하 "DAC"라 함)를 통해 타이밍 콘트롤러(130)로부터 수신된 입력 영상의 픽셀 데이터(디지털 신호)를 감마 보상 전압으로 변환하여 데이터 신호(DATA1~DATA6)를 출력한다. DAC는 픽셀 데이터를 감마 보상 전압으로 변환하여 데이터 신호(DATA1~DATA6)의 전압(이하, "데이터 전압"이라 함)을 출력한다. 데이터 구동부(110)로부터 출력된 데이터 전압은 드라이브 IC(300L, 300R)의 데이터 채널에 연결된 출력 버퍼(Source AMP)를 통해 픽셀 어레이의 데이터 라인들(DL1~DL6)에 공급된다. 감마 보상 전압 발생부(112)는 전원부(136)로부터의 입력 전압을 분압 회로를 통해 분배하여 계조별 감마 보상 전압을 발생하여 데이터 구동부(110)에 공급한다.
타이밍 콘트롤러(130)는 호스트 시스템(200)으로부터 수신되는 입력 영상의 픽셀 데이터를 데이터 구동부(110)에 공급한다. 타이밍 콘트롤러(130)는 호스트 시스템(200)으로부터 수신된 타이밍 신호를 이용하여 게이트 구동부(120L, 120R)와 데이터 구동부(110)의 동작 타이밍을 제어한다.
레벨 시프터(134)는 타이밍 콘트롤러(130)로부터 수신된 게이트 타이밍 신호의 로우 레벨 전압(low level voltage)을 게이트 온 전압(VGL)으로 변환하고, 게이트 타이밍 신호의 하이 레벨 전압(high level voltage)을 게이트 오프 전압(VGH)으로 변환한다. 레벨 시프터(134)로부터 출력된 게이트 타이밍 신호와 게이트 전원은 드라이브 IC(300L, 300R)의 게이트 채널을 통해 게이트 구동부(120L, 120R)에 공급된다.
전원부(136)는 직류-직류 변환기(DC-DC Converter)를 이용하여 플렉시블 표시패널(100)의 픽셀 어레이, 게이트 구동부(120L, 120R), 및 드라이브 IC들(300L, 300R)의 구동에 필요한 전원을 발생한다. 직류-직류 변환기는 차지 펌프(Charge pump), 레귤레이터(Regulator), 벅 변환기(Buck Converter), 부스트 변환기(Boost Converter) 등을 포함할 수 있다. 전원부(136)는 호스트 시스템(200)으로부터의 직류 입력 전압을 조정하여 감마 기준 전압, 게이트 온 전압(VGL). 게이트 오프 전압(VGH), 픽셀 구동 전압(ELVDD), 저전위 전원 전압(ELVSS), 초기화 전압(Vini) 등의 직류 전원을 발생할 수 있다. 감마 기준 전압은 감마 보상 전압 발생부(112)에 공급된다. 게이트 온 전압(VGL)과 게이트 오프 전압(VGH)은 레벨 시프터(134)와 게이트 구동부(120)에 공급된다. 픽셀 구동 전압(ELVDD), 저전위 전원 전압(ELVSS), 초기화 전압(Vin) 등의 픽셀 전원은 픽셀들(P)에 공통으로 공급된다.
게이트 전원은 VGH = 8V, VGL = -7V로, 픽셀 전원은 ELVDD = 4.6V, ELVSS = -2 ~ -3V, Vini = -3 ~ -4V로 설정될 수 있으나 이에 한정되지 않는다. 데이터 전압(Vdata)은 Vdata = 3~6V으로 설정될 수 있으나 이에 한정되지 않는다.
제2 메모리(132)는 전원이 입력될 때 제1 메모리(210)로부터 수신된 보상값, 레지스터 설정 데이터 등을 저장한다. 보상값은 화질 향상을 한 다양한 알고리즘에 적용될 수 있다. 레지스터 설정 데이터는 데이터 구동부(111), 타이밍 콘트롤러(130), 감마 보상 전압 발생부(112) 등의 동작을 정의한다. 제1 메모리(210)는 플래시 메모리(Flash memory)를 포함할 수 있다. 제2 메모리(132)는 SRAM(Static RAM)을 포함할 수 있다.
호스트 시스템(200)은 모바일 기기, 웨어러블 기기, 가상현실, 증강현실 기기 등에서 AP(Application Processor)로 구현될 수 있다. 호스트 시스템(200)은 MIPI(Mobile Industry Processor Interface)를 통해 제1 및 제2 드라이브 IC들(300L, 300R)에 입력 영상의 픽셀 데이터와 명령 코드를 전송한다. 호스트 시스템(200)은　AP에 한정되지 않는다. 예를 들어, 호스트 시스템(200)은 텔레비전 시스템, 셋톱박스, 네비게이션 시스템, 개인용 컴퓨터(PC), 홈 시어터 시스템 등의 메인 보드일 수 있다.
도 6a는 픽셀 회로의 일 예를 보여 주는 회로도이다. 본 발명의 픽셀 회로는 도 6a에 한정되지 않는다. 도 6b는 도 6a에 도시된 픽셀 회로의 구동 방법을 보여 주는 도면이다.
도 6a 및 도 6b를 참조하면, 픽셀 회로는 발광 소자(OLED), 발광 소자(OLED)에 전류를 공급하는 구동 소자(DT), 및 다수의 스위치 소자들(M1~M6)을 이용하여 구동 소자(DT)의 문턱 전압(Vth)을 샘플링하여 구동 소자(DT)의 문턱 전압(Vth)만큼 구동 소자(DT)의 게이트 전압을 보상하는 내부 보상 회로를 포함한다. 구동 소자(DT)와 스위치 소자들(M1~M6) 각각은 p 채널 트랜지스터로 구현될 수 있다.
내부 보상 회로의 동작은 제N-1 스캔 신호[SCAN(N-1)]의 게이트 온 전압(VGL)에 따라 제5 및 제6 스위치 소자들(M5, M6)이 턴-온되어 픽셀 회로를 초기화하는 초기화 기간, 제N 스캔 신호[SCAN(N)]의 게이트 온 전압(VGL)에 따라 제1 및 제2 스위치 소자들(M1, M2)이 턴-온되어 구동 소자(DT)의 문턱 전압이 샘플링되어 커패시터(Cst)에 저장되는 샘플링 기간, 제1 내지 제6 스위치 소자들(M1~M6)이 오프 상태를 유지하는 데이터 기입 기간, 및 제3 및 제4 스위치 소자들(M1, M2)이 턴-온되어 발광 소자(OLED)가 발광되는 발광 기간으로 나뉘어진다. 발광 기간은 저 계조의 휘도를 정밀하게 EM 신호[EM(N)]의 듀티비(duty ration)로 정밀하게 표현하기 위하여, EM 신호[EM(N)]가 게이트 온 저압(VGL)과 게이트 오프 전압(VGH) 사이에서 소정의 듀티비로 스윙하여 제3 및 제4 스위치 소자들(M1, M2)이 온/오프를 반복할 수 있다.
발광 소자(OLED)는 '유기 발광 다이오드'로 구현되거나 무기 발광 다이오드로 구현될 수 있다. 이하에서 발광 소자(OLED)가 '유기 발광 다이오드'로 구현된 예를 설명하기로 한다. 발광 소자(OLED)는 OLED로 구현될 수 있다. 발광 소자(OLED)는 애노드와 캐소드 사이에 형성된 유기 화합물층을 포함한다. 유기 화합물층은 정공주입층(HIL), 정공수송층(HTL), 발광층(EML), 전자수송층(ETL) 및 전자주입층(EIL) 등을 포함할 수 있으나 이에 한정되지 않는다. 발광 소자(OLED)의 애노드는 제4 및 제6 스위치 소자들(M4, M6) 사이의 제4 노드(n4)에 연결된다. 제4 노드(n4)는 발광 소자(OLED)의 애노드, 제4 스위치 소자(M4)의 제2 전극, 및 제6 스위치 소자(M6)의 제2 전극에 연결된다. 발광 소자(OLED)의 캐소드는 저전위 전원 전압(VSS)이 인가되는 VSS 전극(106)에 연결된다. 발광 소자(OLED)는 구동 소자(DT)의 게이트-소스간 전압(Vgs)에 따라 흐르는 전류(Ids)로 발광된다. 발광 소자(OLED)의 전류 패스는 제3 및 제4 스위치 소자(M3, M4)에 의해 스위칭된다.
스토리지 커패시터(Cst)는 VDD 라인(104)과 제1 노드(n1) 사이에 연결된다. 구동 소자(DT)의 문턱 전압(Vth) 만큼 보상된 데이터 전압(Vdata)이 스토리지 커패시터(Cst)에 충전된다. 서브 픽셀들 각각에서 데이터 전압(Vdata)이 구동 소자(DT)의 문턱 전압(Vth) 만큼 보상되기 때문에서 서브 픽셀들에서 구동 소자(DT)의 특성 편차가 보상된다.
제1 스위치 소자(M1)는 제N 스캔 신호[SCAN(N)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 제2 노드(n2)와 제3 노드(n3)를 연결한다. 제2 노드(n2)는 구동 소자(DT)의 게이트, 스토리지 커패시터(Cst)의 제1 전극, 및 제1 스위치 소자(M1)의 제1 전극에 연결된다. 제3 노드(n3)는 구동 소자(DT)의 제2 전극, 제1 스위치 소자(M1)의 제2 전극, 및 제4 스위치 소자(M4)의 제1 전극에 연결된다. 제1 스위치 소자(M1)의 게이트는 제1 게이트 라인(31)에 연결되어 제N 스캔 신호[SCAN(N)]를 공급 받는다. 제1 스위치 소자(M1)의 제1 전극은 제2 노드(n2)에 연결되고, 제1 스위치 소자(M1)의 제2 전극은 제3 노드(n3)에 연결된다.
제2 스위치 소자(M2)는 제N 스캔 신호[SCAN(N)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 데이터 전압(Vdata)을 제1 노드(n1)에 공급한다. 제2 스위치 소자(M2)의 게이트는 제1 게이트 라인(31)에 연결되어 제N 스캔 신호[SCAN(N)]를 공급 받는다. 제2 스위치 소자(M2)의 제1 전극은 제1 노드(n1)에 연결된다. 제2 스위치 소자(M2)의 제2 전극은 데이터 전압(Vdata)이 인가되는 데이터 라인(102)에 연결된다. 제1 노드(n1)는 제2 스위치 소자(M2)의 제1 전극, 제3 스위치 소자(M2)의 제2 전극, 및 구동 소자(DT)의 제1 전극에 연결된다.
제3 스위치 소자(M3)는 EM 신호[EM(N)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 VDD 라인(104)을 제1 노드(n1)에 연결한다. 제3 스위치 소자(M3)의 게이트는 제3 게이트 라인(33)에 연결되어 EM 신호[EM(N)]를 공급 받는다. 제3 스위치 소자(M3)의 제1 전극은 VDD 라인(104)에 연결된다. 제3 스위치 소자(M3)의 제2 전극은 제1 노드(n1)에 연결된다.
제4 스위치 소자(M4)는 EM 신호[EM(N)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 제3 노드(n3)를 발광 소자(OLED)의 애노드에 연결한다. 제4 스위치 소자(M4)의 게이트는 제3 게이트 라인(33)에 연결되어 EM 신호[EM(N)]를 공급 받는다. 제4 스위치 소자(M4)의 제1 전극은 제3 노드(n3)에 연결되고, 제2 전극은 제4 노드(n4)에 연결된다.
EM 신호[EM(N)]는 제3 및 제4 스위치 소자들(M3, M4)의 온/오프를 제어하여 발광 소자(OLED)의 전류 패스(current path)를 스위칭함으로써 발광 소자(OLED)의 점소등 시간을 제어한다.
제5 스위치 소자(M5)는 제N-1 스캔 신호[SCAN(N-1)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 제2 노드(n2)를 Vini 라인(105)에 연결한다. 제5 스위치 소자(M5)의 게이트는 제2 게이트 라인(32)에 연결되어 제N-1 스캔 신호[SCAN(N-1)]를 공급 받는다. 제5 스위치 소자(M5)의 제1 전극은 제2 노드(n2)에 연결되고, 제2 전극은 Vini 라인(105)에 연결된다.
제6 스위치 소자(M6)는 제N-1 스캔 신호[SCAN(N-1)]의 게이트 온 전압(VGL)에 응답하여 턴-온되어 Vini 라인(105)을 제4 노드(n4)에 연결한다. 제6 스위치 소자(M6)의 게이트는 제2 게이트 라인(32)에 연결되어 제N-1 스캔 신호[SCAN(N-1)]를 공급 받는다. 제6 스위치 소자(M6)의 제1 전극은 Vini 라인(105)에 연결되고, 제2 전극은 제4 노드(n4)에 연결된다.
구동 소자(DT)는 게이트-소스간 전압(Vgs)에 따라 발광 소자(OLED)에 흐르는 전류(Ids)를 조절하여 발광 소자(OLED)를 구동한다. 구동 소자(DT)는 제2 노드(n2)에 연결된 게이트, 제1 노드(n1)에 연결된 제1 전극, 및 제3 노드(n3)에 연결된 제2 전극을 포함한다.
초기화 기간(Tini) 동안 제N-1 스캔 신호[SCAN(N-1)]가 게이트 온 전압(VGL)으로 발생된다. 제N 스캔 신호[SCAN(N)]와 EM 신호[EM(N)]는 초기화 기간(Tini) 동안 게이트 오프 전압(VGH)을 유지한다. 따라서, 초기화 기간(Tini) 동안 제5 및 제6 스위치 소자들(M5, M6)이 턴-온(turn-on)되어 제2 및 제4 노드(n2, n4)가 Vini로 초기화된다. 초기화 기간(Tini)과 샘플링 기간(Tsam) 사이에 홀드 기간(Th)이 설정될 수 있다. 홀드 기간(Th)에서 게이트 신호[SCAN(N-1), SCAN(N), EM(N)]는 이전 상태를 유지한다.
샘플링 기간(Tsam) 동안 제N 스캔 신호[SCAN(N)]가 게이트 온 전압(VGL)으로 발생된다. 제N 스캔 신호[SCAN(N)]의 펄스는 제N 픽셀 라인의 데이터 전압(Vdata)에 동기된다. 제N-1 스캔 신호[SCAN(N-1)]와 EM 신호[EM(N)]는 샘플링 기간(Tsam) 동안 게이트 오프 전압(VGH)을 유지한다. 따라서, 샘플링 기간(Tsam) 동안 제1 및 제2 스위치 소자들(M1, M1)이 턴-온된다.
샘플링 기간(Tsam) 동안 구동 소자(DT)의 게이트 전압(DTG)이 제1 및 제2 스위치 소자(M1, M2)를 통해 흐르는 전류에 의해 상승된다. 구동 소자(DT)가 턴-오프될 때 구동 소자(DT)가 턴-오프(turn-off)되기 때문에 게이트 노드 전압(DTG)이 Vdata - |Vth|이다. 이 때, 제1 노드(n)의 전압도 Vdata - |Vth|이다. 샘플링 기간(Tsam)에 구동 소자(DT)의 게이트-소스간 전압(Vgs)은 |Vgs| = Vdata -(Vdata-|Vth|) = |Vth|이다.
데이터 기입 기간(Twr) 동안 제N 스캔 신호[SCAN(N)]가 게이트 오프 전압(VGH)으로 반전된다. 제N-1 스캔 신호[SCAN(N-1)]와 EM 신호[EM(N)]는 샘플링 기간(Tsam) 동안 게이트 오프 전압(VGH)을 유지한다. 따라서, 데이터 기입 기간(Twr) 동안 모든 스위치 소자들(M1~M6)이 오프 상태를 유지한다.
발광 기간(Tem) 동안 EM 신호[EM(N)]가 소정의 듀티비로 온/오프되어 게이트 온 전압(VGL)과 게이트 오프 전압(VGH) 사이에서 스윙한다. 발광 기간(Tem) 동안, 제N-1 및 제N 스캔 신호[SCAN(N-1), SCAN(N)는 게이트 오프 전압(VGH)을 유지한다. 발광 기간(Tem) 동안, 제3 및 제4 스위치 소자들(M3, M4)은 EM 신호(EM)의 전압 따라 온/오프를 반복한다. EM 신호[EM(N)]가 게이트 온 전압(VGL)일 때 제3 및 제4 스위치 소자들(M3, M4)이 턴-온되어 발광 소자(OLED)에 전류가 흐른다. 이 때, 구동 소자(DT)의 Vgs는 |Vgs| = VDD - (Vdata-|Vth|)이고, 발광 소자(OLED)에 흐르는 전류는 K(VDD-Vdata)2이다. K는 구동 소자(DT)의 전하 이동도, 기생 커패시턴스 및 채널 용량 등에 의해 결정되는 비례 상수이다.
본 발명의 폴더블 디스플레이에서, 플렉시블 표시패널(100)은 제1 화면(L), 제2 화면(R), 제1 화면(L)과 제2 화면(R) 사이에 위치하고 폴딩 가능한 폴딩 경계부(EX)를 포함한다. 제1 드라이브 IC(300L)는 제1 화면(L)의 데이터 라인들에 연결되고, 폴딩 경계부(EX)에서 제1 화면(L)과 이웃한 제1 경계부의 데이터 라인들에 연결되어 제1 화면과 상기 제1 경계부의 픽셀들을 구동한다. 제2 드라이브 IC(300R)는 제2 화면(R)의 데이터 라인들에 연결되고, 폴딩 경계부(EX)에서 제2 화면(R)과 이웃한 제2 경계부의 데이터 라인들에 연결되어 제2 화면(R)과 제2 경계부의 픽셀들을 구동한다.
제1 및 제2 화면들(L, R) 중에서 제1 화면(L)만 구동될 때, 제1 드라이브 IC(300L)에서 제1 화면(L)의 데이터 라인들에 연결된 채널들만 구동된다. 이 때, 제1 드라이브 IC(300L)에서 제1 경계부에 연결된 채널들이 셧다운되고 제2 드라이브 IC(300R)의 전체 채널들이 셧다운된다.
제1 및 제2 화면들(L, R) 중에서 제2 화면(R)만 구동될 때, 제2 드라이브 IC(300R)에서 제2 화면(R)의 데이터 라인들에 연결된 채널들만 구동된다. 이 때, 제2 드라이브 IC(300R)에서 제2 경계부에 연결된 채널들이 셧다운되고 제1 드라이브 IC(300L)의 전체 채널들이 셧다운된다.
제1 및 제2 화면들(L, R)이 모두 구동될 때, 제1 드라이브 IC(300L)에서 제1 화면(L)과 제1 경계부의 데이터 라인들에 연결된 채널들이 구동된다. 제2 드라이브 IC(300R)에서 제2 화면(R)과 제2 경계부의 데이터 라인들에 연결된 채널들이 구동된다.
호스트 시스템(200)은 제1 및 제2 화면(L, R)의 구동 여부에 따라 제1 및 제2 드라이브 IC(300L, 300R)의 셧다운과, 이 드라이브 IC들의 채널들의 셧다운을 제어한다.
호스트 시스템(200)은 제1 및 제2 드라이브 IC들(300L, 300R)에 인에이블 신호(EN)를 공급하여 폴더블 디스플레이의 화면을 아래의 표 1과 같이 제어한다. 호스트 시스템(200)은 플렉시블 표시패널의 자세, 화면 개폐를 감지하는 다양한 센서들에 연결되어 이 센서 신호를 바탕으로 화면의 개폐 여부와 사용자가 바라 보는 화면을 판단할 수 있다. 따라서, 호스트 시스템(200)은 화면의 개폐 여부와, 사용자가 바라 보는 화면을 판단하여 폴더블 디스플레이의 화면을 아래와 같이 제어할 수 있다. 호스트 시스템(200)은 화면의 개폐 여부에 관계 없이 사용자 입력 또는 명령에 따라 아래와 같은 인에이블 신호를 발생하여 화면들(L, R)을 제어할 수 있다. 호스트 시스템(200)은 MIPI를 통해 인에이블 신호(EN)를 드라이브 IC들(300L, 300R)로 전송하고, 드라이브 IC들(300L, 300R)은 인에이블 신호(EN)에 응답하여 아래의 표 1과 같이 동작한다. 표 1은 레지스터 설정 데이터로서 제2 메모리(132)에 저장될 수 있다.
Right EN Left EN Dual EN 구분 Left D-IC Right D-IC
0 0 0 Source AMP. Active Shutdown Shutdown
Extra
ERA Left
Right
0 1 0 Source AMP. Active ON Shutdown
Extra OFF
ERA Left ON
Right ON
1 0 0 Source AMP. Active Shutdown ON
Extra OFF
ERA Left ON
Right ON
1 1 1 Source AMP. Active ON ON　
Extra ON ON
ERA Left ON　 OFF　
Right OFF ON
표 1에서 알 수 있는 바와 같이, 인에이블 신호(EN)는 Right EN, Left EN, Dual EN 각각 1 bit 씩 3 bit 신호로 발생될 수 있다. Left EN bit는 제1 화면(L)의 구동 여부를 지시한다. 제1 드라이브 IC(300L)는 Left EN = 1일 때 제1 화면(L)을 구동한다. Right EN bit는 제2 화면(R)의 구동 여부를 지시한다. 제2 드라이브 IC(300R)는 Right EN = 1일 때 제2 화면(R)을 구동한다.
Left EN = 0일 때 제1 드라이브 IC(300L)가 셧다운(shut down)되고, Right EN = 0일 때 제2 드라이브 IC(300R)가 셧다운되어 드라이브 IC의 소비 전류가 감소될 수 있다. 셧다운은 드라이브 IC 전체가 셧다운되는 방법과, 재시동(restart)시 드라이브 IC가 빠르게 웨이크업(wake-up)할 수 있도록 드라이브 IC 내에서 데이터 구동부(110), 레벨 시프터(134) 등 일부 회로가 셧다운하는 방법이 있다.
Dual EN bit는 제1 및 제2 화면(L, R)의 동시 구동 여부를 지시한다. Dual EN bit = 1일 때 제1 및 제2 드라이브 IC(300L, 300R)는 제1 및 제2 화면(L, R)을 구동한다. Dual EN bit = 0일 때 제1 및 제2 드라이브 IC(300L, 300R) 중 적어도 하나고 셧다운된다. Right EN = 0, Left EN =0, 그리고 Dual EN = 0일 때 제1 및 제2 드라이브 IC들(300L, 300R) 모두가 셧다운된다.
표 1에서, Source AMP는 드라이브 IC(300L, 300R)의 출력 버퍼이다. 출력 버퍼(Source AMP)는 Active 채널 버퍼와 Extra 채널 버퍼로 나뉘어진다. 표 1에서, Active는 폴딩 경계부(EX)를 제외한 제1 및 제2 화면(L, R)의 데이터 라인들에 연결된 드라이브 IC(300L, 300R)의 데이터 채널들에 연결된 Active 채널 버퍼이다. Extra는 폴딩 경계부(EX)의 데이터 라인들에 연결된 드라이브 IC(300L, 300R)의 데이터 채널들에 연결된 Extra 채널 버퍼이다.
표 1에서, ERA(Edge round Algorithm)는 도 9에 도시된 바와 같이 화면(L, R) 각각의 코너(Corner) 부분의 픽셀들을 둥글게 처리하기 위한 데이터 처리 옵션이다. 도 9에서, LLERA는 제1 화면(L)의 좌측 코너 픽셀 영역이다. LRERA는 제1 화면(L)의 우측 코너 픽셀 영역이다. 제1 화면(L)의 우측 코너 픽셀 영역(LRERA)는 폴딩 경계부(EX)의 제1 경계부와 이웃한다. 도 9에서 RLERA는 제2 화면(R)의 좌측 코너 픽셀 영역이다. RRERA는 제2 화면(R)의 우측 코너 픽셀 영역이다. 제1 화면(L)의 좌측 코너 픽셀 영역(RLERA)는 폴딩 경계부(EX)의 제2 경계부와 이웃한다.
표 1에서 알 수 있는 바와 같이, 본 발명은 드라이브 IC(300L, 300R)의 출력 버퍼(Source AMP.)를 선택적으로 셧다운시켜 화면 구동에 영향 없이 소비 전력을 줄일 수 있다.
도 7은 드라이브 IC(300L, 300R)의 출력 버퍼(Source AMP.)를 선택적으로 셧다운하는 방법을 보여 주는 도면이다. 도 7에서 AAL은 제1 드라이브 IC(300L)에서 제1 화면(L)의 데이터 라인들에 연결된 제1 Active 채널들이다. EXL는 제1 드라이브 IC(300L)에서 제1 경계부의 데이터 라인들에 연결된 제1 Extra 채널들이다. AMP1는 제1 Active 채널들에 연결된 제1 드라이브 IC(300L)의 출력 버퍼들이다. EXAMP1는 제1 Extra 채널들에 연결된 제1 드라이브 IC(300L)의 출력 버퍼들이다.
AAR은 제2 드라이브 IC(300R)에서 제2 화면(R)의 데이터 라인들에 연결된 제2 Active 채널들이다. EXR을 제2 드라이브 IC(300R)에서 제2 경계부의 데이터 라인들에 연결된 제2 Extra 채널들이다. AMP2는 제2 Active 채널들에 연결된 제2 드라이브 IC(300R)의 출력 버퍼들이다. EXAMP2는 제2 Extra 채널들에 연결된 제2 드라이브 IC(300R)의 출력 버퍼들이다.
도 7을 참조하면, 드라이브 IC들(300L, 300R) 각각은 출력 버퍼들(AMP1, AMP2, EXAMP1, EXAMP2)을 제어하는 바이어스 콘트롤 신호(Bias control signal, BIAS)의 전송 경로를 스위칭하는 스위치 소자들(SW1, SW2)을 포함한다.
바이어스 콘트롤 신호(BIAS)와 스위치 소자(SW1, SW2)의 제어 신호는 호스트 시스템(200)으로부터 발생될 수 있다. 바이어스 콘트롤 신호(BIAS)는 출력 버퍼들(AMP1, AMP2, EXAMP1, EXAMP2)의 온/오프를 제어하고 전류량을 제어한다. 출력 버퍼들(AMP1, AMP2, EXAMP1, EXAMP2)에 바이어스 콘트롤 신호(BIAS)가 인가되지 않으면, 출력 버퍼들(AMP1, AMP2, EXAMP1, EXAMP2)은 셧다운되어 구동되지 않고 소비 전류를 발생하지 않는다. 제1 스위치 소자(SW1)는 호스트 시스템(200)의 제어 하에 Acitive 채널들에 연결된 출력 버퍼들(AMP1, AMP2)과 바이어스 콘트롤 신호 (BIAS) 사이의 전송 경로를 선택적으로 차단한다. 제2 스위치 소자(SW2)는 호스트 시스템(200)의 제어 하에 Extra 채널들에 연결된 출력 버퍼들(EXAMP1, EXAMP2)과 바이어스 콘트롤 신호 (BIAS) 사이의 전송 경로를 선택적으로 차단한다.
이하, 도 8 내지 도 14를 결부하여 제1 및 제2 드라이브 IC(300L, 300R)의 동작을 설명하기로 한다.
도 8 내지 도 16은 제1 및 제2 드라이브 IC(300L, 300R)의 동작을 보여 주는 도면들이다.
도 8 및 도 9를 참조하면, 제1 및 제2 드라이브 IC(300L, 300R)이 동시에 구동되어 제1 및 제2 화면(L, R)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 111로 발생하여 제1 및 제2 드라이브 IC(300L, 300R) 모두를 인에이블한다.
제1 및 제2 화면(L, R)이 펼쳐진 상태라면, 제1 및 제2 화면(L, R) 사이의 폴딩 경계부(EX)의 화면도 구동된다. 제1 드라이브 IC(300L)는 제1 Active 채널들(AAL)에 연결된 출력 버퍼들(AMP1)과, 제1 Extra 채널들(EXL)에 연결된 출력 버퍼들(EXAMP1)을 구동하여(ON) 제1 화면(L)과 제1 경계부의 데이터 라인들에 데이터 전압(Vdata)을 공급한다. 제2 드라이브 IC(300R)는 제2 Active 채널들(AAR)에 연결된 출력 버퍼들(AMP2)과, 제2 Extra 채널들(EXR)에 연결된 출력 버퍼들(EXAMP2)을 구동하여(ON) 제2 화면(R)과 제2 경계부의 데이터 라인들에 데이터 전압(Vdata)을 공급한다.
제1 및 제2 화면(L, R)이 동시에 구동될 때, 제1 화면(L)의 좌측 코너 픽셀 영역(LLERA)과 제2 화면(R)의 우측 코너 픽셀 영역(RRERA)는 ERA에 의해 둥굴게 처리된다. ERA는 도 14에 도시된 바와 같이 코너 픽셀 영역에서 곡선의 경계 라인 밖에 배치된 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경한다. ERA가 실행되면, 미리 설정된 곡선의 경계 라인 밖에 배치된 픽셀들에 입력 영상과 무관한 블랙 계조의 데이터가 기입된다.
제1 및 제2 화면(L, R)이 동시에 구동될 때, 제1 및 제2 화면(L, R) 사이에 재현된 영상이 끊기지 않도록 제1 화면(L)의 우측 코너 픽셀 영역(LRERA)과 제2 화면(R)의 좌측 코너 픽셀 영역(RLERA)의 픽셀들에 입력 영상의 픽셀 데이터가 표시된다.
도 10 및 도 11을 참조하면, 제1 및 제2 드라이브 IC(300L, 300R) 중에서 제1 드라이브 IC(300L)만 구동되어 제1 화면(L)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 010으로 발생하여 제1 드라이브 IC(300L)만 구동하고 제2 드라이브 IC(300R)는 셧다운시킨다. 따라서, 제2 드라이브 IC(300R)는 셧다운되어 데이터 전압과 게이트 제어신호를 출력하지 않기 때문에 소비 전류를 발생하지 않는다.
인에이블 신호(EN)가 010으로 발생될 때 표 1에서 알 수 있는 바와 같이, 제1 화면(L)이 구동되어 입력 영상을 재현하는 반면 폴딩 경계부 영역(EX)과 제2 화면(R)은 구동되지 않는다. 제1 드라이브 IC(300L)는 제1 Active 채널들(AAL)에 연결된 출력 버퍼들(AMP1)을 구동하여 제1 화면(L)의 데이터 라인들에 데이터 전압(Vdata)을 공급한다. 제1 드라이브 IC(300L)에서, 제1 Extra 채널들(EXL)에 연결된 출력 버퍼들(EXAMP1)은 셧다운된다. 제2 드라이브 IC(300R)의 제2 Active 채널들(AAR)과 제2 Extra 채널들(EXR)에 연결된 출력 버퍼들(AMP2, EXAMP2)은 셧다운되어 데이터 전압(Vdata)을 출력하지 않는다.
제1 화면(L)만 구동될 때, 제1 화면(L)이 좌우대칭될 수 있도록 제1 화면(L)의 좌측 코너 픽셀 영역(LLERA)과 우측 코너 픽셀 영역(LRERA)은 ERA에 의해 둥굴게 처리될 수 있다. ERA는 도 15에 도시된 바와 같이 코너 픽셀 영역에서 곡선의 경계 라인 밖에 배치된 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경한다. ERA가 실행되면, 미리 설정된 곡선의 경계 라인 밖에 배치된 픽셀들에 입력 영상과 무관한 블랙 계조의 데이터가 기입된다.
도 12 및 도 13을 참조하면, 제1 및 제2 드라이브 IC(300L, 300R) 중에서 제2 드라이브 IC(300R)만 구동되어 제2 화면(R)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 100으로 발생하여 제2 드라이브 IC(300R)만 구동하고 제1 드라이브 IC(300L)는 셧다운시킨다. 따라서, 제1 드라이브 IC(300L)는 셧다운되어 데이터 전압과 게이트 제어신호를 출력하지 않기 때문에 소비 전류를 발생하지 않는다.
인에이블 신호(EN)가 100으로 발생될 때 표 1에서 알 수 있는 바와 같이, 제2 화면(R)이 구동되어 입력 영상을 재현하는 반면 폴딩 경계부 영역(EX)과 제1 화면(L)은 구동되지 않는다. 제2 드라이브 IC(300R)는 제2 Active 채널들(AAR)에 연결된 출력 버퍼들(AMP2)을 구동하여 제2 화면(R)의 데이터 라인들에 데이터 전압(Vdata)을 공급한다. 제2 드라이브 IC(300R)에서, 제2 Extra 채널들(EXR)에 연결된 출력 버퍼들(EXAMP2)은 셧다운된다. 제1 드라이브 IC(300L)의 제1 Active 채널들(AAL)과 제1 Extra 채널들(EXL)에 연결된 출력 버퍼들(AMP1, EXAMP1)은 셧다운되어 데이터 전압(Vdata)을 출력하지 않는다.
제2 화면(R)만 구동될 때, 제2 화면(R)이 좌우대칭될 수 있도록 제2 화면(R)의 좌측 코너 픽셀 영역(RLERA)과 우측 코너 픽셀 영역(RRERA)은 ERA에 의해 둥굴게 처리될 수 있다. ERA는 도 16에 도시된 바와 같이 코너 픽셀 영역에서 곡선의 경계 라인 밖에 배치된 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경한다. ERA가 실행되면, 미리 설정된 곡선의 경계 라인 밖에 배치된 픽셀들에 입력 영상과 무관한 블랙 계조의 데이터가 기입된다.
도 17 내지 도 19는 게이트 구동부의 동작을 보여 주는 도면들이다.
도 17을 참조하면, 제1 및 제2 드라이브 IC(300L, 300R)이 동시에 구동되어 제1 및 제2 화면(L, R)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 111로 발생하여 제1 및 제2 드라이브 IC(300L, 300R) 모두를 인에이블한다. 이 때, 제1 드라이브 IC(300L)는 게이트 제어신호를 제1 게이트 구동부(120L)에 공급하고, 제2 드라이브 IC(300R)는 게이트 제어신호를 제2 게이트 구동부(120L)에 공급한다. 따라서, 하나의 게이트 라인에서 게이트 라인의 양 끝단에서 게이트 신호가 동시에 인가된다. 게이트 라인들(GL1, GL2)의 양쪽에 연결된 시프트 레지스터에 의해 게이트 신호가 시프트된다.
도 18을 참조하면, 제1 및 제2 드라이브 IC(300L, 300R) 중에서 제1 드라이브 IC(300L)만 구동되어 제1 화면(L)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 010으로 발생하여 제1 드라이브 IC(300L)만 구동하고 제2 드라이브 IC(300R)는 셧다운시킨다. 이 때, 제1 드라이브 IC(300L)는 게이트 제어신호를 제1 게이트 구동부(120L)에 공급한다. 따라서, 제1 게이트 구동부(120L)는 싱글 피딩 방식으로 게이트 신호를 게이트 라인들(GL1, GL2)에 인가한다. 제1 게이트 구동부(120L)의 시프트 레지스터는 게이트 라인들(GL1, GL2)에 인가되는 게이트 신호를 시프트시킨다.
제1 화면(L)만 구동될 때, 제2 드라이브 IC(300R)는 셧다운되어 데이터 전압과 게이트 제어신호를 출력하지 않기 때문에 소비 전류를 발생하지 않는다. 따라서, 제2 드라이브 IC(300R)가 셧다운되기 때문에 제2 게이트 구동부(120R)도 셧다운되어 제2 게이트 구동부(120R)에서 소비 전류가 발생되지 않는다.
도 19를 참조하면, 제1 및 제2 드라이브 IC(300L, 300R) 중에서 제2 드라이브 IC(300R)만 구동되어 제2 화면(R)이 구동된다. 호스트 시스템(200)은 인에이블 신호(EN)를 표 1에서 100으로 발생하여 제2 드라이브 IC(300R)만 구동하고 제1 드라이브 IC(300L)는 셧다운시킨다. 이 때, 제2 드라이브 IC(300R)는 게이트 제어신호를 제2 게이트 구동부(120R)에 공급한다. 따라서, 제2 게이트 구동부(120R)는 싱글 피딩 방식으로 게이트 신호를 게이트 라인들(GL1, GL2)에 인가한다. 제2 게이트 구동부(120R)의 시프트 레지스터는 게이트 라인들(GL1, GL2)에 인가되는 게이트 신호를 시프트시킨다.
제2 화면(R)만 구동될 때, 제1 드라이브 IC(300L)는 셧다운되어 데이터 전압과 게이트 제어신호를 출력하지 않기 때문에 소비 전류를 발생하지 않는다. 따라서, 제1 드라이브 IC(300L)가 셧다운되기 때문에 제1 게이트 구동부(120L)도 셧다운되어 제1 게이트 구동부(120L)에서 소비 전류가 발생되지 않는다.
본 발명의 다른 실시예에 따른 폴더블 디스플레이는 도 20에 도시된 바와 같이 제1 및 제2 화면(L, R) 중 적어도 하나가 두 개 이상의 드라이브 IC들로 구동될 수 있다.
도 20을 참조하면, 플렉시블 표시패널(100)의 화면은 폴딩 경계부(EX)를 중심으로 접히는 제1 및 제2 화면을 포함한다.
제1 화면은 폴딩 경계부(EX)와 가까운 제1-1 화면(L1)과, 제1-1 화면(L1)을 사이에 두고 폴딩 경계부(EX)로부터 분리된 제1-2 화면(L2)을 포함한다. 제2 화면은 폴딩 경계부(EX)와 가까운 제2-1 화면(R1)과, 제2-1 화면(R1)을 사이에 두고 폴딩 경계부(EX)로부터 분리된 제2-2 화면(R2)을 포함한다.
제1-1 드라이브 IC(300L-1)는 제1 Active 채널들(AAL)의 일부 채널들과, 제1 Extra 채널들(EXL)과 연결되어 제1-1 화면(L1)의 픽셀들과 폴딩 경계부(EX)의 좌반부 픽셀들을 구동한다. 제1-2 드라이브 IC(300L-2)는 제1 Active 채널들(AAL)의 나머지 채널들에 연결되어 제1-2 화면(L2)의 픽셀들을 구동한다.
제2-1 드라이브 IC(300R-1)는 제2 Active 채널들(AAR)의 일부 채널들과, 제2 Extra 채널들(EXR)과 연결되어 제2-1 화면(R1)의 픽셀들과 폴딩 경계부(EX)의 우반부 픽셀들을 구동한다. 제2-2 드라이브 IC(300R-2)는 제2 Active 채널들(AAR)의 나머지 채널들에 연결되어 제2-2 화면(R2)의 픽셀들을 구동한다.
이 실시예도 전술한 실시예와 실질적으로 같은 방법으로 화면 구동에 영향 없이 소비 전력을 최소화할 수 있다.
예를 들어, 제1 및 제2 화면들(L, R) 중에서 제1 화면(L)만 구동될 때, 제1-1 드라이브 IC(300L-1)의 채널들 중에서 제1-1 화면(L1)의 데이터 라인들에 연결된 채널들(AAL)만 구동된다. 이 때, 제1-1 드라이브 IC(300L-1)의 채널들 중에서 제1 경계부에 연결된 채널들(EXL)이 셧다운되고, 제1-2, 제2-1, 및 제2-2 드라이브 IC들(300L-2, 300R-1, 300R-2)의 전체 채널들이 셧다운된다.
상기 제1 및 제2 화면들(L, R) 중에서 제2 화면(R)만 구동될 때, 제2-1 드라이브 IC(300R-1)의 채널들 중에서 제2-1 화면(R1)의 데이터 라인들에 연결된 채널들(AAR)만 구동된다. 이 때, 제2-1 드라이브 IC(300R-1)의 채널들 중에서 제2 경계부에 연결된 채널들(EXR)이 셧다운되고, 제2-2, 제1-1, 및 제1-2 드라이브 IC들(300R-2, 300L-1, 300L-2)의 전체 채널들이 셧다운된다.
제1 및 제2 화면들(L, R)이 모두 구동될 때, 제1-1 및 제1-2 드라이브 IC들(300L-1, 300L-2)에서 제1 화면(L)과 상기 제1 경계부의 데이터 라인들에 연결된 채널들(AAL, EXL)이 구동된다. 이 때, 제2-1 및 제2-2 드라이브 IC들(300R-1, 300R-2)에서 제2 화면과 제2 경계부의 데이터 라인들에 연결된 채널들(AAR, EXR)이 구동된다.
호스트 시스템(200)은 제1 및 제2 화면(L, R)의 구동 여부에 따라 드라이브 IC들(300L-1, 300L-2, 300R-1, 300R-2)의 셧다운과, 채널들의 셧다운을 IC별로 개별 제어할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
100 : 표시패널 110 : 데이터 구동부
112 : 감마 보상 전압 발생부 120L : 제1 게이트 구동부
120R : 제2 게이트 구동부 130 : 타이밍 콘트롤러
132 : 제2 메모리 134 : 레벨 시프터
136 : 전원부 200 : 호스트 시스템
210 : 제1 메모리 300L : 제1 드라이브 IC
300R : 제2 드라이브 IC L : 제1 화면
R : 제2 화면 EX : 폴딩 경계부
EN : 인에이블 신호 AAL : 제1 Active 채널
EXL : 제1 Extra 채널 AMP1 : 제1 Active 채널에 연결된 출력 버퍼
EXAMP1 : 제1 Extra 채널에 연결된 출력 버퍼 AAR : 제2 Active 채널
EXR : 제2 Extra 채널 AMP2 : 제2 Active 채널에 연결된 출력 버퍼
EXAMP2 : 제2 Extra 채널에 연결된 출력 버퍼

Claims (15)

  1. 제1 화면, 제2 화면, 상기 제1 화면과 상기 제2 화면 사이에 위치하고 폴딩 가능한 경계부를 포함하는 플렉시블 표시패널;
    상기 제1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 데이터 라인들에 연결되어 상기 제1 화면과 상기 제1 경계부의 픽셀들을 구동하는 제1 드라이브 IC; 및
    상기 제2 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 데이터 라인들에 연결되어 상기 제2 화면과 상기 제2 경계부의 픽셀들을 구동하는 제2 드라이브 IC를 포함하고,
    상기 제1 및 제2 화면들 중에서 상기 제1 화면만 구동될 때,
    상기 제1 드라이브 IC에서 상기 제1 화면의 데이터 라인들에 연결된 채널들만 구동되며,
    상기 제1 드라이브 IC에서 상기 제1 경계부에 연결된 채널들이 셧다운되고 상기 제2 드라이브 IC의 전체 채널들이 셧다운되는 폴더블 디스플레이.
  2. 제 1 항에 있어서,
    상기 제1 및 제2 화면들 중에서 상기 제2 화면만 구동될 때,
    상기 제2 드라이브 IC에서 상기 제2 화면의 데이터 라인들에 연결된 채널들만 구동되고,
    상기 제2 드라이브 IC에서 상기 제2 경계부에 연결된 채널들이 셧다운되고 상기 제1 드라이브 IC의 전체 채널들이 셧다운되는 폴더블 디스플레이.
  3. 제 2 항에 있어서,
    상기 제1 및 제2 화면들이 모두 구동될 때,
    상기 제1 드라이브 IC에서 상기 제1 화면과 상기 제1 경계부의 데이터 라인들에 연결된 채널들이 구동되고,
    상기 제2 드라이브 IC에서 상기 제2 화면과 상기 제2 경계부의 데이터 라인들에 연결된 채널들이 구동되는 폴더블 디스플레이.
  4. 제 1 항에 있어서,
    상기 제1 및 제2 화면의 구동 여부에 따라 상기 제1 및 제2 드라이브 IC의 셧다운과 상기 채널들의 셧다운을 제어하는 호스트 시스템을 더 구비하는 폴더블 디스플레이.
  5. 제 4 항에 있어서,
    상기 호스트 시스템은,
    인에이블 신호를 상기 제1 및 제2 드라이브 IC들로 전송하여 상기 제1 및 제2 드라이브 IC들 각각의 인에이블 및 셧다운을 제어하는 폴더블 디스플레이.
  6. 제 5 항에 있어서,
    상기 인에이블 신호는 상기 제1 화면의 구동 여부를 지시하는 bit, 상기 제2 화면의 구동 여부를 지시하는 bit, 및 상기 제1 및 제2 화면의 동시 구동 여부를 지시하는 bit를 포함하는 폴더블 디스플레이.
  7. 제 2 항에 있어서,
    상기 제1 및 제2 화면이 동시에 구동될 때,
    상기 제1 드라이브 IC는 상기 제1 화면에서 상기 경계부로부터 먼 제1 좌측 코너 픽셀 영역과 상기 경계부와 이웃한 제1 우측 코너 영역 중 상기 제1 좌측 코너 픽셀 영역에서 소정의 곡선 밖의 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경하고,
    상기 제2 드라이브 IC는 상기 제2 화면에서 상기 경계부로부터 먼 제2 우측 코너 픽셀 영역과 상기 경계부와 이웃한 제2 좌측 코너 영역 중 상기 제2 우측 코너 픽셀 영역에서 소정의 곡선 밖의 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경하는 폴더블 디스플레이.
  8. 제 7 항에 있어서,
    상기 제1 및 제2 화면 중 상기 제1 화면만 구동될 때,
    상기 제1 드라이브 IC는 상기 제1 좌측 코너 픽셀 영역과 상기 제1 우측 코너 영역에서 소정의 곡선 밖의 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경하는 폴더블 디스플레이.
  9. 제 8 항에 있어서,
    상기 제1 및 제2 화면 중 상기 제2 화면만 구동될 때,
    상기 제2 드라이브 IC는 상기 제2 좌측 코너 픽셀 영역과 상기 제2 우측 코너 영역에서 소정의 곡선 밖의 픽셀들에 기입될 픽셀 데이터의 계조를 블랙 계조로 변경하는 폴더블 디스플레이.
  10. 제 3 항에 있어서,
    상기 제1 드라이브 IC로부터의 게이트 제어신호에 응답하여 상기 제1 화면의 게이트 라인들에 게이트 신호를 공급하는 제1 게이트 구동부;
    상기 제2 드라이브 IC로부터의 게이트 제어신호에 응답하여 상기 제2 화면의 게이트 라인들에 게이트 신호를 공급하는 제2 게이트 구동부를 포함하고,
    상기 제1 및 제2 화면들 중에서 상기 제1 화면만 구동될 때,
    상기 제1 게이트 구동부가 구동되고 상기 제2 게이트 구동부는 셧다운되는 폴더블 디스플레이.
  11. 제 10 항에 있어서,
    상기 제1 및 제2 화면들 중에서 상기 제2 화면만 구동될 때,
    상기 제2 게이트 구동부가 구동되고 상기 제1 게이트 구동부는 셧다운되는 폴더블 디스플레이.
  12. 제 11 항에 있어서,
    상기 제1 및 제2 화면들이 동시에 구동될 때,
    상기 제1 게이트 구동부가 상기 게이트 라인들의 일측 끝단에서 게이트 신호를 공급함하고, 상기 제2 게이트 구동부가 상기 게이트 라인들의 타측 끝단에서 게이트 신호를 공급하고,
    하나의 게이트 라인에서 게이트 라인의 양측 끝단으로부터 상기 게이트 신호가 동시에 인가되는 폴더블 디스플레이.
  13. 제1 화면, 제2 화면, 상기 제1 화면과 상기 제2 화면 사이에 위치하고 폴딩 가능한 경계부를 포함하는 플렉시블 표시패널;
    상기 제1 화면의 픽셀들과, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 픽셀들을 구동하는 제1 구동부; 및
    상기 제2 화면의 픽셀들과, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 픽셀들을 구동하는 제2 구동부를 포함하고,
    상기 제1 화면은,
    상기 경계부와 가까운 제1-1 화면과, 상기 제1-1 화면을 사이에 두고 상기 경계부로부터 분리된 제1-2 화면을 포함하고,
    상기 제2 화면은
    상기 경계부와 가까운 제2-1 화면과, 상기 제2-1 화면을 사이에 두고 상기 경계부로부터 분리된 제2-2 화면을 포함하고,
    상기 제1 구동부는,
    상기 제1-1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제1 화면과 이웃한 제1 경계부의 데이터 라인들에 연결되어 상기 제1 화면과 상기 제1 경계부의 픽셀들을 구동하는 제1-1 드라이브 IC; 및
    상기 제1-2 화면의 데이터 라인들에 연결되어 상기 제1-2 화면을 구동하는 제1-2 드라이브 IC를 포함하고,
    상기 제2 구동부는,
    상기 제2-1 화면의 데이터 라인들에 연결되고, 상기 경계부에서 상기 제2 화면과 이웃한 제2 경계부의 데이터 라인들에 연결되어 상기 제2 화면과 상기 제2 경계부의 픽셀들을 구동하는 제2-1 드라이브 IC; 및
    상기 제2-2 화면의 데이터 라인들에 연결되어 상기 제2-2 화면을 구동하는 제2-2 드라이브 IC를 포함하고,
    상기 제1 및 제2 화면들 중에서 상기 제1 화면만 구동될 때,
    상기 제1-1 드라이브 IC의 채널들 중에서 상기 제1-1 화면의 데이터 라인들에 연결된 채널들만 구동되며,
    상기 제1-1 드라이브 IC의 채널들 중에서 상기 제1 경계부에 연결된 채널들이 셧다운되고, 상기 제1-2, 상기 제2-1, 및 상기 제2-2 드라이브 IC들의 전체 채널들이 셧다운되는 폴더블 디스플레이.
  14. 제 13 항에 있어서,
    상기 제1 및 제2 화면들 중에서 상기 제2 화면만 구동될 때,
    상기 제2-1 드라이브 IC의 채널들 중에서 상기 제2-1 화면의 데이터 라인들에 연결된 채널들만 구동되며,
    상기 제2-1 드라이브 IC의 채널들 중에서 상기 제2 경계부에 연결된 채널들이 셧다운되고, 상기 제2-2, 상기 제1-1, 및 상기 제1-2 드라이브 IC들의 전체 채널들이 셧다운되는 폴더블 디스플레이.
  15. 제 14 항에 있어서,
    상기 제1 및 제2 화면들이 모두 구동될 때,
    상기 제1-1 및 제1-2 드라이브 IC들에서 상기 제1 화면과 상기 제1 경계부의 데이터 라인들에 연결된 채널들이 구동되고,
    상기 제2-1 및 제2-2 드라이브 IC들에서 상기 제2 화면과 상기 제2 경계부의 데이터 라인들에 연결된 채널들이 구동되는 폴더블 디스플레이.
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