KR960015599A - 비휘발성 반도체 메모리 장치 테스트 방법 - Google Patents
비휘발성 반도체 메모리 장치 테스트 방법 Download PDFInfo
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Abstract
Description
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- 각각의 메모리 셀이, 제어 게이트, 소스, 드레인 및 전하를 축적하여 정보를 기억할 수 있는 전하 저장층을 갖는 트랜지스터로 구성되고, 다수의 메모리 셀이 매트릭스내에 배열된 메모리 셀 어레이를 가지며, 각각의 로우내의 메모리 셀 케이트가 워드 라인을 형성하도록 함께 접속된 비휘발성 반도체 메모리 장치를 테스트하는방법에 있어서, 상기 메모리 셀 어레이로부터 제1 및 제2디코딩 로우와, 테스트 로우를 포함하는 3개의 로우를선택하고, 공통 소스 라인을 형성하기 위해 상기 테스트 로우내의 메모리 셀의 소스를 함께 접속하고, 상기 제1디코딩 로우내의 메모리 셀의 소스에 상응하는 소스에 상기 테스트 로우내의 메모리 셀의 각각의 드레인을 접속하고, 상기 2디코딩 로우내의 메모리 셀의 소스에 상응하는 소스에 상기 제1디코딩 로우내의 메모리 셀의 각각의 드레인을 접속하며, 공통 드레인 라인을 형성하기 위해 상기 제2디코딩 로우내의 메모리 셀의 드레인을 함께 접속하여, 테스트 블럭을 형성하는 단계; 상기 제1 및 제2디코딩 로우내의 메모리 셀을 소거하고, 연속 프로그램하며, 상기 데스트 로우내의 메모리 셀을 소거하는 단계와; 상기 소거하고, 연속 프로그램 및 소거 단계 이후에, 상기 데스트 로우의 워드 라인의 전압에 대하여 상기 공통 드레인 라인을 통해 흐르는 드레인 전류의 제1특성을 측정하는 단계를 포함하는 것을 특징으로 하는 비휘발성 메모리 장치 테스트 방법.
- 제1항에 있어서, 상기 제1특성이 음의 한계 전압을 나타낼 때 과소거된 메모리 셀의 존재를 한정하는 단계를 더 포함하는 것을 특징으로 하는 비휘발성 메모리 장치 테스트 방법.
- 제1항에 있어서, 상기 제1특성을 측정하는 단게는 기준 전위와 상기 기준 전위에 비교된 제1양의 전위로 상기 공통 소스 라인 및 상기 공통 드레인 라인을 각각 유지하고, 상기 제1 및 제2디코딩 로우내의 메모리 셀을 ON상태로 유지하는 동안 실행되는 것을 특징으로 하는 비휘발성 메모리 장치 테스트 방법.
- 제1항에 있어서, 과소거된 메모리 셀이 존재하는지를 제1특성을 기초하여 판정할 때, 상기 테스트 로우내의 과소거된 메모리 셀 및 나머지 메모리 셀을 ON 및 OFF상태를 유지하고, 상기 제2디코딩 메모리내의 메모리 셀을 ON상태로 유지하는 동안, 데스트 로우내의 과소거된 메모리 셀에 상응하는 제1디코딩 로우내의 메모리 셀중 하나를 프로그램하는 단계와; 상기 메모리 셀중 하나를 프로그램하는 단계 이후애, 기준 전위 및 제1양의 전위에서 상기 공통 소스라인 및 상기 공통 드레인 라인을 유지하고, 상기 제l 및 제2디코딩 로우내의 메모리 셀을 ON상태로 유지하는 동안, 상기 테스트 로우의 워드 라인의 전압에 대하여 상기 공통 드레인 라인을 통해 흐르는 드레인 전류의 제2특성을 측정하는 단계를 더 포함하는 것을 특징으로 하는 비휘발성 메모리 장치테스트 방법.
- 제1항에 있어서, 상기 테스트 로우내의 상기 과소거된 메모리 셀에 상응하는 상기 디코딩 로우내의 하나를 제외하고 메모리 셀을 프로그램하는 단계; 상기 제1디코딩 로우내의 메모리 셀을 소거하는 단계와; 하나를 제외한 메모리 셀을 프로그램하고, 상기 제1디코딩 로우내의 메모리 셀을 소거하는 단계 이후에, 기준 전위 및 제1양의 전위에서 상기 공통 소스 라인 및 상기 공통 드레인 라인을 각각 유지하고, 상기 제1 및 제2디코딩 로우내의 메모리 셀을 ON상태를 유지하는 동안, 상기 테스트 로우의 워드 라인의 전압에 대하여 상기 공통 드레인 라인을 통해 흐르는 드레인 전류의 제2특성을 측정하는 단계를 더 포함하는 것을 특징으로 하는 비휘발성 메모리 장치 테스트 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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