SV2000000002A - Conversor de reloj de 2.048 mhz a señal de linea a 2.048 mbit/s - Google Patents
Conversor de reloj de 2.048 mhz a señal de linea a 2.048 mbit/sInfo
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- 230000001360 synchronised effect Effects 0.000 abstract 1
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/0635—Clock or time synchronisation in a network
- H04J3/0685—Clock or time synchronisation in a node; Intranode synchronisation
- H04J3/0691—Synchronisation in a TDM node
Landscapes
- Engineering & Computer Science (AREA)
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- Signal Processing (AREA)
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- Synchronisation In Digital Transmission Systems (AREA)
Abstract
EL CONVERSOR DE RELOJ DE 2.048 MHZ A SEÑAL DE LINEA DE 2.048 MBIT/S, ES UN EQUIPO DISEÑADO PARA GENERAL UNA TRAMA DE SEÑAL PCM A 2.048 MBIT/S A PARTIR DE UN RELOJ DE 2.048 MHZ DE ENTRADA. LA SEÑAL DE TRAMA PCM CON CODIGO DE REDUNDANCIA CICLICA (CRC) QUE CREA ESTE EQUIPO, AUNQUE NO LLEVA TRAFICO DE DATOS SI QUE LLEVA INCLUIDA LA INFORMACION DE FASE DEL RELOJ DE ENTRADA. DISPONE DE OCHO SALIDAS DE DATOS SINCRONIZADAS EN FASE CON EL RELOJ DE ENTRADA DE 2.048 MHZ. TANTO LA INTERFAZ DE ENTRADA COMO LAS OCHO TRAMAS DE SALIDA PCM SE AJUSTAN A LA RECOMENDACIONES G.703, G.704 Y G.706 DE LA UIT-T. ADEMAS DISPONE DE UNA SEÑAL DE ALARMA QUE SE ACTIVA EN EL CASO QUE DESAPAREZCA LA SEÑAL DE RELOJ DE 2.048 MHZ DE LA ENTRADA DEL CONVERSOR.
Applications Claiming Priority (1)
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| ES009802716A ES2148109B1 (es) | 1998-12-30 | 1998-12-30 | Conversor de reloj de 2.048 mhz a señal de linea a 2.048 mbit/s |
Publications (1)
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ID=8306254
Family Applications (1)
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| SV2000000002A SV2000000002A (es) | 1998-12-30 | 2000-01-03 | Conversor de reloj de 2.048 mhz a señal de linea a 2.048 mbit/s |
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