TW200937199A - Data transfer - Google Patents

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200937199 六、發明說明：

C 明戶斤属冬奸々貝J 發明領域 5 ❹ 10 15 ❿ 20 本發明關於用於轉移電腦系統中的資料之一資料轉移 引擎。 L 冬好 3 發明背景 直接記憶體存取(DMA)指的是電腦系統中的一個特 徵，藉由這個特徵’資料可在記憶體裝置及/或記憶體映射 週邊裝置之間直接轉移而不需要透過中央處理單元(CPU) 傳遞該貢料。 儘管DMA現在很普遍’但在無dma的情況下，CPU將 必須把資料從目的裝置讀到該CPU的一個或多個運算元暫 存器’然後把該資料從它的運算元暫存器寫到目的裝置。 這將是處理器資源的一種浪費，尤其是在幾個位元組遭轉 移的時候’因為CPU將必須在整個轉移過程中遭佔用。 而使用DMA，在CPU上運行的軟體僅設定該DMA引擎 以直接轉移資料’藉由使用來源位址，目的位址及要遭轉 移的資料之數量來規劃該DMA引擎。在該設定之後，接著， 該CPU可繼續其他的任務’而該DMA引擎獨立於CPU來完 成該轉移。 但是，該DMA轉移提前遭設定的事實可引入時序難題。 【發明内容】 發明概要 3 200937199 10 15 20 習知地’要設定— DMA，規劃該DMA的軟體必須提供 相關設定資訊給該DMA。然而，儘管在DMA遭設定時的該 時間點上此貞訊可缺正確的，但在設定的時間點與資料 實際遭轉移__之間，歸訊可發生變化。例如，該 來源裝置那時可能有額外的資料或者該目的裝置之可得以 接收該資料的儲存容量可能已減少。 依據本發明之一層面，提供—種積體電路晶片，它 3 ·多個可疋址的晶片上裝置；用以在該等裝置之間轉 資料^DMA倾轉移”；及用以執行用於設定該資料 轉移引擎以執行-轉移之轉移設定程式碼的—中央處理單 几，該設定包含：從該等多個裝置中向資料轉移引擎指干 -來源裝:的位址與一目的裳置的位址;遭配置以在該轉 Γ=Τ執行之後的—時間產生-觸發的時序裝 置;及遭配置以在該時間決定要遭轉移的資料的數量2 移控制裝置;其中該_弓|擎遭配置以接收來自該= 置之該觸發及來自該轉移控制裝置之n 週邊介面。 之貝枓轉移到該目的 因此藉由產生針對資料之該數量以及 啟動該DMA轉移，本發明允許在' ^觸發的決疋來 上而不是在D Μ A設定的時間點上決二轉移本身的時間點 量。要轉㈣資料之該數4不^轉移的資料之該數 上遭指示，因此該軟體不必提前_^崎的時間點 在本發明的一尤其有利的_中1^⑽〇

4 200937199 一個用於一外部週邊裝置的週邊介面，且該目的裝置是該 等週邊介面之一。 本發明已經認識到的是，上述時序問題在寫資料到外 部週邊裝置的驅動軟體的情況中是尤其有問題的。典型 5 地，這样的軟體只具有有限的時間量運行在該CPU上，所 以必須提前設定轉移，然後允許硬體計時器決定該等轉移 何時發生。 在實施例中，該目的週邊介面可以是在無線通訊中使 〇 用的一RF介面。該RF介面可遭組配以透過一無線蜂巢式網 10 路通訊。 - 上述時序問題在RF驅動軟體的情況中是尤其有問題的 . 尤其是對蜂巢式通訊來說，因為對與典型地遭排程用於該 RF驅動之處理器時間量相關之該週邊裝置上之輸出的連續 要求。因此本發明對無線通訊有一尤其有利的應用。 15 在進一步的實施例中，轉移控制裝置可遭組配以依據 在該來源裝置中有多少等待遭轉移的資料來決定該數量。 © 該轉移控制裝置可遭組配以依據該目的週邊介面的一 個或多個暫存器中可得以接收資料的空間來決定該數量。 該時序裝置可遭配置以依據一外部時序事件來決定該 20 時間。 該外部時序事件可透過一啓動週邊裝置而不是透過該 目的週邊裝置及與該來源裝置相關聯的一週邊裝置來產 生，而該控制裝置可遭配置以依據從該啓動週邊裝置接收 到的一指示來決定該數量。 5 200937199 該時序裝置可遭配置以在該轉移和至少一個其他的轉 移之該等時序之間做出仲裁，並且依據該仲裁產生該觸發。 _該時序裝置可遭配置以依據在該設定中由該中央處理 單凡指定的-時間來決定該時間。 5 豸資料轉移引擎可包含第- DMA級和第二DMA級，且 έ第DMA級可遭配置以將來自該來源裝置之資料提供給 該第二DM A級。 對遭定時在不為該來源裝置或目的裝置所知的一外部 時序事件時啟動的DMA來說，本發明具有尤其的優勢而不 疋專有的優勢。進一步說，要轉移的位元組之數目可藉由 "T月b既不疋該來源農置也不是該目的裝置的一啓動週邊裝 置來產生。 依據本發明之另一層面，提供了一種在一積體電路晶 片中轉移資料的方法，該方法包含以下步驟：執行用於設 15疋一DMA資料轉移引擎以執行一轉移之轉移程式碼，該設 定包含：從多個可定址晶片上裝置中向該資料轉移引擎指 不一來源裝置及目的裝置的位址；決定在該轉移程式碼遭 執行之後的一時間’該轉移應在該時間發生，且在該時間 產生一觸發；在該時間’決定要轉移的資料之數量；把該 2〇 觸發及針對該數量的一指示提供給資料轉移引擎；及依據 該DMA引擎接收到該觸發，使用該DMA引擎把來自該來源 裝置之該數量之資料轉移到該目的裝置。 為了對本發明有一個更好的理解及顯示如何實行本發 明，現在將以範例的方式參考附圖。 200937199 圖式簡單說明 第1圖是軟體數據機電腦祕的—示意性方塊圖， 第2圖是-DMA貧料轉移引擎的一示意性方塊圖，及 第3圖是一 DMA引擎的—較低層的一示 意性方塊圖。 5 β 10 15 Ο 20 【實施方式3 較佳實施例之詳細說明 第1圖不意性地說明了供在一行動終端機（諸如行動電 活）中使用的一積體電路包2。該電路2包含連接著一指令記 憶體10、一資料記憶體12、—指令快取記憶體6，及一資料 快取記憶體8的一中央處理單元(cpu)4。指令記憶體1〇、資 料記憶體12、指令快取記憶體6 ’及資料快取記憶體8的每 一個都遭連接到一直接記憶體存取(DMA)資料轉移引擎 14，該轉移引擎14接著連接到包含一資料匯流排和一位址 匯流排的一系統互連體16。 該系統互連體16在該DMA資料轉移引擎14、一記憶體 控制器18 ’及以連接到外部裝置（即在積體電路2外部）的週 邊介面20與22的形式的各種晶片上裝置之間連接。該記憶 體控制器18連接到一個或多個外部記憶體裝置(未表示）。例 如’該記憶體控制器18可支援與RAM(諸如SDRAM或行動 DDR)的連接、與快閃記憶體（諸如nand快閃或NOR快閃） 的連接’及/或與一安全ROM的連接。週邊介面的例子包括 一類比射頻（RF)介面22及一個或多個額外的週邊介面20。 一個或多個額外的週邊介面20的每一個連接到一各自的外 部裝置（也未表示）。例如該等週邊介面2〇可包括一USIM介 7 200937199 面20a、一電源管理介面20b、一UART介面2〇c、一音訊介 面20d，及/或一通用1/0介面2〇e。該RF介面22與一外部射 頻前端及天線(也未表示）連接，且最終透過空中介面與一無 線蜂巢式網路連接。在有多個週邊介面的時候，一些或全 5部這些週邊介面可透過一週邊匯流排（也未表示）連接到該 系統互連體16。 在一較佳的實施例中’使用的晶片是藉由Icem設計並 且以Livanto®的商標名稱銷售的。這樣的一晶片具有例如 在W02006/117562中所描述的一已特定化的處理器平台。 10 在本發明的一較佳的應用中，該積體電路2遭組配為一 軟體數據機或“軟數據機，，，使用一無線蜂巢式網路來處理 無線通訊。軟體數據機背後的原理是在—通用的可規劃的 可再組配的處理器中執行該等無線通訊所需的信號處理的 主要部分，而不是在專用的硬體上執行。 15 較佳地，該軟體數據機是一軟基頻數據機。也就是說， 在接收端，從自天線接收RF信號直到且包括混合降頻至基 頻的所有的無線電功能都以專用硬體來實施。同樣地，在 發射端，從自基頻混合升頻到輸出RF信號至天線的所有的 功能都以專用硬體來實施。然而，該基帶域中的所有功能 20 都以遭儲存於指令記憶體10、資料記憶體12及外部記憶體 上的軟體來實施，且藉由處理器4執行。 在—較佳的實施例中，該RF介面22的該接收部分中的 專用硬體可包含一低雜訊放大器（LNA)，用以將接收到的 RF信號降頻轉換到中頻(IF)及用以從IF降頻轉換到基頻的 200937199 混合器、RF及IF濾波器級，及一類比到數位轉換(ADC)級。 對於多個接收分集支路中的每一個而言，在每一同相和正 交的基頻支路上提供一ADC。該]^?介面22的發射部分中的 該專用硬體可包含一數位到類比轉換(DAC)級，及用以將基 5 ❹ 10 15 Ο 20 頻信號升頻轉換到IF及從IF升頻轉換到RF的混合器、RF及 IF濾波器級，及一功率放大器（PA)。可取捨地，這些級的 其中一些可在一外部前端中遭實施(在這種情況下，就其本 身而論，該RF介面可能不輸入且不輸出RF信號，但是在其 遭組配以以RF通訊為最終目的而與該111；前端通訊已升頻/ 降頻轉換或已部分地處理之信號的意義上來說，它仍然指 的是一個RF介面）。該RF介面的該“週邊”是該天線及任何需 要在該晶片2外部的相關聯前端。執行這種無線電功能所需 硬體的細節對於該技藝中具有通常知識者者來說是習知的。 接收到的資料藉由該系統互連體16、DMA資料轉移引 擎14及資料記憶體12遭從該RF介面22傳遞到該處理器4來 進仃信號處理。要遭發射的資料藉由該資料記憶體12、1)1^八 資料轉移引擎14及系統互連體16遭從該處理器4傳遞到該 RF 介面 22。 運行在該處理器4上的該軟體數據機然後可處理諸如 下述之功能： -調變與解調， -交錯與解交錯， -速率匹配與解匹配， -通道估計， 9 200937199 -等化， -季巴式處理， -位元對數相似度比(LLR)計算， -發射分集處理， 5 -接收分集處理， -多輸入多輸出（ΜΙΜΟ)處理， _語音編解瑪， -透過功率控制或適應性調變及編碼的鏈路適應，及/或 -蜂巢格量測。 ❹ 10 現關於第2圖對該DMA資料轉移引擎14作更詳細的討

論。在實施例中，該資料轉移引擎14包含多個不同的DMA 引擎階層級(hierarchical stage):較低層DMA引擎26，在本 文中指的是HRL(硬體已調節潛時）’及一個或多個較高層 DMA引擎24。該（等）較高層DMA引擎24遭配置以接收來自 15 資料快取記憶體8、資料記憶體12、記憶體控制器18、RF 介面22及額外的週邊介面20中的任一個之資料(若需要，可 透過該系統互連體16);及寫資料到該指令快取記憶體6、 © 指令記憶體10、資料快取8記憶體、資料記憶體12及記憶體 控制器18。較低層HRL DMA引擎26是一‘‘附加”，其特定地 20 遭配置以透過該系統互連體16來將資料寫入到該等週邊介 面20及22的記憶體可定址暫存器，即，寫入到週邊介面而 不是儲存記憶體。該資料轉移引擎14還包含連接到該等 DMA層級24及26的一計時器28及轉移控制器29。該計時器 28及控制器29之操作在下文中遭討論。 10 200937199 該結構是層級式的，即，一較低層DMA引擎26之資料 緩衝器由一較高層DMA引擎24來饋送。 在操作中，該CPU 4執行藉由如下動作來設定一Dma 轉移的程式碼：隨著與該轉移相關聯的任何時序條件，將 5 源位址和目的位址寫入到—較高層DMA引擎24的暫存器。 s亥CPU 4可設定在任何該等不同的記憶体已定址裝置6、8、 10、12、18、20及22之間的一些這樣的轉移。這些轉移在 該計時器28的控制下可遭定時在某些時間發生，例如藉由 © —外部時序事件或過去某一預定時間段來觸發。進一步， 10因為DMA引擎14只具有有限數目的通道，所以這些轉移的 時序可能會相互衝突，因此該計時器28也可遭組配以在該 - 料移之該科序之間做出仲裁，例如基於該等轉移的相 對延遲及/或根據優先方案。 時序問題尤其與用於-週邊裝置的驅動軟體有關，典 15型地，該驅動軟体只具有有限的時間量在CPU上運行，因 此需要提前(在其他任務遭排程之前，例如用於其他週邊裝 ® 置的其他驅動軟體)設定-個❹個轉移。因此，在該設定 之後，該硬體計時器28當一個轉移停止的時候，當缓 衝器為-新的轉移而遭再規劃的時候，及當該新的轉移遭 20啟動的時候計時。該系統計時器28確保這些暫存器寫入發 生在正確的時間，即使用於此週邊裝置的該驅動軟體不再 現時地遭排程並遭該CPU 4執行。 由於對與在該CPU 4上遭排如於該肝驅動之時間量 有關之經由該RF介面22之輸出（分頁、交遞、蜂巢格量值、 11 200937199 語音資料等）的速續要求，一軟體數據機的用於該介 的RF驅動，尤其對於無線蜂巢式通訊而言，特別易受、= 難題的影響。 習知地，透過該CPU 4的該設定還將必須包括把要遭轉 5移的位元組之數目的一指示寫入到該較高層DMA引擎24 然而，正如所述，在該轉移遭設定的時間與該轉移實際遭 執行的時間之間，情況可能會變化。例如該來源裝置可处 有額外的資料要轉移或該目的裝置可能已經改變了可得以 用來接收遭轉移資料的儲存空間。 10 15 20 這個問題對定時在該源週邊介面或該目的週邊介面都 不知曉的由一外部週邊裝置產生的一外部時序事件時啟動 的DMA轉移來説是特別（不是專有）地重要，目為這個事件 相對於該驅動之該排程動作的時序無法遭知曉。 因此，本發明的實施例遭提供轉移控制邏輯元件29， 該轉移控制邏輯元件29遭組配以衫要遭轉移之資料的數 量’其中，該決定在該轉移實際發生的時候Μ是在直透 =U 4遭設定的時候遭執行。㈣，這並不綱地在 個時刻實現，但要點是與該轉料不是與該設定 ，齡）。輯時_提供朗發且絲制器四提 的位元組之數目的1示職HRL26，該HRL26 邊裳置2G=時把位讀之該數目寫人到討論巾的這個週

姆細置之資料 的二間來做決定。該數量甚至可 12 200937199 基於來自啓動（launching)週邊裝置而不是該來源和目的週 邊裝置的輸入來決定。 該HRL 26及其與一較高層DMA引擎24、計時器28及控 制器29之介面現在關於第3圖來進一步詳細地討論。 5 e 10 15 Ο 20 該HRL 26包含具有連接到該較高層DMA引擎24的一 輸入33的一位址解碼器32。該HRL 26進一步包含N個佇列 區塊30⑴…30(N) ’每一區塊具有包含一組先入先出（FIF〇) h料緩衝器之一各自的資料仔列40( 1)...40(N)，及包含一組 FIFO位址緩衝器之一各自的相對應的位址佇列 42⑴…42(N)。每一個資料佇列4〇⑴…4〇(N)和位址佇列 42(1)…42(N)具有連接到該位址解碼器32的一各自的輸 入。對每一個資料佇列40⑴…40(N)，該位址解碼器32還提 供路由44(1)·.·44(Ν)來透過該較高層DMA引擎24從來源裝 置8、12、18、20、22擷取資料並把它傳遞到該各自的資料 佇列40⑴…40(N)。該HRL 26進一步包含一循環式 (round-robin)仲裁多工器38’與每一個資料仵列4〇(1)...4〇(N) 和位址佇列42(1)...42(N)的一輸出遭連接到該多工器38之 一各自的輸入。該多工器38具有連接到該系統互連體16的 一輸出46。 另外，每一個佇列區塊3〇⑴…3〇(N)包含一各自的計數 器34(1).·.34(N)’每一計數器具有連接到該多工器38之一各 自的控制輸入的一輸出。每—計數器34⑴…34(n)還具有一 輸入’該輸入透過一各自的控制匯流排36(1)···36(Ν)(本文 中所#曰的疋一 SIC(簡單互連).介面或匯流排）來連接到該計 13 200937199 時器28及控制器29。每一 SIC控制匯流排36⑴…36(N)較佳 地包含來自該計時器28的一單一觸發線及來自該控制器29 的7位元寬的計數匯流排。在實施例中，是這個控制介面36 有利地允許把一DMA寫入一週邊介面的時序與透過該CPU 5 4之轉移之該設定的時序分離。 在操作中，該較高層DMA引擎24傳遞該來源及目的位 址到該HRL 26b的位址解碼器32。該位址解碼器32找到一閒 置佇列區塊30(每一區塊3〇係用於到一不同目的地之轉 移），並且傳遞該等目的位址到此區塊的位址佇列42中。該 10 位址解碼器32還利用該來源位址來經由路由44透過該較高 層DMA引擎24請求來自該來源裝置8、12、18、20或22的該 相對應的來源資料，並且把該已擷取的資料傳遞到該資料 佇列40。較佳地，該資料佇列中的每一項都是32位元字組 寬。因此’該等佇列儲存資料字組對及相對應的目的位址， 15 以藉由該較高層DMA引擎24來饋送而將該資料寫入到目的 裝置。 如果在該等佇列40中無資料遭設定，則該HRL等待資 料。假定在該觸發啟動該HRL寫入到該目的地之前資料是 可得的’但這不是強制的。如果該等佇列40是空的，則到 20 該較高層DMA引擎的DMA請求信號將遭確認，然後資料將 會在稍後遭下送到該HRL。 當該計時器28決定寫入到某一週邊裝置的操作到了該 發生的時候，如以上所討論的，它透過該相對應的SIC控制 匯流排36的該觸發線來提供一觸發信號到適當的佇列區塊 200937199 30的該計數器34。伴隨著該觸發信號，控制邏輯元件29在 該觸發產生的時候也提供要遭轉移的位元組之數目的一計 數。該計數器34然後計數出來自與它的相對應的目的位址 配對的該資料件列40的資料位元組之數目。 5 循環式仲裁多工器38輸出該等資料位元組及相對應的 目的位址到該系統互連體16的資料與位址匯流排上，以一 循環式的方式在任何具有等待輸出的資料之佇列區塊3〇之 该等输出之間循環。 使用HRL的例子是從在一不同的時鐘域内之被稱為蜂 10巢式計時器（CET)的一週邊裝置產生SIC信號的情況。該來 源實際上是一CPU寫入(並不直接寫入到目的週邊裝置，取 而代之的是，該CPU把位址和資料寫入到HRL佇列中）。該 目的地是該RF介面FIFO組態暫存器。CPIL^RF介面均不知 何時該寫入將遭排程，因此其被提前設定並且該等信 15號在正確的時間執行該寫入。該cet異步於目標及目的裝置。 應了解以上實施例僅以例子的方式描述。例如不必使 用不同層級的DMA，計時器與轉移控制器可在-單-DMA 引擎中用來控制轉移。進一步，轉移可藉由其他時序事件 觸發及/或要轉移資料的量可基於其他準則來決定。對該技 «中八有通常知識者而言，本發明的其他變化和使用在本 中所，。出之揭露内容後將顯而易見。本發明的範圍不受 所描述的實施例的限制，而僅受後附專财請的限制。 【圖式簡草說明】 第1圖是軟體數據機電腦系統的一示意性方塊圖， 15 200937199 第2圖是一 DMA資料轉移引擎的一示意性方塊圖，及 第3圖是一 DMA引擎的一較低層的一示意性方塊圖。 【主要元件符號說明】 2.. .積體体電路包、積體電路、晶片 4.. .中央處理單元(CPU)、處理器 6.. .指令快取記憶體 8.. .資料快取記憶體

10.. .指令記憶體 12.. .資料記憶體 14…直接記憶體存取(DMA)資料轉移引擎

16.. .系統互連體 18…記憶體控制器 20…週邊介面 20a".USIM 介面 20b...電源管理介面 20c".UART 介面 20d…音訊介面 20e...通用I/O介面 22.. .類比射頻(RF)介面、週邊介面 24.. .較高層DMA引擎 26…較低層DMA引擎、較低層HRL DMA引擎 28...計時益 16 200937199 29…轉移控制器、轉移控制邏輯元件 30(1)..·(η).·.佇列區塊 32…位址解碼器 33·.·輸入 34(1)...⑼…計數器 36(1)...(Ν)...控制匯流為卜、控制介面 38.. .循環式仲裁多工器 40(1)...⑼…資料仔列 42(1)…⑼…位址佇列 44(1)...(Ν)...路由 46.. .輸出

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Claims (1)

1. 200937199 七、申請專利範圍： 1. 一種積體電路晶片，其包含： 多個可定址的晶片上裝置； 用於在該等裝置之間轉移資料的一直接記憶體存 5 取(DMA)資料轉移引擎；及 用於執行用以設定該資料轉移引擎以執行一轉移 之轉移設定程式碼的一中央處理單元，該設定包含從該 等多個裝置中向該資料轉移引擎指示一來源裝置的位 址及一目的裝置的位址； 10 遭配置以在該轉移設定程式碼遭執行之後的一時 間產生一觸發的時序裝置；及 遭配置以在該時間決定要遭轉移的資料之數量的 轉移控制裝置； 其中該DMA引擎遭配置以接收來自該時序裝置的 15 該觸發及來自該轉移控制裝置的針對該數量之一指 示，且遭配置以根據該觸發把該數量之資料轉移到該目 的週邊介面。 2. 如申請專利範圍第1項所述之積體電路晶片，其中該等 裝置包括至少一個用於一外部週邊裝置的週邊介面，且 20 該目的裝置是該等週邊介面之一。 3. 如申請專利範圍第2項所述之積體電路晶片，其中該目 的週邊介面是在無線通訊中使用的一射頻(RF)介面。 4. 如申請專利範圍第3項所述之積體電路晶片，其中該RF 介面遭組配以透過一無線蜂巢式網路通訊。 200937199 5. 如前述申請專利範圍中任一項所述之積體電路晶片，其 中該轉移控制裝置遭組配以依據在該來源裝置中等待 遭轉移的資料之多少來決定該數量。 6. 如前述申請專利範圍中任一項所述之積體電路晶片，其 5 中該轉移控制裝置遭組配以依據在該目的週邊介面的 一個或多個暫存器中可接收資料的空間來決定該數量。 7. 如前述申請專利範圍所述之積體電路晶片’其中該時序 裝置遭配置以依據一外部時序事件來決定該時間。 ® 8.如申請專利範圍第7項所述之積體電路晶片，其中該外 10 部時序事件是藉由一啓動週邊裝置而不是該目的週邊 裝置及與該來源裝置相關聯的一週邊裝置產生的，且該 . 控制裝置遭配置以依據從該啓動週邊裝置接收到的一 指示來決定該數量。 9. 如前述申請專利範圍中任一項所述之積體電路晶片，其 15 中該時序裝置遭配置以在該轉移及至少一個其他的轉 移之時序之間做出仲裁，且遭配置以根據該仲裁產生該 ® 觸發。 10. 如前述申請專利範圍中任一項所述之積體電路晶片，該 時序裝置遭配置以依據在該設定中由該中央處理單元 20 指定的一時間來決定該時間。 11. 如前述申請專利範圍中任一項所述之積體電路晶片，其 中該資料轉移引擎包含一第一DMA級及一第二DMA 級，該第一DMA級遭配置以將來自該來源裝置之資料提 供給該第二DMA級。 19 200937199 12. —種在一積體電路晶片中轉移資料的方法，該方法包含 以下步驟： 執行用於設定一 DMA資料轉移引擎以執行一轉移 之轉移程式碼，該設定包含從多個可定址的晶片上裝置 5 中向該資料轉移引擎指示一來源裝置及一目的裝置的 位址； 決定在該轉移程式碼遭執行之後的一時間，該轉移 應在該時間發生，及在該時間產生一觸發； 在該時間，決定要轉移的資料的數量； 10 把該觸發及針對該數量的一指示提供給該資料轉 移引擎；及 依據該DMA引擎接收到該觸發，使用該DMA引擎 把來自該來源裝置之該數量之資料轉移到該目的裝置。 13. 如申請專利範圍第12項所述之方法，其中該等裝置包括 15 至少一個用於一外部週邊裝置的週邊介面，且該目的裝 置是該等週邊介面之一。 14. 如申請專利範圍第13項所述之方法，其中該目的週邊介 面是一在無線通訊中使用的一 RF介面。 15. 如申請專利範圍第14項所述之方法，包含透過一無線蜂 20 巢式網路使用該RF介面通訊。 16. 如申請專利範圍第12項到第15項中任一項所述之方 法，其中該決定該數量的步驟包含依據在該來源裝置中 等待遭轉移的資料的多少來決定該數量。 17. 如申請專利範圍第12項到第16項中任一項所述之方 200937199 法，其中該決定該數量的步驟包含依據在該目的週邊介 面的一個或多個暫存器中可得以接收資料的空間來決 定該數量。 18. 如申請專利範圍第12項到第17項中任一項所述之方 5 法，其中該決定該時間的步驟包含依據一外部時序事件 來決定該時間。 19. 如申請專利範圍第12項到第18項中任一項所述之方 法，其包含使用一啓動週邊裝置而不是該目的週邊裝置 ® 及與該來源裝置相關聯的一週邊裝置來產生該外部時 10 序事件，其中該決定該數量的步驟包含依據從該啓動週 — 邊裝置接收到的一指示來決定該數量。 ‘ 20.如申請專利範圍第12項到第19項中任一項所述之方 法，其包含在該轉移及至少一個其他的轉移之時序之間 做出仲裁，及依據該仲裁產生該觸發。 15 21.如申請專利範圍第12項到第20項中任一項所述之方 法，其中該決定該時間的步驟包含依據在該設定中由該 中央處理單元指定的一時間來決定該時間。 22.如前述申請專利範圍中任一項所述之方法，其中該資料 轉移引擎包含一第一 DMA級及一第二DMA級，並且該 20 方法包含將來自該來源裝置資料提供給該第二DMA級。 21