TWI514346B - 顯示器面板 - Google Patents

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TWI514346B TW102146543A TW102146543A TWI514346B TW I514346 B TWI514346 B TW I514346B TW 102146543 A TW102146543 A TW 102146543A TW 102146543 A TW102146543 A TW 102146543A TW I514346 B TWI514346 B TW I514346B
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Jia Hao Bai
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Innolux Corp
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Description

顯示器面板
本發明系關於一種顯示器面板與顯示器裝置；特別關於一種具有增強的驅動能力並可有效縮減驅動電路面積之顯示器面板與顯示器裝置。
移位暫存器(shift register)被廣泛應用於顯示器裝置之資料驅動電路與掃描驅動電路，用以分別控制各資料線取樣資料訊號之時序，以及為各閘極線產生掃描訊號。在掃描驅動電路中，移位暫存器用以產生一掃描訊號至各閘極線，用以驅動各閘極線上的畫素。另一方面，在資料驅動電路中，移位暫存器用以輸出一選取訊號至各資料線，使得影像資料可依序被寫入各資料線。
當顯示器裝置之解析度增加時，所需之畫素數量與對應之控制電路的數量也會隨之增加。然而，為了避免大幅增加顯示器驅動裝置之整體電路面積，控制電路必須被精簡，並且精簡的控制電路仍必須保持足夠的驅動能力。有鑑於此，需要一種全新的驅動電路，不僅具有增強的驅動能力，更可有效精簡電路面積。
根據本發明之一實施例，一種顯示器面板，包括一掃描驅動電路。掃描驅動電路包括複數串接之移位暫存器，其中移位暫存器之至少一者包括控制電路、抬昇電路與輸出電路。控制電路用以根據一啟動訊號控制第一控制節點之電壓，以及根據重置訊號控制第二控制節點之電壓。抬昇電路耦接至控制電路，用以抬昇第一控制節點之電壓。輸出電路耦接至抬昇電路與控制電路，用以根據第一控制節點之電壓於複數輸出節點輸出複數閘極驅動訊號。閘極驅動訊號之其中一者被提供至下一級移位暫存器，用以作為下一級移位暫存器之該啟動訊號。
30‧‧‧掃描驅動電路
100‧‧‧顯示器裝置
101‧‧‧顯示器面板
102‧‧‧輸入單元
110‧‧‧掃描驅動電路
120‧‧‧資料驅動電路
130‧‧‧畫素矩陣
140‧‧‧控制晶片
200、400、500、800、SR[1]、SR[2]、SR[3]、SR[N-1]、SR[N]‧‧‧移位暫存器
201、401、501、801‧‧‧控制電路
202、403、503、803‧‧‧輸出電路
402、502、802‧‧‧抬昇電路
811、812‧‧‧電路子單元
Cc1、Cp‧‧‧電容
CK、CK1、CK2、CK3、CK4‧‧‧時脈訊號
D1、D2‧‧‧時間區間
G(1)、G(2)、G(3)、G(4)、G(5)、G(6)、G(7)、G(8)、G(9)、G(n-2)、G(n-1)、G(n)、G(n+1)、G(n+2)、G(3N-5)、G(3N-4)、G(3N-3)、G(3N-2)、G(3N-1)、G(3N)‧‧‧閘極驅動訊號
M1、M2、Tc1、Tc2、Tc3、TFT1-1、TFT1-2、TFT1-3、TFT2-1、TFT2-2、TFT2-3、Ts1、Ts2、Ts3‧‧‧電晶體
Ncp、P、Q、SP‧‧‧控制節點
OUT、OUT1、OUT2、OUT3‧‧‧輸出節點
SStart ‧‧‧啟動訊號
SPreCharge ‧‧‧預充電訊號
SReset ‧‧‧重置訊號
T1、T2、T3、T4‧‧‧時間
V0 、V1 、V2 、V3 、V4 、VGL ‧‧‧電壓
第1圖係顯示根據本發明之一實施例所述之顯示器裝置方塊圖。
第2圖係顯示一移位暫存器方塊圖。
第3圖係顯示根據本發明之一實施例所述之移位暫存器串接方塊圖。
第4圖係顯示根據本發明之一實施例所述之一對多移位暫存器方塊圖。
第5圖係顯示根據本發明之一實施例所述之一對多移位暫存器電路圖。
第6圖係顯示根據本發明之一實施例所述之各節點電壓 變化與訊號波形圖。
第7圖係顯示根據本發明之另一實施例所述之移位暫存器串接方塊圖。
第8圖係顯示根據本發明之另一實施例所述之一對多移位暫存器電路圖。
第9圖係顯示根據本發明之另一實施例所述之各節點電壓變化與訊號波形圖。
為使本發明之製造、操作方法、目標和優點能更明顯易懂，下文特舉幾個較佳實施例，並配合所附圖式，作詳細說明如下：
實施例：
第1圖係顯示根據本發明之一實施例所述之顯示器裝置方塊圖。如圖所示，顯示器裝置100可包括一顯示器面板101、一資料驅動電路120與一控制晶片140，其中顯示器面板101包括一掃描驅動電路110及一畫素矩陣130。掃描驅動電路110用以產生複數閘極驅動訊號以驅動畫素矩陣130之複數畫素。資料驅動電路120用以產生複數資料驅動訊號以提供影像資料至畫素矩陣130之複數畫素。控制晶片140用以產生複數時序訊號，包括時脈訊號、重置訊號與起始脈衝等。
此外，顯示器裝置100可進一步包括一輸入單元102。輸入單元102用於接收影像訊號，以控制顯示器面板101顯示影像。根據本發明之實施例，顯示器裝置100可應用於一 電子裝置中，其中電子裝置有多種實施方式，包括：一行動電話、一數位相機、一個人數位助理、一行動電腦、一桌上型電腦、一電視機、一汽車用顯示器、一可攜式光碟撥放器、或任何包括影像顯示功能的裝置。
根據本發明之一實施例，掃描驅動電路110包括複數串接之移位暫存器，其可依序產生一閘極驅動訊號至各閘極線，用以驅動各閘極線上之畫素。
第2圖係顯示一移位暫存器方塊圖。移位暫存器200可包含控制電路201與輸出電路202。控制電路201根據啟動訊號SStart 與重置訊號SReset 控制控制節點P與Q之電壓位準。輸出電路202可包含電晶體M1與M2，以及電容Cc1。電晶體M1耦接至控制節點P，用以根據控制節點P之電壓切換其導通狀態。電晶體M2耦接至控制節點Q，用以根據控制節點Q之電壓切換其導通狀態。當電晶體M1被導通時，時脈訊號CK可被傳送至輸出節點OUT，作為輸出之閘極驅動訊號。當電晶體M2被導通時，輸出節點OUT之電壓可被重置為低操作電壓VGL 。由於閘極驅動訊號通常需被傳送至下一級移位暫存器，用以作為下一級移位暫存器之啟動訊號，因此，輸出電路202通常會配置電容Cc1，用以抬昇控制節點P之電壓位準，以增強閘極驅動訊號之驅動能力，使得閘極驅動訊號之電壓足夠啟動下一級移位暫存器。
第2圖所示之移位暫存器200為一對一移位暫存器，其中移位暫存器200僅輸出一閘極驅動訊號。然而，為了進一步精簡掃描驅動電路的電路面積，移位暫存器可被改良 為一對多的架構。換言之，一級移位暫存器可輸出多筆閘極驅動訊號，用以驅動多條閘極線。
第3圖係顯示根據本發明之一實施例所述之移位暫存器串接方塊圖。掃描驅動電路30可包括複數串接之一對多移位暫存器SR[1]、SR[2]、SR[3]、...SR[N-1]、SR[N]，其中N為一正整數。值得注意的是，為了清楚闡述本發明之概念，第3圖中所示之移位暫存器SR[1]~SR[N]為一對三多移位暫存器。然而，必須理解的是，任何熟習此項技藝者，在不脫離本發明之精神和範圍內，當可根據本發明之概念做些許的更動與潤飾，實作出一對二、一對四、或其他形式之一對多移位暫存器。因此，本發明並不限於第3圖所示之架構。
如圖所示，各級移位暫存器SR[1]~SR[N]分別用以輸出三個閘極驅動訊號，例如，移位暫存器SR[1]可輸出閘極驅動訊號G(1)~G(3)，移位暫存器SR[2]可輸出閘極驅動訊號G(4)~G(6)，並以此類推。除第一級移位暫存器SR[1]之外，各級移位暫存器可接收前一級移位暫存器所輸出之多個閘極驅動訊號之其中一者作為啟動訊號，而第一級移位暫存器SR[1]則可自控制晶片接收起始脈衝作為對應之啟動訊號SStart 。此外，除最後一級移位暫存器SR[N]之外，各級移位暫存器可接收後一級移位暫存器所輸出之多個閘極驅動訊號之其中一者作為重置訊號(圖未示)，而最後一級移位暫存器SR[N]則可自控制晶片接收系統重置訊號作為對應之重置訊號。
第4圖係顯示根據本發明之一實施例所述之一對多移位暫存器方塊圖。移位暫存器400可包括控制電路401、 抬昇電路402與輸出電路403。控制電路401可根據一啟動訊號SStat 控制控制節點P之一電壓，以及根據重置訊號SReset 控制控制節點Q之一電壓。如上述，啟動訊號SStart 可以是起始脈衝或前一級移位暫存器所輸出之多個閘極驅動訊號之其中一者，而重置訊號SReset 可以是系統重置訊號或後一級移位暫存器所輸出之多個閘極驅動訊號之其中一者。
抬昇電路402耦接至控制電路401，用以抬昇控制節點P之電壓。輸出電路403耦接至抬昇電路402與控制電路401，用以根據控制節點P與Q之電壓於複數輸出節點輸出複數閘極驅動訊號。根據本發明之一實施例，控制電路401可於第一時間區間拉高控制節點P之電壓至第一高電壓位準，而抬昇電路402可於第二時間區間進一步抬昇控制節點P之電壓至高於第一高電壓位準之第二高電壓位準。以下段落將對本發明所提出之一對多移位暫存器電路做更詳細的介紹。
第5圖係顯示根據本發明之一實施例所述之一對多移位暫存器電路圖。移位暫存器500可包括控制電路501、抬昇電路502與輸出電路503。控制電路501可根據一啟動訊號SStart 控制控制節點P之一電壓，以及根據重置訊號SReset 控制控制節點Q之一電壓。輸出電路503可包括複數輸出單元，各輸出單元分別包括一對串聯耦接之電晶體，例如，電晶體TFT1-1與TFT2-1、TFT1-2與TFT2-2、以及TFT1-3與TFT2-3。各輸出單元分別接收不同之時脈訊號作為對應之輸入訊號，並且用以於輸出節點OUT1、OUT2與OUT3輸出對應之閘極驅動訊號G(n)、G(n+1)與G(n+2)，其中n為一正整數。
根據本發明之一實施例，電晶體TFT1-1具有第一端耦接至用以接收時脈訊號CK1之一輸入節點、一第二端耦接至控制節點P、以及第三端耦接至輸出節點OUT1，而電晶體TFT2-1具有第一端耦接至輸出節點OUT1、一第二端耦接至控制節點Q、以及第三端耦接至低操作電壓VGL 。同樣地，電晶體TFT1-2具有第一端耦接至用以接收時脈訊號CK2之一輸入節點、一第二端耦接至控制節點P、以及第三端耦接至輸出節點OUT2，而電晶體TFT2-2具有第一端耦接至輸出節點OUT2、一第二端耦接至控制節點Q、以及第三端耦接至低操作電壓VGL 。電晶體TFT1-3具有第一端耦接至用以接收時脈訊號CK3之一輸入節點、一第二端耦接至控制節點P、以及第三端耦接至輸出節點OUT3，而電晶體TFT2-3具有第一端耦接至輸出節點OUT3、一第二端耦接至控制節點Q、以及第三端耦接至低操作電壓VGL 。
抬昇電路502可包括電容Cp與複數抬昇元件。電容Cp跨接於控制節點P與Ncp之間。第一抬昇元件耦接至控制節點Ncp，用以接收啟動訊號SStart ，並且因應啟動訊號SStart 控制控制節點Ncp之一電壓。第二抬昇元件耦接於控制節點Ncp與輸出節點OUT1~OUT3之其中一者之間，用以接收閘極驅動訊號G(n)~G(n+2)之其中一者，並且因應所接收之閘極驅動訊號進一步抬昇控制節點Ncp之電壓。
根據本發明之一實施例，抬昇元件可以是電晶體，例如，電晶體Tc1與Tc2。電晶體Tc1具有第一端耦接至控制節點Ncp、第二端接收啟動訊號SStart 、以及第三端耦接至低 操作電壓VGL 。電晶體Tc2具有第一端耦接至控制節點Ncp、第二端耦接至輸出節點OUT1、以及第三端耦接至用以接收時脈訊號CK1之輸入節點。根據本發明之一實施例，抬昇電路502可進一步包括電晶體Tc3。電晶體Tc3具有第一端耦接至控制節點Ncp、第二端接收重置訊號SReset 、以及第三端耦接至低操作電壓VGL ，用以因應重置訊號SReset 重置控制節點Ncp之電壓。
第6圖係顯示根據本發明之一實施例所述之各節點電壓變化與訊號波形圖。根據本發明之一實施例，啟動訊號SStart 可以是前一級移位暫存器所輸出之閘極驅動訊號G(n-1)，而重置訊號SReset 可以是後一級移位暫存器所輸出之閘極驅動訊號G(n+3)。結合第5圖的電路與第6圖的波形圖，以下將對本發明所提出之一對多移位暫存器電路之操作做更詳細的介紹。
假設控制節點P之初始電壓為V0 ，其中電壓V0 可具有低電壓位準，例如，低操作電壓VGL 之電壓位準。當啟動訊號SStart 之一脈衝抵達時，控制節點P之電壓會藉由控制電路501之控制相應被抬升為具有高電壓位準V1 。此時，電晶體Tc1會被導通，使得控制節點Ncp之電壓具有低操作電壓VGL 之一低電壓位準。同一時間，電晶體TFT1-1、TFT1-2與TFT1-3亦會被導通，用以分別將時脈訊號CK1、CK2與CK3之波形輸出作為對應之閘極驅動訊號G(n)、G(n+1)與G(n+2)。
當時脈訊號CK1之一脈衝抵達時，閘極驅動訊號G(n)會相應地產生一脈衝，此時，電晶體Tc2會被導通，以拉 高控制節點Ncp之電壓至約略等於高操作電壓VGH 之一高電壓位準。此時，控制節點P之電壓會因應控制節點Ncp之電壓變化被拉高至另一高電壓位準V2 。如第6圖所示，控制節點P於第一時間區間D1內具有高電壓位準V1 ，並且於第二時間區間D2內具有高電壓位準V2 ，其中V2 >V1 。最後，當重置訊號SReset 之一脈衝抵達時，控制節點P之電壓會被重置。同一時間，控制節點Q之電壓會具有高電壓位準，用以重置輸出節點OUT1~OUT3之電壓位準。
根據本發明之一實施例，由於控制節點Ncp之電壓先因應啟動訊號SStart 之脈衝被充電至低電壓位準，再因應時脈訊號CK1與閘極驅動訊號G(n)被充電至高電壓位準。因此，藉由電容Cp之耦合效應，控制節點Ncp之電壓變化會被耦合至控制節點P，使得控制節點P之電壓會從電壓V1 被拉高至V2 ，用以加強移位暫存器之驅動能力，其中當電路內之電子元件被適當的設計，V2 與V1 之壓差ΔP可接近(VGH -VGL )。
相較於第2圖所示之電路，於本發明之較佳實施例中，輸出電路中的電容被取消，改為使用抬昇電路502作為抬昇控制節點P之主要力量，如此一來，控制節點P之抬昇壓差ΔP不會因為輸出電路中的電容分散效應而衰減。值得注意的是，若不取消輸出電路之電容，則當輸出電路耦接之輸出單元數量越多，電容分散效應越大，使得控制節點P之電壓會被衰減的越嚴重。
於本發明之較佳實施例中，如第6圖所示，控制節點P之電壓於第二時間區間D2內可有效被抬昇至遠高於系 統之高操作電壓VGH 之一電壓位準，如此一來，有效增強了控制節點P的驅動能力，使得於各輸入節點接收的時脈信號之脈衝可完整地被傳送至輸出節點作為閘極脈衝。值得注意的是，於本發明所提出之電路架構中，即便輸出電路耦接之輸出單元數量增加，控制節點P之電壓也不會大幅衰減，有效解決傳統一對多移位暫存器電路驅動能力不足的問題。
此外，如上述，由於移位暫存器輸出之閘極驅動訊號將提供至下一級移位暫存器作為該級移位暫存器之啟動訊號，因此，除了增強控制節點P於第二時間區間D2之電壓抬昇能力之外，根據本發明之另一實施例，控制電路401/501可進一步接收一預充電訊號，並且根據預充電訊號與啟動訊號控制控制節點P於第一時間區間D1之電壓，用以進一步提升啟動訊號於第一時間區間D1之驅動能力。
根據本發明之一實施例，預充電訊號可以是前一級移位暫存器所輸出之複數閘極驅動訊號之其中一者，並且預充電訊號之脈衝以抵達早於啟動訊號之脈衝為較佳。第7圖係顯示根據本發明之另一實施例所述之移位暫存器電路方塊圖。移位暫存器電路70可包括複數串接之一對多移位暫存器SR[1]、SR[2]、SR[3]、...SR[N-1]、SR[N]，其中N為一正整數。值得注意的是，為了清楚闡述本發明之概念，第7圖中所示之移位暫存器SR[1]~SR[N]為一對三多移位暫存器。然而，必須理解的是，任何熟習此項技藝者，在不脫離本發明之精神和範圍內，當可根據本發明之概念做些許的更動與潤飾，實作出一對二、一對四、或其他形式之一對多移位暫存器。因此， 本發明並不限於第3圖所示之架構。
第7圖所示之電路架構與第3圖雷同，其差異僅在於除第一級移位暫存器SR[1]之外，各級移位暫存器接收前一級移位暫存器所輸出之多個閘極驅動訊號之其中兩者作為啟動訊號與預充電訊號。關於第7圖之介紹可參考第3圖之說明，並於此不再贅述。以下段落將對本發明所提出之控制電路做更詳細的介紹。
第8圖係顯示根據本發明之另一實施例所述之一對多移位暫存器電路圖。移位暫存器800可包括控制電路801、抬昇電路802與輸出電路803。抬昇電路802與輸出電路803之電路架構與第5圖所示之抬昇電路502與輸出電路503雷同，因此相關的介紹可參考第5圖之說明，於此不再贅述。根據本發明之一實施例，控制電路801可包括多個電路子單元，例如，電路子單元811與812。電路子單元811可根據啟動訊號SStart 與預充電訊號SPreCharge 控制控制節點P之電壓，電路子單元812可根據重置訊號SReset 控制控制節點Q之電壓。值得注意的是，控制電路當可包括其他未顯示於圖中之電路子單元，因此本發明並不限於第8圖所示之架構。
電路子單元811可包括複數控制元件。第一控制元件耦接至控制節點SP，並且接收預充電訊號SPreCharge ，用以因應預充電訊號SPreCharge 控制控制節點SP之一電壓。第二控制元件耦接至控制節點P與SP，並且接收啟動訊號SStart ，用以因應啟動訊號SStart 抬昇控制節點SP之電壓。第三控制元件耦接至控制節點SP，並且接收輸入訊號CK1，用以因應輸入訊號 CK1重置控制節點SP之電壓。
根據本發明之一實施例，控制元件可以是電晶體，例如，電晶體Ts1、Ts2與Ts3。電晶體Ts1具有第一端與第二端接收預充電訊號SPreCharge 、以及第三端耦接至控制節點SP。電晶體Ts2具有第一端接收啟動訊號該、第二端耦接至控制節點SP、以及第三端耦接至控制節點P。電晶體Ts3具有第一端耦接至控制節點SP，第二端接收一輸入訊號CK1、以及第三端耦接至低操作電壓VGL 。
第9圖係顯示根據本發明之另一實施例所述之各節點電壓變化與訊號波形圖。根據本發明之一實施例，啟動訊號SStart 可以是前一級移位暫存器所輸出之閘極驅動訊號G(n-1)，預充電訊號SPreCharge 可以是前一級移位暫存器所輸出之閘極驅動訊號G(n-2)，而重置訊號SReset 可以是後一級移位暫存器所輸出之閘極驅動訊號G(n+3)。結合第8圖的電路與第9圖的波形圖，以下將對本發明所提出之控制電路之操作做更詳細的介紹。
根據本發明之一實施例，當預充電訊號SPreCharge 之一脈衝於時間T1抵達時，電晶體Ts1被導通，使得控制節點SP之電壓具有第三高電壓位準V3 。同一時間，電晶體Ts2也會因應控制節點SP之高電壓位準而導通。當啟動訊號SStart 之一脈衝於時間T2抵達時，控制節點P之電壓會被拉高為具有第一高電壓位準V1 ，使得控制節點SP之電壓因應控制節點P之電壓變化(即，由V0 至V1 )被拉高至高於第三高電壓位準V3 之第四高電壓位準V4 。
於本發明之實施例中，利用預充電訊號SPreCharge 透過電晶體Ts1對控制節點SP充電，並且提前將電晶體Ts2導通，使得當啟動訊號SStart 之一脈衝抵達時，控制節點SP之電壓會被進一步抬昇，如此控制節點SP便可順利地對控制節點P充電而沒有壓降，有效提升控制節點P於第一時間區間D1之驅動能力。
當時脈訊號CK1之一脈衝於時間T3抵達時，控制節點P之電壓會如上述因應控制節點Ncp之電壓變化被拉高至另一高電壓位準V2 。如第9圖所示，控制節點P於第一時間區間D1內具有高電壓位準V1 ，並且於第二時間區間D2內具有高電壓位準V2 ，其中V2 >V1 。同一時間(T3)，電晶體Ts3會被導通，用以重置控制節點SP之電壓，並且關閉電晶體Ts2。最後，當重置訊號SReset 之一脈衝於時間T4抵達時，控制節點P之電壓會被重置。同一時間(T4)，控制節點Q之電壓會具有高電壓位準，用以重置輸出節點OUT1~OUT3之電壓位準。
於本發明之較佳實施例中，控制節點P於第一時間區間D1之電壓位準可透過電路子單元811之兩階式控制有效被提升，且控制節點P之電壓於第二時間區間D2之電壓位準可透過抬昇電路402/502/802之控制有效被提升，如此一來，有效增強了控制節點P的驅動能力，使得於各輸入節點接收的時脈信號之脈衝可完整地被傳送至輸出節點作為閘極脈衝，且各移位暫存器輸出之閘極驅動訊號亦可完整地被提供至下一級移位暫存器作為該級移位暫存器之啟動訊號，有效解決傳統一對多移位暫存器驅動能力不足的問題。此外，藉由單 一級移位暫存器具有多輸出單元的設計，也可有效縮減移位暫存器電路之電路面積，使得整體掃描驅動電路的面積可更為精簡。
值得注意的是，為了清楚闡述本發明之概念，於上述之實施例中所示之移位暫存器均為一對三移位暫存器。然而，必須理解的是，任何熟習此項技藝者，在不脫離本發明之精神和範圍內，當可根據本發明之概念做些許的更動與潤飾，實作出一對二、一對四、或其他形式之一對多移位暫存器。因此，本發明並不限於圖中所示之架構。此外，於本發明之實施例中，一對K之移位暫存器電路以使用(K+1)個時脈訊號為較佳。例如，於第6圖與第9圖所示波形範例中，1對3移位暫存器所使用之時脈訊號包含了CK1~CK4。然而，必須注意的是，於圖中所示之時脈訊號於各輸入端點之配置僅為多種可能實施例之其中一種，因此本發明並不限於圖中所示之時脈訊號配置。
申請專利範圍中用以修飾元件之“第一”、“第二”等序數詞之使用本身未暗示任何優先權、優先次序、各元件之間之先後次序、或方法所執行之步驟之次序，而僅用作標識來區分具有相同名稱(具有不同序數詞)之不同元件。
本發明雖以較佳實施例揭露如上，然其並非用以限定本發明的範圍，任何熟習此項技藝者，在不脫離本發明之精神和範圍內，當可做些許的更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
400‧‧‧移位暫存器
401‧‧‧控制電路
402‧‧‧抬昇電路
403‧‧‧輸出電路
SStart ‧‧‧啟動訊號
SReset ‧‧‧重置訊號

Claims (10)

  1. 一種顯示器面板，包括：一掃描驅動電路，包括複數串接之移位暫存器，其中該等移位暫存器之至少一者包括：一控制電路，用以根據一啟動訊號控制一第一控制節點之電壓，以及根據一重置訊號控制一第二控制節點之電壓；一抬昇電路，耦接至該控制電路，用以抬昇該第一控制節點之電壓；以及一輸出電路，耦接至該抬昇電路與該控制電路，用以根據該第一控制節點之電壓於複數輸出節點依序輸出複數閘極驅動訊號，並提供該等閘極驅動訊號至不同的閘極線，其中該等閘極驅動訊號之其中一者被提供至下一級移位暫存器，用以作為下一級移位暫存器之該啟動訊號。
  2. 如申請專利範圍第1項所述之顯示器面板，其中該抬昇電路包括：一電容，耦接於該第一控制節點與一第三控制節點之間；一第一電晶體，具有一第一端耦接至該第三控制節點、一第二端接收該啟動訊號、以及一第三端耦接至一低操作電壓；以及一第二電晶體，具有一第一端耦接至該第三控制節點、一第二端耦接至該等輸出節點之其中一者、以及一第三端耦接至一輸入節點，用以接收一輸入訊號。
  3. 如申請專利範圍第2項所述之顯示器面板，其中當該啟動訊號之一脈衝抵達時，該第一控制節點之電壓具有一第一高電壓位準，並且該第一電晶體被導通，使得該第三控制節點之電壓具有一低電壓位準。
  4. 如申請專利範圍第3項所述之顯示器面板，其中當該等閘極驅動訊號之其中一者之一脈衝抵達時，該第二電晶體被導通，用以根據該輸入訊號拉高該第三控制節點之電壓，使得該第一控制節點之電壓因應該第三控制節點之電壓變化被拉高至高於該第一高電壓位準之一第二高電壓位準。
  5. 如申請專利範圍第2項所述之顯示器面板，其中該抬昇電路更包括：一第三電晶體，具有一第一端耦接至該第三控制節點、一第二端接收該重置訊號、以及一第三端耦接至該低操作電壓，用以因應該重置訊號重置該第三控制節點之電壓。
  6. 如申請專利範圍第1項所述之顯示器面板，其中該控制電路更接收一預充電訊號，並且根據該預充電訊號與該啟動訊號控制該第一控制節點之電壓，其中該預充電訊號為前一級移位暫存器所輸出之該等閘極驅動訊號之其中一者，並且該預充電訊號之一脈衝抵達早於該啟動訊號之一脈衝。
  7. 如申請專利範圍第6項所述之顯示器面板，其中該控制電路包括： 一第四電晶體，具有一第一端與一第二端接收該預充電訊號、以及一第三端耦接至該第四控制節點；以及一第五電晶體，具有一第一端接收該啟動訊號、一第二端耦接至一第四控制節點、以及一第三端耦接至該第一控制節點。
  8. 如申請專利範圍第7項所述之顯示器面板，其中當該預充電訊號之一脈衝抵達時，該第四電晶體被導通，使得該第四控制節點之電壓具有一第三高電壓位準，並且該第五電晶體被導通。
  9. 如申請專利範圍第8項所述之顯示器面板，其中當該啟動訊號之一脈衝抵達時，該第一控制節點之電壓被拉高，使得該第四控制節點之電壓因應該第一控制節點之電壓變化被拉高至高於該第三高電壓位準之一第四高電壓位準。
  10. 如申請專利範圍第7項所述之顯示器面板，其中該控制電路包括：一第六電晶體，具有一第一端耦接至該第四控制節點，一第二端接收一輸入訊號、以及一第三端耦接至一低操作電壓，用以因應該輸入訊號重置該第四控制節點之電壓。
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