UA123768U - Формувач одиночної двоімпульсної кодової серії з перенастроюваними часовими параметрами - Google Patents

Abstract

Формувач одиночної двоімпульсної кодової серії з перенастроюваними часовими параметрами містить: реверсивний двійковий лічильник, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід дозволу синхронного паралельного завантаження і входи подачі даних при завантаженні, вхід дозволу режиму лічби, вхід асинхронної установки у нульовий стан, вихід переповнювання; перший і другий синхронні DL-тригери зі входом дозволу переходу L і входом асинхронної установки у нульовий стан; перший і другий елементи АБО; стартостопний пристрій, який містить: синхронний D-тригер зі входом асинхронної установки у нульовий стан, ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до джерела живлення, перший і другий елементи І, при цьому перший вхід першого елемента АБО з'єднано з виходом D-тригера, вихід першого елемента АБО з'єднано з першим входом другого елемента І; загальна точка послідовно сполучених резистора і конденсатора з'єднана з інформаційним входом D-тригера, з одним входом першого та другим входом другого елементів І; вихід першого елемента І сполучений зі входом асинхронної установки D-тригера в нульовий стан; вихід другого елемента І з'єднаний зі входами асинхронної установки лічильників у нульовий стан; тактові входи лічильників утворюють вхід формувача - вхід подачі періодичної послідовності імпульсів з виходу зовнішнього кварцового генератора; тактовий вхід D-тригера утворює вхід подачі імпульсів запуску; входи паралельного завантаження першого лічильника утворюють входи налагодження формувача на задані часові параметри вихідних імпульсів. Другий вхід першого елемента АБО з'єднано з прямим виходом першого DL-тригера. Третій вхід першого елемента АБО з'єднано з прямим виходом другого DL-тригера. Прямий вихід першого DL-тригера, що утворює вихід формувача, з'єднано зі входом подачі тактових імпульсів другого DL-тригера. Інверсний вихід першого DL-тригера з'єднано з його входом D і другим входом першого елемента І. Інверсний вихід другого DL-тригера з'єднано з його входом D, виходи другого, третього і четвертого розрядів лічильника з'єднано зі входами другого елемента АБО, вихід якого з'єднано зі входом дозволу паралельного завантаження лічильника і входом дозволу переходу першого DL-тригера.

Description

Корисна модель належить до імпульсної, обчислювальної і вимірювальної техніки, призначена для формування одиночної двоїмпульсної кодової серії з перенастроюваними часовими параметрами.

Відомі формувачі, що містять кварцовий задаючий генератор, який працює в безперервному режимі, пристрій синхронізації і вихідний пристрій, що забезпечує формування необхідних імпульсів, часові параметри яких визначаються часовими параметрами імпульсів, що подаються на вхід (Ю.В. Новиков Основьії цифровой техники. - М.: "МИР", 2001. - Рис. 5.13-5.18).

Відомі формувачі одиночної двоїмпульсної кодової серії з перенастроюваними часовими параметрами (патенти України на корисну модель Мо Ме93738, 98689, 98692, 98694-98698, 102429).

Недолік відомих пристроїв - складність внутрішньої структури.

Найбільш близьким за технічною суттю і результатом, що досягається, є формувач одиночної двоїмпульсної кодової серії з перенастроюваними часовими параметрами (патенти

України на корисну модель Мо 98690), який містить: реверсивний двійковий лічильник, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід дозволу синхронного паралельного завантаження і входи подачі даних при завантаженні, вхід дозволу режиму лічби, вхід асинхронної установки у нульовий стан, вихід переповнювання; перший і другий синхронні І -тригери зі входом дозволу переходу - ГІ і входом асинхронної установки у нульовий стан; перший і другий елементи АБО; стартостопний пристрій, який містить: синхронний Ю-тригер зі входом асинхронної установки у нульовий стан, ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до джерела живлення, перший і другий елементи І, при цьому перший вхід першого елемента АБО з'єднано з виходом О-тригера, вихід першого елемента АБО з'єднано з першим входом другого елемента

Ії загальна точка послідовно сполучених резистора і конденсатора з'єднана з інформаційним входом ЮО-тригера, з одним входом першого та другим входом другого елементів І!; вихід першого елемента І сполучений зі входом асинхронної установки ЮО-тригера в нульовий стан; вихід другого елемента І! з'єднаний зі входами асинхронної установки лічильників у нульовий стан; тактові входи лічильників утворюють вхід формувача - вхід подачі періодичної послідовності імпульсів з виходу зовнішнього кварцового генератора; тактовий вхід Ю-тригера

Зо утворює вхід подачі імпульсів запуску; входи паралельного завантаження першого лічильника утворюють входи налагодження формувача на задані часові параметри вихідних імпульсів.

Недолік відомого пристрою - складність схеми формувача, що обумовлено необхідністю використання додаткових логічних елементів і двох УК-тригерів і, як наслідок, висока споживана потужність, висока вартість.

В основу корисної моделі поставлено задачу спрощення структури формувача, зменшення споживаної потужності та вартості.

Поставлена задача вирішується тим, що в формувачі одиночної двоімпульсної кодової серії з перенастроюваними часовими параметрами, який містить: реверсивний двійковий лічильник, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід дозволу синхронного паралельного завантаження і входи подачі даних при завантаженні, вхід дозволу режиму лічби, вхід асинхронної установки у нульовий стан, вихід переповнювання; перший і другий синхронні І -тригери зі входом дозволу переходу - ГІ і входом асинхронної установки у нульовий стан; перший і другий елементи АБО; стартостопний пристрій, який містить: синхронний Ю-тригер зі входом асинхронної установки у нульовий стан, ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до джерела живлення, перший і другий елементи І, при цьому перший вхід першого елемента АБО з'єднано з виходом ЮО-тригера, вихід першого елемента АБО з'єднано з першим входом другого елемента

Ії загальна точка послідовно сполучених резистора і конденсатора з'єднана з інформаційним входом ЮО-тригера, з одним входом першого та другим входом другого елементів І; вихід першого елемента І! сполучений зі входом асинхронної установки ЮО-тригера в нульовий стан; вихід другого елемента І! з'єднаний зі входами асинхронної установки лічильників у нульовий стан; тактові входи лічильників утворюють вхід формувача - вхід подачі періодичної послідовності імпульсів з виходу зовнішнього кварцового генератора; тактовий вхід Ю-тригера утворює вхід подачі імпульсів запуску; входи паралельного завантаження першого лічильника утворюють входи налагодження формувача на задані часові параметри вихідних імпульсів, відповідно до корисної моделі, другий вхід першого елемента АБО з'єднано з прямим виходом першого бі -тригера, третій вхід першого елемента АБО з'єднано з прямим виходом другого Оі - тригера, прямий вихід першого 0 -тригера, що утворює вихід формувача, з'єднано зі входом подачі тактових імпульсів другого 0 -тригера, інверсний вихід першого 0 -тригера з'єднано з бо його входом ОО і другим входом першого елемента І, інверсний вихід другого ОІ-тригера з'єднано з його входом 0, виходи другого третього і четвертого розрядів лічильника з'єднано зі входами другого елемента АБО, вихід якого з'єднано зі входом дозволу паралельного завантаження лічильника і входом дозволу переходу першого Обі -тригера; настроювання формувача на задані часові параметри вихідної послідовності імпульсів забезпечується значенням сигналів на входах паралельного завантаження лічильника, які у залежності від заданих часових параметрів серії можуть бути з'єднані з виходом переповнення лічильника, з виходом першого розряду лічильника, з виходами першого бі -тригера, з рівнем логічного нуля або одиниці, так при настроюванні формувача на формування одиночної кодової серії, тривалість першого імпульсу у якій дорівнює десяти періодам тактових імпульсів (що подаються на вхід формувача з виходу зовнішнього кварцового генератора), тривалість паузи дорівнює семи періодам тактових імпульсів, тривалість другого імпульсу дорівнює двом періодам, перший вхід паралельного завантаження лічильника з'єднано з прямим виходом першого бі -тригера, другий вхід паралельного завантаження з'єднано з рівнем логічної одиниці, третій вхід паралельного завантаження з'єднано з прямим виходом першого Пі -тригера, четвертий вхід паралельного завантаження лічильника з'єднано з його виходом переповнення.

На фіг. 1 приведена схема формувача.

Формувач містить: реверсивний двійковий лічильник 1, налагоджений на режим віднімання, який має вхід подачі тактових імпульсів С, вхід налагодження на режим підсумовування/віднімання Ш, вхід дозволу синхронного паралельного завантаження Г і входи подачі завантажуваних даних Оо-Оз, вхід дозволу режиму лічби Ро, вхід асинхронної установки у нульовий стан НЯ, вихід переповнювання Р:;и; перший (2) і другий (3) синхронні Оі -тригери зі входом дозволу переходу Г і входом асинхронної установки у нульовий стан В; синхронний О- тригер 4 зі входом асинхронної установки у нульовий стан ВЕ; перший (5) і другий (6) елементи І; перший (7) і другий (8) елементи АБО; послідовно з'єднані резистор 9 і конденсатор 10, підключені до джерела живлення ЖЕ.

Загальна точка послідовно сполучених резистора 9 і конденсатора 10, з'єднана з інформаційним входом тригера 4, з першими входами елементів 5, 6. Другий вхід елемента 5 з'єднано з інверсним виходом (91) тригера 2 і з його входом 0. Вихід елемента 5 з'єднано зі входом асинхронної установки тригера 4 у нульовий стан. Другий вхід елемента 6 з'єднано з виходом елемента 7. Вихід елемента 6 з'єднано зі входами асинхронної установки у нульовий стан лічильника 1 і тригерів 2, 3.

Перший вхід елемента 7 з'єднано з прямим виходом (0) тригера 4, другий -3з прямим виходом (01) тригера 2, третій - з прямим виходом (02) тригера 3. Прямий вихід тригера 2, що утворює вихід (ЕР) формувача, з'єднано зі входом подачі тактових імпульсів (С) тригера 3.

Інверсний вихід (ог) тригера З з'єднано з його входом 0. Виходи другого (С), третього (О») і четвертого (Оз) розрядів лічильника 1 з'єднано зі входами елемента 8, вихід якого з'єднано зі входом (І) дозволу паралельного завантаження лічильника 1 і входом (І) дозволу переходу тригера 2.

Настроювання формувача на задані часові параметри вихідної послідовності імпульсів забезпечується значенням сигналів на входах паралельного завантаження першого лічильника, які дорівнюють нулю, одиниці або формуються значенням сигналів з виходу переповнення лічильника, з виходу першого розряду лічильника і з виходу тригера 2.

Так при настроюванні формувача на формування одиночної кодової серії, тривалість першого імпульсу у якій дорівнює десяти періодам (10Т) тактових імпульсів (що подаються на вхід формувача з виходу зовнішнього кварцового генератора), тривалість паузи дорівнює семи періодам (7Т) тривалість другого імпульсу дорівнює двом періодам (27) перший вхід (о) паралельного завантаження лічильника з'єднано з прямим виходом першого бі -тригера, другий вхід (01) паралельного завантаження з'єднано з рівнем логічної одиниці, третій вхід ОЮг) паралельного завантаження з'єднано з прямим виходом першого Іі -тригера, четвертий вхід (Оз) паралельного завантаження лічильника з'єднано з його виходом переповнення. Тактові входи лічильника і тригерів 2, З утворюють вхід (С) формувача - вхід подачі періодичної послідовності імпульсів з виходу зовнішнього кварцового генератора. Тактовий вхід тригера 4 утворює вхід подачі імпульсів запуску (етап).

Працює формувач в наступній послідовності.

Наявність ланцюжка, що складається із поєднаних послідовно резистора 9 і конденсатора 10, підключеного до шини живлячої напруги 4-Е, при включенні джерела живлення протягом деякого проміжку часу формує рівень логічного нуля на входах елементів 5 та 6, забезпечуючи формування рівня логічного нуля на їхніх виходах, тобто на входах В асинхронної установки у нульовий стан тригерів 2, 3, 4 і лічильника 1.

Після закінчення перехідного процесу, пов'язаного з включенням джерела живлення, лічильник і тригери переходять у нульовий стан, формуючи: рівень логічної одиниці на виході переповнення лічильника, рівень логічного нуля на прямих виходах тригерів, на виходах О1-Оз лічильника, на виході елемента 8, на виході елемента 7, який з'єднано зі входом елемента 6, що забезпечує рівень логічного нуля на входах НВ асинхронної установки у нульовий стан лічильника і тригерів і по закінченню перехідного процесу, пов'язаного із зарядом конденсатора 10. Оскільки режим асинхронної установки лічильника і тригера у нульовий стан має пріоритет по відношенню до всіх останніх режимів, то до тих пір, поки на вході елемента 6 (а отже і на його виході) зберігатиметься рівень логічного нуля, при надходженні тактових імпульсів нульовий стан лічильника і тригерів залишатиметься незмінним, тобто залишатиметься незмінним нульове значення на виході формувача.

Під час вступу імпульсу запуску (5іап) на тактовий вхід С тригера 4 тригер переходить в одиничний стан), формуючи рівень логічної одиниці на його виході (0-1), виході елемента 7, а отже на вході та виході елемента б, що забезпечує рівень логічної одиниці на входах В лічильника і тригерів 2, 3, знімаючи блокування. Оскільки на входах І лічильника і тригерів 2, 3, рівень логічного нуля, то до моменту вступу чергового тактового імпульсу лічильник знаходиться у режимі готовності завантаження, а тригер 2 у режимі готовності до переходу.

І тоді під час вступу першого (після закінчення перехідного процесу, пов'язаного із зняттям блокування) тактового імпульсу С по його фронту відбувається паралельне завантаження лічильника значеннями сигналів, які сформовані на входах 0о-ЮОз (О0-02-01-0, р.- 1 -З,

Оз-Р4-1). Лічильник переходить у стан 1010-10, що веде до формування нульового значення на виході переповнення лічильника, одиничного значення на виході елемента 8 і входах лічильника, до заборони завантаження лічильника 1 і дозволу режиму лічби (віднімання).

Тригер 2 переходить в одиничний стан (01-1, Си -0) що веде до формування одиничного значення на виході формувача, а також переходу тригера.

В одиничний стан (02-1, ог -0), формування нульового значення на вході і виході елемента 5 і переходу тригера 4 у нульовий стан. Під час вступу подальших тактових імпульсів зміст лічильника 1 зменшуватиметься, а одиничний стан тригера 2 залишається незмінним. Як тільки зміст лічильника 1 стане рівним 0001 на виході елемента 8 формується нульове

Зо значення. В результаті цього лічильник знову перейде в режим завантаження, а тригер 2 - В режим переходу. І тоді під час вступу наступного тактового імпульсу по його фронту знову відбувається паралельне завантаження лічильника значеннями сигналів, на входах Оо-Юз (бо-01-1, 0-1, Ю2-01-1, Оз-РА-0).

Лічильник переходить у стан 0111-7. Тригер 2 перейде у нульовий стан, формуючи нульове значення на виході формувача.

Під час вступу подальших тактових імпульсів зміст лічильника зменшуватиметься, а нульовий стан тригера 2 залишається незмінним. Як тільки зміст лічильника 1 стане рівним 0001 на виході елемента 8 формується нульове значення. В результаті цього лічильник перейде в режим завантаження, а тригер 2 - в режим переходу. І тоді під час вступу наступного тактового імпульсу тригер 2 переходить в одиничний стан (01-11, Си -0) що веде до формування одиничного значення на виході формувача, а також переходу тригера З в нульовий стан (02-0 Відбувається паралельне завантаження лічильника значеннями сигналів, на входах бо-Оз (Оо-02-031-0, О1- СІ »Оз-Ра-0). Лічильник переходить у стан 0010-2. Тригер 2 перейде в одиничній стан, формуючи одиничне значення на виході формувача.

Під час вступу подальших тактових імпульсів зміст лічильника 1 зменшуватиметься, а одиничній стан тригера 2 залишається незмінним. Як тільки зміст лічильника 1 стане рівним 0001 на виході елемента 8 формується нульове значення. В результаті цього тригер 2 - в режим переходу. І тоді під час вступу наступного тактового імпульсу тригер 2 перейде в нульовий стан, на входах елемента 7 і його виході буде сформований рівень логічного 0, обумовлюючи рівень логічного нуля на вході та виході елемента б, що призведе до переходу лічильника у нульовий стан, а отже до припинення процесу генерації. Зі вступом наступного імпульсу запуску усі процеси повторюються.

На фіг. 2 приведений граф переходів формувача, що складається з трьох гілок (верхня вітка - граф переходів лічильника, середня - граф переходів тригера 2, нижня - граф переходів тригера З із загальною вершиною, відповідною нульовому стану лічильника і тригерів 2, З а на фіг. З зображені епюри, що ілюструють роботу для варіанта настроювання формувача на тривалість першого імпульсу, яка дорівнює 10Т, паузи між ними, що дорівнює 7Т, тривалість другого імпульсу дорівнює 2Т.

На відміну від відомого пристрою спрощення структури формувача дозволило спростити технологію його виготовлення, знизити споживану потужність і вартість.

Claims (1)

1. ФОРМУЛА КОРИСНОЇ МОДЕЛІ

   Формувач одиночної двоіїмпульсної кодової серії з перенастроюваними часовими параметрами, який містить: реверсивний двійковий лічильник, налагоджений на режим віднімання, що має вхід подачі імпульсів синхронізації, вхід дозволу синхронного паралельного завантаження і входи подачі даних при завантаженні, вхід дозволу режиму лічби, вхід асинхронної установки у нульовий стан, вихід переповнювання; перший і другий синхронні 0 -тригери зі входом дозволу переходу ГІ і входом асинхронної установки у нульовий стан; перший і другий елементи АБО; стартостопний пристрій, який містить: синхронний ЮО-тригер зі входом асинхронної установки у нульовий стан, ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до джерела живлення, перший і другий елементи І, при цьому перший вхід першого елемента АБО з'єднано з виходом О-тригера, вихід першого елемента АБО з'єднано з першим входом другого елемента І; загальна точка послідовно сполучених резистора і конденсатора з'єднана з інформаційним входом О-тригера, з одним входом першого та другим входом другого елементів Ії вихід першого елемента | сполучений зі входом асинхронної установки ЮО-тригера в нульовий стан; вихід другого елемента І з'єднаний зі входами асинхронної установки лічильників у нульовий стан; тактові входи лічильників утворюють вхід формувача - вхід подачі періодичної послідовності імпульсів з виходу зовнішнього кварцового генератора; тактовий вхід Ю-тригера утворює вхід подачі імпульсів запуску; входи паралельного завантаження першого лічильника утворюють входи налагодження формувача на задані часові параметри вихідних імпульсів, який відрізняється тим, що другий вхід першого елемента АБО з'єднано з прямим виходом першого Обі -тригера, третій вхід першого елемента АБО з'єднано з прямим виходом другого ОІ-тригера, прямий вихід першого Оі-тригера, що утворює вихід формувача, з'єднано зі входом подачі тактових імпульсів другого 0 -тригера, інверсний вихід першого Обі -тригера з'єднано з його входом О і другим входом першого елемента І, інверсний вихід другого ОіІ-тригера з'єднано з його входом ОО, виходи другого, третього і четвертого розрядів лічильника з'єднано зі входами другого елемента АБО, вихід якого з'єднано зі входом дозволу паралельного завантаження лічильника і входом дозволу переходу першого Пі - тригера; настроювання формувача на задані часові параметри вихідної послідовності імпульсів забезпечується значенням сигналів на входах паралельного завантаження лічильника, які у залежності від заданих часових параметрів серії можуть бути з'єднані з виходом переповнення лічильника, з виходом першого розряду лічильника, з виходами першого Обі -тригера, з рівнем логічного нуля або одиниці, так при настроюванні формувача на формування одиночної кодової серії, тривалість першого імпульсу у якій дорівнює десяти періодам тактових імпульсів (що подаються на вхід формувача з виходу зовнішнього кварцового генератора), тривалість паузи дорівнює семи періодам тактових імпульсів, тривалість другого імпульсу дорівнює двом періодам, перший вхід паралельного завантаження лічильника з'єднано з прямим виходом першого ОІ -тригера, другий вхід паралельного завантаження з рівнем логічної одиниці, третій вхід паралельного завантаження з'єднано з прямим виходом першого Оі -тригера, четвертий вхід паралельного завантаження лічильника з'єднано з його виходом перетворення.