WO2012014992A1 - 不揮発性半導体メモリ装置及びその製造方法、並びに電荷蓄積膜 - Google Patents

不揮発性半導体メモリ装置及びその製造方法、並びに電荷蓄積膜 Download PDF

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    • H10P14/69433Inorganic materials composed of nitrides containing silicon the material being a silicon nitride not containing oxygen, e.g. SixNy or SixByNz

Definitions

  • the present invention relates to a nonvolatile semiconductor memory device, a manufacturing method thereof, and a charge storage film, and more particularly to a nonvolatile semiconductor memory device having a MONOS structure or a SONOS structure, a manufacturing method thereof, and a charge storage film of the memory device.
  • a nonvolatile semiconductor memory device such as a flash memory has been developed and widely used as a storage medium.
  • a MONOS (Metal-Oxide-Nitride-Oxide-Silicon) structure (MONOS-type memory cell structure) or a SONOS (Silicon-Silicon-silicon structure) using a silicon nitride film manufactured by LPCVD is used.
  • a memory technology having an Oxide-Nitride-Oxide-Silicon structure (SONOS type memory cell structure) is known (for example, see Patent Document 1).
  • the memory having such a structure does not lose its memory even after the power is turned off, and can perform high-speed writing and reading.
  • the current main force is a floating gate type, and this floating gate functions as a region for accumulating and holding charges.
  • a floating gate for example, a polycrystalline silicon film
  • a tunnel insulating film also referred to as a gate insulating film
  • a control gate electrode is formed on the semiconductor substrate on both sides of the control gate electrode, with a blocking insulating film (for example, a silicon oxide film or an aluminum oxide film) interposed therebetween. Source / drain regions are formed in the substrate.
  • the blocking insulating film has a function of blocking current between the floating gate which is a charge storage film and the control electrode.
  • a silicon nitride film is formed by LPCVD on a tunnel insulating film (for example, a silicon oxide film) provided on a semiconductor substrate.
  • a nonvolatile semiconductor memory device in which a control gate electrode is formed with a blocking insulating film (for example, a silicon oxide film) interposed therebetween, and a source / drain region is formed on a semiconductor substrate on both sides of the control gate electrode. It has been.
  • the source electrode when writing to the memory, the source electrode is usually grounded, a sufficiently high voltage is applied to the gate electrode and the drain electrode, and electrons are directed from the source electrode to the drain electrode.
  • the electrons flowing through the channel portion become thermal electrons having a large momentum, and some of them pass through the tunnel insulating film and accumulate in the floating gate.
  • the gate is closed after sufficient electrons are accumulated in the floating gate, the electrons accumulated in the floating gate can be blocked and held by the tunnel insulating film. That is, the information is stored.
  • erasing information if the gate electrode is grounded and the source electrode is kept at a high potential, electrons are gradually removed from the floating gate and information storage is erased.
  • a charge storage film in the nonvolatile semiconductor memory device having the above-described structure a charge storage film including at least a Si 3 N 4 film and an insulating film containing La and Si provided thereon has been proposed (for example, Patent Documents). 2).
  • This silicon nitride film is manufactured by a normal CVD method, and the charge trap amount is increased by using a charge storage film having such a laminated structure.
  • a silicon nitride film can be produced from SiH 4 gas and NH 3 gas by catalytic chemical vapor deposition (Cat-CVD method) (see, for example, Patent Document 3).
  • the limit of miniaturization is pointed out due to the limit of the charge storage capability of the Si 3 N 4 film. Therefore, improvement of charge accumulation / holding characteristics (charge holding characteristics) of the Si 3 N 4 film is required.
  • the limit of the principle miniaturization of each constituent film is pointed out, and the charge storage capability of the charge storage film is required to be improved.
  • An object of the present invention is to solve the above-mentioned problems of the prior art, and has a charge storage film made of a silicon nitride film having high charge storage / holding characteristics, and can be miniaturized, for example, a MONOS structure
  • Another object of the present invention is to provide a nonvolatile semiconductor memory device having a SONOS structure, a manufacturing method thereof, and the charge storage film.
  • the nonvolatile semiconductor memory device of the present invention includes a tunnel insulating film on a semiconductor substrate, a charge storage film on the tunnel insulating film, a blocking insulating film on the charge storage film, and a control gate electrode on the blocking insulating film And a source / drain region formed in the semiconductor substrate on both sides of the control gate electrode, and the charge storage film is a silicon nitride film produced by catalytic chemical vapor deposition, The ratio N / Si is 1.2 to 1.4.
  • the charge storage amount is increased and the charge retention characteristics are improved. Is achieved.
  • the charge storage / retention characteristics tend to deteriorate, and if it exceeds 1.4, the insulation characteristics tend to deteriorate.
  • the content of hydrogen atoms introduced into the silicon nitride film by catalytic chemical vapor deposition is 5 to 20 at%.
  • the charge storage / retention characteristics tend to deteriorate, and when it exceeds 20 at%, the insulation characteristics tend to deteriorate.
  • N—H bonds introduced into the silicon nitride film by catalytic chemical vapor deposition are 5 ⁇ 10 21 to 5 ⁇ 10 22 bonds / cm 3 .
  • the N—H bond is less than 5 ⁇ 10 21 , the charge storage / retention characteristics tend to deteriorate, and if it exceeds 5 ⁇ 10 22 bonds / cm 3 , the insulation characteristics tend to deteriorate. .
  • the nonvolatile semiconductor memory device of the present invention includes a tunnel insulating film on a semiconductor substrate, a charge storage film on the tunnel insulating film, a blocking insulating film on the charge storage film, and a control gate electrode on the blocking insulating film And a source / drain region formed in the semiconductor substrate on both sides of the control gate electrode, and the charge storage film is a silicon nitride film produced by catalytic chemical vapor deposition,
  • the ratio N / Si is 1.2 to 1.4
  • the content of hydrogen atoms introduced into the silicon nitride film by catalytic chemical vapor deposition is 5 to 20 at%
  • the N—H bond introduced into the film by catalytic chemical vapor deposition is 5 ⁇ 10 21 to 5 ⁇ 10 22 / cm 3 .
  • the silicon nitride film is decomposed by introducing SiH 4 and NH 3 gas into a vacuum chamber, contacting with a heated catalyst, and forming a film on a target heating surface disposed in the vacuum chamber. It is produced by a phase growth method.
  • the silicon nitride film introduces SiH 4 , NH 3 , and H 2 gas into a vacuum chamber, is brought into contact with a heated catalyst, is decomposed, and is formed on a target heating surface disposed in the vacuum chamber. It is produced by catalytic chemical vapor deposition.
  • the silicon nitride film is produced by catalytic chemical vapor deposition at a pressure of less than 100 Pa in a vacuum chamber.
  • the lower limit is the pressure that can usually be achieved.
  • the temperature of the target heating surface is 100 to 500 ° C.
  • the desired silicon nitride film tends to be difficult to obtain.
  • the catalyst is made of a material selected from at least one metal selected from W, Mo, and Ta, and an alloy including at least two of these metals.
  • the heating temperature of the catalyst is 1500 to 2000 ° C.
  • the heating temperature is out of the range, a desired silicon nitride film tends to be difficult to obtain.
  • a method for manufacturing a nonvolatile semiconductor memory device includes a silicon nitride film formed by catalytic chemical vapor deposition on a tunnel insulating film formed on a semiconductor substrate, and formed on the tunnel insulating film, A charge storage film having an element ratio N / Si of 1.2 to 1.4 is formed, a blocking insulating film is formed on the charge storage film, a control gate electrode is formed on the blocking insulating film, and the control Source / drain regions are formed in the semiconductor substrate on both sides of the gate electrode.
  • the content of hydrogen atoms introduced into the silicon nitride film by catalytic chemical vapor deposition is 5 to 20 at%.
  • the number of NH bonds introduced into the silicon nitride film by catalytic chemical vapor deposition is 5 ⁇ 10 21 to 5 ⁇ 10 22 / cm 3.
  • the silicon nitride film is decomposed by introducing SiH 4 and NH 3 gas into a vacuum chamber, contacting with a heated catalyst, and disposed in the vacuum chamber It is produced by a catalytic chemical vapor deposition method in which a film is formed on a heated surface.
  • the silicon nitride film is decomposed by introducing SiH 4 , NH 3 , and H 2 gas into a vacuum chamber and contacting with a heated catalyst, It is produced by a catalytic chemical vapor deposition method in which a film is formed on a target heating surface that is arranged.
  • the silicon nitride film is formed by catalytic chemical vapor deposition at a pressure of less than 100 Pa in a vacuum chamber.
  • the temperature of the target heating surface is 100 to 500 ° C.
  • the catalyst is made of a material selected from at least one metal selected from W, Mo, and Ta and an alloy including at least two of these metals. To do.
  • the heating temperature of the catalyst is 1500 to 2000 ° C.
  • the charge storage film of the present invention is a silicon nitride film produced by a catalytic chemical vapor deposition method and has a constituent element ratio N / Si of 1.2 to 1.4.
  • the silicon nitride film contains 5 to 20 at% of hydrogen atoms introduced by catalytic chemical vapor deposition.
  • the charge storage film is characterized in that the silicon nitride film has 5 ⁇ 10 21 to 5 ⁇ 10 22 bonds / cm 3 of NH bonds introduced by catalytic chemical vapor deposition.
  • the use of a charge storage film made of a silicon nitride film manufactured by catalytic chemical vapor deposition with high charge retention characteristics avoids the limit of miniaturization and advances the integration.
  • the nonvolatile semiconductor memory device for example, a memory device having a MONOS structure or a SONOS structure
  • a memory device having a MONOS structure or a SONOS structure can be provided.
  • 6 is a graph showing the relationship between the N / Si ratio and the midgap voltage (V) in order to study the influence of the N / Si ratio on the memory window (V) in the silicon nitride film obtained in Example 1.
  • 6 is a graph showing the relationship between retention time (seconds) and midgap voltage (V) in order to study the charge retention characteristics of a silicon nitride film produced by catalytic chemical vapor deposition in Example 2.
  • the graph which shows the relationship between retention time (second) and mid gap voltage (V), in order to examine the charge retention characteristic of the silicon nitride film produced by the conventional LPCVD method.
  • the graph which shows the Arrhenius plot which put together the result in Example 2.
  • FIG. Shown by comparing the results of the charge retention characteristics of Example 2 obtained in catalytic chemical vapor deposition of silicon nitride film, LPCVD method using the Si 3 N 4 film and Si 3 N 4 film obtained by PECVD table.
  • the nonvolatile semiconductor memory device includes a tunnel insulating film on a semiconductor substrate, a charge storage film on the tunnel insulating film, and the charge storage film.
  • the silicon nitride film produced by the method has a constituent element ratio N / Si of 1.2 to 1.4 as measured by the method described below, and is introduced into the silicon nitride film by catalytic chemical vapor deposition
  • the hydrogen atom content measured is 5 to 20 at% as measured by the method described below, and the NH bond introduced into the silicon nitride film by catalytic chemical vapor deposition is measured by the method described below.
  • Consists is 5 ⁇ 10 21 ⁇ 5 ⁇ 10 22 / cm 3 or Te.
  • the constituent element ratio N / Si is measured by Rutherford Backscattering Spectroscopy.
  • the sample was irradiated with He + ions with an energy of 480 keV at an angle of 45 degrees with respect to the normal of the sample surface, and the scattered He + ions were detected with a deflection magnetic field energy analyzer at a scattering angle of 90 degrees. .
  • the hydrogen atom content is measured by elastic recoil detection analysis.
  • a method is used in which N + ions with an energy of 480 keV are irradiated to the sample at an angle of 70 degrees with respect to the normal of the sample surface, and the recoiled H + ions are detected with a deflection magnetic field type energy analyzer at a scattering angle of 30 degrees. It was.
  • N—H bonds are measured by Fourier Transform Infrared Spectroscopy. The specific number of bonds is W.W. A. Lanford, M.C. J. et al. Calculation was performed using the conversion factor of Rand's paper (J. Appl. Phys. 49 (1978) 2473).
  • the nonvolatile semiconductor memory device of the present invention has, for example, the MONOS type structure shown in FIG. 1, the tunnel insulating film 12 made of silicon oxide (SiO 2 ) formed on the Si substrate 11, and the tunnel insulating film Formed on the charge storage film 13 made of silicon nitride, a blocking insulating film 14 made of silicon oxide (SiO 2 ) formed on the charge storage film 13, and formed on the blocking insulating film 14.
  • the control gate electrode 15 made of polysilicon or metal and the source region 16 / drain region 17 formed on the Si substrate 11 on both sides of the control gate electrode 15 are provided. A voltage is applied to the control gate electrode 15 It is configured to be able to.
  • the blocking insulating film 14 has a function of blocking current between the floating gate that is the charge storage film 13 and the control gate electrode 15.
  • Information is stored by capturing holes and / or electrons in the charge trapping center in the silicon nitride film as described above.
  • the charge storage film made of the silicon nitride film of the present invention it is possible to cope with high integration and high speed in the nonvolatile semiconductor memory device and also miniaturization.
  • this manufacturing method forms a tunnel insulating film on a semiconductor substrate, and SiH 4 and NH 3 gas are formed on the tunnel insulating film.
  • Gas amount ratio: NH 3 / SiH 4 1 to 500, heated to 1500 to 2000 ° C.
  • a silicon nitride film produced by catalytic chemical vapor deposition which is decomposed by contacting with an alloy, and formed on the target heating surface, with a constituent element ratio N / Si of 1.2 to 1 .4, forming a charge storage film having a content of introduced hydrogen atoms of 5 to 20 at% and introduced NH bonds of 5 ⁇ 10 21 to 5 ⁇ 10 22 / cm 3 , Block on the membrane Grayed insulating film is formed, the forming a control gate electrode on the blocking insulating film, it comprises forming a source / drain region in the semiconductor substrate on both sides of the control gate electrode.
  • catalytic chemical vapor deposition which comprises contacting with a heated catalyst, decomposing, and forming a film on the target heated surface.
  • N / Si ratio hydrogen atom content
  • charge storage film having N—H bond number.
  • the silicon nitride film is formed by catalytic chemical vapor deposition at a pressure of less than 100 Pa in a vacuum chamber and a temperature of a target heating surface of 100 to 500 ° C. .
  • this charge storage film is a silicon nitride film manufactured by catalytic chemical vapor deposition, and the constituent element ratio N / Si is determined by the above method. 1.2 to 1.4 as measured, the content of hydrogen atoms introduced into the silicon nitride film by catalytic chemical vapor deposition is 5 to 20 at% as measured by the above method, and the silicon nitride film
  • the NH bond introduced by the catalytic chemical vapor deposition method is 5 ⁇ 10 21 to 5 ⁇ 10 22 / cm 3 as measured by the above method.
  • a film manufactured by a known method can be used as the film other than the charge storage film constituting the nonvolatile semiconductor memory device.
  • a Si substrate or the like can be used as a semiconductor substrate, and a silicon oxide film, an aluminum oxide film, or the like is used as a tunnel insulating film that selectively passes charges provided on the semiconductor substrate.
  • a blocking insulating film provided thereon a silicon oxide film, an aluminum oxide film or the like can be used.
  • the control gate electrode provided on the blocking insulating film polysilicon, aluminum or the like can be used.
  • the source / drain regions can be formed by thermal diffusion, ion implantation or the like.
  • the silicon nitride film can be formed by a film forming apparatus having a schematic configuration shown in FIG.
  • the film forming apparatus shown in FIG. 2 has a vacuum chamber 21, and a substrate (film formation target) mounting table 22 is disposed in the vacuum chamber 21, and at a position facing the substrate mounting table 22.
  • a nozzle 23 is arranged for introducing the source gas into the tank and supplying it onto the substrate.
  • the nozzle 23 is connected to the source gas supply system 24.
  • the raw material gas may be, for example, SiH 4 and NH 3 gas, or SiH 4, NH 3, and H 2 gas.
  • a plurality of holes 25 are provided at positions facing the substrate mounting table 22 on the lower surface of the nozzle 23.
  • the source gas is introduced into the vacuum chamber 21 from the source gas supply system 24 through the holes 25 of the nozzle 23, The source gas is configured to be ejected toward the substrate 26 placed on the substrate mounting table 22 during film formation.
  • a linear catalyst 27 made of a material selected from at least one metal selected from W, Mo, and Ta and an alloy consisting of at least two of these metals. Is arranged.
  • the catalyst 27 is energized by a power supply 28 installed outside the vacuum chamber 21 to generate heat, for example, at a temperature of 1500 ° C. or higher and 2000 ° C. or lower (for example, 1700 ° C.) and used for forming a silicon nitride film. .
  • a vacuum pump 29 is connected to the vacuum chamber 21 via a variable valve 30.
  • the vacuum pump 29 evacuates the inside of the vacuum chamber 21 to a predetermined pressure, and maintains the vacuum atmosphere.
  • a silicon nitride film is formed by placing the substrate 26 on the substrate platform 22 and raising the temperature of the substrate 26 to 100 ° C. or more and 500 ° C. or less using a heating means 31 such as a heater provided inside the substrate platform 22. It is configured to do so.
  • a method for forming a silicon nitride film using the film forming apparatus shown in FIG. 2 will be described below.
  • the opening of the variable valve 30 is changed, the exhaust speed of the vacuum pump 29 is reduced, and the source gas (SiH 4 and NH 3 gas, Alternatively, SiH 4 , NH 3 , and H 2 gas) are introduced to make the inside of the vacuum chamber 21 have a source gas atmosphere of less than 100 Pa.
  • evaluation is performed using a capacitor in which a silicon oxide is stacked on a silicon substrate as an elemental experiment showing the effectiveness of a charge storage film made of a silicon nitride film.
  • the film forming apparatus shown in FIG. 2 is used, and silane (SiH 4 ) and ammonia (NH 3 ) are used as source gases in amounts of 4 to 7 sccm, respectively, and a film forming temperature of 400 is formed on the silicon substrate.
  • a silicon nitride film was formed by catalytic chemical vapor deposition at a temperature of 10 ° C., a pressure of 10 Pa, and a catalyst temperature of 1700 ° C. In this case, the relationship between the N / Si composition ratio and the midgap voltage (V) was examined by changing the N / Si composition ratio.
  • the midgap voltage refers to a gate voltage when the Fermi level of silicon coincides with the center of the forbidden band on the silicon surface.
  • the horizontal axis represents the N / Si ratio
  • the vertical axis represents the midgap voltage (V).
  • the difference between the program and erase midgap voltages is the memory window (V).
  • the memory window (V) uses silane dichloride (SiH 2 Cl 2 ) and NH 3 as source gases, and the film formation temperature. : 750 ° C., pressure: 30 Pa, wider than the film prepared by the LPCVD method, and slightly narrower when N / Si ratio ⁇ 1.33. Therefore, if the N / Si ratio ⁇ 1.33, it is possible to secure a memory window that is equal to or larger than the memory window when the LPCVD method is used.
  • the film formation temperature is 400 ° C.
  • the silicon nitride film is formed at a low temperature of 300 ° C. Forming.
  • a memory window larger than that in the case of a silicon nitride film manufactured at a high temperature of 750 ° C. by the LPCVD method can be secured.
  • the film forming temperature can be lowered as compared with the LPCVD method.
  • the film forming apparatus shown in FIG. 2 is used, SiH 4 and NH 3 are used as source gases in amounts of 5 sccm and 200 sccm, respectively, film forming temperature: 300 ° C., pressure: 10 Pa, catalyst temperature: 1700 At 4 ° C., a 49.9 nm thick silicon nitride film was formed by catalytic chemical vapor deposition.
  • the substrate having the silicon nitride film thus formed was programmed and erased at a program voltage of +22 V and an erase voltage of ⁇ 25 V, and then the ambient temperature was 27 ° C., 126 ° C., 202 ° C., 233
  • the charge retention characteristics were evaluated by measuring the midgap voltage every predetermined time under the condition of ° C. The result is shown in FIG.
  • silane chloride (SiH 2 Cl 2 ) and NH 3 were used as source gases, and a Si substrate having a film thickness of 750 ° C., a pressure of 30 Pa, and a 48.5 nm-thickness by LPCVD method on a silicon substrate.
  • a 3 N 4 film was formed, and charge retention characteristics were evaluated in the same manner as described above. The result is shown in FIG.
  • the horizontal axis represents the retention time (seconds)
  • the vertical axis represents the midgap voltage
  • the difference between the program and erase midgap voltages (memory window) remains high for a long time. It shows that the retention characteristics are good.
  • the silicon nitride film of the present invention has higher charge retention characteristics than the LPCVD method. It can be seen that the silicon nitride film of the present invention has a retention characteristic of 10 years or more from the state of the accelerated test at 233 ° C.
  • a Si 3 N 4 film having a film thickness of 56.2 nm was formed by plasma enhanced chemical vapor deposition (PECVD) at a film forming temperature of 350 ° C. using SiH 4 , NH 3 and N 2 as source gases.
  • PECVD plasma enhanced chemical vapor deposition
  • the memory window was the highest (memory window: 17.8 V), and then silicon nitridation by the LPCVD method. It can be seen that the product (memory window: 15.7 V) decreases in the order of the silicon nitride film (memory window: 10.9 V) by PECVD.
  • the present invention there is provided a miniaturized and highly integrated nonvolatile semiconductor memory device having a charge storage film made of a silicon nitride film having high charge retention characteristics, a method for manufacturing the same, and the charge storage film. Therefore, the present invention can be used in the field of semiconductor memory technology.

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Abstract

 半導体基板上のトンネル絶縁膜12と、前記トンネル絶縁膜上の電荷蓄積膜13と、前記電荷蓄積膜上のブロッキング絶縁膜14と、前記ブロッキング絶縁膜上の制御ゲート電極15と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域16,17とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4である。前記膜をこの順序で形成することからなる。

Description

不揮発性半導体メモリ装置及びその製造方法、並びに電荷蓄積膜
 本発明は、不揮発性半導体メモリ装置及びその製造方法、並びに電荷蓄積膜に関し、特にMONOS構造又はSONOS構造の不揮発性半導体メモリ装置及びその製造方法、並びにこのメモリ装置の電荷蓄積膜に関する。
 近年、記憶媒体としてフラッシュメモリ等の不揮発性半導体メモリ装置が開発され、汎用されている。CPU混載用不揮発メモリ装置としては、従来から、LPCVD法で作製されたシリコン窒化物膜を使用したMONOS(Metal-Oxide-Nitride-Oxide-Silicon)構造(MONOS型メモリセル構造)やSONOS(Silicon-Oxide-Nitride-Oxide-Silicon)構造(SONOS型メモリセル構造)のメモリ技術が知られている(例えば、特許文献1参照)。このような構造のメモリは、電源を落とした後でも記憶が失われず、高速書き込みや読み出しが可能である。
 上記した不揮発性半導体メモリ装置の場合、現在の主力は、フローティングゲート型であり、このフローティングゲートが、電荷を蓄積し、保持する領域として機能する。従来の不揮発性半導体メモリ装置では、フローティングゲート(例えば、多結晶シリコン膜)が、半導体基板上に設けられた電荷を選択的に通過せしめるトンネル絶縁膜(ゲート絶縁膜とも称され、例えば、シリコン酸化物膜からなる。)上に形成され、その上にさらにブロッキング絶縁膜(例えば、シリコン酸化物膜やアルミニウム酸化物膜)を挟んで制御ゲート電極が形成されており、制御ゲート電極の両側の半導体基板にはソース/ドレイン領域が形成されている。ブロッキング絶縁膜は、電荷蓄積膜であるフローティングゲートと制御電極との間の電流を阻止する機能を有する。
 フローティングゲートにSi膜を使用するものとして、例えば、半導体基板上に設けられたトンネル絶縁膜(例えば、シリコン酸化物膜)上にLPCVD法によりシリコン窒化物膜が形成され、その上にさらにブロッキング絶縁膜(例えば、シリコン酸化物膜)を挟んで制御ゲート電極が形成されており、制御ゲート電極の両側の半導体基板にはソース/ドレイン領域が形成されている不揮発性半導体メモリ装置が知られている。
 上記のようなメモリ装置によれば、メモリに書き込みを行う際には、通常、ソース電極を接地し、ゲート電極及びドレイン電極に十分に高い電圧を印加し、ソース電極からドレイン電極に向けて電子を流すと、チャネル部を流れる電子が運動量の大きな熱電子となって、その一部がトンネル絶縁膜を通過してフローティングゲートに蓄積されていく。このフローティングゲートに十分に電子が蓄積された後でゲートを閉じても、フローティングゲートに蓄積された電子はトンネル絶縁膜に遮られて保持され得る。すなわち、情報が記憶された状態になる。逆に情報を消去する場合は、ゲート電極を接地し、ソース電極を高電位に保てば、フローティングゲートから電子が徐々に抜け、情報の記憶が消去される。
 かくして、フローティングゲート型の不揮発性半導体メモリ装置においては、フローティングゲートへの正確な電荷チャージ、チャージされた電荷の長期間(例えば、10年以上といわれている)の保持性能が必要となる。
 近年の集積回路の微細化の流れと共に、不揮発性半導体メモリ装置の分野でも、微細化、大容量化の流れが顕在化し、それに対応する技術への対応に迫られている。そのため、電荷蓄積膜としてシリコン窒化物膜を使用するフローティングゲート型の不揮発性半導体メモリ装置においても、電荷保持特性を向上することにより微細化、大容量化を達成することが求められている。
 上記した構造の不揮発性半導体メモリ装置における電荷蓄積膜として、少なくともSi膜と、その上に設けたLa及びSiを含む絶縁膜とを備えたものが提案されている(例えば、特許文献2参照)。このシリコン窒化物膜は通常のCVD法により作製されており、このような積層構造の電荷蓄積膜とすることにより、電荷トラップ量が増大するとしている。
 さらに、シリコン窒化物膜について、触媒化学気相成長法(Cat-CVD法)によってSiHガスとNHガスとから作製できるがことが知られている(例えば、特許文献3参照)。
特開2002-190535号公報 特開2009-194311号公報 特開昭63-40314号公報
 上記したLPCVD法により作製されたシリコン窒化物膜を使用したMONOS構造やSONOS構造の不揮発性半導体メモリ装置では、このSi膜の電荷蓄積能力の限界から、その微細化の限界が指摘されており、Si膜の電荷蓄積・保持特性(電荷保持特性)の向上が求められている。換言すれば、フローティングゲート型の不揮発性半導体メモリ装置では、各構成膜に対する原理的な微細化の限界が指摘され、電荷蓄積膜の電荷蓄積能力の向上が求められている。
 本発明の課題は、上述の従来技術の問題点を解決することにあり、電荷蓄積・保持特性の高いシリコン窒化物膜からなる電荷蓄積膜を有し、微細化が達成され得る、例えばMONOS構造又はSONOS構造の不揮発性半導体メモリ装置及びその製造方法、並びにこの電荷蓄積膜を提供することにある。
 本発明の不揮発性半導体メモリ装置は、半導体基板上のトンネル絶縁膜と、前記トンネル絶縁膜上の電荷蓄積膜と、前記電荷蓄積膜上のブロッキング絶縁膜と、前記ブロッキング絶縁膜上の制御ゲート電極と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であることを特徴とする。
 上記した触媒化学気相成長法により作製されたシリコン窒化物膜を電荷蓄積膜として用いることにより、電荷蓄積量が増加し、また、電荷保持特性が改善されるので、不揮発性半導体メモリ装置の微細化が達成される。
 前記N/Si比が、1.2未満であると、電荷蓄積・保持特性が劣化する傾向があり、また、1.4を超えると、絶縁特性が劣化する傾向がある。
 前記シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が5~20at%であることを特徴とする。
 前記水素原子の含有量が、5at%未満であると、電荷蓄積・保持特性が劣化する傾向があり、また、20at%を超えると、絶縁特性が劣化する傾向がある。
 前記シリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が5×1021~5×1022個/cmであることを特徴とする。
 前記N-H結合が、5×1021未満であると、電荷蓄積・保持特性が劣化する傾向があり、また、5×1022個/cmを超えると、絶縁特性が劣化する傾向がある。
 本発明の不揮発性半導体メモリ装置は、半導体基板上のトンネル絶縁膜と、前記トンネル絶縁膜上の電荷蓄積膜と、前記電荷蓄積膜上のブロッキング絶縁膜と、前記ブロッキング絶縁膜上の制御ゲート電極と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であり、このシリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、5~20at%であり、そしてこのシリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、5×1021~5×1022個/cmであることを特徴とする。
 前記シリコン窒化物膜が、真空槽内にSiH及びNHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する、触媒化学気相成長法で作製されることを特徴とする。
 前記シリコン窒化物膜が、SiHガスとNHガスとの導入ガス量(sccm)比をNH/SiH=1~500とし、触媒化学気相成長法で作製されたものであることを特徴とする。
 このガス量比の範囲を外れると、所望のシリコン窒化物膜が得られ難い傾向がある。
 前記シリコン窒化物膜が、真空槽内にSiH、NH、及びHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する、触媒化学気相成長法で作製されたものであることを特徴とする。
 前記シリコン窒化物膜が、SiHガスとNHガスとHとの導入ガス量(sccm)比を(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1とし、触媒化学気相成長法で作製されたものであることを特徴とする。
 このガス量比の範囲を外れると、所望のシリコン窒化物膜が得られ難い傾向がある。
 前記シリコン窒化物膜が、真空槽内の圧力100Pa未満で、触媒化学気相成長法で作製されたものであることを特徴とする。下限は通常達成できる圧力である。
 この圧力が100Paを超えると、所望のシリコン窒化物膜が得られ難い傾向がある。
 前記対象加熱表面の温度が100~500℃であることを特徴とする。
 この対象加熱表面の温度範囲を外れると、所望のシリコン窒化物膜が得られ難い傾向がある。
 前記触媒が、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなることを特徴とする。
 前記触媒の加熱温度が、1500~2000℃であることを特徴とする。
 この加熱温度の範囲を外れると、所望のシリコン窒化物膜が得られ難い傾向がある。
 本発明の不揮発性半導体メモリ装置の製造方法は、半導体基板上にトンネル絶縁膜を形成し、前記トンネル絶縁膜上に、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4である電荷蓄積膜を形成し、前記電荷蓄積膜上にブロッキング絶縁膜を形成し、前記ブロッキング絶縁膜上に制御ゲート電極を形成し、前記制御ゲート電極の両側の前記半導体基板にソース/ドレイン領域を形成することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、5~20at%であることを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、5×1021~5×1022個/cmであることを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、真空槽内にSiH及びNHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する触媒化学気相成長法で作製することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、SiHガスとNHガスとの導入ガス量比をNH/SiH=1~500とし、触媒化学気相成長法で作製することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、真空槽内にSiH、NH、及びHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する触媒化学気相成長法で作製することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、SiHガスとNHガスとHとの導入ガス量比を(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1とし、触媒化学気相成長法で作製することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、真空槽内の圧力100Pa未満で、触媒化学気相成長法で作製することを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、対象加熱表面の温度が100~500℃であることを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、触媒が、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなることを特徴とする。
 前記不揮発性半導体メモリ装置の製造方法において、触媒の加熱温度が、1500~2000℃であることを特徴とする。
 本発明の電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であることを特徴とする。
 前記電荷蓄積膜において、シリコン窒化物膜が、触媒化学気相成長法で導入された水素原子を5~20at%含有していることを特徴とする。
 前記電荷蓄積膜において、シリコン窒化物膜が、触媒化学気相成長法で導入されたN-H結合を5×1021~5×1022個/cm有していることを特徴とする。
 本発明によれば、電荷保持特性の高い、触媒化学気相成長法により作製されたシリコン窒化物膜からなる電荷蓄積膜を用いることにより、微細化限界が回避され、かつ高集積化の進んだ不揮発性半導体メモリ装置(例えば、MONOS構造やSONOS構造のメモリ装置)を提供することができるという効果を奏する。
本発明の一実施の形態であるMONOS型構造を有する不揮発性半導体メモリ装置の構成例を示す模式的側面図。 本発明におけるシリコン窒化物膜を形成するための成膜装置の一構成例を示す模式的側面図。 実施例1で得られたシリコン窒化物膜におけるN/Si比のメモリウインドウ(V)に及ぼす影響を検討するために、N/Si比とミッドギャップ電圧(V)との関係を示すグラフ。 実施例2において触媒化学気相成長法により作製されたシリコン窒化物膜の電荷保持特性を検討するために、保持時間(秒)とミッドギャップ電圧(V)との関係を示すグラフ。 従来のLPCVD法により作製されたシリコン窒化物膜の電荷保持特性を検討するために、保持時間(秒)とミッドギャップ電圧(V)との関係を示すグラフ。 実施例2における結果を纏めたアレニウスプロットを示すグラフ。 実施例2で得られた触媒化学気相成長法によるシリコン窒化物膜、LPCVD法によるSi膜及びPECVD法により得られたSi膜の電荷保持特性の結果を比較して示す表。
 本発明に係る不揮発性半導体メモリ装置の実施の形態によれば、この不揮発性半導体メモリ装置は、半導体基板上のトンネル絶縁膜と、前記トンネル絶縁膜上の電荷蓄積膜と、前記電荷蓄積膜上のブロッキング絶縁膜と、前記ブロッキング絶縁膜上の制御ゲート電極と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが、以下記載の方法により測定して1.2~1.4、シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、以下記載の方法により測定して5~20at%、かつシリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、以下記載の方法により測定して5×1021~5×1022個/cmであることからなる。
 構成元素比N/Siは、ラザフォード後方散乱法(Rutherford Backscattering Spectroscopy)により測定される。エネルギー480keVのHeイオンを試料面の法線に対して45度の角度で試料に照射し、散乱されたHeイオンを散乱角90度で偏向磁場型エネルギー分析器により検出する方法を用いた。
 水素原子の含有量は、弾性反跳粒子検出法(Elastic Recoil Detection Analysis)により測定される。エネルギー480keVのNイオンを試料面の法線に対して70度の角度で試料に照射し、反跳されたHイオンを散乱角30度で偏向磁場型エネルギー分析器により検出する方法を用いた。
 N-H結合は、フーリエ変換赤外分光法(Fourier Transform Infrared Spectroscopy)により測定される。具体的な結合個数は、W.A.Lanford、M.J.Randの論文(J. Appl. Phys. 49(1978)2473)の換算係数を用いて計算した。
 本発明の不揮発性半導体メモリ装置は、例えば、図1に示すMONOS型構造を有する場合、Si基板11上に形成されたシリコン酸化物(SiO)からなるトンネル絶縁膜12と、このトンネル絶縁膜12上に形成されたシリコン窒化物からなる電荷蓄積膜13と、この電荷蓄積膜13上に形成されたシリコン酸化物(SiO)からなるブロッキング絶縁膜14と、このブロッキング絶縁膜14上に形成された、ポリシリコン又は金属からなる制御ゲート電極15と、そして制御ゲート電極15の両側のSi基板11に形成されたソース領域16/ドレイン領域17とを備え、制御ゲート電極15には電圧が印加できるように構成されている。ブロッキング絶縁膜14は、電荷蓄積膜13であるフローティングゲートと制御ゲート電極15との間の電流を阻止する機能を有する。
 上記のようなシリコン窒化物膜中の電荷捕獲中心に正孔及び/又は電子を捕獲させることで情報を記憶する。本発明のシリコン窒化物膜からなる電荷蓄積膜を使用することにより、不揮発性半導体メモリ装置における高集積化や高速化に対応できると共に、微細化にも対応できる。
 前記シリコン窒化物膜は、例えば、真空槽内にSiH及びNHガスをNH/SiH=1~500のガス量(sccm)比で導入し、又はSiH、NH、及びHガスを(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1のガス量(sccm)比で導入し、この原料ガスを、真空槽内の圧力を1~100Paに設定してある状態で、1500~2000℃に加熱された、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなる触媒と接触させて分解せしめ、真空槽内に配置されている表面温度が100~500℃の対象加熱表面に、触媒化学気相成長法で作製される。
 本発明に係る不揮発性半導体メモリ装置の製造方法の実施の形態によれば、この製造方法は、半導体基板上にトンネル絶縁膜を形成し、このトンネル絶縁膜上に、SiH及びNHガスをガス量比:NH/SiH=1~500で用い、1500~2000℃に加熱した触媒(例えば、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金)に接触させて分解せしめ、対象加熱表面に成膜することからなる触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4、導入された水素原子の含有量が5~20at%、導入されたN-H結合が5×1021~5×1022個/cmである電荷蓄積膜を形成し、前記電荷蓄積膜上にブロッキング絶縁膜を形成し、前記ブロッキング絶縁膜上に制御ゲート電極を形成し、前記制御ゲート電極の両側の前記半導体基板にソース/ドレイン領域を形成することからなる。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、SiH、NH、及びHガスをガス量比:(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1で用い、加熱した触媒に接触させて分解せしめ、対象加熱表面に成膜することからなる触媒化学気相成長法で作製し、上記した構成元素比(N/Si比)、水素原子含有量、N-H結合数を有する電荷蓄積膜とすることからなる。
 前記不揮発性半導体メモリ装置の製造方法において、シリコン窒化物膜を、真空槽内の圧力100Pa未満で、かつ対象加熱表面の温度を100~500℃で触媒化学気相成長法で作製することからなる。
 本発明に係る電荷蓄積膜の実施の形態によれば、この電荷蓄積膜は、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが、上記方法により測定して1.2~1.4、シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、上記方法により測定して5~20at%、かつシリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、上記方法により測定して5×1021~5×1022個/cmであることからなる。
 上記不揮発性半導体メモリ装置を構成する電荷蓄積膜以外の膜は、公知の方法で作製した膜を使用できる。例えば、半導体基板としては、Si基板等を用いることができ、この半導体基板上に設けられた電荷を選択的に通過せしめるトンネル絶縁膜としては、シリコン酸化物膜、アルミニウム酸化物膜等を用いることができ、その上に設けられるブロッキング絶縁膜としては、シリコン酸化物膜、アルミニウム酸化物膜等を用いることができ、このブロッキング絶縁膜上に設けられる制御ゲート電極としては、ポリシリコン、アルミニウム等を用いることができ、そしてソース/ドレイン領域は、熱拡散、イオン注入等によって形成される。
 上記シリコン窒化物膜は、図2に模式的構成を示す成膜装置により形成できる。図2に示す成膜装置は真空槽21を有しており、この真空槽21内には基板(成膜対象物)載置台22が配置され、そしてこの基板載置台22と対向する位置には、原料ガスを槽内に導入して基板上に供給するためのノズル23が配置されている。ノズル23は原料ガス供給系24に接続されている。図2では1つの原料ガス供給系を示してあるが、通常、使用する原料ガスの数だけ設けられる。原料ガスとしては、例えばSiH及びNHガス、又はSiH、NH、及びHガスを用いることができる。
 ノズル23の下面である基板載置台22に対向する位置には複数の孔25が設けられており、原料ガス供給系24からノズル23の孔25を経て真空槽21内へ原料ガスを導入すると、原料ガスは、成膜時に基板載置台22に置かれる基板26に向かって噴出され得るように構成されている。
 ノズル23と基板載置台22との間には、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなる線状の触媒27が配置されている。この触媒27に、真空槽21の外部に設置された電源28により通電し、発熱させて、例えば1500℃以上、2000℃以下の温度(例えば、1700℃)にしてシリコン窒化物膜の形成に用いる。
 また、真空槽21には真空ポンプ29が可変バルブ30を介して接続されており、この真空ポンプ29により真空槽21内を所定の圧力に真空排気し、真空雰囲気を維持しながら、基板26を基板載置台22上に載置し、基板載置台22内部に設けられたヒータ等の加熱手段31を用いて基板26を100℃以上、500℃以下に昇温させてシリコン窒化物膜の形成を行えるように構成されている。
 図2に示す成膜装置を用いてシリコン窒化物膜を形成する方法について以下説明する。上記のようにして基板26を昇温させた後、可変バルブ30の開度を変え、真空ポンプ29の排気速度を低下させ、ノズル23から流量制御しながら原料ガス(SiH及びNHガス、又はSiH、NH、及びHガス)を導入し、真空槽21内を100Pa未満の原料ガス雰囲気にする。
 真空槽21内へ導入された原料ガスは、加熱された触媒27に接触すると、それぞれが分解され、各ガスからラジカルが生成される。これらのラジカルが、基板26表面に到達すると、基板26表面にシリコン窒化物膜が形成される。
 以下の実施例では、シリコン窒化物膜からなる電荷蓄積膜の有効性を示す要素実験として、シリコン基板上にシリコン酸化物を積層したキャパシタを用いて評価を行う。
 本実施例では、図2に示す成膜装置を用い、原料ガスとしてシラン(SiH)及びアンモニア(NH)を、それぞれ、4~7sccmの量で用い、シリコン基板上に、成膜温度400℃、圧力10Pa、触媒温度1700℃で、触媒化学気相成長法によりシリコン窒化物膜を形成した。この場合、N/Si組成比を変えて、N/Si組成比とミッドギャップ電圧(V)との関係を検討した。
 N/Si比=1.24、1.28、1.32、1.34のシリコン窒化物膜を用いて、プログラム(Program)電圧を+22V、消去(Erase)電圧を-25Vとして、プログラム及び消去動作を行った場合のミッドギャップ電圧を測定した。その結果を表1及び図3に示す。なお、ここで、ミッドギャップ電圧とは、シリコン表面で、シリコンのフェルミ準位が、禁制帯の中央に一致する場合のゲート電圧をいう。図3において、横軸はN/Si比であり、縦軸はミッドギャップ電圧(V)である。また、プログラムと消去のミッドギャップ電圧の差がメモリウインドウ(V)である。
Figure JPOXMLDOC01-appb-T000001
 表1及び図3から、本発明におけるN/Si比≧1.33の場合に、メモリウインドウ(V)は、原料ガスとして二塩化シラン(SiHCl)及びNHを用い、成膜温度:750℃、圧力:30Paで、LPCVD法で作製した膜より広く、N/Si比<1.33の場合に若干狭かった。このことからN/Si比≧1.33であれば、LPCVD法で作製する場合のメモリウインドウ以上のメモリウインドウを確保できる。
 本実施例での触媒化学気相成長法では、成膜温度400℃、また、以下に示す実施例2での触媒化学気相成長法では、成膜温度300℃という低温でシリコン窒化物膜を形成している。このように触媒化学気相成長法により低温で作製されたシリコン窒化物膜の場合、LPCVD法により750℃という高温で作製したシリコン窒化物膜の場合のメモリウインドウ以上のメモリウインドウを確保できる。本発明の触媒化学気相成長法によれば、LPCVD法に比べて、成膜温度を低温化できる。
 本実施例では、図2に示す成膜装置を用い、原料ガスとしてSiH及びNHを、それぞれ、5sccmと200sccmの量で用い、成膜温度:300℃、圧力:10Pa、触媒温度:1700℃で、触媒化学気相成長法により49.9nm膜厚のシリコン窒化物膜を形成した。かくして得られたシリコン窒化物膜の形成された基板に対して、プログラム電圧を+22V、消去電圧を-25Vとして、プログラム及び消去動作を行った後、雰囲気温度27℃、126℃、202℃、233℃の条件で、所定の時間毎にミッドギャップ電圧を測定することによって、電荷保持特性を評価した。その結果を図4に示す。
 また、対照試験として、原料ガスとして塩化シラン(SiHCl)及びNHを用い、シリコン基板上に、成膜温度:750℃、圧力:30Paで、LPCVD法で48.5nm膜厚のSi膜を形成し、上記と同様にして電荷保持特性を評価した。その結果を図5に示す。
 図4及び5において、横軸は保持時間(秒)であり、縦軸はミッドギャップ電圧であり、プログラムと消去のミッドギャップ電圧の差(メモリウインドウ)が長期間高い値を維持するほど、電荷保持特性が良好であることを示す。
 図4と図5とを比較すれば、本発明のシリコン窒化物膜の方が、LPCVD法の場合と比べて高い電荷保持特性を有することが分かる。本発明のシリコン窒化物膜では、233℃の加速試験の状態から、10年以上の保持特性があることが分かる。
 図4及び5における温度依存性を評価するために、横軸に温度、縦軸に活性化エネルギー(Lnt)をとり、アレニウスプロットを作成し、その結果を図6に示す。図6から明らかなように、触媒化学気相成長法により作製されたシリコン窒化物膜(SiH-NH系Cat-CVD:Ea=3.3eV)の方が、LPCVD法により作製されたシリコン窒化物膜(SiHCl-NH系LPCVD:Ea=0.7eV)の4倍以上活性化エネルギーが高く、両者の間のトラップ準位は本質的に異なることが分かる。すなわち、前者の場合、いったんトラップに入った正孔をたたき出すのに沢山のエネルギーを必要とし、温度を負荷しても正孔は出てきづらく、そのために電荷を長期間保持することができるものと推測される。
 対照試験として、原料ガスとしてSiH、NH及びNを用い、成膜温度:350℃で、プラズマ化学気相成長法(PECVD法)で56.2nm膜厚のSi膜を形成し、上記と同様にして電荷保持特性を評価した。
 上記対照試験のPECVD法により得られたSi膜の電荷保持特性の結果を、実施例2で得られた触媒化学気相成長法によるシリコン窒化物膜及びLPCVD法によるSi膜の場合と比較して図7に示す。
 図7から明らかなように、実施例2で得られた触媒化学気相成長法によるシリコン窒化物膜の場合、メモリウインドウが一番高く(メモリウインドウ:17.8V)、次いでLPCVD法によるシリコン窒化物(メモリウインドウ:15.7V)、PECVD法によるシリコン窒化物膜(メモリウインドウ:10.9V)の順に低くなることが分かる。
 本発明によれば、電荷保持特性の高いシリコン窒化物膜からなる電荷蓄積膜を有し、微細化され、高集積化された不揮発性半導体メモリ装置及びその製造方法、並びにこの電荷蓄積膜を提供できるので、本発明は、半導体メモリ技術分野で利用可能である。
11 Si基板            12 トンネル絶縁膜
13 電荷蓄積膜           14 ブロッキング絶縁膜
15 制御ゲート電極         16 ソース領域
17 ドレイン領域          21 真空槽
22 基板載置台           23 ノズル
24 原料ガス供給系         25 孔
26 基板              27 触媒
28 電源              29 真空ポンプ
30 可変バルブ           31 加熱手段

Claims (26)

  1. 半導体基板上のトンネル絶縁膜と、前記トンネル絶縁膜上の電荷蓄積膜と、前記電荷蓄積膜上のブロッキング絶縁膜と、前記ブロッキング絶縁膜上の制御ゲート電極と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であることを特徴とする不揮発性半導体メモリ装置。
  2. 前記シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、5~20at%であることを特徴とする請求項1記載の不揮発性半導体メモリ装置。
  3. 前記シリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、5×1021~5×1022個/cmであることを特徴とする請求項1又は2記載の不揮発性半導体メモリ装置。
  4. 半導体基板上のトンネル絶縁膜と、前記トンネル絶縁膜上の電荷蓄積膜と、前記電荷蓄積膜上のブロッキング絶縁膜と、前記ブロッキング絶縁膜上の制御ゲート電極と、前記制御ゲート電極の両側の前記半導体基板に形成されるソース/ドレイン領域とを備え、前記電荷蓄積膜が、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であり、このシリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、5~20at%であり、そしてこのシリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、5×1021~5×1022個/cmであることを特徴とする不揮発性半導体メモリ装置。
  5. 前記シリコン窒化物膜が、真空槽内にSiH及びNHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する、触媒化学気相成長法で作製されることを特徴とする請求項1~4のいずれか1項記載の不揮発性半導体メモリ装置。
  6. 前記シリコン窒化物膜が、SiHガスとNHガスとの導入ガス量比をNH/SiH=1~500とし、触媒化学気相成長法で作製されたものであることを特徴とする請求項5記載の不揮発性半導体メモリ装置。
  7. 前記シリコン窒化物膜が、真空槽内にSiH、NH、及びHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する、触媒化学気相成長法で作製されたものであることを特徴とする請求項1~4のいずれか1項記載の不揮発性半導体メモリ装置。
  8. 前記シリコン窒化物膜が、SiHガスとNHガスとHとの導入ガス量比を(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1とし、触媒化学気相成長法で作製されたものであることを特徴とする請求項7記載の不揮発性半導体メモリ装置。
  9. 前記シリコン窒化物膜が、真空槽内の圧力100Pa未満で、触媒化学気相成長法で作製されたものであることを特徴とする請求項1~8のいずれか1項記載の不揮発性半導体メモリ装置。
  10. 前記対象加熱表面の温度が100~500℃であることを特徴とする請求項5~9のいずれか1項記載の不揮発性半導体メモリ装置。
  11. 前記触媒が、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなることを特徴とする請求項1~10のいずれか1項記載の不揮発性半導体メモリ装置。
  12. 前記触媒の加熱温度が、1500~2000℃であることを特徴とする請求項1~11のいずれか1項記載の不揮発性半導体メモリ装置。
  13. 半導体基板上にトンネル絶縁膜を形成し、前記トンネル絶縁膜上に、触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4である電荷蓄積膜を形成し、前記電荷蓄積膜上にブロッキング絶縁膜を形成し、前記ブロッキング絶縁膜上に制御ゲート電極を形成し、前記制御ゲート電極の両側の前記半導体基板にソース/ドレイン領域を形成することを特徴とする不揮発性半導体メモリ装置の製造方法。
  14. 前記シリコン窒化物膜に触媒化学気相成長法で導入された水素原子の含有量が、5~20at%であることを特徴とする請求項13記載の不揮発性半導体メモリ装置の製造方法。
  15. 前記シリコン窒化物膜に触媒化学気相成長法で導入されたN-H結合が、5×1021~5×1022個/cmであることを特徴とする請求項13又は14記載の不揮発性半導体メモリ装置の製造方法。
  16. 前記シリコン窒化物膜を、真空槽内にSiH及びNHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する触媒化学気相成長法で作製することを特徴とする請求項13~15のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  17. 前記シリコン窒化物膜を、SiHガスとNHガスとの導入ガス量比をNH/SiH=1~500とし、触媒化学気相成長法で作製することを特徴とする請求項16記載の不揮発性半導体メモリ装置の製造方法。
  18. 前記シリコン窒化物膜を、真空槽内にSiH、NH、及びHガスを導入し、加熱した触媒に接触させて分解せしめ、前記真空槽内に配置された対象加熱表面に成膜する触媒化学気相成長法で作製することを特徴とする請求項13~15のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  19. 前記シリコン窒化物膜を、SiHガスとNHガスとHとの導入ガス量比を(NH+H)/SiH=1~500、NH/(NH+H)=0.01~1とし、触媒化学気相成長法で作製することを特徴とする請求項18記載の不揮発性半導体メモリ装置の製造方法。
  20. 前記シリコン窒化物膜を、真空槽内の圧力100Pa未満で、触媒化学気相成長法で作製することを特徴とする請求項13~19のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  21. 前記対象加熱表面の温度が100~500℃であることを特徴とする請求項16~20のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  22. 前記触媒が、W、Mo、及びTaから選ばれた少なくとも1種の金属並びにこれら金属の少なくとも2種からなる合金から選ばれた材料からなることを特徴とする請求項16~21のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  23. 前記触媒の加熱温度が、1500~2000℃であることを特徴とする請求項16~22のいずれか1項記載の不揮発性半導体メモリ装置の製造方法。
  24. 触媒化学気相成長法で作製されたシリコン窒化物膜であって、構成元素比N/Siが1.2~1.4であることを特徴とする電荷蓄積膜。
  25. 前記シリコン窒化物膜が、触媒化学気相成長法で導入された水素原子を5~20at%含有していることを特徴とする請求項24記載の電荷蓄積膜。
  26. 前記シリコン窒化物膜が、触媒化学気相成長法で導入されたN-H結合を5×1021~5×1022個/cm有していることを特徴とする請求項24又は25記載の電荷蓄積膜。
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* Cited by examiner, † Cited by third party
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006269673A (ja) * 2005-03-23 2006-10-05 Nec Electronics Corp 半導体装置およびその製造方法
JP2007194511A (ja) * 2006-01-23 2007-08-02 Renesas Technology Corp 不揮発性半導体記憶装置およびその製造方法
JP2010067993A (ja) * 2004-03-26 2010-03-25 Ulvac Japan Ltd 単位層ポスト処理を用いた触媒化学蒸着法による成膜方法

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3868324B2 (ja) * 2002-04-15 2007-01-17 三菱電機株式会社 シリコン窒化膜の成膜方法、成膜装置、及び半導体装置の製造方法
JP2005179744A (ja) * 2003-12-19 2005-07-07 Toshiba Corp 触媒cvd装置及び触媒cvd法
JP4714208B2 (ja) * 2007-11-22 2011-06-29 キヤノンアネルバ株式会社 発熱体cvd装置及び成膜方法
JP2009170660A (ja) * 2008-01-16 2009-07-30 Toshiba Corp 半導体記憶装置およびその製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010067993A (ja) * 2004-03-26 2010-03-25 Ulvac Japan Ltd 単位層ポスト処理を用いた触媒化学蒸着法による成膜方法
JP2006269673A (ja) * 2005-03-23 2006-10-05 Nec Electronics Corp 半導体装置およびその製造方法
JP2007194511A (ja) * 2006-01-23 2007-08-02 Renesas Technology Corp 不揮発性半導体記憶装置およびその製造方法

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