ES2046106B1 - Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion. - Google Patents

Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion.

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METODO DE REALIZACION DE CIRCUITOS ALINEADORES INMUNES A LOS DESLIZAMIENTOS OCURRIDOS EN LA MEMORIA ELASTICA DE RECEPCION. APLICABLE A SISTEMAS DIGITALES DE TRANSMISION DE DATOS. BASADO EN GENERAR SEÑALES DE CONTROL EN LA MEMORIA ELASTICA (1) QUE INDIQUEN CUANDO SE REPITE O SE PIERDE INFORMACION, HACIENDO POSIBLE EL CONTROL DE CIRCUITOS ALINEADORES DE MANERA QUE UN DESLIZAMIENTO EN LA MEMORIA ELASTICA (1), DEBIDO A DIFERENCIAS DE FRECUENCIA ENTRE EL RELOJ DE RECEPCION Y DEL SISTEMA DE EMISION, NO IMPLIQUE FORZOSAMENTE EL DESALINEAMIENTO CUANDO SE ALCANZA EL ESTADO DE ALINEAMIENTO. PARA ELLO SE HA PREVISTO UNA ETAPA DE GENERACION DE SEÑALES TRAMA CONSTITUIDA POR LA MEMORIA ELASTICA (1), UN CONTADOR DE LECTURA (2), UN CONTADOR DE ESCRITURA (3), UN BLOQUE COMPARADOR Y DE CONTROL (4) QUE GENERA DICHAS SEÑALES TRAMA, Y UN CIRCUITO PIPO (5); CONECTANDOSE A ESA ETAPA UN CIRCUITO ALINEADOR DE MULTITRAMA DE SEÑALIZACION ASOCIADA AL CANAL PARA UNA TRAMA G.704 A 2.048 KBIT/S O UN CIRCUITO ALINEADOR SEGUN LA RECOMENDACION X.50 PARA LOS INTERVALOS DE CANAL A 64 KBIT/S CONTENIDOS EN UNA TRAMA G.704 A 2.048 KBIT/S, TODO ELLO DISEÑADO SEGUN EL METODO DE LA INVENCION.
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