HK69697A - Process, coder and decoder for data transmission and/or storage - Google Patents

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HK69697A
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Claims (7)

  1. Procédé pour la transmission et/ou l'enregistrement de données où, au niveau du codeur, les données sont d'abord transformées segment par segment en signaux numériques d'une longueur de mot variable (In), puis affectées à des blocs de longueur moyenne constante (m) à l'aide de premières mémoires (3, 4), sachant que certaines composantes des données choisies dans les segments des signaux numériques, et notamment une composante fixe (DC) et les composantes variables essentielles (ACn), sont disposées dans chacun desdits blocs, et sachant en outre que les blocs dont la longueur est inférieure à la longueur de mot moyenne sont remplis à l'aide de composantes de données (ACX) prélevées dans les blocs dont la longueur est supérieure à la longueur de mot moyenne, et qu'au niveau du décodeur, lesdits blocs sont récupérés dans leur longueur initiale variable (In) à l'aide de secondes mémoires (9, 10), procédé caractérisé en ce que chacun desdits blocs comprend en outre un indicateur d'adresse (FL) et une information de pointeur d'adresse (POI), qui, à la suite d'erreurs de transmission et/ou de lecture lors du décodage, indiquent les adresses dans lesdites secondes mémoires (9, 10) où les composantes de données (ACx) prélevées dans les blocs d'une longueur supérieure à la longueur de mot moyenne, peuvent être récupérées puis utilisées pour le décodage.
  2. Procédé selon la revendication 1 caractérisé en ce que les signaux numériques incluent des coefficients codés provenant d'une transformation cosinus discrète.
  3. Procédé selon la revendication 2 caractérisé en ce que les blocs de longueur constante moyenne comprennent une information (I) précisant les types de coefficients de transformation cosinus discrète contenus dans les signaux numériques pour chacun des blocs concernés.
  4. Procédé selon l'une quelconque ou plusieurs des revendications 1 à 3 caractérisé en ce que l'indicateur d'adresse (FL) sert à marquer de manière adéquate les blocs avec ou sans composantes variables importés d'autres blocs.
  5. Procédé selon l'une quelconque ou plusieurs des revendications 1 à 4 caractérisé en ce que les blocs avec ou sans composantes provenant d'autres blocs, comportent des informations de pointeur d'adresse (POIi, POIj) dont les indices (i, j) sont incrémentés d'une valeur de '1' lors du codage d'un certain type de bloc.
  6. Codeur pour un procédé selon l'une quelconque ou plusieurs des revendications 1 à 5, intégrant :
    - un circuit de codage (1) transformant les données segment par segment en signaux numériques de longueur de mot variable (In) ;
    - un multiplexeur (2) monté en aval, qui forme des blocs de longueur moyenne constante (m) à l'aide de première mémoires (3, 4), sachant que des composantes de données choisies dans les segments des signaux numérique - notamment une composante fixe (DC) et les composantes variables essentielles (ACn) - sont enregistrées dans lesdites premières mémoires pour chacun de ces blocs, et sachant en outre que les blocs dont la longueur est inférieure à la longueur moyenne sont remplis à l'aide de composantes de données (ACx) prélevées dans les blocs dont la longueur est supérieure à la longueur moyenne ;
    - un démultiplexeur (5) disposé en aval desdites mémoires, qui lie les données appartenant au bloc respectif et les transmet vers un canal de données (6) ;
    codeur caractérisé en ce qu'il comporte :
    - un circuit pour le calcul des pointeurs d'adresses (13), alimenté par lesdites premières mémoires, qui commande le multiplexeur et le démultiplexeur et fournit aux premières mémoires un indicateur d'adresse (FL) et une information de pointeur d'adresse (POI) pour chacun des blocs.
  7. Décodeur pour un procédé selon l'une quelconque ou plusieurs des revendications 1 à 5, intégrant :
    - un circuit de décodage (7) prévu en aval du canal de données (6) pour séparer des données d'un bloc ;
    - un multiplexeur (8) disposé en aval et permettant, en association avec des mémoires en aval (9, 10), de récupérer des blocs de données avec leur longueur de mot variable initiale (ln) ;
    - un démultiplexeur (11) prévu à la suite desdites mémoires, qui lie les données appartenant au bloc respectif et les transmet vers un décodeur de longueur variable (12) dont la sortie fournit des données correspondant aux données de source lors du codage ;
    décodeur caractérisé en ce qu'il comporte :
    - un circuit pour le calcul des pointeurs d'adresses (14) qui commande le multiplexeur et le démultiplexeur et transmet auxdites mémoires des informations de pointeurs d'adresses (POI), sachant que le circuit de décodage (7) décode les pointeurs d'adresses à partir du flux de données arrivant et retransmet des informations de pointeurs d'adresses et des indicateurs d'adresses (FL) vers le circuit pour le calcul des pointeurs d'adresses (14).
HK69697A 1990-10-24 1997-05-22 Process, coder and decoder for data transmission and/or storage HK69697A (en)

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