JP2000224604A - 画像処理装置 - Google Patents
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- H04N23/84—Camera processing pipelines; Components thereof for processing colour signals
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- H04N23/00—Cameras or camera modules comprising electronic image sensors; Control thereof
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/10—Circuitry of solid-state image sensors [SSIS]; Control thereof for transforming different wavelengths into image signals
- H04N25/11—Arrangement of colour filter arrays [CFA]; Filter mosaics
- H04N25/13—Arrangement of colour filter arrays [CFA]; Filter mosaics characterised by the spectral characteristics of the filter elements
- H04N25/134—Arrangement of colour filter arrays [CFA]; Filter mosaics characterised by the spectral characteristics of the filter elements based on three different wavelength filter elements
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- H04N25/44—Extracting pixel data from image sensors by controlling scanning circuits, e.g. by modifying the number of pixels sampled or to be sampled by partially reading an SSIS array
- H04N25/445—Extracting pixel data from image sensors by controlling scanning circuits, e.g. by modifying the number of pixels sampled or to be sampled by partially reading an SSIS array by skipping some contiguous pixels within the read portion of the array
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
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- H04N25/73—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors using interline transfer [IT]
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Abstract
(57)【要約】
【課題】多画素のＣＣＤを用いて入力される画像データ
を単板イメージのまま間引き、表示装置の解像度に合わ
せて動画を表示させることができる画像処理装置を提供
する。 【解決手段】動画表示モードのとき、ＣＰＵ３８はセレ
クタ２４に指示を与えて分周回路２２の出力信号を信号
処理部２６に同期信号として供給させる。Ｇストライプ
又はベイヤー配列のＣＣＤ１２を用いた場合、分周回路
２２によってクロックを奇数分の１（例えば、１／３又
は１／５）の周波数に分周して信号処理部２６に入力す
ることで、信号処理部２６には画素配列を変えることな
く画素数が奇数分の１に間引かれた画像データが取り込
まれる。かかる入力画像データを信号処理部２６におい
て適宜処理した後、これを液晶モニタ３２に出力するこ
とにより動画表示を行う。
を単板イメージのまま間引き、表示装置の解像度に合わ
せて動画を表示させることができる画像処理装置を提供
する。 【解決手段】動画表示モードのとき、ＣＰＵ３８はセレ
クタ２４に指示を与えて分周回路２２の出力信号を信号
処理部２６に同期信号として供給させる。Ｇストライプ
又はベイヤー配列のＣＣＤ１２を用いた場合、分周回路
２２によってクロックを奇数分の１（例えば、１／３又
は１／５）の周波数に分周して信号処理部２６に入力す
ることで、信号処理部２６には画素配列を変えることな
く画素数が奇数分の１に間引かれた画像データが取り込
まれる。かかる入力画像データを信号処理部２６におい
て適宜処理した後、これを液晶モニタ３２に出力するこ
とにより動画表示を行う。
Description
【０００１】
【発明の属する技術分野】本発明は画像処理装置に係
り、特にデジタルカメラなどのように、多画素のＣＣＤ
撮像素子を用いて入力される画像データを間引き処理し
て、表示装置の解像度に合わせて動画を表示することが
できる画像記録再生装置に好適な画像処理装置に関す
る。
り、特にデジタルカメラなどのように、多画素のＣＣＤ
撮像素子を用いて入力される画像データを間引き処理し
て、表示装置の解像度に合わせて動画を表示することが
できる画像記録再生装置に好適な画像処理装置に関す
る。
【０００２】
【従来の技術】ＣＣＤ等の撮像素子を用いて光学像を電
子画像信号に変換し、これを適宜信号処理することによ
って画像データを得る技術は広く知られている。特開平
８−５１５０９号公報においては、データ量の少ない画
像処理装置を得ることを目的とし、アナログのＲＧＢ信
号をＡ／Ｄコンバータでデジタル信号に変換する際に、
サンプリング信号発生回路により、Ｒ，Ｂデータを間引
いてデータ量を少なくし、メモリ容量の削減を図る技術
が開示されている。
子画像信号に変換し、これを適宜信号処理することによ
って画像データを得る技術は広く知られている。特開平
８−５１５０９号公報においては、データ量の少ない画
像処理装置を得ることを目的とし、アナログのＲＧＢ信
号をＡ／Ｄコンバータでデジタル信号に変換する際に、
サンプリング信号発生回路により、Ｒ，Ｂデータを間引
いてデータ量を少なくし、メモリ容量の削減を図る技術
が開示されている。
【０００３】
【発明が解決しようとする課題】ところで、従来から、
多画素の単板ＣＣＤから入力される画像データを動画表
示する場合には、表示装置の解像度に合わせるために、
適宜間引き処理を行って画像データを縮小している。か
かる縮小化の手法は様々な態様があるが、例えば、ＣＣ
Ｄの画素配列がＧストライプ配列の場合、水平転送路の
出力部からＲＧＢＧＲＧＢＧ…と点順次に出力されるＣ
ＣＤの出力データ（１線データ）から、全画素分のＲの
みのデータ、Ｇのみのデータ、Ｂのみのデータを生成す
る処理（３線化）を行い、３線化した後に適当な間引き
率でデータを間引く処理が行われている。
多画素の単板ＣＣＤから入力される画像データを動画表
示する場合には、表示装置の解像度に合わせるために、
適宜間引き処理を行って画像データを縮小している。か
かる縮小化の手法は様々な態様があるが、例えば、ＣＣ
Ｄの画素配列がＧストライプ配列の場合、水平転送路の
出力部からＲＧＢＧＲＧＢＧ…と点順次に出力されるＣ
ＣＤの出力データ（１線データ）から、全画素分のＲの
みのデータ、Ｇのみのデータ、Ｂのみのデータを生成す
る処理（３線化）を行い、３線化した後に適当な間引き
率でデータを間引く処理が行われている。
【０００４】一方、ベイヤー配列の場合であれば、水平
出力がＲＧＲＧＲＧ…と繰り返されるＲＧライン、又は
ＧＢＧＢＧＢ…と繰り返されるＧＢラインの１線データ
を２線化してから間引くという方法が採用されることが
多い。しかしながら、これら従来の手法は、水平転送路
の出力部から得られる全データを信号処理部に取り込ん
でから３線化（又は２線化）処理した後に間引き行うも
のであり、信号処理ＬＳＩなどの間引き機能や縮小機
能、或いは内蔵のバッファ容量等に依存している。ま
た、高画質化の要望に伴いＣＣＤの多画素化が進むにつ
れ、動画表示の解像度（動解像度）を得るためにＣＣＤ
駆動用のクロック周波数が上がっていくことになるが、
このとき高い周波数のクロックで信号処理を行うことに
なり、消費電力が大きくなるという問題もある。
出力がＲＧＲＧＲＧ…と繰り返されるＲＧライン、又は
ＧＢＧＢＧＢ…と繰り返されるＧＢラインの１線データ
を２線化してから間引くという方法が採用されることが
多い。しかしながら、これら従来の手法は、水平転送路
の出力部から得られる全データを信号処理部に取り込ん
でから３線化（又は２線化）処理した後に間引き行うも
のであり、信号処理ＬＳＩなどの間引き機能や縮小機
能、或いは内蔵のバッファ容量等に依存している。ま
た、高画質化の要望に伴いＣＣＤの多画素化が進むにつ
れ、動画表示の解像度（動解像度）を得るためにＣＣＤ
駆動用のクロック周波数が上がっていくことになるが、
このとき高い周波数のクロックで信号処理を行うことに
なり、消費電力が大きくなるという問題もある。
【０００５】本発明はこのような事情に鑑みてなされた
もので、多画素のＣＣＤから得られる画像データの画素
数を単板イメージのまま間引き、メモリ容量の削減と消
費電力の低減を図ることができる画像処理装置を提供す
ることを目的とする。
もので、多画素のＣＣＤから得られる画像データの画素
数を単板イメージのまま間引き、メモリ容量の削減と消
費電力の低減を図ることができる画像処理装置を提供す
ることを目的とする。
【０００６】
【課題を解決するための手段】前記目的を達成するため
に本発明に係る画像処理装置は、撮像素子の駆動クロッ
クを分周する分周手段と、前記駆動クロックに従って前
記撮像素子から出力される画像信号をデジタルデータに
変換するＡ／Ｄ変換手段と、前記Ａ／Ｄ変換手段から出
力される画像データを前記分周手段から提供される分周
クロックに同期するタイミングで取り込み、当該取り込
んだ画像データを処理する信号処理部と、を備えたこと
を特徴としている。
に本発明に係る画像処理装置は、撮像素子の駆動クロッ
クを分周する分周手段と、前記駆動クロックに従って前
記撮像素子から出力される画像信号をデジタルデータに
変換するＡ／Ｄ変換手段と、前記Ａ／Ｄ変換手段から出
力される画像データを前記分周手段から提供される分周
クロックに同期するタイミングで取り込み、当該取り込
んだ画像データを処理する信号処理部と、を備えたこと
を特徴としている。
【０００７】本発明によれば、撮像素子から読み出され
るアナログ形式の撮像信号は、Ａ／Ｄ変換手段において
撮像素子の駆動クロックに同期したデジタルデータに変
換される。そして、このデジタルデータを信号処理部に
入力するにあたり、該信号処理部に対して前記駆動クロ
ックを分周したクロックを与えている。信号処理部は分
周されたクロックに同期して画像データを取り込むた
め、信号処理部に入力されるデータは分周比に応じて間
引かれる。これにより、撮像素子の単板イメージのまま
データを間引くことができ、信号処理部の内蔵メモリの
容量を削減し、消費電力の低減を図ることができる。
るアナログ形式の撮像信号は、Ａ／Ｄ変換手段において
撮像素子の駆動クロックに同期したデジタルデータに変
換される。そして、このデジタルデータを信号処理部に
入力するにあたり、該信号処理部に対して前記駆動クロ
ックを分周したクロックを与えている。信号処理部は分
周されたクロックに同期して画像データを取り込むた
め、信号処理部に入力されるデータは分周比に応じて間
引かれる。これにより、撮像素子の単板イメージのまま
データを間引くことができ、信号処理部の内蔵メモリの
容量を削減し、消費電力の低減を図ることができる。
【０００８】特に、駆動クロックを奇数分の１に分周し
て信号処理部に与えることにより、ＣＣＤ固体撮像素子
の画素配列がＧストライプであるか、ベイヤー配列であ
るかにかかわらず、画素配列を変えることなく単板イメ
ージの画像データの画素数を奇数分の１に間引くことが
できる。本発明の他の態様に係る画像処理装置は、撮像
素子と、前記撮像素子を駆動するための駆動クロックを
発生させるタイミング信号発生手段と、前記駆動クロッ
クを分周する分周手段と、前記駆動クロックに従って前
記撮像素子から出力される画像信号をデジタルデータに
変換するＡ／Ｄ変換手段と、前記Ａ／Ｄ変換手段から出
力される画像データを前記駆動クロック又は前記分周手
段から提供される分周クロックに同期するタイミングで
取り込み、当該取り込んだ画像データを処理する信号処
理部と、前記駆動クロック又は前記分周手段から出力さ
れる分周クロックの何れか一方を選択的に前記信号処理
部に加えることができる選択手段と、前記分周クロック
に同期するタイミングで前記信号処理部に入力され該信
号処理部において処理された画像データに基づいて画像
を表示する表示装置と、撮影開始指示信号の受入に呼応
して前記撮像素子から読み出され、前記駆動クロックに
同期するタイミングで前記信号処理部に入力され該信号
処理部において処理された画像データを記録する記録手
段と、を備えたことを特徴としている。
て信号処理部に与えることにより、ＣＣＤ固体撮像素子
の画素配列がＧストライプであるか、ベイヤー配列であ
るかにかかわらず、画素配列を変えることなく単板イメ
ージの画像データの画素数を奇数分の１に間引くことが
できる。本発明の他の態様に係る画像処理装置は、撮像
素子と、前記撮像素子を駆動するための駆動クロックを
発生させるタイミング信号発生手段と、前記駆動クロッ
クを分周する分周手段と、前記駆動クロックに従って前
記撮像素子から出力される画像信号をデジタルデータに
変換するＡ／Ｄ変換手段と、前記Ａ／Ｄ変換手段から出
力される画像データを前記駆動クロック又は前記分周手
段から提供される分周クロックに同期するタイミングで
取り込み、当該取り込んだ画像データを処理する信号処
理部と、前記駆動クロック又は前記分周手段から出力さ
れる分周クロックの何れか一方を選択的に前記信号処理
部に加えることができる選択手段と、前記分周クロック
に同期するタイミングで前記信号処理部に入力され該信
号処理部において処理された画像データに基づいて画像
を表示する表示装置と、撮影開始指示信号の受入に呼応
して前記撮像素子から読み出され、前記駆動クロックに
同期するタイミングで前記信号処理部に入力され該信号
処理部において処理された画像データを記録する記録手
段と、を備えたことを特徴としている。
【０００９】本発明によれば、動画表示中は表示装置の
解像度に合わせるために、駆動クロックを分周して信号
処理部に入力することで擬似的にデータを間引き、縮小
画像を得る。その一方、画像記録時、すなわち、撮影開
始指示信号の受入に呼応して撮像した画像データを記録
装置に記録する際には、駆動クロックを分周せずに信号
処理部に入力して高画素数の画像を取得する。
解像度に合わせるために、駆動クロックを分周して信号
処理部に入力することで擬似的にデータを間引き、縮小
画像を得る。その一方、画像記録時、すなわち、撮影開
始指示信号の受入に呼応して撮像した画像データを記録
装置に記録する際には、駆動クロックを分周せずに信号
処理部に入力して高画素数の画像を取得する。
【００１０】こうすることにより、信号処理部の内蔵メ
モリの容量や、従来の間引き機能に制限されることな
く、表示装置の解像度に合わせて動画を表示できるシス
テムが達成される。また、動画表示中、信号処理部に入
力されるクロック周波数が従来よりも低くなるので、信
号処理部における消費電力も低減される。
モリの容量や、従来の間引き機能に制限されることな
く、表示装置の解像度に合わせて動画を表示できるシス
テムが達成される。また、動画表示中、信号処理部に入
力されるクロック周波数が従来よりも低くなるので、信
号処理部における消費電力も低減される。
【００１１】
【発明の実施の形態】以下添付図面に従って本発明に係
る画像処理装置の好ましい実施の形態について説明す
る。図１は本発明の実施の形態に係る画像処理装置の構
成を示すブロック図である。この画像処理装置１０は、
画像の記録及び再生機能を併せ持つ電子カメラに適用さ
れ、主として、ＣＣＤ固体撮像素子（以下、ＣＣＤと略
記する。）１２、ＣＤＳ回路等を含むアナログ処理部１
４、Ａ／Ｄコンバータ１６、ＣＣＤ駆動回路１８、タイ
ミングジェネレータ（ＴＧ）２０、分周回路２２、セレ
クタ２４、信号処理部２６、フレームメモリ２８、Ｄ／
Ａコンバータ３０、液晶モニタ（ＬＣＤ）３２、記録装
置３４、操作部３６及び中央演算処理装置（ＣＰＵ）３
８等から構成される。
る画像処理装置の好ましい実施の形態について説明す
る。図１は本発明の実施の形態に係る画像処理装置の構
成を示すブロック図である。この画像処理装置１０は、
画像の記録及び再生機能を併せ持つ電子カメラに適用さ
れ、主として、ＣＣＤ固体撮像素子（以下、ＣＣＤと略
記する。）１２、ＣＤＳ回路等を含むアナログ処理部１
４、Ａ／Ｄコンバータ１６、ＣＣＤ駆動回路１８、タイ
ミングジェネレータ（ＴＧ）２０、分周回路２２、セレ
クタ２４、信号処理部２６、フレームメモリ２８、Ｄ／
Ａコンバータ３０、液晶モニタ（ＬＣＤ）３２、記録装
置３４、操作部３６及び中央演算処理装置（ＣＰＵ）３
８等から構成される。
【００１２】ＣＣＤ１２の画素数は、希望する画質との
関係で適正なものを選択する必要があるが、例えば本装
置では２３０万画素程度の画素数を有するものとし、水
平方向画素数が１９２０画素であるＧストライプ配列の
ＣＣＤ１２が用いられている。図示せぬ撮影レンズを介
してＣＣＤ１２の受光面に結像された光学像は、ＣＣＤ
１２の各感光画素において光の入射光量に応じた量の信
号電荷に変換される。このようにして蓄積された信号電
荷は、ＣＣＤ駆動回路１８から加えられるリードゲート
パルスによって並列的に垂直転送路に転送される。次
に、垂直転送路の電極に１周期分のクロックパルスを印
加することにより１行分の信号電荷が水平転送路に転送
される（この動作をラインシフトという。）。次いで、
水平転送路の電極に２相クロックパルス（駆動クロック
に相当）を印加することで１水平ライン分の信号が出力
部を介して出力される。以下、ラインシフトと水平転送
路の水平転送とを繰り返すことによって、垂直転送路の
信号電荷を全て読み出すことができる。こうしてＣＣＤ
１２の出力部からは各感光画素の蓄積電荷に応じた電圧
信号（アナログ画像信号）が順次出力される。
関係で適正なものを選択する必要があるが、例えば本装
置では２３０万画素程度の画素数を有するものとし、水
平方向画素数が１９２０画素であるＧストライプ配列の
ＣＣＤ１２が用いられている。図示せぬ撮影レンズを介
してＣＣＤ１２の受光面に結像された光学像は、ＣＣＤ
１２の各感光画素において光の入射光量に応じた量の信
号電荷に変換される。このようにして蓄積された信号電
荷は、ＣＣＤ駆動回路１８から加えられるリードゲート
パルスによって並列的に垂直転送路に転送される。次
に、垂直転送路の電極に１周期分のクロックパルスを印
加することにより１行分の信号電荷が水平転送路に転送
される（この動作をラインシフトという。）。次いで、
水平転送路の電極に２相クロックパルス（駆動クロック
に相当）を印加することで１水平ライン分の信号が出力
部を介して出力される。以下、ラインシフトと水平転送
路の水平転送とを繰り返すことによって、垂直転送路の
信号電荷を全て読み出すことができる。こうしてＣＣＤ
１２の出力部からは各感光画素の蓄積電荷に応じた電圧
信号（アナログ画像信号）が順次出力される。
【００１３】なお、ＣＣＤ１２にはシャッタゲートを介
してシャッタドレインが設けられており、シャッタゲー
トをシャッタゲートパルスによって駆動することによ
り、蓄積した信号電荷をシャッタドレインに掃き出すこ
とができる。すなわち、このＣＣＤ１２は、シャッタゲ
ートパルスによって各感光画素に蓄積される電荷の蓄積
時間（シャッタスピード）を制御する、いわゆる電子シ
ャッタ機能を有している。
してシャッタドレインが設けられており、シャッタゲー
トをシャッタゲートパルスによって駆動することによ
り、蓄積した信号電荷をシャッタドレインに掃き出すこ
とができる。すなわち、このＣＣＤ１２は、シャッタゲ
ートパルスによって各感光画素に蓄積される電荷の蓄積
時間（シャッタスピード）を制御する、いわゆる電子シ
ャッタ機能を有している。
【００１４】ＣＣＤ１２から読み出された信号はアナロ
グ処理部１４に加えられ、ＣＤＳ回路において各画素毎
にサンプリングホールドされ、かつＲ，Ｇ，Ｂ信号に色
分離されてゲインコントロールアンプに加えられる。ゲ
インコントロールアンプは入力するＲ，Ｇ，Ｂ信号を適
宜のゲインで増幅しホワイトバランスを調整する。ゲイ
ンコントロールアンプから出力されたＲ，Ｇ，Ｂ信号は
点順次化されてＡ／Ｄコンバータ１６に供給される。Ａ
／Ｄコンバータ１６は入力するＲ，Ｇ，Ｂ信号を順次デ
ジタル信号に変換する。デジタル化されたＲ，Ｇ，Ｂ信
号は信号処理部２６へと提供される。
グ処理部１４に加えられ、ＣＤＳ回路において各画素毎
にサンプリングホールドされ、かつＲ，Ｇ，Ｂ信号に色
分離されてゲインコントロールアンプに加えられる。ゲ
インコントロールアンプは入力するＲ，Ｇ，Ｂ信号を適
宜のゲインで増幅しホワイトバランスを調整する。ゲイ
ンコントロールアンプから出力されたＲ，Ｇ，Ｂ信号は
点順次化されてＡ／Ｄコンバータ１６に供給される。Ａ
／Ｄコンバータ１６は入力するＲ，Ｇ，Ｂ信号を順次デ
ジタル信号に変換する。デジタル化されたＲ，Ｇ，Ｂ信
号は信号処理部２６へと提供される。
【００１５】ＣＣＤ駆動回路１８、アナログ処理部１４
及びＡ／Ｄコンバータ１６にはＣＰＵ３８によって制御
されるタイミングジェネレータ２０から出力されるクロ
ックが加えられており、このクロックによって各回路の
同期がとられている。また、タイミングジェネレータ２
０から出力されるクロックは分周回路２２に加えられて
おり、ここで１／３の周波数に分周される。分周回路２
２の出力（分周クロックという）はセレクタ２４の一方
の入力端子に供給されている。
及びＡ／Ｄコンバータ１６にはＣＰＵ３８によって制御
されるタイミングジェネレータ２０から出力されるクロ
ックが加えられており、このクロックによって各回路の
同期がとられている。また、タイミングジェネレータ２
０から出力されるクロックは分周回路２２に加えられて
おり、ここで１／３の周波数に分周される。分周回路２
２の出力（分周クロックという）はセレクタ２４の一方
の入力端子に供給されている。
【００１６】セレクタ２４の他方の入力端子には前記タ
イミングジェネレータ２０の出力するクロックが加えら
れており、ＣＰＵ３８からの指令（選択信号）に従って
セレクタ２４の出力が切り替えられるようになってい
る。信号処理部２６はＡ／Ｄコンバータ１６から出力さ
れる画像信号を前記セレクタ２４から受入するクロック
に従って取り込み、所定の画像処理を行う。すなわち、
セレクタ２４から出力されるクロックが前記分周回路２
２を経由した分周クロックの場合には、Ａ／Ｄコンバー
タ１６の出力信号のうち分周クロックに同期する画素の
信号のみが信号処理部２６に取り込まれる。一方、セレ
クタ２４から出力されるクロックが分周されていない駆
動クロックの場合には、全画素分の信号が信号処理部２
６に取り込まれることになる。
イミングジェネレータ２０の出力するクロックが加えら
れており、ＣＰＵ３８からの指令（選択信号）に従って
セレクタ２４の出力が切り替えられるようになってい
る。信号処理部２６はＡ／Ｄコンバータ１６から出力さ
れる画像信号を前記セレクタ２４から受入するクロック
に従って取り込み、所定の画像処理を行う。すなわち、
セレクタ２４から出力されるクロックが前記分周回路２
２を経由した分周クロックの場合には、Ａ／Ｄコンバー
タ１６の出力信号のうち分周クロックに同期する画素の
信号のみが信号処理部２６に取り込まれる。一方、セレ
クタ２４から出力されるクロックが分周されていない駆
動クロックの場合には、全画素分の信号が信号処理部２
６に取り込まれることになる。
【００１７】信号処理部２６は輝度・色差信号作成回路
（ＹＣ処理回路）やガンマ補正回路、測光値演算回路、
圧縮／伸張回路等のデジタル画像処理回路を含み、Ａ／
Ｄコンバータ１６を介して入力されるＲ，Ｇ，Ｂのデジ
タル信号から輝度信号Ｙと、クロマ信号Ｃ（色差信号Ｂ
−Ｙ，Ｒ−Ｙ）が作成される。信号処理部２６の処理に
より得られた画像データはフレームメモリ２８に記憶さ
れる。また、信号処理部２６から出力される画像データ
はＤ／Ａコンバータ３０を介してアナログ信号に変換さ
れた後、液晶モニタ３２に供給される。こうして、ＣＣ
Ｄ１２が捉えている映像がモニタ画面上に表示される。
（ＹＣ処理回路）やガンマ補正回路、測光値演算回路、
圧縮／伸張回路等のデジタル画像処理回路を含み、Ａ／
Ｄコンバータ１６を介して入力されるＲ，Ｇ，Ｂのデジ
タル信号から輝度信号Ｙと、クロマ信号Ｃ（色差信号Ｂ
−Ｙ，Ｒ−Ｙ）が作成される。信号処理部２６の処理に
より得られた画像データはフレームメモリ２８に記憶さ
れる。また、信号処理部２６から出力される画像データ
はＤ／Ａコンバータ３０を介してアナログ信号に変換さ
れた後、液晶モニタ３２に供給される。こうして、ＣＣ
Ｄ１２が捉えている映像がモニタ画面上に表示される。
【００１８】ＣＰＵ３８は、本画像処理装置１０の各回
路を統括・制御するもので、所定のアルゴリズムに従っ
て露出値、フォーカス位置等の各種演算を行い、自動露
光制御、オートフォーカス、オートストロボ、オートホ
ワイトバランス等の制御を行うともに、操作部３６から
入力信号に基づいてズーミング、フォーカシング等の撮
影動作に必要な各機構部の制御、液晶モニタ３２の表示
制御、記録装置３４の書き込み／読み出し制御等を行
う。
路を統括・制御するもので、所定のアルゴリズムに従っ
て露出値、フォーカス位置等の各種演算を行い、自動露
光制御、オートフォーカス、オートストロボ、オートホ
ワイトバランス等の制御を行うともに、操作部３６から
入力信号に基づいてズーミング、フォーカシング等の撮
影動作に必要な各機構部の制御、液晶モニタ３２の表示
制御、記録装置３４の書き込み／読み出し制御等を行
う。
【００１９】すなわち、ＣＰＵ３８は、信号処理部２６
に取り込まれた画像信号に基づいて算出した露出値に従
ってＣＣＤ１２の電荷蓄積時間や図示せぬ絞りを制御す
るとともに、算出したＲＢゲイン値に従ってアナログ処
理部１４のゲインコントロールアンプを制御し、ホワイ
トバランスを設定する。また、ＣＰＵ３８は画像信号か
ら被写体像の鮮鋭度を示す焦点評価値を演算し、その焦
点評価値に基づいてフォーカス位置を算出する。そし
て、算出したフォーカス位置に従って図示せぬフォーカ
ス駆動回路を介してフォーカス光学系を制御し、フォー
カス位置を設定する。なお、オートフォーカス手段は、
上述の形態に限らず、ＡＦセンサなど公知の測距手段を
用いてもよい。
に取り込まれた画像信号に基づいて算出した露出値に従
ってＣＣＤ１２の電荷蓄積時間や図示せぬ絞りを制御す
るとともに、算出したＲＢゲイン値に従ってアナログ処
理部１４のゲインコントロールアンプを制御し、ホワイ
トバランスを設定する。また、ＣＰＵ３８は画像信号か
ら被写体像の鮮鋭度を示す焦点評価値を演算し、その焦
点評価値に基づいてフォーカス位置を算出する。そし
て、算出したフォーカス位置に従って図示せぬフォーカ
ス駆動回路を介してフォーカス光学系を制御し、フォー
カス位置を設定する。なお、オートフォーカス手段は、
上述の形態に限らず、ＡＦセンサなど公知の測距手段を
用いてもよい。
【００２０】更に、ＣＰＵ３８は、操作部３６に含まれ
るズームスイッチによって撮影者が設定した撮影レンズ
の焦点距離にしたがってズーム駆動制御回路を介してズ
ーム光学系１１を制御し、撮影レンズの焦点距離を設定
する。操作部３６に含まれるレリーズボタンの押圧操作
等によって発っせられる撮影開始指示信号がＣＰＵ３８
に加えられると、該撮影開始指示信号の受入に呼応し
て、ＣＣＤ１２から読み出された画像信号は、分周しな
い駆動クロックに同期して信号処理部２６に入力され、
所定の処理を経た後、必要に応じて圧縮処理され、記録
装置３４に記録される。なお、記録装置３４における記
録媒体の形態は、メモリカードなど着脱自在な外部記録
媒体でもよいし、カメラ本体に内蔵した内部メモリでも
よい。また、撮影開始指示信号はリモコンや外部接続機
器などのように装置の外部から与えられる場合もある。
るズームスイッチによって撮影者が設定した撮影レンズ
の焦点距離にしたがってズーム駆動制御回路を介してズ
ーム光学系１１を制御し、撮影レンズの焦点距離を設定
する。操作部３６に含まれるレリーズボタンの押圧操作
等によって発っせられる撮影開始指示信号がＣＰＵ３８
に加えられると、該撮影開始指示信号の受入に呼応し
て、ＣＣＤ１２から読み出された画像信号は、分周しな
い駆動クロックに同期して信号処理部２６に入力され、
所定の処理を経た後、必要に応じて圧縮処理され、記録
装置３４に記録される。なお、記録装置３４における記
録媒体の形態は、メモリカードなど着脱自在な外部記録
媒体でもよいし、カメラ本体に内蔵した内部メモリでも
よい。また、撮影開始指示信号はリモコンや外部接続機
器などのように装置の外部から与えられる場合もある。
【００２１】また、記録装置３４に保存した画像データ
はＣＰＵ３８の制御に基づいて読み出しが可能であり、
読み出された画像データは伸張処理された後、液晶モニ
タ３２に出力される。このように、記録装置３４に保存
されている画像データの再生表示も可能である。次に、
上記の如く構成された画像処理装置の作用について説明
する。
はＣＰＵ３８の制御に基づいて読み出しが可能であり、
読み出された画像データは伸張処理された後、液晶モニ
タ３２に出力される。このように、記録装置３４に保存
されている画像データの再生表示も可能である。次に、
上記の如く構成された画像処理装置の作用について説明
する。
【００２２】ＣＣＤ１２から読み出される全画素分の画
像データ、すなわち、Ａ／Ｄコンバータ１６から出力さ
れる画像データは水平方向の画素数が１９２０画素であ
るのに対し、液晶モニタ３２の解像度はＶＧＡの規格に
従う場合、水平方向画素は６４０画素である。したがっ
て、適当な間引き処理を行って水平を６４０画素にする
必要があるが、本実施の形態に係る画像処理装置１０
は、タイミングジェネレータ２０からのクロックを分周
回路２２で３分周して、これを信号処理部２６に加える
ことにより、信号処理部２６への入力段階で画像データ
の画素数を６４０画素に間引いている。
像データ、すなわち、Ａ／Ｄコンバータ１６から出力さ
れる画像データは水平方向の画素数が１９２０画素であ
るのに対し、液晶モニタ３２の解像度はＶＧＡの規格に
従う場合、水平方向画素は６４０画素である。したがっ
て、適当な間引き処理を行って水平を６４０画素にする
必要があるが、本実施の形態に係る画像処理装置１０
は、タイミングジェネレータ２０からのクロックを分周
回路２２で３分周して、これを信号処理部２６に加える
ことにより、信号処理部２６への入力段階で画像データ
の画素数を６４０画素に間引いている。
【００２３】この様子を図２に示す。ＣＣＤ１２からの
撮像データはＡ／Ｄコンバータ１６によって駆動クロッ
クと、これに同期したデジタル信号に変換される。動画
表示モードのとき、ＣＰＵ３８はセレクタ２４に指示を
与えて分周回路２２の出力信号（１／３分周クロック）
を信号処理部２６に同期信号として供給させる。Ａ／Ｄ
コンバータ１６からは一水平ライン出力についてＲＧＢ
ＧＲＧＢＧ…という具合に「ＲＧＢＧ」を単位としてこ
れが繰り返される形で出力されている。信号処理部２６
が１／３分周クロックに同期して画像データを取り込む
場合、Ｒ−Ｇ−Ｂ−Ｇ−…という順に画像データを取り
込むことになり、Ａ／Ｄコンバータ１６から出力される
データの画素配列と同じ画素配列によって画像データを
取り込むことができる。こうして、信号処理部２６には
水平６４０画素のデータが入力される。かかる入力デー
タに所定の処理を施した後、液晶モニタ３２に出力する
ことにより、動画表示を行う。なお、ＣＣＤ１２の垂直
方向画素の間引き処理については、信号処理部２６に取
り込んだ後の処理工程において不要データをメモリに格
納しない等の手法により行う。
撮像データはＡ／Ｄコンバータ１６によって駆動クロッ
クと、これに同期したデジタル信号に変換される。動画
表示モードのとき、ＣＰＵ３８はセレクタ２４に指示を
与えて分周回路２２の出力信号（１／３分周クロック）
を信号処理部２６に同期信号として供給させる。Ａ／Ｄ
コンバータ１６からは一水平ライン出力についてＲＧＢ
ＧＲＧＢＧ…という具合に「ＲＧＢＧ」を単位としてこ
れが繰り返される形で出力されている。信号処理部２６
が１／３分周クロックに同期して画像データを取り込む
場合、Ｒ−Ｇ−Ｂ−Ｇ−…という順に画像データを取り
込むことになり、Ａ／Ｄコンバータ１６から出力される
データの画素配列と同じ画素配列によって画像データを
取り込むことができる。こうして、信号処理部２６には
水平６４０画素のデータが入力される。かかる入力デー
タに所定の処理を施した後、液晶モニタ３２に出力する
ことにより、動画表示を行う。なお、ＣＣＤ１２の垂直
方向画素の間引き処理については、信号処理部２６に取
り込んだ後の処理工程において不要データをメモリに格
納しない等の手法により行う。
【００２４】その一方、レリーズボタン等から撮影開始
指示信号が与えられた時には、ＣＰＵ３８はセレクタ２
４に指示を与えて分周しないクロックを信号処理部２６
に供給させる。これにより、間引きのない撮像データが
取り込まれ、高画質の画像を記録装置３４に保存するこ
とができる。本実施の形態に係る画像処理装置１０によ
れば、クロックを分周し、モニタの解像度に合わせて入
力データを間引くようにしたので信号処理部２６におけ
る処理負担が軽減され、信号処理部２６の内蔵メモリや
間引き機能に制限されない動画処理のためのシステムを
構成できる。また、信号処理部２６に入力されるクロッ
ク周波数が小さくなるので、信号処理部２６での消費電
力を低減できる。
指示信号が与えられた時には、ＣＰＵ３８はセレクタ２
４に指示を与えて分周しないクロックを信号処理部２６
に供給させる。これにより、間引きのない撮像データが
取り込まれ、高画質の画像を記録装置３４に保存するこ
とができる。本実施の形態に係る画像処理装置１０によ
れば、クロックを分周し、モニタの解像度に合わせて入
力データを間引くようにしたので信号処理部２６におけ
る処理負担が軽減され、信号処理部２６の内蔵メモリや
間引き機能に制限されない動画処理のためのシステムを
構成できる。また、信号処理部２６に入力されるクロッ
ク周波数が小さくなるので、信号処理部２６での消費電
力を低減できる。
【００２５】上記説明ではＧストライプ配列のＣＣＤ１
２を例に説明したが、これに限らず、ベイヤー配列など
の画素配列を有するＣＣＤのデータについても、水平出
力を奇数分の１に間引くことにより、画素配列を変えず
に間引き処理することができる。図３にはベイヤー配列
のＣＣＤを用いた場合の撮像データの間引き処理の一例
が示されている。ベイヤー配列のＣＣＤを用いる場合に
は、図１で説明した１／３分周の分周回路２２に代え
て、ＣＣＤ１２の駆動パルスを１／５の周波数に分周す
る分周回路を採用することができる。
２を例に説明したが、これに限らず、ベイヤー配列など
の画素配列を有するＣＣＤのデータについても、水平出
力を奇数分の１に間引くことにより、画素配列を変えず
に間引き処理することができる。図３にはベイヤー配列
のＣＣＤを用いた場合の撮像データの間引き処理の一例
が示されている。ベイヤー配列のＣＣＤを用いる場合に
は、図１で説明した１／３分周の分周回路２２に代え
て、ＣＣＤ１２の駆動パルスを１／５の周波数に分周す
る分周回路を採用することができる。
【００２６】そして、動画表示モードのとき、ＣＰＵ３
８はセレクタ２４に指示を与えて分周回路２２の出力信
号（１／５分周クロック）を信号処理部２６に同期信号
として供給させる。ＲＧラインの読み出しの場合、図３
に示すようにＡ／Ｄコンバータ１６からはＲＧＲＧＲＧ
…という具合にＲとＧが交互に繰り返される形で出力さ
れてている。信号処理部２６が１／５分周クロックに同
期して画像データを取り込む場合、Ｒ−Ｇ−Ｒ−Ｇ−…
という順に画像データを取り込むことになり、Ａ／Ｄコ
ンバータ１６から出力されるデータの画素配列と同じ画
素配列によって画像データを取り込むことができる。
８はセレクタ２４に指示を与えて分周回路２２の出力信
号（１／５分周クロック）を信号処理部２６に同期信号
として供給させる。ＲＧラインの読み出しの場合、図３
に示すようにＡ／Ｄコンバータ１６からはＲＧＲＧＲＧ
…という具合にＲとＧが交互に繰り返される形で出力さ
れてている。信号処理部２６が１／５分周クロックに同
期して画像データを取り込む場合、Ｒ−Ｇ−Ｒ−Ｇ−…
という順に画像データを取り込むことになり、Ａ／Ｄコ
ンバータ１６から出力されるデータの画素配列と同じ画
素配列によって画像データを取り込むことができる。
【００２７】また、図には示さないが、ＧＢラインの読
み出しの場合も同様に、Ａ／Ｄコンバータ１６からの出
力はＧＢＧＧＢ…という具合にＧとＢが交互に繰り返さ
れる形となっている。信号処理部２６が１／５分周クロ
ックに同期して画像データを取り込むと、Ｇ−Ｂ−Ｇ−
Ｂ−…という順に画像データを順次取り込むことにな
り、画素配列を変えることなく画素を間引くことができ
る。
み出しの場合も同様に、Ａ／Ｄコンバータ１６からの出
力はＧＢＧＧＢ…という具合にＧとＢが交互に繰り返さ
れる形となっている。信号処理部２６が１／５分周クロ
ックに同期して画像データを取り込むと、Ｇ−Ｂ−Ｇ−
Ｂ−…という順に画像データを順次取り込むことにな
り、画素配列を変えることなく画素を間引くことができ
る。
【００２８】上記説明ではＧストライプ又はベイヤー配
列のＣＣＤを用いて、これら画素配列との関係でタイミ
ングジェネレータ２０から出力されるクロックを１／
３、１／５の周波数に分周して信号処理部２６に入力す
る例を説明したが、分周比は上記値に限定するものでは
ない。Ｇストライプやベイヤー配列など現在広く用いら
れている配列形態の場合、奇数分の１に分周することに
より、画素配列を変えることなくデータを間引くことが
できる。なお、「１」は奇数であるが、１／１は分周す
るという概念に含まれないため、当然に除かれる。
列のＣＣＤを用いて、これら画素配列との関係でタイミ
ングジェネレータ２０から出力されるクロックを１／
３、１／５の周波数に分周して信号処理部２６に入力す
る例を説明したが、分周比は上記値に限定するものでは
ない。Ｇストライプやベイヤー配列など現在広く用いら
れている配列形態の場合、奇数分の１に分周することに
より、画素配列を変えることなくデータを間引くことが
できる。なお、「１」は奇数であるが、１／１は分周す
るという概念に含まれないため、当然に除かれる。
【００２９】また、上記以外のカラーフィルター配列を
有する撮像素子が用いられる場合には、その配列形態と
の関係を考慮して撮像素子から出力される画素配列を変
えることなく、データを間引くことができるようにクロ
ックの分周比を設定すればよく、奇数分の１に分周する
場合のみならず、偶数分の１に分周する態様もありう
る。
有する撮像素子が用いられる場合には、その配列形態と
の関係を考慮して撮像素子から出力される画素配列を変
えることなく、データを間引くことができるようにクロ
ックの分周比を設定すればよく、奇数分の１に分周する
場合のみならず、偶数分の１に分周する態様もありう
る。
【００３０】
【発明の効果】以上説明したように本発明に係る画像処
理装置によれば、撮像素子の駆動クロックを分周してこ
れよりも周波数の低いクロックを生成し、この分周クロ
ックを信号処理部に入力することにより、信号処理部へ
の入力段階で画像データの画素を間引くようにしたの
で、信号処理部の内蔵メモリの容量を削減できるととも
に、消費電力の低減を図ることができる。
理装置によれば、撮像素子の駆動クロックを分周してこ
れよりも周波数の低いクロックを生成し、この分周クロ
ックを信号処理部に入力することにより、信号処理部へ
の入力段階で画像データの画素を間引くようにしたの
で、信号処理部の内蔵メモリの容量を削減できるととも
に、消費電力の低減を図ることができる。
【図１】本発明の実施の形態に係る画像処理装置の構成
を示すブロック図
を示すブロック図
【図２】Ｇストライプ配列のＣＣＤを用いた場合の撮像
データの間引き処理の一例を示すタイミングチャート
データの間引き処理の一例を示すタイミングチャート
【図３】ベイヤー配列のＣＣＤを用いた場合の撮像デー
タの間引き処理の一例を示すタイミングチャート
タの間引き処理の一例を示すタイミングチャート
１０…画像処理装置、１２…ＣＣＤ（撮像素子）、１６
…Ａ／Ｄコンバータ（Ａ／Ｄ変換手段）、１８…ＣＣＤ
駆動回路、２０…タイミングジェネレータ（タイミング
発生手段）、２２…分周回路（分周手段）、２４…セレ
クタ（選択手段）、２６…信号処理部、３２…液晶モニ
タ（表示装置）、３４…記録装置（記録手段）、３８…
ＣＰＵ
…Ａ／Ｄコンバータ（Ａ／Ｄ変換手段）、１８…ＣＣＤ
駆動回路、２０…タイミングジェネレータ（タイミング
発生手段）、２２…分周回路（分周手段）、２４…セレ
クタ（選択手段）、２６…信号処理部、３２…液晶モニ
タ（表示装置）、３４…記録装置（記録手段）、３８…
ＣＰＵ
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 5C022 AA13 AB67 AC03 AC31 AC32 AC42 AC54 AC69 5C024 AA01 BA01 CA24 DA01 DA05 DA07 EA04 FA01 FA11 GA11 HA06 HA07 HA14 HA24 5C065 AA03 BB48 CC01 CC08 CC09 DD02 DD17 EE06 EE12 FF02 GG12 GG18 GG30 GG32 GG33 GG49 GG50
Claims (5)
- 【請求項１】 撮像素子の駆動クロックを分周する分周
手段と、 前記駆動クロックに従って前記撮像素子から出力される
画像信号をデジタルデータに変換するＡ／Ｄ変換手段
と、 前記Ａ／Ｄ変換手段から出力される画像データを前記分
周手段から提供される分周クロックに同期するタイミン
グで取り込み、当該取り込んだ画像データを処理する信
号処理部と、 を備えたことを特徴とする画像処理装置。 - 【請求項２】 前記撮像素子としてＧストライプ又はベ
イヤー配列の画素配列を有するＣＣＤ固体撮像素子が用
いられていることを特徴とする請求項１記載の画像処理
装置。 - 【請求項３】 前記分周手段は、前記駆動クロックの周
波数を奇数分の１に分周するものであることを特徴とす
る請求項１又は２記載の画像処理装置。 - 【請求項４】 前記信号処理部から出力される画像デー
タに基づいて画像を表示する表示装置を備えたことを特
徴とする請求項１記載の画像処理装置。 - 【請求項５】 撮像素子と、 前記撮像素子を駆動するための駆動クロックを発生させ
るタイミング発生手段と、 前記駆動クロックを分周する分周手段と、 前記駆動クロックに従って前記撮像素子から出力される
画像信号をデジタルデータに変換するＡ／Ｄ変換手段
と、 前記Ａ／Ｄ変換手段から出力される画像データを前記駆
動クロック又は前記分周手段から提供される分周クロッ
クに同期するタイミングで取り込み、当該取り込んだ画
像データを処理する信号処理部と、 前記駆動クロック又は前記分周手段から出力される分周
クロックの何れか一方を選択的に前記信号処理部に加え
ることができる選択手段と、 前記分周クロックに同期するタイミングで前記信号処理
部に入力され該信号処理部において処理された画像デー
タに基づいて画像を表示する表示装置と、 撮影開始指示信号の受入に呼応して前記撮像素子から読
み出され、前記駆動クロックに同期するタイミングで前
記信号処理部に入力され該信号処理部において処理され
た画像データを記録する記録手段と、 を備えたことを特徴とする画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02211599A JP4616429B2 (ja) | 1999-01-29 | 1999-01-29 | 画像処理装置 |
| US09/492,787 US6867803B1 (en) | 1999-01-29 | 2000-01-28 | Image processing unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP02211599A JP4616429B2 (ja) | 1999-01-29 | 1999-01-29 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2000224604A true JP2000224604A (ja) | 2000-08-11 |
| JP4616429B2 JP4616429B2 (ja) | 2011-01-19 |
Family
ID=12073898
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP02211599A Expired - Fee Related JP4616429B2 (ja) | 1999-01-29 | 1999-01-29 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6867803B1 (ja) |
| JP (1) | JP4616429B2 (ja) |
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| EP1526719A2 (en) | 2003-10-23 | 2005-04-27 | Nokia Corporation | Camera output format for real time viewfinder/video image |
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| US5206730A (en) * | 1989-11-10 | 1993-04-27 | Konica Corporation | Still video camera having one-shot and serial shot modes |
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| JP3740235B2 (ja) * | 1996-12-20 | 2006-02-01 | キヤノン株式会社 | 撮像装置及び撮像記録再生装置 |
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-
1999
- 1999-01-29 JP JP02211599A patent/JP4616429B2/ja not_active Expired - Fee Related
-
2000
- 2000-01-28 US US09/492,787 patent/US6867803B1/en not_active Expired - Lifetime
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