JP2000307357A - プリアンプ回路 - Google Patents
プリアンプ回路Info
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- H03—ELECTRONIC CIRCUITRY
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Abstract
号に対して、1つの信号経路のみで対処できるプリアン
プ回路を提供することを目的とする。 【解決手段】 非反転入力端子が音声入力端子に接続さ
れた演算増幅器、演算増幅器の出力端子と演算増幅器の
反転入力端子との間に接続された第1抵抗ならびに、演
算増幅器の反転入力端子と接地との間に直列に接続され
た第2抵抗およびスイッチング素子を有する負帰還回
路、小信号入力モードと大信号入力モードとを切り替え
るための操作スイッチ、ならびに操作スイッチが大信号
入力モードに切り替えられている場合にスイッチング素
子をオフ状態とさせて演算増幅器をバッファ回路として
動作させ、操作スイッチが小信号入力モードに切り替え
られている場合にスイッチング素子をオン状態とさせて
演算増幅器を増幅回路として動作させるオンオフ制御回
路を備えている。
Description
のプリアンプ回路に関する。
ルの低い音声信号と、外部音声入力端子から入力される
信号レベルの高い音声信号とを記録媒体に記録する録音
機能、これらの入力音声信号を再生出力させるモニタ機
能等を備えたオーディオ機器が知られている。
られた従来のプリアンプ回路を示している。
第1スイッチ102、バッファ103、アンプ104、
第2スイッチ105ならびに両スイッチ102、105
を制御するためのスライドスイッチ106を備えてい
る。音声入力端子101には、マイクロフォンからの信
号レベルの低い音声信号または外部音声入力端子からの
信号レベルの高い音声信号が入力される。
からの信号レベルの高い音声信号が入力される場合に
は、図3に示すように、スライドスイッチ106は接点
106bと接点106cとを短絡させるような位置(大
信号側位置)に設定され、第1スイッチ102および第
2スイッチ105の接触子は、接点102a、105a
側に接続される。したがって、音声入力端子101に入
力された信号レベルの高い音声信号は、バッファ103
を介して出力される。
らの信号レベルの低い音声信号が入力される場合には、
スライドスイッチ106は接点106bと接点106a
とを短絡させるような位置(小信号側位置)に設定さ
れ、第1スイッチ102および第2スイッチ105の接
触子は、接点102b、105b側に接続される。した
がって、音声入力端子101に入力された出力レベルの
低い音声信号は、アンプ104によって増幅されて、出
力される。
3を含む信号経路と、アンプ104を含む信号経路と
の、2つの信号経路が必要であるという問題がある。ま
た、スライドスイッチ106が小信号側位置に切り替え
られている場合に、信号レベルの高い音声信号が入力さ
れると、アンプ104がハードグリップ状態となり、電
源ラインが大きく振られ、ノイズが出力されるという問
題がある。
ルの異なる入力音声信号に対して、1つの信号経路のみ
で対処できるプリアンプ回路を提供することを目的とす
る。
力音声信号に対して、1つの信号経路のみで対処できる
とともに、ノイズの低減化が図れるプリアンプ回路を提
供することを目的とする。
リアンプ回路は、非反転入力端子が音声入力端子に接続
された演算増幅器、演算増幅器の出力端子と演算増幅器
の反転入力端子との間に接続された第1抵抗ならびに、
演算増幅器の反転入力端子と接地との間に直列に接続さ
れた第2抵抗およびスイッチング素子を有する負帰還回
路、小信号入力モードと大信号入力モードとを切り替え
るための操作スイッチ、ならびに操作スイッチが大信号
入力モードに切り替えられている場合にスイッチング素
子をオフ状態とさせて演算増幅器をバッファ回路として
動作させ、操作スイッチが小信号入力モードに切り替え
られている場合にスイッチング素子をオン状態とさせて
演算増幅器を増幅回路として動作させるオンオフ制御回
路を備えていることを特徴とする。
レベル以上となった場合に、スイッチング素子をオフ状
態にさせるためのノイズ発生防止回路を設けることが好
ましい。
演算増幅器の出力電圧を分圧する分圧回路、分圧回路の
出力を整流する整流回路および整流回路の出力電圧が所
定値以上である場合に、スイッチング素子をオフ状態と
させる制御素子からなるものが用いられる。
非反転入力端子が音声入力端子に接続された演算増幅
器、演算増幅器の出力端子と演算増幅器の反転入力端子
との間に接続された第1抵抗ならびに、演算増幅器の反
転入力端子と接地との間に直列に接続された第2抵抗お
よびスイッチング素子を有する負帰還回路、常時は、ス
イッチング素子をオン状態とさせて演算増幅器を増幅回
路として動作させるための駆動回路、ならびに演算増幅
器の出力信号の信号レベルが所定レベル以上となった場
合に、スイッチング素子をオフ状態にさせて演算増幅器
をバッファ回路として動作させるためのオンオフ制御回
路を備えていることを特徴とする。
算増幅器の出力電圧を分圧する分圧回路、分圧回路の出
力を整流する整流回路および整流回路の出力電圧が所定
値以上である場合に、スイッチング素子をオフ状態とさ
せる制御素子からなるものが用いられる。
形態について説明する。
る。
プ:operation amplifier)2の非反転入力端子に接続さ
れている。演算増幅器2の出力端子は、抵抗3を介して
演算増幅器2の反転入力端子に接続されている。演算増
幅器2の反転入力端子は、第2抵抗4およびスイッチン
グトランジスタ5を介して接地されている。つまり、演
算増幅器2には、抵抗3、抵抗4および第1のスイッチ
ングトランジスタ5からなる負帰還回路によって負帰還
がかけられている。
入力される音声信号の信号レベルに応じて、演算増幅器
2を非反転増幅回路として動作させるか、バッファ回路
として動作させるかを切り替えるものである。スライド
スイッチ6の接点6aは、直流電源に接続されている。
スライドスイッチ6の接点6cは、接地されている。ス
ライドスイッチ6の接点6bは、抵抗7および抵抗8か
らなる分圧回路を介して接地されている。
イッチングトランジスタ5のベースに接続されていると
ともに、第2のスイッチングトランジスタ9を介して接
地されている。第2のスイッチングトランジスタ9のベ
ースには、演算増幅器2の出力が分圧回路10、整流回
路20および抵抗30を介して送られる。分圧回路10
は、抵抗11および抵抗12から構成されている。整流
回路20は、ダイオード21、ダイオード22およびコ
ンデンサ23から構成されている。
の信号レベルの高い音声信号が入力される場合(大信号
入力モード時)には、スライドスイッチ6は図1に示す
ように接点6bと接点6cとを短絡させるような位置
(大信号側位置)に設定される。この結果、第1のスイ
ッチングトランジスタ5がオフ状態となるので、演算増
幅器2はバッファ回路として動作する。したがって、音
声入力端子1に入力された音声信号は、演算増幅器2お
よび抵抗3からなるバッファ回路を介して出力される。
信号レベルの低い音声信号が入力される場合(小信号入
力モード時)には、スライドスイッチ6は接点6bと接
点6aとを短絡させるような位置(小信号側位置)に設
定される。この結果、第1のスイッチングトランジスタ
5がオン状態となるので、演算増幅器2は非反転増幅回
路として動作する。したがって、音声入力端子1に入力
された音声信号は、演算増幅器2、抵抗3、抵抗4およ
び第1のスイッチングトランジスタ5からなる非反転増
幅回路を介して出力される。つまり、音声入力端子1に
入力された音声信号は、増幅されて出力される。
って分圧された後、整流回路20によって整流される。
整流回路20から出力される直流電圧は、抵抗30を介
して第2のスイッチングトランジスタ9のベースに印加
される。したがって、スライドスイッチ6が小信号側位
置に切り替えられている場合において、音声入力端子1
に信号レベルの高い音声信号が入力されたときには、第
2のスイッチングトランジスタ9がオンとなり、第1の
スイッチングトランジスタ5がオフとされるので、演算
増幅器2はバッファ回路として動作するようになる。
位置に切り替えられている場合において、音声入力端子
1に信号レベルの高い音声信号が入力されたときに、演
算増幅器2、抵抗3、抵抗4および第1のスイッチング
トランジスタ5からなる非反転増幅回路がハードグリッ
プ状態になるのが回避され、ノイズの発生が防止され
る。
がオンとなっている場合において、音声入力端子1に入
力している音声信号の信号レベルが低くなると、第2の
スイッチングトランジスタ9がオフとなり、第1のスイ
ッチングトランジスタ5がオンとなるので、演算増幅器
2は再び非反転増幅回路として動作するようになる。
なる入力音声信号に対して、1つの信号経路のみで対処
できるとともに、ノイズの低減化が図れるようになる。
いる。図2において、図1と同じものには、同じ符号を
付してその説明を省略する。
ンプ回路におけるスライドスイッチ6が設けられていな
い。そして、抵抗7および抵抗8からなる分圧回路に、
直流電源が常に接続されている。したがって、このプリ
アンプ回路の動作は、図1のプリアンプ回路においてス
ライドスイッチ6が小信号側位置に切り替えられている
場合の動作と同じになる。
幅回路として動作する。そして、演算増幅器2の出力レ
ベルが所定レベル以上になると、演算増幅器2はバッフ
ァ回路として動作するようになる。したがって、スライ
ドスイッチ6が設けられていなくても、音声入力端子1
に外部音声入力端子からの信号レベルの高い音声信号が
入力された場合に演算増幅器2をバッファ回路として動
作させることができるようになる。
入力音声信号に対して、1つの信号経路のみで対処でき
るようになる。
なる入力音声信号に対して、1つの信号経路のみで対処
できるとともに、ノイズの低減化が図れるようになる。
る。
る。
である。
Claims (5)
- 【請求項1】 非反転入力端子が音声入力端子に接続さ
れた演算増幅器、演算増幅器の出力端子と演算増幅器の
反転入力端子との間に接続された第1抵抗ならびに、演
算増幅器の反転入力端子と接地との間に直列に接続され
た第2抵抗およびスイッチング素子を有する負帰還回
路、 小信号入力モードと大信号入力モードとを切り替えるた
めの操作スイッチ、ならびに操作スイッチが大信号入力
モードに切り替えられている場合にスイッチング素子を
オフ状態とさせて演算増幅器をバッファ回路として動作
させ、操作スイッチが小信号入力モードに切り替えられ
ている場合にスイッチング素子をオン状態とさせて演算
増幅器を増幅回路として動作させるオンオフ制御回路、 を備えているプリアンプ回路。 - 【請求項2】 演算増幅器の出力信号の信号レベルが所
定レベル以上となった場合に、スイッチング素子をオフ
状態にさせるためのノイズ発生防止回路を備えている請
求項1に記載のプリアンプ回路。 - 【請求項3】 ノイズ発生防止回路は、演算増幅器の出
力電圧を分圧する分圧回路、分圧回路の出力を整流する
整流回路および整流回路の出力電圧が所定値以上である
場合に、スイッチング素子をオフ状態とさせる制御素子
を備えている請求項2に記載のプリアンプ回路。 - 【請求項4】 非反転入力端子が音声入力端子に接続さ
れた演算増幅器、 演算増幅器の出力端子と演算増幅器の反転入力端子との
間に接続された第1抵抗ならびに、演算増幅器の反転入
力端子と接地との間に直列に接続された第2抵抗および
スイッチング素子を有する負帰還回路、 常時は、スイッチング素子をオン状態とさせて演算増幅
器を増幅回路として動作させるための駆動回路、ならび
に演算増幅器の出力信号の信号レベルが所定レベル以上
となった場合に、スイッチング素子をオフ状態にさせて
演算増幅器をバッファ回路として動作させるためのオン
オフ制御回路、 を備えているプリアンプ回路。 - 【請求項5】 オンオフ制御回路は、演算増幅器の出力
電圧を分圧する分圧回路、分圧回路の出力を整流する整
流回路および整流回路の出力電圧が所定値以上である場
合に、スイッチング素子をオフ状態とさせる制御素子を
備えている請求項4に記載のプリアンプ回路。
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