JP2000323454A - 基板の異方性エッチング方法 - Google Patents

基板の異方性エッチング方法

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Abstract

(57)【要約】 【課題】 マスクを通して横方向に規定されたくぼみ構
造を与えるためにプラズマを使用する、シリコンのプラ
ズマエッチング方法を提供する。 【解決手段】 この方法は、一方できわめて大きいエッ
チング速度とマスクに関連する高い選択性とを達成しな
がら、プラズマのパラメータ変化に基づいて、よく制御
された異方性エッチングを生じる。混合ガスは、チャン
バが排気されたのち真空チャンバに導入され、プラズマ
がチャンバ内に発生する。基板の表面はプラズマに晒さ
れる。電源は、プラズマ放電のために用いられる。統合
制御システムが、プラズマ放電電力および基板のバイア
ス電圧のレベル調整のために用いられる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、エッチング速度お
よび選択性が増加される、好ましくはエッチングマスク
で規定された基板の異方性プラズマエッチング方法に関
する。この方法は、超小型電気機械システム(micr
o−electromechanicalsyste
m、MEMS)ならびに超小型電子装置の製造のために
適切に実施することができる。
【0002】
【従来の技術】特に単結晶シリコンに対する異方性プラ
ズマエッチングは、基板の結晶方位あるいはドーピング
のレベルの影響を受けずに加工することが可能である。
また、この方法は、ドープされた、あるいはドープされ
ていないポリシリコンに適用される。好ましい応用分野
は、構造が高いアスペクト比をもつ、すなわち高い構造
上の高さ対幅の比をもつ、MEMSの技術である。その
他の例には、アクチュエータ、表面波フィルタ、遅延線
等を製造するために、狭い溝と垂直な壁がエッチングさ
れる表面波技術がある。その他の超小型電子技術の応用
には、記憶セル、絶縁物、コレクタの接点等がある。
【0003】通常、異方性シリコンエッチングに用いら
れる反応性イオンエッチング(RIE)法は、比較的高
いエネルギーのイオン(100eV以上)およびフッ
素、塩素、あるいは臭素などの反応性ハロゲンを使用
し、それらは、直接プラズマで用いられるか、あるいは
CF、CFBr、C、CCl、CHCl
などの対応する化合物から放出される。その結果得られ
るエッチング場所、すなわちエッチングされる領域のイ
オン衝撃が、消耗されるべきシリコンとラジカルとの反
応を開始させる。側壁のエッチングは、イオンの指向性
により最小限となる。
【0004】問題は、シリコン除去速度(すなわちエッ
チング速度)を増すために、プラズマ放電と結び付けら
れる電力を増加することにより、プラズマ密度を高めよ
うとした場合に起こる。これはプラズマ放電用の電源の
電力を増すか、あるいは基板に印加されるバイアス電圧
の値を増すことにより、達成することができる。しかし
ながら電力を増すと、生成されるイオンはより高温にな
り、またイオンの動く方向はよりランダムになる。その
結果、より多くのイオンおよびラジカルが、トレンチの
壁によって消耗され、これはエッチング異方性の避ける
ことのできない損失を伴うことになる。この問題を克服
するためには、エッチング速度を下げねばならず、その
結果処理量は低下する。
【0005】遭遇するその他の問題は、マスクの劣化で
ある。エッチング速度が低下すると、エッチング時間、
したがってマスクの露出時間が増加し、より急速なマス
クの劣化、すなわち選択性の低下につながる。
【0006】米国特許第5,501,893号には、エ
ッチングと重合の交互するステップを含むエッチング方
法が開示されている。この重合ステップの目的は、その
前のエッチングステップで露出した表面にポリマー層を
与え、一時的なエッチングストップを形成する。したが
って、側壁はエッチングステップ中にエッチングから保
護される。しかしながら、それぞれエッチングおよび重
合ステップ中で異なるガス混合物が反復されるように、
エッチングおよび重合のステップ中で導入されるガス混
合物は、異なっている。エッチングステップでは、ガス
混合物はSFおよびArを含み、重合ステップでは、
ガス混合物はCHFおよびArを含む。
【0007】異なるガスを反復させることに伴う問題
は、エッチング/堆積サイクルの時間比が、ガス混合物
の速度に依存し、逐次変化して一様性に影響を及ぼす。
また、種がエッチングされたトレンチの底に達する時間
は、トレンチが異なるサイズの開口部をもつと著しく変
化する。また、この方法は、一般により複雑な装置を必
要とし、サイクルの中に2つの異なるガス混合物を導入
するように制御する。
【0008】ポリマーを生成する不飽和モノマーと、フ
ッ素、臭素、あるいはヨウ素のラジカルとを共存させ
て、プラズマをできるだけ冷却させることが望ましい。
イオン化にとって十分なエネルギーレベルは、個々のガ
スに対して異なる。場合によっては、ポリマー生成ガス
(C、CHF)に対する活性化エネルギーは、
ラジカル生成ガス(SF)に対するものより2倍大き
い。
【0009】
【発明が解決しようとする課題】本発明の目的は、エッ
チングおよびパッシベートの両者に対する最適条件に到
達するために、反応性ガスの活性化エネルギーの違いを
用いることにより、また高アスペクト比および高選択性
のエッチング方法を生じさせるために、速い速度でこれ
らの条件を交互させることにより、エッチングすべきシ
リコン表面の処理を高める方法を確立することである。
【0010】
【課題を解決するための手段】本発明の目的は、下記ス
テップを含む、基板(一般にはシリコン)の異方性プラ
ズマエッチング方法を提供することにより達成され、そ
のステップは、 a)電磁石電源に接続された電極上に、選択的にエッチ
ングすべき表面を有する基板を置くステップと、 b)エッチングガス(SF)およびパッシベートガス
(CHF、C等)からなる混合ガスを、処理チ
ャンバ中に導入するステップと、 c)混合ガスを、エッチング用のイオンおよびラジカル
を含むプラズマを生成するのに十分な、より低い電力
(100〜800W)の電磁放射で励起させるステップ
と、 d)ステップc)と同時に、電磁石電源を介して基板に
高いバイアス電圧(50〜500eV)を印加し、きわ
めて高い異方性エッチングを生じるステップと、 e)プラズマ中に不飽和モノマーを生成させ、保護用ポ
リマーコーティングを形成するために、高電力(100
0〜3000W)の電磁放射で混合ガスを励起するステ
ップと、 f)ステップe)と同時に、基板に低いバイアス電圧
(0〜25eV)を印加し、エッチングすべき表面の露
出した側壁上に絶縁保護ポリマーコーティングを形成す
るステップと、 ステップc)およびd)と、ステップe)およびf)と
を交互させ、現在他の方法を用いて行われているものよ
りも、高いエッチング速度および選択性で異方性エッチ
ングを行うステップとを含む。
【0011】本発明で用いた方法は、冷却媒体としてヘ
リウムガスを用いることなく、基板をエッチングするこ
とを可能にする。これは、より低い電力が、エッチング
ガスの励起に用いられ、工程中に発生する熱をより少な
くすることになるためである。
【0012】さらに本発明の利点は、工程中に、混合ガ
スの一定の流れが処理チャンバ中に注入され、その結
果、より安定かつ再現性のある工程になることである。
【0013】以下、本発明について添付の図面と関連し
て詳細に説明する。
【0014】
【発明の実施の形態】以下は、図1および図2aから図
2cに関連する本発明の詳細な説明である。図1を参照
すると、装置は、エッチングチャンバ10を含む。基板
14を保持する基板ホルダ12、およびチャンバ10の
上部近くに設けられた誘導カプラ16が、チャンバ10
の中に設けられる。基板ホルダ12は、基板14のバイ
アス用発振器18と電気的に接続された電極であり、発
振器は、電源19および整合回路網21を含む。処理ガ
スをチャンバに導入するため、注入口の管路20が、チ
ャンバの上部に位置している。処理ガスは、ガス容器2
2、24、および26の中に貯蔵される。チャンバ10
への処理ガスの流量は、制御バルブ28により制御され
る。プラズマ誘導は、RF電源30および結合される整
合回路網32により電力を供給された誘導カプラ16に
より生じる。チャンバ10中の圧力は、機械式ポンプ3
4、ターボ分子ポンプ36、およびスロットルバルブ3
8により、従来の方法で制御される。もちろん本発明
は、この特定の装置に限定されるものではない。
【0015】次に図2a〜図2cと関連して、基板のエ
ッチング方法を説明する。シリコン基板40、および異
方性のエッチングを施そうとしているシリコン基板40
の領域を露出するエッチングマスク42を含む基板14
を、基板ホルダ/電極12上に置き、第1エッチングス
テップにかける。このステップにおいては、好ましくは
100から400sccmの範囲の一定流量、および
0.1から10Paの範囲の圧力をもち、エッチングガ
スとパッシベートガス(例えばSF、C、およ
びCHF)とを含んでいる混合ガスを、チャンバ10
に導入する。プラズマは、好ましくは100から800
Wの範囲の比較的低いRF電力を、電源30から印加す
ることにより誘導される。同時に、50から500e
V、好ましくは80から300eVの範囲の比較的高い
値の電場を生じさせるために、バイアス電圧が、基板の
発振器18により与えられる。プラズマ誘導のために印
加した低いRF電力が、非常に高いレートを有する指向
性エッチングを与える。特にプラズマは、イオンの指向
性の制御が可能なように印加された低いエネルギーによ
り、「低温」である。また、基板14の高電位は、エッ
チングされる表面に向かってイオンを強く加速する。両
方の要因が、イオンの優れた指向性を生じ、結果として
高い異方性エッチングを生じる。図2aに、シリコン基
板40のエッチングされた部分44を示す。
【0016】一定時間、例えば10〜100秒後、プラ
ズマの高エネルギー励起状態を作り出すために、電源3
0を比較的高い電力、好ましくは1000から3000
Wの範囲に切り替え、また基板の発振器により発生した
バイアス電位を、比較的低い、あるいはほぼゼロの値
(すなわち0〜25eV)に下げる。プラズマの高エネ
ルギー励起は、ポリマー層46の形成に帰着する条件を
作り出す。さらに、種の等方性運動は、図2bに示すよ
うに、トレンチの底のポリマー層46の厚さを側壁上の
厚さと同じにする。この間、基板14上の低いバイアス
により、いかなるエッチングも妨げられる。一定時間、
例えば0.5〜3秒後、図2bに示すように、所定の厚
さの保護ポリマー層46が、トレンチの壁上に形成され
る。この保護ポリマー層46は、上記で論じられた方法
で行うこれに続くエッチングステップ中、その前のエッ
チングステップで形成されたトレンチの壁が浸食される
のを妨げる。
【0017】特に、次のエッチングステップ中、その前
にエッチングされた側壁は、ポリマー層46により保護
されたままであり、一方トレンチの底のポリマー層は、
図2cの参照符号48で識別されるように、高いバイア
ス電位により加速される異方性のイオン衝撃により急速
に剥ぎ取られ、トレンチの基部でシリコンがさらにエッ
チングされることを可能にする。エッチングおよびパッ
シベートステップは、トレンチが所望の深さに達するま
で交互に繰り返される。
【0018】上記で論じた従来の方法と比べた場合、こ
の方法にはいくつかの利点がある。具体的には、本発明
により一定のガス混合物を連続的に導入する結果、種は
より均一に分布することになる。これは基板の全体にわ
たって、より優れた一様性を与える。これとは対照的
に、ガスが反復される従来の場合、エッチング/堆積サ
イクルの時間比が、ガスの速度に依存し、逐次変化して
一様性に影響を及ぼす。
【0019】さらに、反復されるガス法を用いる場合、
種がエッチングされたトレンチの底に到着する時間は、
異なるサイズの開口部をもつトレンチに対しては著しく
異なる。これは、異なるアスペクト比をもつトレンチに
対し、達成される深さのばらつきを増加させる(Asp
ect Ratio Dependent Etch
(アスペクト比依存性エッチング))。ガス混合物が一
定な本方法の場合には、ガス組成は、異なるサイズの開
口部をもつトレンチに対して均一であることになる。こ
れはまた、一様性を改善する(マイクロローディング効
果)。
【0020】さらに、本発明の方法は、エッチングの間
に用いられる低い電力と、堆積の間に用いられる低いバ
イアス電圧の組合せにより、マスク材料に対してきわめ
て高い選択性を提供する。
【0021】本発明の精神から逸脱することなく多くの
変更を行うことができるので、前記の説明に含まれ、ま
た添付の図面に示された全ての事柄は、例示であって限
定するものではないと解されることを意図している。例
えば、本発明は、上記で論じたエッチングガスおよびパ
ッシベートガスのリストには限定されない。その他のシ
リコンエッチングガスには、CF、NF、NF
F、HBr、CCl、CFCl、CFCl、B
、Cl、I、HCl、ClF、およびBCl
がある。また、その他のパッシベートガスには、CH
、CH、H、C、C、CH
r、C、C、およびC がある。
【0022】これに加えて、エッチングおよびパッシベ
ートの作用を、チャンバ内の圧力を交互させることによ
って達成してもよい。特に、パッシベートの間のポリマ
ーの形成は、圧力により生じる。圧力が高いほどポリマ
ーの形成は激しく、したがってパッシベートの程度は大
きい。対照的に、圧力が低いほどポリマーの形成は弱
く、したがってパッシベートの程度は小さい。同様に、
エッチングの間の圧力の増加は、エッチングレートを増
大し、一方圧力の減少は、エッチング速度を低下させ
る。
【図面の簡単な説明】
【図1】本発明に用いるエッチング装置を示す概略図で
ある。
【図2a】本発明の方法ステップを示す図である。
【図2b】本発明の方法ステップを示す図である。
【図2c】本発明の方法ステップを示す図である。
【符号の説明】
10 チャンバ 12 基板ホルダ 14 シリコン基板 16 誘導カプラ 18 発振器 20 管路 22、24、26 ガス容器 28 制御バルブ 30 RF電源 42 マスク 44 エッチングされた部分 46 保護ポリマー層
フロントページの続き (72)発明者 ケビン・ユイ アメリカ合衆国、カリフオルニア・95132、 サン・ホウゼイ、トラフアルガー・プレイ ス・3479 (72)発明者 マイケル・フエルドボーム アメリカ合衆国、カリフオルニア・94538、 フリーモント、モウリー・アベニユー・ 4875、ナンバー・110 (72)発明者 ミシエル・ピユーク フランス国、74009・アネシー・セデツク ス、アブニユ・ドウ・ブログミー・98、ボ ワツト・ポスタル・69

Claims (14)

    【特許請求の範囲】
  1. 【請求項1】 シリコン基板をエッチングするための異
    方性エッチング方法であって、 エッチングガスとパッシベートガスとを含んでいる混合
    ガスを、エッチングすべきシリコン基板を備えるチャン
    バ中に導入する導入ステップと、 第1の時間期間中、前記基板の表面から材料を除去し、
    それにより露出した表面を得るように、励起電力および
    基板バイアスを制御することにより、前記混合ガスの存
    在下で前記基板をエッチングするエッチングステップ
    と、 第2の時間期間中、前記露出した表面をポリマー層で被
    覆するように、励起電力および基板バイアスを制御する
    ことにより、前記混合ガスの存在下で前記基板をパッシ
    ベートするパッシベートステップであって、前記エッチ
    ングステップ中およびパッシベートステップ中、前記混
    合ガスが同じであるパッシベートステップと、 前記エッチングステップを繰り返すステップとを含むエ
    ッチング方法。
  2. 【請求項2】 さらに、前記パッシベートステップを繰
    り返すステップを含む、請求項1に記載のエッチング方
    法。
  3. 【請求項3】 前記エッチングステップが、前記チャン
    バ中に配置された誘導カプラに100から800Wの範
    囲のRF電力を印加するステップと、前記基板に電圧を
    印加して、50から300eVの範囲の基板バイアスを
    生じさせるステップとを含む、請求項1に記載のエッチ
    ング方法。
  4. 【請求項4】 前記パッシベートステップが、前記チャ
    ンバ中に配置された誘導カプラに1000から3000
    Wの範囲のRF電力を印加するステップと、前記基板に
    電圧を印加して、0から25eVの範囲の基板バイアス
    を生じさせるステップとを含む、請求項3に記載のエッ
    チング方法。
  5. 【請求項5】 前記エッチングステップを、10〜10
    0秒行う、請求項3に記載のエッチング方法。
  6. 【請求項6】 前記エッチングステップを、10〜10
    0秒行う、請求項4に記載のエッチング方法。
  7. 【請求項7】 前記パッシベートステップを、0.5〜
    3秒行う、請求項4に記載のエッチング方法。
  8. 【請求項8】 前記パッシベートステップを、0.5〜
    3秒行う、請求項5に記載のエッチング方法。
  9. 【請求項9】 前記導入ステップが、チャンバ中にSF
    、C、およびCHFを導入するステップを含
    む、請求項1に記載のエッチング方法。
  10. 【請求項10】 前記チャンバ中のガス圧力が、0.1
    から10Paの範囲にある、請求項1に記載のエッチン
    グ方法。
  11. 【請求項11】 さらに、前記チャンバ中の圧力を変化
    させるステップを含む、請求項1に記載のエッチング方
    法。
  12. 【請求項12】 前記導入ステップ中、前記混合ガス
    が、前記エッチングステップ中および前記パッシベート
    ステップ中に一定の流量で導入される、請求項1に記載
    のエッチング方法。
  13. 【請求項13】 エッチングステップ中の前記励起電力
    が、前記パッシベートステップ中の励起電力より低い、
    請求項1に記載のエッチング方法。
  14. 【請求項14】 前記エッチングステップ中の前記基板
    バイアスが、前記パッシベートステップ中の前記基板バ
    イアスより低い、請求項1に記載のエッチング方法。
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Cited By (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2004086478A1 (ja) * 2003-03-25 2004-10-07 Sumitomo Precision Products Co., Ltd. シリコン基板のエッチング方法及びエッチング装置
JP2005086079A (ja) * 2003-09-10 2005-03-31 Denso Corp 半導体装置の製造方法
JP2006503425A (ja) * 2002-10-14 2006-01-26 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 基板に構造を異方性エッチングするためのプラズマ装置及び方法
JP2006191043A (ja) * 2005-01-03 2006-07-20 Alcatel 半導体基板をプラズマエッチングしてマスクを作るための装置
JP2009500836A (ja) * 2005-07-06 2009-01-08 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング ウエハのスタックのエッチングを行うための反応装置
JP2012084872A (ja) * 2010-09-15 2012-04-26 Tokyo Electron Ltd プラズマエッチング処理装置、プラズマエッチング処理方法、および半導体素子製造方法
JP2015032597A (ja) * 2013-07-31 2015-02-16 日本ゼオン株式会社 プラズマエッチング方法
KR20170054280A (ko) * 2015-11-04 2017-05-17 램 리써치 코포레이션 플라즈마 전력 레벨에 반응하는 2-모드 프로세스 가스 조성을 사용하는 플라즈마 에칭을 위한 방법들 및 시스템들
KR20180051663A (ko) * 2015-10-02 2018-05-16 어플라이드 머티어리얼스, 인코포레이티드 원자 레벨 레졸루션 및 플라즈마 프로세싱 제어를 위한 방법들
KR20190040313A (ko) * 2016-09-06 2019-04-17 도쿄엘렉트론가부시키가이샤 유사 원자층 에칭 방법
WO2022085424A1 (ja) * 2020-10-19 2022-04-28 東京エレクトロン株式会社 基板処理方法および基板処理装置
JP2022067033A (ja) * 2020-10-19 2022-05-02 東京エレクトロン株式会社 基板処理方法および基板処理装置

Families Citing this family (26)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20050158666A1 (en) * 1999-10-15 2005-07-21 Taiwan Semiconductor Manufacturing Company, Ltd. Lateral etch inhibited multiple etch method for etching material etchable with oxygen containing plasma
US6921723B1 (en) * 2002-04-23 2005-07-26 Applied Materials, Inc. Etching method having high silicon-to-photoresist selectivity
US20040077178A1 (en) * 2002-10-17 2004-04-22 Applied Materials, Inc. Method for laterally etching a semiconductor structure
US20050029226A1 (en) * 2003-08-07 2005-02-10 Advanced Power Technology, Inc. Plasma etching using dibromomethane addition
DE10345402B4 (de) * 2003-09-30 2005-10-13 Infineon Technologies Ag Verfahren zur Bearbeitung einer Halbleiterstruktur mit einer Vertiefung
WO2006003962A1 (ja) * 2004-07-02 2006-01-12 Ulvac, Inc. エッチング方法及び装置
US7183215B2 (en) * 2004-07-21 2007-02-27 Hewlett-Packard Development Company, L.P. Etching with electrostatically attracted ions
US20060168794A1 (en) * 2005-01-28 2006-08-03 Hitachi Global Storage Technologies Method to control mask profile for read sensor definition
WO2007031778A1 (en) * 2005-09-16 2007-03-22 Aviza Technology Limited A method of etching a feature in a silicone substrate
US8071481B2 (en) 2009-04-23 2011-12-06 Taiwan Semiconductor Manufacturing Co., Ltd. Method for forming highly strained source/drain trenches
US8901004B2 (en) * 2009-07-27 2014-12-02 Lam Research Corporation Plasma etch method to reduce micro-loading
JP5537324B2 (ja) * 2010-08-05 2014-07-02 株式会社東芝 半導体装置の製造方法
US9318341B2 (en) * 2010-12-20 2016-04-19 Applied Materials, Inc. Methods for etching a substrate
KR101251072B1 (ko) * 2011-07-12 2013-04-12 에이피티씨 주식회사 반도체소자의 식각방법
CN103159163B (zh) * 2011-12-19 2016-06-08 北京北方微电子基地设备工艺研究中心有限责任公司 基片刻蚀方法及基片处理设备
CN104134611B (zh) * 2013-05-03 2017-09-29 无锡华润上华半导体有限公司 硅释放工艺
KR102170856B1 (ko) 2014-02-19 2020-10-29 삼성전자주식회사 반도체 장치 및 그 제조 방법
CN106653594B (zh) * 2015-10-30 2019-05-28 中微半导体设备(上海)股份有限公司 一种在高宽比硅刻蚀中用于提高侧壁刻蚀效果的方法
US9607847B1 (en) * 2015-12-18 2017-03-28 Texas Instruments Incorporated Enhanced lateral cavity etch
US9941121B1 (en) 2017-01-24 2018-04-10 International Business Machines Corporation Selective dry etch for directed self assembly of block copolymers
EP3794157B1 (en) * 2018-05-17 2022-03-16 Evatec AG Method of treating a substrate and vacuum deposition apparatus
US11393703B2 (en) * 2018-06-18 2022-07-19 Applied Materials, Inc. Apparatus and method for controlling a flow process material to a deposition chamber
JP7621145B2 (ja) * 2021-03-15 2025-01-24 東京エレクトロン株式会社 基板処理方法および基板処理装置
CN117080062B (zh) * 2023-10-13 2024-01-26 无锡邑文微电子科技股份有限公司 碗状刻蚀的方法
EP4557348A1 (en) * 2023-11-16 2025-05-21 AlixLabs AB Cyclic processing of a silicon nanostructure
WO2026064073A1 (en) * 2024-09-17 2026-03-26 Lam Research Corporation Selective etch with passivation tuning

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6190421A (ja) * 1984-10-11 1986-05-08 Canon Inc 堆積膜形成方法
JPS62154734A (ja) * 1985-12-27 1987-07-09 Hitachi Ltd エツチング方法およびそれに用いる装置
JPH02260424A (ja) * 1989-03-30 1990-10-23 Matsushita Electric Ind Co Ltd ドライエッチング方法
JPH0817807A (ja) * 1995-03-15 1996-01-19 Hitachi Ltd プラズマ処理方法
JPH113879A (ja) * 1997-06-11 1999-01-06 Hitachi Ltd 表面処理装置およびその運転方法

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4784720A (en) 1985-05-03 1988-11-15 Texas Instruments Incorporated Trench etch process for a single-wafer RIE dry etch reactor
JP2603217B2 (ja) 1985-07-12 1997-04-23 株式会社日立製作所 表面処理方法及び表面処理装置
US4666555A (en) * 1985-08-23 1987-05-19 Intel Corporation Plasma etching of silicon using fluorinated gas mixtures
JPS62253785A (ja) 1986-04-28 1987-11-05 Tokyo Univ 間欠的エツチング方法
US4729815A (en) 1986-07-21 1988-03-08 Motorola, Inc. Multiple step trench etching process
KR900007687B1 (ko) 1986-10-17 1990-10-18 가부시기가이샤 히다찌세이사꾸쇼 플라즈마처리방법 및 장치
US4698128A (en) * 1986-11-17 1987-10-06 Motorola, Inc. Sloped contact etch process
US4983253A (en) * 1988-05-27 1991-01-08 University Of Houston-University Park Magnetically enhanced RIE process and apparatus
JP2918892B2 (ja) * 1988-10-14 1999-07-12 株式会社日立製作所 プラズマエッチング処理方法
JP2941572B2 (ja) 1992-08-11 1999-08-25 三菱電機株式会社 プラズマエッチング装置及び半導体装置の製造方法
DE4241045C1 (de) 1992-12-05 1994-05-26 Bosch Gmbh Robert Verfahren zum anisotropen Ätzen von Silicium
DE4420962C2 (de) 1994-06-16 1998-09-17 Bosch Gmbh Robert Verfahren zur Bearbeitung von Silizium
US5779926A (en) 1994-09-16 1998-07-14 Applied Materials, Inc. Plasma process for etching multicomponent alloys
US5716534A (en) 1994-12-05 1998-02-10 Tokyo Electron Limited Plasma processing method and plasma etching method
US5759921A (en) * 1995-09-21 1998-06-02 Lsi Logic Corporation Integrated circuit device fabrication by plasma etching
US5637189A (en) * 1996-06-25 1997-06-10 Xerox Corporation Dry etch process control using electrically biased stop junctions
DE69725245T2 (de) 1996-08-01 2004-08-12 Surface Technoloy Systems Plc Verfahren zur Ätzung von Substraten
DE19706682C2 (de) 1997-02-20 1999-01-14 Bosch Gmbh Robert Anisotropes fluorbasiertes Plasmaätzverfahren für Silizium
US5807789A (en) * 1997-03-20 1998-09-15 Taiwan Semiconductor Manufacturing, Co., Ltd. Method for forming a shallow trench with tapered profile and round corners for the application of shallow trench isolation (STI)
DE19736370C2 (de) 1997-08-21 2001-12-06 Bosch Gmbh Robert Verfahren zum anisotropen Ätzen von Silizium

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6190421A (ja) * 1984-10-11 1986-05-08 Canon Inc 堆積膜形成方法
JPS62154734A (ja) * 1985-12-27 1987-07-09 Hitachi Ltd エツチング方法およびそれに用いる装置
JPH02260424A (ja) * 1989-03-30 1990-10-23 Matsushita Electric Ind Co Ltd ドライエッチング方法
JPH0817807A (ja) * 1995-03-15 1996-01-19 Hitachi Ltd プラズマ処理方法
JPH113879A (ja) * 1997-06-11 1999-01-06 Hitachi Ltd 表面処理装置およびその運転方法

Cited By (23)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7855150B2 (en) 2002-10-14 2010-12-21 Robert Bosch Gmbh Plasma system and method for anisotropically etching structures into a substrate
JP2006503425A (ja) * 2002-10-14 2006-01-26 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング 基板に構造を異方性エッチングするためのプラズマ装置及び方法
JP2004296474A (ja) * 2003-03-25 2004-10-21 Sumitomo Precision Prod Co Ltd シリコン基板のエッチング方法及びエッチング装置
US7220678B2 (en) 2003-03-25 2007-05-22 Sumitomo Precision Products Co., Ltd. Method for etching of a silicon substrate and etching apparatus
WO2004086478A1 (ja) * 2003-03-25 2004-10-07 Sumitomo Precision Products Co., Ltd. シリコン基板のエッチング方法及びエッチング装置
JP2005086079A (ja) * 2003-09-10 2005-03-31 Denso Corp 半導体装置の製造方法
JP2006191043A (ja) * 2005-01-03 2006-07-20 Alcatel 半導体基板をプラズマエッチングしてマスクを作るための装置
JP2009500836A (ja) * 2005-07-06 2009-01-08 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング ウエハのスタックのエッチングを行うための反応装置
JP2012084872A (ja) * 2010-09-15 2012-04-26 Tokyo Electron Ltd プラズマエッチング処理装置、プラズマエッチング処理方法、および半導体素子製造方法
JP2015032597A (ja) * 2013-07-31 2015-02-16 日本ゼオン株式会社 プラズマエッチング方法
JP2018536981A (ja) * 2015-10-02 2018-12-13 アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated 原子レベル分解能及びプラズマ処理制御のための方法
KR102811330B1 (ko) * 2015-10-02 2025-05-21 어플라이드 머티어리얼스, 인코포레이티드 원자 레벨 레졸루션 및 플라즈마 프로세싱 제어를 위한 방법들
KR20180051663A (ko) * 2015-10-02 2018-05-16 어플라이드 머티어리얼스, 인코포레이티드 원자 레벨 레졸루션 및 플라즈마 프로세싱 제어를 위한 방법들
KR20170054280A (ko) * 2015-11-04 2017-05-17 램 리써치 코포레이션 플라즈마 전력 레벨에 반응하는 2-모드 프로세스 가스 조성을 사용하는 플라즈마 에칭을 위한 방법들 및 시스템들
JP2021093548A (ja) * 2015-11-04 2021-06-17 ラム リサーチ コーポレーションLam Research Corporation プラズマ処理システム
JP7122422B2 (ja) 2015-11-04 2022-08-19 ラム リサーチ コーポレーション プラズマ処理システム
KR102725132B1 (ko) * 2015-11-04 2024-10-31 램 리써치 코포레이션 플라즈마 전력 레벨에 반응하는 2-모드 프로세스 가스 조성을 사용하는 플라즈마 에칭을 위한 방법들 및 시스템들
JP2017112350A (ja) * 2015-11-04 2017-06-22 ラム リサーチ コーポレーションLam Research Corporation プラズマ電力レベルに応じて二様態プロセスガス組成を使用するプラズマエッチングのための方法及びシステム
KR20190040313A (ko) * 2016-09-06 2019-04-17 도쿄엘렉트론가부시키가이샤 유사 원자층 에칭 방법
KR102489215B1 (ko) 2016-09-06 2023-01-16 도쿄엘렉트론가부시키가이샤 유사 원자층 에칭 방법
WO2022085424A1 (ja) * 2020-10-19 2022-04-28 東京エレクトロン株式会社 基板処理方法および基板処理装置
JP2022067033A (ja) * 2020-10-19 2022-05-02 東京エレクトロン株式会社 基板処理方法および基板処理装置
JP7692696B2 (ja) 2020-10-19 2025-06-16 東京エレクトロン株式会社 基板処理方法および基板処理装置

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