JP2003100986A - 半導体装置 - Google Patents
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- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
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Abstract
(57)【要約】
【課題】 リードフレームとヒートシンク間の絶縁性を
確保することを可能にする。 【解決手段】 リードフレーム1と、リードフレームに
実装されるパワー半導体素子2及び制御半導体素子3
と、パワー半導体素子及び制御半導体素子とリードフレ
ームを電気的にそれぞれ接続する第1ワイヤ4及び第2
ワイヤ5と、リードフレームの半導体素子の実装面に対
向する面に、絶縁層8を介して形成されたヒートシンク
7とを有し、ヒートシンクがリードフレームと少なくと
も部分的に離間している。
確保することを可能にする。 【解決手段】 リードフレーム1と、リードフレームに
実装されるパワー半導体素子2及び制御半導体素子3
と、パワー半導体素子及び制御半導体素子とリードフレ
ームを電気的にそれぞれ接続する第1ワイヤ4及び第2
ワイヤ5と、リードフレームの半導体素子の実装面に対
向する面に、絶縁層8を介して形成されたヒートシンク
7とを有し、ヒートシンクがリードフレームと少なくと
も部分的に離間している。
Description
【0001】
【発明の属する技術分野】本発明は半導体装置に関し、
特に樹脂封止タイプのインテリジェントパワーモジュー
ルに使用されるものである。
特に樹脂封止タイプのインテリジェントパワーモジュー
ルに使用されるものである。
【0002】
【従来の技術】図4に従来の半導体装置の断面図を示
す。リードフレーム1とこのリードフレーム1上に実装
されたパワー半導体素子2及び制御半導体素子3と、上
記リードフレーム1とパワー半導体素子2とを電気的に
接続するAlからなるワイヤ4と、上記リードフレーム
1と制御半導体素子3とを電気的に接続するAuからな
るワイヤ5と、上記リードフレーム1の、パワー半導体
素子2及び制御半導体素子3の実装面に対向する面側
に、絶縁層8を介して貼り付けたヒートシンク7とを有
し、装置全体を封止樹脂6で封止した構造となってい
る。
す。リードフレーム1とこのリードフレーム1上に実装
されたパワー半導体素子2及び制御半導体素子3と、上
記リードフレーム1とパワー半導体素子2とを電気的に
接続するAlからなるワイヤ4と、上記リードフレーム
1と制御半導体素子3とを電気的に接続するAuからな
るワイヤ5と、上記リードフレーム1の、パワー半導体
素子2及び制御半導体素子3の実装面に対向する面側
に、絶縁層8を介して貼り付けたヒートシンク7とを有
し、装置全体を封止樹脂6で封止した構造となってい
る。
【0003】
【発明が解決しようとする課題】この従来の半導体装置
は、リードフレーム1に、パワー半導体素子2及び制御
半導体素子3を実装し、Alからなるワイヤ4とAuか
らなるワイヤ5で接続したものを、絶縁層8が形成され
たヒートシンク7を貼り付けると同時に、封止樹脂6で
トランスファモールドするが、このトランスファモール
ド時に絶縁層8と、パワー半導体素子2が実装された面
以外のリードフレーム1との界面に封止樹脂6が充填さ
れず、リードフレーム1とヒートシンク7の間に絶縁性
を確保することができなくなるという問題があった。
は、リードフレーム1に、パワー半導体素子2及び制御
半導体素子3を実装し、Alからなるワイヤ4とAuか
らなるワイヤ5で接続したものを、絶縁層8が形成され
たヒートシンク7を貼り付けると同時に、封止樹脂6で
トランスファモールドするが、このトランスファモール
ド時に絶縁層8と、パワー半導体素子2が実装された面
以外のリードフレーム1との界面に封止樹脂6が充填さ
れず、リードフレーム1とヒートシンク7の間に絶縁性
を確保することができなくなるという問題があった。
【0004】本発明は、上記事情を考慮してなされたも
のであって、リードフレームとヒートシンク間の絶縁性
を確保することのできる半導体装置を提供することを目
的とする。
のであって、リードフレームとヒートシンク間の絶縁性
を確保することのできる半導体装置を提供することを目
的とする。
【0005】
【課題を解決するための手段】本発明による半導体装置
は、リードフレームと、リードフレームに実装されるパ
ワー半導体素子及び制御半導体素子と、前記パワー半導
体素子及び制御半導体素子と前記リードフレームを電気
的にそれぞれ接続する第1ワイヤ及び第2ワイヤと、前
記リードフレームの前記半導体素子の実装面に対向する
面に、絶縁層を介して形成されたヒートシンクとを有
し、前記ヒートシンクが前記リードフレームと少なくと
も部分的に離間していることを特徴とする。
は、リードフレームと、リードフレームに実装されるパ
ワー半導体素子及び制御半導体素子と、前記パワー半導
体素子及び制御半導体素子と前記リードフレームを電気
的にそれぞれ接続する第1ワイヤ及び第2ワイヤと、前
記リードフレームの前記半導体素子の実装面に対向する
面に、絶縁層を介して形成されたヒートシンクとを有
し、前記ヒートシンクが前記リードフレームと少なくと
も部分的に離間していることを特徴とする。
【0006】なお、前記ヒートシンクの前記絶縁層形成
面の周辺部に周辺にいくに従ってリードフレームから離
れるように形成された、前記絶縁層を有する段差部を設
けるように構成しても良い。
面の周辺部に周辺にいくに従ってリードフレームから離
れるように形成された、前記絶縁層を有する段差部を設
けるように構成しても良い。
【0007】なお、前記ヒートシンクの前記絶縁層形成
面の周辺部に周辺にいくに従ってリードフレームから離
れるように形成された、前記絶縁層を有するテーパー部
を設けるように構成しても良い。
面の周辺部に周辺にいくに従ってリードフレームから離
れるように形成された、前記絶縁層を有するテーパー部
を設けるように構成しても良い。
【0008】なお、前記リードフレームの前記パワー半
導体素子実装部が、前記絶縁層が形成されたヒートシン
ク側に押し下げられた構成のディプレス部が設けられる
ように構成しても良い。
導体素子実装部が、前記絶縁層が形成されたヒートシン
ク側に押し下げられた構成のディプレス部が設けられる
ように構成しても良い。
【0009】
【発明の実施の形態】以下、本発明による半導体装置の
実施形態を、図面を参照しながら説明する。
実施形態を、図面を参照しながら説明する。
【0010】(第1実施形態)本発明による半導体装置
の第1実施形態の構成を示す断面図を図1に示す。この
実施形態の半導体装置は、リードフレーム1上にパワー
半導体素子2及び制御半導体素子3が実装された構成と
なっている。そして、リードフレーム1とパワー半導体
素子2とがAlからなるワイヤ4で、リードフレーム1
と制御半導体素子3とがAuからなるワイヤ5で電気的
に接続された構成となっている。また、リードフレーム
1の、パワー半導体素子2及び制御半導体素子3の実装
面に対向する面側に、絶縁層8を介してヒートシンク7
が形成され、全体を封止樹脂6で封止された構成となっ
ている。そして、ヒートシンク7の、絶縁層8形成面側
の周辺部には、周辺にいくに従ってリードフレームから
離れるように形成された段差部7Aが設けられた構成と
なっている。なお、この段差部7A上には絶縁層8が形
成されている。また、装置全体が封止樹脂6で封止され
た構造となっている。
の第1実施形態の構成を示す断面図を図1に示す。この
実施形態の半導体装置は、リードフレーム1上にパワー
半導体素子2及び制御半導体素子3が実装された構成と
なっている。そして、リードフレーム1とパワー半導体
素子2とがAlからなるワイヤ4で、リードフレーム1
と制御半導体素子3とがAuからなるワイヤ5で電気的
に接続された構成となっている。また、リードフレーム
1の、パワー半導体素子2及び制御半導体素子3の実装
面に対向する面側に、絶縁層8を介してヒートシンク7
が形成され、全体を封止樹脂6で封止された構成となっ
ている。そして、ヒートシンク7の、絶縁層8形成面側
の周辺部には、周辺にいくに従ってリードフレームから
離れるように形成された段差部7Aが設けられた構成と
なっている。なお、この段差部7A上には絶縁層8が形
成されている。また、装置全体が封止樹脂6で封止され
た構造となっている。
【0011】このように、ヒートシンク7の周辺部に段
差部7Aを設けることで、リードフレーム1とヒートシ
ンク7の間に絶縁距離を確保する。これにより、トラン
スファモールド時に封止樹脂6の未充填がたとえ発生し
た場合でも絶縁性が確保できる。
差部7Aを設けることで、リードフレーム1とヒートシ
ンク7の間に絶縁距離を確保する。これにより、トラン
スファモールド時に封止樹脂6の未充填がたとえ発生し
た場合でも絶縁性が確保できる。
【0012】(第2実施形態)本発明による半導体装置
の第2実施形態の構成を図2に示す。この第2実施形態
の半導体装置は、第1実施形態の半導体装置おいて、段
差部7Aの代わりに、周辺にいくに従ってリードフレー
ムから離れるように形成されたテーパー部7Bが設けら
れた構成となっている。このように構成したことによ
り、リードフレーム1とヒートシンク7の間の絶縁距離
を確保する構造となっている。これにより、トランスフ
ァモールド時に封止樹脂6の未充填がたとえ発生した場
合でも絶縁性が確保できる。
の第2実施形態の構成を図2に示す。この第2実施形態
の半導体装置は、第1実施形態の半導体装置おいて、段
差部7Aの代わりに、周辺にいくに従ってリードフレー
ムから離れるように形成されたテーパー部7Bが設けら
れた構成となっている。このように構成したことによ
り、リードフレーム1とヒートシンク7の間の絶縁距離
を確保する構造となっている。これにより、トランスフ
ァモールド時に封止樹脂6の未充填がたとえ発生した場
合でも絶縁性が確保できる。
【0013】(第3実施形態)本発明による半導体装置
の第3実施形態の構成を図3に示す。この第3実施形態
の半導体装置は、従来の半導体装置において、リードフ
レーム1のパワー半導体素子2が実装された面を、絶縁
層8が形成されたヒートシンク7側に押し下げたディプ
レス部1Aを有する構造となっている。このように構成
することにより、リードフレーム1とヒートシンク7の
間の絶縁距離を確保する構造となっている。これによ
り、トランスファモールド時に封止樹脂6の未充填がた
とえ発生した場合でも絶縁性が確保できる。
の第3実施形態の構成を図3に示す。この第3実施形態
の半導体装置は、従来の半導体装置において、リードフ
レーム1のパワー半導体素子2が実装された面を、絶縁
層8が形成されたヒートシンク7側に押し下げたディプ
レス部1Aを有する構造となっている。このように構成
することにより、リードフレーム1とヒートシンク7の
間の絶縁距離を確保する構造となっている。これによ
り、トランスファモールド時に封止樹脂6の未充填がた
とえ発生した場合でも絶縁性が確保できる。
【0014】
【発明の効果】以上述べたように、本発明によれば、リ
ードフレームとヒートシンク間の絶縁距離を確保するこ
とができる。
ードフレームとヒートシンク間の絶縁距離を確保するこ
とができる。
【図1】本発明による半導体装置の第1実施形態の構成
を示す断面図。
を示す断面図。
【図2】本発明による半導体装置の第2実施形態の構成
を示す断面図。
を示す断面図。
【図3】本発明による半導体装置の第3実施形態の構成
を示す断面図。
を示す断面図。
【図4】従来の半導体装置の構成を示す断面図。
1 リードフレーム
1A ディプレス部
2 パワー半導体素子
3 制御半導体素子
4 ワイヤ
5 ワイヤ
6 封止樹脂
7 ヒートシンク
7A 段差部
7B テーパー部
8 絶縁層
─────────────────────────────────────────────────────
フロントページの続き
(72)発明者 堀 哲 二
神奈川県川崎市幸区小向東芝町1番地 株
式会社東芝マイクロエレクトロニクスセン
ター内
Claims (4)
- 【請求項1】リードフレームと、リードフレームに実装
されるパワー半導体素子及び制御半導体素子と、前記パ
ワー半導体素子及び制御半導体素子と前記リードフレー
ムを電気的にそれぞれ接続する第1ワイヤ及び第2ワイ
ヤと、前記リードフレームの前記半導体素子の実装面に
対向する面に、絶縁層を介して形成されたヒートシンク
とを有し、前記ヒートシンクが前記リードフレームと少
なくとも部分的に離間していることを特徴とする半導体
装置。 - 【請求項2】前記ヒートシンクの前記絶縁層形成面の周
辺部に周辺にいくに従ってリードフレームから離れるよ
うに形成された、前記絶縁層を有する段差部を設けたこ
とを特徴とする請求項1記載の半導体装置。 - 【請求項3】前記ヒートシンクの前記絶縁層形成面の周
辺部に、周辺にいくに従ってリードフレームから離れる
ように形成された、前記絶縁層を有するテーパー部を設
けたことを特徴とする請求項1記載の半導体装置。 - 【請求項4】前記リードフレームの前記パワー半導体素
子実装部が、前記絶縁層が形成されたヒートシンク側に
押し下げられた構成のディプレス部が設けられているこ
とを特徴とする請求項1記載の半導体装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001293339A JP2003100986A (ja) | 2001-09-26 | 2001-09-26 | 半導体装置 |
| US10/251,763 US20030057573A1 (en) | 2001-09-26 | 2002-09-23 | Semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001293339A JP2003100986A (ja) | 2001-09-26 | 2001-09-26 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2003100986A true JP2003100986A (ja) | 2003-04-04 |
Family
ID=19115153
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001293339A Abandoned JP2003100986A (ja) | 2001-09-26 | 2001-09-26 | 半導体装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US20030057573A1 (ja) |
| JP (1) | JP2003100986A (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008140979A (ja) * | 2006-12-01 | 2008-06-19 | Denso Corp | パッケージ型半導体装置 |
| JP2013051300A (ja) * | 2011-08-31 | 2013-03-14 | Sanken Electric Co Ltd | 半導体モジュール |
| WO2016125419A1 (ja) * | 2015-02-04 | 2016-08-11 | 三菱電機株式会社 | 半導体装置 |
| JPWO2014122908A1 (ja) * | 2013-02-05 | 2017-01-26 | パナソニックIpマネジメント株式会社 | 半導体装置およびその製造方法 |
| WO2022249810A1 (ja) * | 2021-05-27 | 2022-12-01 | 株式会社デンソー | 半導体装置 |
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|---|---|---|---|---|
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| US7775685B2 (en) * | 2003-05-27 | 2010-08-17 | Cree, Inc. | Power surface mount light emitting die package |
| US7264378B2 (en) | 2002-09-04 | 2007-09-04 | Cree, Inc. | Power surface mount light emitting die package |
| EP1424728A1 (de) * | 2002-11-27 | 2004-06-02 | Abb Research Ltd. | Leistungshalbleitermodul |
| US7692206B2 (en) * | 2002-12-06 | 2010-04-06 | Cree, Inc. | Composite leadframe LED package and method of making the same |
| US6897486B2 (en) | 2002-12-06 | 2005-05-24 | Ban P. Loh | LED package die having a small footprint |
| US7456499B2 (en) | 2004-06-04 | 2008-11-25 | Cree, Inc. | Power light emitting die package with reflecting lens and the method of making the same |
| US7280288B2 (en) | 2004-06-04 | 2007-10-09 | Cree, Inc. | Composite optical lens with an integrated reflector |
| EP1622237A1 (de) * | 2004-07-28 | 2006-02-01 | Infineon Technologies Fiber Optics GmbH | Optisches oder elektronisches Modul und Verfahren zu dessen Herstellung |
| US7224047B2 (en) * | 2004-12-18 | 2007-05-29 | Lsi Corporation | Semiconductor device package with reduced leakage |
| JP4547279B2 (ja) * | 2005-02-08 | 2010-09-22 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
| US7980743B2 (en) | 2005-06-14 | 2011-07-19 | Cree, Inc. | LED backlighting for displays |
| US20070130759A1 (en) * | 2005-06-15 | 2007-06-14 | Gem Services, Inc. | Semiconductor device package leadframe formed from multiple metal layers |
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