JP3343246B1 - 補正の再使用による合理的なicマスク・レイアウトの光学的プロセス補正 - Google Patents
補正の再使用による合理的なicマスク・レイアウトの光学的プロセス補正Info
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- JP3343246B1 JP3343246B1 JP2000615853A JP2000615853A JP3343246B1 JP 3343246 B1 JP3343246 B1 JP 3343246B1 JP 2000615853 A JP2000615853 A JP 2000615853A JP 2000615853 A JP2000615853 A JP 2000615853A JP 3343246 B1 JP3343246 B1 JP 3343246B1
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- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F7/00—Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
- G03F7/70—Microphotolithographic exposure; Apparatus therefor
- G03F7/70425—Imaging strategies, e.g. for increasing throughput or resolution, printing product fields larger than the image field or compensating lithography- or non-lithography errors, e.g. proximity correction, mix-and-match, stitching or double patterning
- G03F7/70433—Layout for increasing efficiency or for compensating imaging errors, e.g. layout of exposure fields for reducing focus errors; Use of mask features for increasing efficiency or for compensating imaging errors
- G03F7/70441—Optical proximity correction [OPC]
-
- G—PHYSICS
- G03—PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
- G03F—PHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
- G03F1/00—Originals for photomechanical production of textured or patterned surfaces, e.g., masks, photo-masks, reticles; Mask blanks or pellicles therefor; Containers specially adapted therefor; Preparation thereof
- G03F1/36—Masks having proximity correction features; Preparation thereof, e.g. optical proximity correction [OPC] design processes
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Preparing Plates And Mask In Photomechanical Process (AREA)
Abstract
【要約】
EDAツールは、第2の領域が、OPCの目的で第1の
領域と等価であると判定されたときに、その第1の領域
に対して決定された補正を、第2の領域上で再使用す
る、合理的な方法でICマスク・レイアウトに対して光
学的および/またはプロセス予備補償を実行するOPC
モジュールを備える。OPCモジュールは、領域毎に、
ICマスク・レイアウトに対して補正を実行し、その補
正は、一実施形態では、レジスト・モデル・ベースのシ
ミュレーションならびに光学的モデル・ベースのシミュ
レーションを含むモデル・ベースのシミュレーションを
繰り返し使用して決定する。
領域と等価であると判定されたときに、その第1の領域
に対して決定された補正を、第2の領域上で再使用す
る、合理的な方法でICマスク・レイアウトに対して光
学的および/またはプロセス予備補償を実行するOPC
モジュールを備える。OPCモジュールは、領域毎に、
ICマスク・レイアウトに対して補正を実行し、その補
正は、一実施形態では、レジスト・モデル・ベースのシ
ミュレーションならびに光学的モデル・ベースのシミュ
レーションを含むモデル・ベースのシミュレーションを
繰り返し使用して決定する。
Description
【0001】(発明の背景) 1.発明の分野 本発明は、集積回路(IC)設計の分野に関する。より
詳細には、本発明は、ICマスク・レイアウトに対する
光学的予備補償(pre-compensation)とプロセス予備補
償の適用に関する。
詳細には、本発明は、ICマスク・レイアウトに対する
光学的予備補償(pre-compensation)とプロセス予備補
償の適用に関する。
【0002】2.背景情報 長年にわたって、IC設計がますます複雑さを増してき
ており、IC設計者は、ますますIC設計において、設
計者を支援する電子設計自動化(EDA:electronic d
esign automation)ツールに依存するようになった。こ
れらのツールは、システム設計、配置、配線パス選定か
らレイアウト確認にいたる設計プロセス全体にわたる。
ており、IC設計者は、ますますIC設計において、設
計者を支援する電子設計自動化(EDA:electronic d
esign automation)ツールに依存するようになった。こ
れらのツールは、システム設計、配置、配線パス選定か
らレイアウト確認にいたる設計プロセス全体にわたる。
【0003】1ミクロン未満のICの場合、線幅の「臨
界寸法」が、光源の波長より小さくなるため、設計者
は、所望の1ミクロン未満のICイメージを達成するた
めに、ICマスク・レイアウトの様々な幾何形状の辺に
対して必要な予備補償(または補正(correction)とも
称する)を行うために、EDAツールにますます依存す
るようになっている。(本願明細書において使用する用
語マスクは、レチクルをも含むものとする。)これらの
補正を自動的に行うための様々な技術は、光学的近接効
果補正(optical proximity correction)または光学及
びプロセス補正(optical and process correction)と
一般に称する。後者の場合、プロセス歪みならびに光学
的歪みに対して予備補償が行われる。光学的歪みだけに
対するものであろうと、あるいは双方の歪みに対するも
のであろうと、以下では、すべての予備補償をOPCと
総称する。
界寸法」が、光源の波長より小さくなるため、設計者
は、所望の1ミクロン未満のICイメージを達成するた
めに、ICマスク・レイアウトの様々な幾何形状の辺に
対して必要な予備補償(または補正(correction)とも
称する)を行うために、EDAツールにますます依存す
るようになっている。(本願明細書において使用する用
語マスクは、レチクルをも含むものとする。)これらの
補正を自動的に行うための様々な技術は、光学的近接効
果補正(optical proximity correction)または光学及
びプロセス補正(optical and process correction)と
一般に称する。後者の場合、プロセス歪みならびに光学
的歪みに対して予備補償が行われる。光学的歪みだけに
対するものであろうと、あるいは双方の歪みに対するも
のであろうと、以下では、すべての予備補償をOPCと
総称する。
【0004】一般的にいって、OPC技術は、ルール・
ベースの技術またはモデル・ベースの技術として分類す
ることができる。ルール・ベースの技術では、ある予め
指定された条件が検出された場合、たとえばある幾学的
形状が、他の形状の存在下で、ある臨界距離内で使用さ
れるときに所定の補正が行われる。モデル・ベースの技
術では、様々なモデル、たとえば光学的モデルを使用し
て、コンピュータ・シミュレーションによって補正が算
出される。したがって、一般的にいって、ルール・ベー
スの技術は、正確さでは劣るものの、計算を多用しない
といえる。他方、モデル・ベースの技術はより正確であ
るが、計算をより多用する。さらに、ある大規模ICで
は、モデル・ベースの技術の中には、非常に強力な計算
システムを必要とするため、非実用的になるものもあ
る。したがって、複雑なICの設計者は、しばしば正確
さと計算効率の、この難しい選択に直面する。
ベースの技術またはモデル・ベースの技術として分類す
ることができる。ルール・ベースの技術では、ある予め
指定された条件が検出された場合、たとえばある幾学的
形状が、他の形状の存在下で、ある臨界距離内で使用さ
れるときに所定の補正が行われる。モデル・ベースの技
術では、様々なモデル、たとえば光学的モデルを使用し
て、コンピュータ・シミュレーションによって補正が算
出される。したがって、一般的にいって、ルール・ベー
スの技術は、正確さでは劣るものの、計算を多用しない
といえる。他方、モデル・ベースの技術はより正確であ
るが、計算をより多用する。さらに、ある大規模ICで
は、モデル・ベースの技術の中には、非常に強力な計算
システムを必要とするため、非実用的になるものもあ
る。したがって、複雑なICの設計者は、しばしば正確
さと計算効率の、この難しい選択に直面する。
【0005】したがって、所望の改善された正確さを維
持しつつ、計算負荷がより軽い、より合理的なモデル・
ベースのOPC技術が求められている。
持しつつ、計算負荷がより軽い、より合理的なモデル・
ベースのOPC技術が求められている。
【0006】(発明の概要) EDAツールは、ICマスク・レイアウトに対して光学
的および/またはプロセス予備補償を合理的な方法で実
行するOPCモジュールを備え、第2の領域がOPCの
目的で第1の領域と等価であると判定されたとき、第1
の領域に対して決定された補正を第2の領域で再使用す
る。OPCモジュールは、ICマスク・レイアウトに対
して領域毎に補正を実行し、補正は、モデル・ベースの
シミュレーションを反復使用して決定される。そのシミ
ュレーションは一実施態様においては、レジスト・モデ
ル・ベースのシミュレーションならびに光学的モデル・
ベースのシミュレーションを含む。
的および/またはプロセス予備補償を合理的な方法で実
行するOPCモジュールを備え、第2の領域がOPCの
目的で第1の領域と等価であると判定されたとき、第1
の領域に対して決定された補正を第2の領域で再使用す
る。OPCモジュールは、ICマスク・レイアウトに対
して領域毎に補正を実行し、補正は、モデル・ベースの
シミュレーションを反復使用して決定される。そのシミ
ュレーションは一実施態様においては、レジスト・モデ
ル・ベースのシミュレーションならびに光学的モデル・
ベースのシミュレーションを含む。
【0007】本発明を、添付の図面に示す限定的ではな
く例示的な実施形態を使用して説明する。図面中同じ参
照番号は同様の要素を示すものとする。
く例示的な実施形態を使用して説明する。図面中同じ参
照番号は同様の要素を示すものとする。
【0008】(発明の詳細な説明) 以下の説明において、本発明の様々な態様について説明
し、本発明の安全な理解を与えるために様々な詳細を記
載する。ただし、本発明が、本発明の一部のみまたはす
べての態様で実施できること、および本発明が、具体的
な詳細事項なしで実施できることは、当業者にとって明
らかであろう。他の場合では、周知の特徴については、
本発明をあいまいにしないために、省略または簡略に示
す。
し、本発明の安全な理解を与えるために様々な詳細を記
載する。ただし、本発明が、本発明の一部のみまたはす
べての態様で実施できること、および本発明が、具体的
な詳細事項なしで実施できることは、当業者にとって明
らかであろう。他の場合では、周知の特徴については、
本発明をあいまいにしないために、省略または簡略に示
す。
【0009】説明の一部は、他の当業者に自分の仕事の
内容を伝達するために当業者が一般に使用している用
語、たとえば、マスク・レイアウト、幾何形状、モデル
・ベースのシミュレーション等を使用して示す。また、
説明の一部は決定する、生成する、等の用語を使用し
て、コンピュータ・システムによって実行されるオペレ
ーションの形で示す。当業者にはよく理解できるよう
に、これらのオペレーションおよび操作を受ける量は、
デジタル・システムの電気/光学的構成部品を介して、
格納され、転送され、組み合わされる、あるいはその他
の形で操作を受けることのできる、電気的、磁気的、ま
たは光学的な信号の形をとる。またデジタル・システム
という用語は、汎用ならびに専用のデータ処理機械、シ
ステムなどを含み、それらは独立型、補助型、または埋
め込み型であってよい。
内容を伝達するために当業者が一般に使用している用
語、たとえば、マスク・レイアウト、幾何形状、モデル
・ベースのシミュレーション等を使用して示す。また、
説明の一部は決定する、生成する、等の用語を使用し
て、コンピュータ・システムによって実行されるオペレ
ーションの形で示す。当業者にはよく理解できるよう
に、これらのオペレーションおよび操作を受ける量は、
デジタル・システムの電気/光学的構成部品を介して、
格納され、転送され、組み合わされる、あるいはその他
の形で操作を受けることのできる、電気的、磁気的、ま
たは光学的な信号の形をとる。またデジタル・システム
という用語は、汎用ならびに専用のデータ処理機械、シ
ステムなどを含み、それらは独立型、補助型、または埋
め込み型であってよい。
【0010】様々なオペレーションは、本発明を理解す
るために最も役立つ方式で順番に実行される多数の離散
ステップとして記載する。しかし、説明の順序は、これ
らのオペレーションが、必ず提示された順序で実行され
る、さらには順序依存であることを示唆するものと解釈
すべきではない。最後に、フレーズ「一実施形態におい
て」という表現を繰り返し使用するが、それは、同じで
もよいが、必ずしも同一の実施形態を表すものではな
い。
るために最も役立つ方式で順番に実行される多数の離散
ステップとして記載する。しかし、説明の順序は、これ
らのオペレーションが、必ず提示された順序で実行され
る、さらには順序依存であることを示唆するものと解釈
すべきではない。最後に、フレーズ「一実施形態におい
て」という表現を繰り返し使用するが、それは、同じで
もよいが、必ずしも同一の実施形態を表すものではな
い。
【0011】図1を参照すると、いくつかの実施形態に
よる本発明の概要を示すブロック図が示されている。本
発明の教示を組み込んだ、OPCモジュール100が示
してあるが、それは、領域毎にICマスク・レイアウト
102に対するOPCの自動実行により補正済みICマ
スク・レイアウト104を生成することを含んでいる。
具体的には、第2の領域が、OPCの目的で第1の領域
と等価であるとみなされる場合に、OPCモジュール1
00は、第1の領域に対して決定された補正を第2の領
域で再使用する。その結果、ICマスク・レイアウト1
04を生成するために、ICマスク・レイアウト102
に対してOPCを実行するのに必要とされる計算の量
は、大幅に減少する。
よる本発明の概要を示すブロック図が示されている。本
発明の教示を組み込んだ、OPCモジュール100が示
してあるが、それは、領域毎にICマスク・レイアウト
102に対するOPCの自動実行により補正済みICマ
スク・レイアウト104を生成することを含んでいる。
具体的には、第2の領域が、OPCの目的で第1の領域
と等価であるとみなされる場合に、OPCモジュール1
00は、第1の領域に対して決定された補正を第2の領
域で再使用する。その結果、ICマスク・レイアウト1
04を生成するために、ICマスク・レイアウト102
に対してOPCを実行するのに必要とされる計算の量
は、大幅に減少する。
【0012】例示の実施形態において、OPCモジュー
ル100は、図示するように、互いに動作可能に結合さ
れている、いくつかのプリプロセッサ108、等価性ア
ナライザ109、シミュレータ110、補正ポストプロ
セッサ112、および補正データベース114を含む。
プリプロセッサ108は、具体的にはフラグメンテーシ
ョン・プリプロセッサ108aおよびタグ付けプリプロ
セッサ108bを含む。プリプロセッサ108は、適切
な補正を決定する目的で、後で解析するための記述的デ
ータを準備するために、ICマスク・レイアウト102
のフォーマル記述をまとめて前処理する。とりわけ、プ
リプロセッサ108は、本発明の合理的な手法に従って
後続の解析が効率的に実行できるように、記述的データ
をまとめて準備し、それによって1つの領域に対して決
定された補正が、別のOPC等価領域に、効率的に再使
用できるようになる。等価性アナライザ109は、2つ
の領域が、OPCの目的で、「等価か」どうか領域毎に
判定するために、パターン認識解析を実行する。等価で
ある場合、アナライザ109は、さらに以前に決定され
た補正をその領域に再使用されるようにし、コストのか
かる再計算の反復を避ける。シミュレータ110は、特
定の「ユニークな」領域に対して適切な補正を決定する
ために、各「ユニークな」領域ごとにモデル・ベースの
解析を実行する。補正ポストプロセッサ112は、各領
域ごとに決定された補正を行う。各「ユニークな」領域
ごとに、シミュレーションおよび補正プロセスは、補正
済みマスク・レイアウトが十分に予備補償され、所定の
許容範囲レベル内の所望のイメージをもたらすとみなさ
れるまで、所望の結果106を参照しながら、繰り返し
複数回実行される。補正データベース114は、2つの
領域が比較され、それらがOPCの目的で等価であるか
どうか判定できるようにするのに必要なデータを格納す
る。さらに、補正データベース114は、1つの領域に
対して決定された補正が、後者の領域がOPCの目的で
前者の領域と等価であると判定されるとき、他の領域に
再使用できるようにするのに必要なデータを格納する。
ル100は、図示するように、互いに動作可能に結合さ
れている、いくつかのプリプロセッサ108、等価性ア
ナライザ109、シミュレータ110、補正ポストプロ
セッサ112、および補正データベース114を含む。
プリプロセッサ108は、具体的にはフラグメンテーシ
ョン・プリプロセッサ108aおよびタグ付けプリプロ
セッサ108bを含む。プリプロセッサ108は、適切
な補正を決定する目的で、後で解析するための記述的デ
ータを準備するために、ICマスク・レイアウト102
のフォーマル記述をまとめて前処理する。とりわけ、プ
リプロセッサ108は、本発明の合理的な手法に従って
後続の解析が効率的に実行できるように、記述的データ
をまとめて準備し、それによって1つの領域に対して決
定された補正が、別のOPC等価領域に、効率的に再使
用できるようになる。等価性アナライザ109は、2つ
の領域が、OPCの目的で、「等価か」どうか領域毎に
判定するために、パターン認識解析を実行する。等価で
ある場合、アナライザ109は、さらに以前に決定され
た補正をその領域に再使用されるようにし、コストのか
かる再計算の反復を避ける。シミュレータ110は、特
定の「ユニークな」領域に対して適切な補正を決定する
ために、各「ユニークな」領域ごとにモデル・ベースの
解析を実行する。補正ポストプロセッサ112は、各領
域ごとに決定された補正を行う。各「ユニークな」領域
ごとに、シミュレーションおよび補正プロセスは、補正
済みマスク・レイアウトが十分に予備補償され、所定の
許容範囲レベル内の所望のイメージをもたらすとみなさ
れるまで、所望の結果106を参照しながら、繰り返し
複数回実行される。補正データベース114は、2つの
領域が比較され、それらがOPCの目的で等価であるか
どうか判定できるようにするのに必要なデータを格納す
る。さらに、補正データベース114は、1つの領域に
対して決定された補正が、後者の領域がOPCの目的で
前者の領域と等価であると判定されるとき、他の領域に
再使用できるようにするのに必要なデータを格納する。
【0013】引き続き図1を参照すると、図示の実施形
態では、ICマスク・レイアウト102は、多角形とパ
ス、より具体的には、とりわけ多角形の頂点およびパス
からなるGDS IIフォーマットで記述される。フラ
グメンテーション・プリプロセッサ108aは、解析の
目的で、幾何形状の各辺をとり、追加の「頂点」を挿入
して、その辺をさらに多数の辺セグメントまたはフラグ
メントに分解し、それによって、適切な補正を決定する
ために実行される、後続の解析の解像度を改善する(図
2参照)。当業者ならわかるように、このように追加の
頂点を挿入し、辺を多数の辺フラグメントに分解する
と、後続のシミュレーション解析の計算コストが相当増
大する結果を招く。後でより詳細に述べるように、正確
さを改善するためのこの計算コストの大幅な増大を避け
るために、等価性アナライザ109は、有利には、高価
な計算が各OPC「ユニークな」領域ごとに1回だけ実
行され、OPCから見て等価な領域に対しては決定され
た補正を再使用する。タグ付けプリプロセッサ108b
は、アナライザ109による等価性解析が効率的実行が
容易になるように、タグ識別子を使用して、ICマスク
・レイアウト102の各領域の幾何的形状を特徴付け
る。タグ識別子の例は、辺フラグメントを垂直辺フラグ
メント、水平辺フラグメント、線端辺フラグメントと隣
接している辺フラグメント、凹角辺フラグメント等とし
て特徴付ける識別子である。タグ付けは、「辺フラグメ
ント・タグ付けを使用したサブミクロンIC設計用の改
良された方法および装置(Improved Meth
od and Apparatus For Sub−
micron IC Design Using Ed
ge Fragment Tagging)」との名称
で、本出願と同時に出願された同時係属出願、第
号の主題であり、これを参照により完全に本明
細書に組み込む。
態では、ICマスク・レイアウト102は、多角形とパ
ス、より具体的には、とりわけ多角形の頂点およびパス
からなるGDS IIフォーマットで記述される。フラ
グメンテーション・プリプロセッサ108aは、解析の
目的で、幾何形状の各辺をとり、追加の「頂点」を挿入
して、その辺をさらに多数の辺セグメントまたはフラグ
メントに分解し、それによって、適切な補正を決定する
ために実行される、後続の解析の解像度を改善する(図
2参照)。当業者ならわかるように、このように追加の
頂点を挿入し、辺を多数の辺フラグメントに分解する
と、後続のシミュレーション解析の計算コストが相当増
大する結果を招く。後でより詳細に述べるように、正確
さを改善するためのこの計算コストの大幅な増大を避け
るために、等価性アナライザ109は、有利には、高価
な計算が各OPC「ユニークな」領域ごとに1回だけ実
行され、OPCから見て等価な領域に対しては決定され
た補正を再使用する。タグ付けプリプロセッサ108b
は、アナライザ109による等価性解析が効率的実行が
容易になるように、タグ識別子を使用して、ICマスク
・レイアウト102の各領域の幾何的形状を特徴付け
る。タグ識別子の例は、辺フラグメントを垂直辺フラグ
メント、水平辺フラグメント、線端辺フラグメントと隣
接している辺フラグメント、凹角辺フラグメント等とし
て特徴付ける識別子である。タグ付けは、「辺フラグメ
ント・タグ付けを使用したサブミクロンIC設計用の改
良された方法および装置(Improved Meth
od and Apparatus For Sub−
micron IC Design Using Ed
ge Fragment Tagging)」との名称
で、本出願と同時に出願された同時係属出願、第
号の主題であり、これを参照により完全に本明
細書に組み込む。
【0014】図示の実施形態において、等価性アナライ
ザ109は「ウィンドウ化領域」毎に、効率的に等価性
解析を実行する。ウィンドウ化領域は、元の領域を囲
み、それを含んでいる。ウィンドウ化領域は、OPC解
析のために含めるべき直かに隣接した領域の包囲リング
によって、元の領域の周辺を拡大してゆく方法によって
形成される。包囲リングの大きさは、ウィンドウ寸法
(dw )によって決められる。この包囲領域内に配置さ
れている幾何形状は、OPC解析の点から見て重要であ
ると見なされる(図3a〜3b参照)。代替実施形態に
おいては、異なる拡大方向に対して、異なるdw を使用
することができる。アナライザ109は、タグ付けプリ
プロセッサ108bにより辺フラグメントに対してタグ
付けされたタグ識別子を使用して、ウィンドウ化領域の
幾何形状を以前に補正されたウィンドウ化領域の(補正
前の状態における)幾何形状と比較する。一実施形態に
おいては、2つの領域が、すべての外観、すなわち、幾
何形状の数、寸法、および相対配置において同一である
場合にのみ、2つのウィンドウ化領域は等価であるとみ
なされる。他の実施形態においては、2つのウィンドウ
化領域が、同じ数の幾何形状を有し、幾何形状の寸法お
よび相対配置が、すべて所定の許容範囲レベル内にある
場合に、2つのウィンドウ化領域は等価であるとみなさ
れる。また他の実施形態においては、等価性を判定する
ために、他の基準を代わりに使用することもできる。シ
ミュレータ110は、レジスト・モデルならびに光学的
モデルの双方を用いて、ICマスク・レイアウト102
のウィンドウ化ユニークな領域に対してシミュレーショ
ン解析を実行する。一実施形態においては、使用するレ
ジスト・モデルは、可変閾値レジスト(VTR)モデル
である。
ザ109は「ウィンドウ化領域」毎に、効率的に等価性
解析を実行する。ウィンドウ化領域は、元の領域を囲
み、それを含んでいる。ウィンドウ化領域は、OPC解
析のために含めるべき直かに隣接した領域の包囲リング
によって、元の領域の周辺を拡大してゆく方法によって
形成される。包囲リングの大きさは、ウィンドウ寸法
(dw )によって決められる。この包囲領域内に配置さ
れている幾何形状は、OPC解析の点から見て重要であ
ると見なされる(図3a〜3b参照)。代替実施形態に
おいては、異なる拡大方向に対して、異なるdw を使用
することができる。アナライザ109は、タグ付けプリ
プロセッサ108bにより辺フラグメントに対してタグ
付けされたタグ識別子を使用して、ウィンドウ化領域の
幾何形状を以前に補正されたウィンドウ化領域の(補正
前の状態における)幾何形状と比較する。一実施形態に
おいては、2つの領域が、すべての外観、すなわち、幾
何形状の数、寸法、および相対配置において同一である
場合にのみ、2つのウィンドウ化領域は等価であるとみ
なされる。他の実施形態においては、2つのウィンドウ
化領域が、同じ数の幾何形状を有し、幾何形状の寸法お
よび相対配置が、すべて所定の許容範囲レベル内にある
場合に、2つのウィンドウ化領域は等価であるとみなさ
れる。また他の実施形態においては、等価性を判定する
ために、他の基準を代わりに使用することもできる。シ
ミュレータ110は、レジスト・モデルならびに光学的
モデルの双方を用いて、ICマスク・レイアウト102
のウィンドウ化ユニークな領域に対してシミュレーショ
ン解析を実行する。一実施形態においては、使用するレ
ジスト・モデルは、可変閾値レジスト(VTR)モデル
である。
【0015】最後に、補正データベース114は、IC
マスク・レイアウトの各ウィンドウ化OPCのユニーク
な領域、およびこれらの各ウィンドウ化OPCのユニー
クな領域の補正状態の記述データを格納するために使用
される(図4参照)。代替実施形態においては、これら
の各ウィンドウ化OPCのユニークな領域の補正状態の
代わりに、ウィンドウ化OPCのユニークな領域のそれ
ぞれに加えられる補正(マスク摂動 (mask perturbatio
n)とも称する)を格納する。さらに他の実施形態におい
ては、補正すなわちマスク摂動、ならびにウィンドウ化
OPCのユニークな領域の補正状態が格納される。
マスク・レイアウトの各ウィンドウ化OPCのユニーク
な領域、およびこれらの各ウィンドウ化OPCのユニー
クな領域の補正状態の記述データを格納するために使用
される(図4参照)。代替実施形態においては、これら
の各ウィンドウ化OPCのユニークな領域の補正状態の
代わりに、ウィンドウ化OPCのユニークな領域のそれ
ぞれに加えられる補正(マスク摂動 (mask perturbatio
n)とも称する)を格納する。さらに他の実施形態におい
ては、補正すなわちマスク摂動、ならびにウィンドウ化
OPCのユニークな領域の補正状態が格納される。
【0016】補正データベース114を使用して必要な
データを格納すること、およびシミュレーションによっ
てある領域に対して決定された補正を以前の領域とOP
C等価であるとみなされる他の領域に再使用することを
除いては、プリプロセッサ108(タグ付けプリプロセ
ッサ108bを除く)、シミュレータ110、および補
正ポストプロセッサ112(等価性アナライザ109を
除く)は、カッブ(Cobb)等、「大領域位相シフト
・マスク設計(Large area phase−s
hift mask design)」、SPIE S
ymposium on Optical Micro
lithography報文集、第2197巻、348
〜360ページ、1994;カッブ等、「低複雑性高速
マスク設計(Fast low complexity
mask design)」、SPIE Sympo
sium on Optical Microlith
ography報文集、第2440巻、313〜327
ページ、1995;カッブ等「OPCのための高速疎架
空イメージ算出(Fast sparse aeria
l image calculation for O
PC)」、BACUS Symposium on P
hotomask Technology報文集、第2
621巻、534〜545ページ、1995;カッブ
等、「近接補正に対する数学的およびCADフレームワ
ーク」、SPIE Symposium on Opt
ical Microlithography報文集、
第2726巻、348〜360ページ、1996;およ
び、カッブ等、「可変閾値レジスト・モデルを有する光
学近接補正上の実験的な結果(Experimenta
l Results on Optical Prox
imity Corrections with Va
riable Threshold Resist M
odel)」、SPIE Symposium on
Optical Microlithography報
文集、第3051巻、458〜468ページ、1997
に詳細に記述されている。これらの論文をここに参照に
より完全に組み込むものとする。
データを格納すること、およびシミュレーションによっ
てある領域に対して決定された補正を以前の領域とOP
C等価であるとみなされる他の領域に再使用することを
除いては、プリプロセッサ108(タグ付けプリプロセ
ッサ108bを除く)、シミュレータ110、および補
正ポストプロセッサ112(等価性アナライザ109を
除く)は、カッブ(Cobb)等、「大領域位相シフト
・マスク設計(Large area phase−s
hift mask design)」、SPIE S
ymposium on Optical Micro
lithography報文集、第2197巻、348
〜360ページ、1994;カッブ等、「低複雑性高速
マスク設計(Fast low complexity
mask design)」、SPIE Sympo
sium on Optical Microlith
ography報文集、第2440巻、313〜327
ページ、1995;カッブ等「OPCのための高速疎架
空イメージ算出(Fast sparse aeria
l image calculation for O
PC)」、BACUS Symposium on P
hotomask Technology報文集、第2
621巻、534〜545ページ、1995;カッブ
等、「近接補正に対する数学的およびCADフレームワ
ーク」、SPIE Symposium on Opt
ical Microlithography報文集、
第2726巻、348〜360ページ、1996;およ
び、カッブ等、「可変閾値レジスト・モデルを有する光
学近接補正上の実験的な結果(Experimenta
l Results on Optical Prox
imity Corrections with Va
riable Threshold Resist M
odel)」、SPIE Symposium on
Optical Microlithography報
文集、第3051巻、458〜468ページ、1997
に詳細に記述されている。これらの論文をここに参照に
より完全に組み込むものとする。
【0017】次に図5を参照すると、一実施形態による
上記のOPCモジュールの動作流れを示すフローチャー
トを示す。(括弧内の参照番号は、図1の要素を参照し
ている)。図のように、502において、フラグメンテ
ーション・プリプロセッサ(108a)は、辺をフラグ
メント化し、タグ付けプリプロセッサ(108b)は、
ICマスク・レイアウト(102)の辺フラグメントを
タグ付けする。504で、等価性アナライザ(109)
は解析のためICマスク・レイアウトのウィンドウ化領
域を選択する。解析の順序は、重要ではない。一実施形
態では系統的であり、別の実施形態では任意である。5
06で、アナライザ(109)は、ウィンドウ化領域
が、以前に補正されたウィンドウ化領域と等価かどうか
判定する。例示の実施形態では、アナライザ(109)
は補正データベース(114)から、以前に補正された
ウィンドウ化領域の補正前の状態の記述的データを検索
する。等価性解析は、タグ付けプリプロセッサ(10
9)によって適用されたタグ識別子を使用して、効率的
に実行される。
上記のOPCモジュールの動作流れを示すフローチャー
トを示す。(括弧内の参照番号は、図1の要素を参照し
ている)。図のように、502において、フラグメンテ
ーション・プリプロセッサ(108a)は、辺をフラグ
メント化し、タグ付けプリプロセッサ(108b)は、
ICマスク・レイアウト(102)の辺フラグメントを
タグ付けする。504で、等価性アナライザ(109)
は解析のためICマスク・レイアウトのウィンドウ化領
域を選択する。解析の順序は、重要ではない。一実施形
態では系統的であり、別の実施形態では任意である。5
06で、アナライザ(109)は、ウィンドウ化領域
が、以前に補正されたウィンドウ化領域と等価かどうか
判定する。例示の実施形態では、アナライザ(109)
は補正データベース(114)から、以前に補正された
ウィンドウ化領域の補正前の状態の記述的データを検索
する。等価性解析は、タグ付けプリプロセッサ(10
9)によって適用されたタグ識別子を使用して、効率的
に実行される。
【0018】ウィンドウ化領域が、以前に補正された領
域とOPC等価であると判定された場合、処理は508
に進み、そこで、アナライザ(109)は、その領域で
以前に決定されていた補正が再使用されるようにして、
タイムリーなシミュレーションを再度実行する必要性を
回避する。一実施形態では、アナライザ(109)は、
以前に補正された領域の補正された状態が検索され、補
正データベース(114)から出力されるようにする。
さらに別の実施形態では、アナライザ(109)は、以
前に決定された補正またはマスク摂動が、補正ポストプ
ロセッサ(112)によって補正データベース(11
4)から検索され、ICマスク・レイアウト(102)
に適用されるようにする。
域とOPC等価であると判定された場合、処理は508
に進み、そこで、アナライザ(109)は、その領域で
以前に決定されていた補正が再使用されるようにして、
タイムリーなシミュレーションを再度実行する必要性を
回避する。一実施形態では、アナライザ(109)は、
以前に補正された領域の補正された状態が検索され、補
正データベース(114)から出力されるようにする。
さらに別の実施形態では、アナライザ(109)は、以
前に決定された補正またはマスク摂動が、補正ポストプ
ロセッサ(112)によって補正データベース(11
4)から検索され、ICマスク・レイアウト(102)
に適用されるようにする。
【0019】一方、ウィンドウ化領域が、OPCから見
て、以前に補正された領域のいずれとも等価でないと判
定された場合、処理は510で続行され、シミュレータ
(110)は、補正ポストプロセッサ(112)と協働
して、行うべき補正を繰り返し判定する。判定を行い、
決定された補正を適用すると、514で、シミュレータ
(110)および補正ポストプロセッサ(112)は、
決定された補正が、他のOPC等価なウィンドウ化領域
で後で再使用されるのに必要なデータを保管する。シミ
ュレータ(110)および/または補正ポストプロセッ
サ(112)は、補正データベース(114)に、ウィ
ンドウ化領域の補正前の状態の記述的データを保管す
る。加えて、一実施形態では、補正ポストプロセッサ
(112)はウィンドウ化領域の補正された状態を保管
する。別の一実施形態では、補正ポストプロセッサ(1
12)は、代わりに適用すべき補正を保管する。さらに
他の実施形態では、補正ポストプロセッサ(112)
は、その両方を保管する。
て、以前に補正された領域のいずれとも等価でないと判
定された場合、処理は510で続行され、シミュレータ
(110)は、補正ポストプロセッサ(112)と協働
して、行うべき補正を繰り返し判定する。判定を行い、
決定された補正を適用すると、514で、シミュレータ
(110)および補正ポストプロセッサ(112)は、
決定された補正が、他のOPC等価なウィンドウ化領域
で後で再使用されるのに必要なデータを保管する。シミ
ュレータ(110)および/または補正ポストプロセッ
サ(112)は、補正データベース(114)に、ウィ
ンドウ化領域の補正前の状態の記述的データを保管す
る。加えて、一実施形態では、補正ポストプロセッサ
(112)はウィンドウ化領域の補正された状態を保管
する。別の一実施形態では、補正ポストプロセッサ(1
12)は、代わりに適用すべき補正を保管する。さらに
他の実施形態では、補正ポストプロセッサ(112)
は、その両方を保管する。
【0020】オペレーション508または514から、
処理は516に進み、そこで、アナライザ(109)は
すべての領域が処理されたかどうかを判定する。アナラ
イザ(109)はオペレーション504からオペレーシ
ョン514まで、選択的にシミュレータ(110)およ
び補正ポストプロセッサ(112)を必要な回数だけ起
動し、ICマスク・レイアウト(102)のすべての領
域が処理されかつ補正されるまで、処理を反復する。
処理は516に進み、そこで、アナライザ(109)は
すべての領域が処理されたかどうかを判定する。アナラ
イザ(109)はオペレーション504からオペレーシ
ョン514まで、選択的にシミュレータ(110)およ
び補正ポストプロセッサ(112)を必要な回数だけ起
動し、ICマスク・レイアウト(102)のすべての領
域が処理されかつ補正されるまで、処理を反復する。
【0021】次に図6は、一実施形態による本発明のO
PCモジュールを組み込んだEDAツールを示す。図の
ように、EDAツール・セット600は、図1〜5を参
照して上述した本発明の教示を組み込んだOPCモジュ
ール602を含む。加えて、EDAツール・セット60
0は他のツール・モジュール604を含む。これらの他
のツール・モジュール602の例には、論理合成モジュ
ール、フェーズ割当てモジュール、レイアウト確認モジ
ュールなどが含まれるが、それだけに限定されない。
PCモジュールを組み込んだEDAツールを示す。図の
ように、EDAツール・セット600は、図1〜5を参
照して上述した本発明の教示を組み込んだOPCモジュ
ール602を含む。加えて、EDAツール・セット60
0は他のツール・モジュール604を含む。これらの他
のツール・モジュール602の例には、論理合成モジュ
ール、フェーズ割当てモジュール、レイアウト確認モジ
ュールなどが含まれるが、それだけに限定されない。
【0022】図7は、本発明を実施するために使用する
のに適したコンピュータ・システムの一実施形態を示
す。図のように、コンピュータ・システム700は、シ
ステム・バス706を介して互いに結合されているプロ
セッサ702とメモリ704を含む。システム・バス7
06には、ハード・ディスク、フロッピー(登録商標)
・ディスク等の不揮発性の大容量記憶装置708、キー
ボード、ディスプレイ等の入出力装置710、およびモ
デル、LANインターフェース等の通信インターフェー
ス712が結合される。これらの要素はそれぞれ、その
技術分野で知られている通常の機能を実行する。とりわ
け、システム・メモリ704および不揮発性大容量記憶
装置708は、本発明の上記の教示を実施する、プログ
ラム命令の作業用コピーおよび永続的コピーを格納する
のに使用される。システム・メモリ704および不揮発
性大容量記憶装置706は、IC設計を格納するのにも
使用することができる。本発明を実施するためのプログ
ラム命令の永続的コピーは、配布用のソース/媒体71
4、および任意選択で、通信インターフェース712を
使用して、工場においてまたは現場において不揮発性大
容量記憶装置708にロードすることができる。配布媒
体714の例には、テープ、CDROM、DVD等の記
録可能媒体が含まれる。一実施形態では、プログラム命
令は、図6のEDAツール600を実施する、プログラ
ム命令の集まりの一部分である。要素702〜714の
構成は、よく知られており、したがって、これ以上説明
しない。
のに適したコンピュータ・システムの一実施形態を示
す。図のように、コンピュータ・システム700は、シ
ステム・バス706を介して互いに結合されているプロ
セッサ702とメモリ704を含む。システム・バス7
06には、ハード・ディスク、フロッピー(登録商標)
・ディスク等の不揮発性の大容量記憶装置708、キー
ボード、ディスプレイ等の入出力装置710、およびモ
デル、LANインターフェース等の通信インターフェー
ス712が結合される。これらの要素はそれぞれ、その
技術分野で知られている通常の機能を実行する。とりわ
け、システム・メモリ704および不揮発性大容量記憶
装置708は、本発明の上記の教示を実施する、プログ
ラム命令の作業用コピーおよび永続的コピーを格納する
のに使用される。システム・メモリ704および不揮発
性大容量記憶装置706は、IC設計を格納するのにも
使用することができる。本発明を実施するためのプログ
ラム命令の永続的コピーは、配布用のソース/媒体71
4、および任意選択で、通信インターフェース712を
使用して、工場においてまたは現場において不揮発性大
容量記憶装置708にロードすることができる。配布媒
体714の例には、テープ、CDROM、DVD等の記
録可能媒体が含まれる。一実施形態では、プログラム命
令は、図6のEDAツール600を実施する、プログラ
ム命令の集まりの一部分である。要素702〜714の
構成は、よく知られており、したがって、これ以上説明
しない。
【0023】一般に、当業者なら、本発明が記述した実
施形態に限定されていないことを理解するであろう。そ
うではなく、本発明は添付の特許請求の範囲の趣旨およ
び範囲に含まれる変更形態および改変形態で実施するこ
とができる。したがって以上の記述は、本発明を限定す
るものではなく、例示するものであると見なすべきであ
る。
施形態に限定されていないことを理解するであろう。そ
うではなく、本発明は添付の特許請求の範囲の趣旨およ
び範囲に含まれる変更形態および改変形態で実施するこ
とができる。したがって以上の記述は、本発明を限定す
るものではなく、例示するものであると見なすべきであ
る。
【0024】以上、補正の再使用によりICマスク・レ
イアウトに対する光学的プロセス補正を実行する合理的
な手法を記述した。 [図面の簡単な説明]
イアウトに対する光学的プロセス補正を実行する合理的
な手法を記述した。 [図面の簡単な説明]
【図1】一実施形態による本発明の概要を示す図であ
る。
る。
【図2】ICマスク・レイアウトの幾何形状の辺をフラ
グメント化する概念を示す図である。
グメント化する概念を示す図である。
【図3】OPC解析のためのウィンドウ化領域の概念を
示す図(a)と、OPC解析のためのウィンドウ化領域
の概念を示す図(b)である。
示す図(a)と、OPC解析のためのウィンドウ化領域
の概念を示す図(b)である。
【図4】さらに一実施形態による補正データベースを示
す図である。
す図である。
【図5】一実施形態によるOPCモジュールのオペレー
ション上の流れを示す図である。
ション上の流れを示す図である。
【図6】一実施形態による、本発明のOPCモジュール
を組み込んだ、例示的なEDAツールを示す図である。
を組み込んだ、例示的なEDAツールを示す図である。
【図7】図6のEDAツールを実施するプログラム命令
でプログラムされるのに適したコンピュータ・システム
の例を示す図である。
でプログラムされるのに適したコンピュータ・システム
の例を示す図である。
フロントページの続き (56)参考文献 Maurer et al,Proc ess Proximity Corr ection Using an Au tomated Software T ool,proceedings of the SPIE,米国,The i nternational socie ty for optical eng neering,1998,245−253P Maurer et al,Eval uation of a fast a nd flexible OPC pa ckage:OPTISSIMO,Pr oceedings of the S PIE,米国,1996,412−418 (58)調査した分野(Int.Cl.7,DB名) G03F 1/00 - 1/16
Claims (27)
- 【請求項1】 それぞれICマスク・レイアウトのエア
リアル・サブセットである領域に対して、領域毎にIC
マスクを逐次レイアウトするためのOPCを決定するス
テップと;第2の領域が、OPCの目的において、第1
の領域と等価であるとみなされる場合、前記第1の領域
に対して決定されたOPCを、前記第2の領域に対して
再使用するステップとから構成され;各領域に対する前
記OPCは、モデル・ベース・シミュレーションを反復
使用して決定されるものであり、かつ、前記モデル・ベ
ース・シミュレーションの各々は、モデル・ベース・シ
ミュレーションが実行されている領域から拡大距離内に
ある、隣接する領域の幾何学的形状を含むことを特徴と
するICマスク・レイアウトにOPCを実行するための
方法。 - 【請求項2】 補正の適用に先立って、OPCの目的の
ために、前記方法が、各領域が既に補正済みの領域のい
ずれか1つと等価であるかどうかを決定するステップを
さらに含む、請求項1に記載の方法。 - 【請求項3】 前記幾何学的形状を特性化し、前記等価
性決定の有効な実行を容易にするために、前記方法が、
タグ識別子を用いて各領域の幾何学的形状を選択的にタ
グ付けするステップをさらに含む、請求項2に記載の方
法。 - 【請求項4】 前記方法が、前記決定されたOPCおよ
び対応する補正済み領域の補正前状態を保存するステッ
プをさらに含む、請求項1に記載の方法。 - 【請求項5】 前記決定されたOPCを再使用する前記
ステップが、前記第2の領域のために、保存されている
前記第1の領域に対して決定されたOPCを検索し、検
索したOPCを前記第2の領域に適用するステップを含
む、請求項4に記載の方法。 - 【請求項6】 前記方法が、前記補正済み領域を、その
補正済み状態および補正前状態で保存するステップをさ
らに含む、請求項1に記載の方法。 - 【請求項7】 前記決定されたOPCを再使用する前記
ステップが、前記第2の領域のために、補正済みの第1
の領域を、その補正済みの状態で検索し、補正済みの第
2の領域として使用するためのコピーを生成するステッ
プを含む、請求項6に記載の方法。 - 【請求項8】 前記モデル・ベース・シミュレーション
が、レジスト・モデル・ベース・シミュレーションおよ
び光学モデル・ベース・シミュレーションを含む、請求
項1に記載の方法。 - 【請求項9】 前記レジスト・モデル・ベース・シミュ
レーションの各々が可変しきい値レジスト・モデルを使
用する、請求項8に記載の方法。 - 【請求項10】 コンピュータ・システムをプログラム
するためのプログラム命令が記録された記録可能媒体を
備え、それぞれICマスク・レイアウトのエアリアル・
サブセットである領域に対して、領域毎にICマスクを
逐次レイアウトするためのOPCを決定し;また、第2
の領域が、OPCの目的において、第1の領域と等価で
あるとみなされる場合、前記第1の領域に対して決定さ
れたOPCを、前記第2の領域に対して再使用し;さら
に、モデル・ベース・シミュレーションを反復使用して
各領域に対するOPCを決定し;かつ、モデル・ベース
・シミュレーションを実行する場合、前記モデル・ベー
ス・シミュレーションが実行されている領域から拡大距
離内にある、隣接する領域の幾何学的形状を包含するこ
とを特徴とするICマスク・レイアウトにOPCを実行
する装置。 - 【請求項11】 補正の適用に先立って、OPCの目的
のために、前記プログラム命令が、前記コンピュータ・
システムによる、各領域が既に補正済みの領域のいずれ
か1つと等価であるかどうかの決定をさらに可能にす
る、請求項10に記載の装置。 - 【請求項12】 前記幾何学的形状を特性化し、前記等
価性決定の有効な実行を容易にするために、前記プログ
ラム命令が、前記コンピュータ・システムによる、タグ
識別子を用いた各領域の幾何学的形状の選択的タグ付け
をさらに可能にする、請求項11に記載の装置。 - 【請求項13】 前記プログラム命令が、前記コンピュ
ータ・システムによる、前記決定されたOPCおよび対
応する補正済み領域の補正前状態の保存をさらに可能に
する、請求項10に記載の装置。 - 【請求項14】 前記プログラム命令が、前記第2の領
域のために、前記コンピュータ・システムによる、保存
されている前記第1の領域に対して決定されたOPCの
検索、および検索したOPCを前記第2の領域への適用
を可能にする、請求項13に記載の装置。 - 【請求項15】 前記プログラム命令が、前記コンピュ
ータ・システムによる、前記補正済み領域の、その補正
済み状態および補正前状態での保存をさらに可能にす
る、請求項10に記載の装置。 - 【請求項16】 前記プログラム命令が、前記第2の領
域のために、前記コンピュータ・システムによる、補正
済みの第1の領域の、その補正済みの状態での検索、お
よび補正済みの第2の領域として使用するためのコピー
の生成をさらに可能にする、請求項15に記載の装置。 - 【請求項17】 前記モデル・ベース・シミュレーショ
ンを実行する場合に、前記プログラム命令が、前記コン
ピュータ・システムによる、レジスト・モデル・ベース
・シミュレーションおよび光学モデル・ベース・シミュ
レーションの包含を可能にする、請求項10に記載の装
置。 - 【請求項18】 レジスト・モデル・ベース・シミュレ
ーションを実行する場合に、前記プログラム命令が、前
記コンピュータ・システムによる可変しきい値レジスト
・モデルの使用を可能にする、請求項17に記載の装
置。 - 【請求項19】 複数のプログラム命令が格納された記
憶媒体と、 それぞれICマスク・レイアウトのエアリアル・サブセ
ットである領域に対して、領域毎にICマスクを逐次レ
イアウトするためのOPCを決定し、第2の領域が、O
PCの目的に対して、第1の領域と等価であるとみなさ
れる場合、前記第1の領域に対して決定されたOPCを
前記第2の領域に対して再使用し、また、モデル・ベー
ス・シミュレーションを用いて、各領域に対するOPC
を反復して決定し、かつ、各領域に対して、前記モデル
・ベース・シミュレーションを実行する領域から拡大距
離内にある、隣接する領域の幾何学的形状を含むモデル
・ベース・シミュレーションを実行するためのプログラ
ム命令を実行する、前記記憶媒体に結合されたプロセッ
サとを備えるコンピュータ・システム。 - 【請求項20】 補正の適用に先立って、OPCの目的
のために、前記プロセッサが、各領域が既に補正済みの
領域のいずれか1つと等価であるかどうかを決定するた
めのプログラム命令を実行する、請求項19に記載のコ
ンピュータ・システム。 - 【請求項21】 前記幾何学的形状を特性化し、前記等
価性決定の有効な実行を容易にするために、前記プロセ
ッサが、タグ識別子を用いて各領域の幾何学的形状を選
択的にタグ付けするためのプログラム命令をさらに実行
する、請求項20に記載のコンピュータ・システム。 - 【請求項22】 前記プロセッサが、前記決定されたO
PCおよび対応する補正済み領域の補正前状態を保存す
るためのプログラム命令をさらに実行する、請求項19
に記載のコンピュータ・システム。 - 【請求項23】 前記プロセッサが、前記第2の領域の
ために、前記保存されている前記第1の領域に対して決
定されたOPCを検索し、かつ、検索したOPCを前記
第2の領域に適用するためのプログラム命令をさらに実
行する、請求項22に記載のコンピュータ・システム。 - 【請求項24】 前記プロセッサが、前記補正済み領域
を、その補正済み状態および補正前状態で保存するため
のプログラム命令をさらに実行する、請求項19に記載
のコンピュータ・システム。 - 【請求項25】 前記プロセッサが、前記第2の領域の
ために、補正済みの第1の領域を、その補正済みの状態
で検索し、かつ、補正済みの第2の領域として使用する
ためのコピーを生成するためのプログラム命令をさらに
実行する、請求項24に記載のコンピュータ・システ
ム。 - 【請求項26】 前記プロセッサが、レジスト・モデル
・ベース・シミュレーションおよび光学モデル・ベース
・シミュレーションを実行するためのプログラム命令を
実行する、請求項19に記載のコンピュータ・システ
ム。 - 【請求項27】 前記プロセッサが、可変しきい値レジ
スト・モデルを使用して前記レジスト・モデル・ベース
・シミュレーションを実行するためのプログラム命令を
実行する、請求項26に記載のコンピュータ・システ
ム。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US09/302,561 | 1999-04-30 | ||
| US09/302,561 US6301697B1 (en) | 1999-04-30 | 1999-04-30 | Streamlined IC mask layout optical and process correction through correction reuse |
| PCT/US2000/005658 WO2000067074A1 (en) | 1999-04-30 | 2000-03-03 | Streamlined ic mask layout optical and process correction through correction reuse |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP3343246B1 true JP3343246B1 (ja) | 2002-11-11 |
| JP2002543470A JP2002543470A (ja) | 2002-12-17 |
Family
ID=23168275
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000615853A Ceased JP3343246B1 (ja) | 1999-04-30 | 2000-03-03 | 補正の再使用による合理的なicマスク・レイアウトの光学的プロセス補正 |
Country Status (5)
| Country | Link |
|---|---|
| US (3) | US6301697B1 (ja) |
| EP (1) | EP1177479B1 (ja) |
| JP (1) | JP3343246B1 (ja) |
| AU (1) | AU3722200A (ja) |
| WO (1) | WO2000067074A1 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8127257B2 (en) | 2008-03-03 | 2012-02-28 | Renesas Electronics Corporation | Designing method of photo-mask and method of manufacturing semiconductor device using the photo-mask |
| US8739075B2 (en) | 2008-03-21 | 2014-05-27 | Fujitsu Semiconductor Limited | Method of making pattern data, and medium for storing the program for making the pattern data |
Families Citing this family (98)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| WO2000067074A1 (en) | 2000-11-09 |
| EP1177479B1 (en) | 2011-07-27 |
| AU3722200A (en) | 2000-11-17 |
| JP2002543470A (ja) | 2002-12-17 |
| WO2000067074A9 (en) | 2002-06-20 |
| US20020026627A1 (en) | 2002-02-28 |
| US20050160388A1 (en) | 2005-07-21 |
| US7155699B2 (en) | 2006-12-26 |
| US6301697B1 (en) | 2001-10-09 |
| EP1177479A1 (en) | 2002-02-06 |
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