JP3534207B2 - 半導体ウェーハの製造方法 - Google Patents
半導体ウェーハの製造方法Info
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Description
方法に係り、特に詳しくはディスクリートデバイス用ウ
ェーハおよびディスクリートデバイス用ウェーハを用い
るエピタキシャルウェーハの製造方法に関する。
FZ法を用いて製造したシリコン単結晶をスライスした
上、ラッピング、ポリシング、熱処理等を施した半導体
ウェーハを用いて製造される。また、半導体デバイスは
動作原理によって、ディスクリートデバイス、MOS
IC、バイポーラICの3種類に分けられるが、これら
のうちディスクリートデバイスは、ダイオード、トラン
ジスタ、サイリスタ等、集積度の低い小容量の素子であ
る。
デバイス用であると否とを問わず、すべて図3に示す加
工工程を経ている。すなわち、シリコン単結晶をスライ
スし、外周の面取りを行った後、表裏両面をそれぞれ5
0〜60μmラッピングし、更に化学研磨を施す。前記
化学研磨代は40〜70μmである。次に、ウェーハ内
部に分布している高密度の微小欠陥を利用して汚染不純
物や点欠陥を捕獲するイントリンシックゲッタリング
(以下IGという)のための熱処理あるいは、ウェーハ
に形成した加工変質層を利用して汚染不純物や点欠陥を
捕獲するエクストリンシックゲッタリング(以下EGと
いう)のためのポリシリコンコーティングあるいはサン
ドブラスト等をウェーハ裏面に施す。前記処理の後、ウ
ェーハを保持盤に貼り付け、メカノケミカルポリシング
によりウェーハ表面を鏡面に仕上げる。鏡面研磨代は1
0〜20μmで、アズカットウェーハの厚さのうち12
0〜130μmは研磨されることになる。最後にウェー
ハを洗浄する。また、エピタキシャルウェーハの場合
は、洗浄後のウェーハの鏡面にエピタキシャル成長を行
う。
スは集積度が低いので、ウェーハ処理工程におけるリソ
グラフィによるレジストパターン形成の際に、集積度の
高いMOS IC、バイポーラIC用ウェーハのような
完全な鏡面を必要としない。しかし、図3においてメカ
ノケミカルポリシングを省略し、ラップドウェーハに化
学研磨のみを施した状態でリソグラフィによるレジスト
パターン形成を行うと、ディスクリートデバイスであっ
てもウェーハの表側の仕上げ面が粗すぎるため、不具合
が起こる。このため、従来の半導体ウェーハ製造工程で
は化学研磨の後にメカノケミカルポリシングを施して高
度の鏡面をもつウェーハとしている。また、不純物のゲ
ッタリングのために、IG効果を期待した熱処理と、E
G効果を期待したポリシリコンコーティング(あるいは
サンドブラスト処理)の両方を施している。従って、半
導体ウェーハ製造の工程数が多くなり、特にディスクリ
ートデバイス用ウェーハに関しては製造のリードタイム
が長く、コストが高いという問題点があった。
れたもので、ディスクリートデバイス用ウェーハおよび
このウェーハを用いるエピタキシャルウェーハとして、
加工工程数が少なく、短期間に、かつ安価に製造するこ
とができる半導体ウェーハの製造方法を提供することを
目的としている。
ーハの製造方法は、半導体ウェーハの表側および裏側の
面を、表側の面よりも裏側の面が粗く仕上げるように平
面研削し、つぎに化学研磨を行って仕上げることを特徴
とする。その場合、平面研削に用いる砥石の粒度を、ウ
ェーハの表側においては#2000以上、裏側において
は#600以下とすることを特徴とする。その場合、半
導体ウェーハの表側の面については、次工程の化学研磨
で加工変質層を完全に除去でき鏡面に近い状態に仕上が
る程度に仕上げ研削するとともに、半導体ウェーハの裏
側の面については、次工程の化学研磨で当該化学研磨後
も加工変質層が残る程度に粗く粗研削し、つぎに、半導
体ウェーハを化学研磨することにより、表側の面を、加
工変質層が完全に除去された鏡面に近い状態に仕上げる
とともに、裏側の面を、加工変質層が残る状態にするこ
とを特徴とする。
工程において、ウェーハの表側と裏側とで砥石の粒度を
変えることにしたので、ウェーハの表側の面は表面あら
さが良好な状態となり、前記平面研削工程に続く化学研
磨工程を経ることによってリソグラフィに十分対応でき
る表面状態が得られる。これに対してウェーハの裏側の
面には、平面研削工程で加えられた加工変質層が化学研
磨工程後においても残存するので、EG機能がそのまま
保持されることになる。従って、メカノケミカルポリシ
ングを行わなくても、ディスクリートデバイス用ウェー
ハおよびこのウェーハを用いるエピタキシャルウェーハ
を少ない工程数で、かつ安価に製造することができる。
方法の実施例について、図面を参照して説明する。図1
はディスクリートデバイス用ウェーハの加工工程を示
す。従来工程と同様にシリコン単結晶をスライス、面取
りした後、表裏両面を平面研削する。この場合、ウェー
ハの裏側の面は#600以下の砥石を用いて荒研削のみ
行い、表側の面については#2000以上の砥石を用い
て仕上げ研削を行う。平面研削時の研削代は表裏合わせ
て約40μmである。次に、このウェーハに表裏合わせ
て10〜20μmの化学研磨を施すが、その際、表側の
面は前記平面研削による加工変質層を完全に除去して鏡
面に近い状態に仕上げる。また、裏側の面は平面研削に
よる加工変質層が残るようにエッチングする。最後に洗
浄を行うと、ディスクリートデバイス用ウェーハが完成
する。なお、エピタキシャルウェーハの場合は、前記ウ
ェーハの表側の面にエピタキシャル成長を施す。
れた半導体ウェーハの模式的断面図である。半導体ウェ
ーハ1の表側の面1aは化学研磨により鏡面に近い状態
に仕上げられていて、デバイス製造工程で行われるリソ
グラフィに十分対応できるあらさとなっている。一方、
前記ウェーハ1の裏側の面1bには平面研削による加工
変質層2が残っていて、EG機能を発揮することができ
る。
で砥石の粒度を変え、裏側の面を粗く仕上げるととも
に、化学研磨後も裏側の加工変質層が残るようにしたの
で、従来のようにEG機能付与のための工程を設けなく
てもウェーハの裏側の面にEG機能を持たせることがで
きる。ディスクリートデバイスはMOS IC、バイポ
ーラIC等に比べて集積度が低く、構造が簡単なので、
ゲッタリング機能としてはEGのみで十分である。ま
た、化学研磨前に平面研削工程を入れることによって従
来のラップドウェーハよりも表側の面の仕上げ状態が改
善され、メカノケミカルポリシング工程を省略してもリ
ソグラフィが十分に可能となる。
ィスクリートデバイス用ウェーハおよびこのウェーハを
用いるエピタキシャルウェーハの製造に当たり、化学研
磨工程の前に平面研削工程を設け、ウェーハの表側に仕
上げ研削を、裏側に荒研削をそれぞれ施した上、化学研
磨を行うことにしたので、表側の面はメカノケミカルポ
リシングを行わなくてもデバイス製造工程のリソグラフ
ィに十分対応できる表面状態となる。また、裏側の面に
は加工変質層が残るため、EG機能がそのまま保持され
る。従って、本発明の製造方法を用いれば次の効果を得
ることができる。 (1)従来の製造方法に比べて工程が短縮されるため、
リードタイムが約20%短くなり、製造コストが低減す
る。 (2)従来の製造方法に比べて研削、研磨代が約1/2
に減少するので、素材ロスを低減させることができる。 (3)ラッピング、メカノケミカルポリシングを行わな
いので、ウェーハの厚さの目標値に対するカタヨリとバ
ラツキが小さくなるとともに、ウェーハの平坦度が向上
する。
を示す図である。
ーハの模式的断面図である。
る。
Claims (3)
- 【請求項1】 半導体ウェーハの表側および裏側の
面を、表側の面よりも裏側の面が粗く仕上げるように平
面研削し、つぎに化学研磨を行って仕上げることを特徴
とする半導体ウェーハの製造方法。 - 【請求項2】 平面研削に用いる砥石の粒度を、ウ
ェーハの表側においては#2000以上、裏側において
は#600以下とすることを特徴とする請求項1記載の
半導体ウェーハの製造方法。 - 【請求項3】 半導体ウェーハの表側の面について
は、次工程の化学研磨で加工変質層を完全に除去でき鏡
面に近い状態に仕上がる程度に仕上げ研削するととも
に、半導体ウェーハの裏側の面については、次工程の化
学研磨で当該化学研磨後も加工変質層が残る程度に粗く
粗研削し、 つぎに、半導体ウェーハを化学研磨することにより、表
側の面を、加工変質層が完全に除去された鏡面に近い状
態に仕上げるとともに、裏側の面を、加工変質層が残る
状態にすることを特徴とする半導体ウェーハの製造方
法。
Priority Applications (3)
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