JP5963732B2 - チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 - Google Patents
チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 Download PDFInfo
- Publication number
- JP5963732B2 JP5963732B2 JP2013226674A JP2013226674A JP5963732B2 JP 5963732 B2 JP5963732 B2 JP 5963732B2 JP 2013226674 A JP2013226674 A JP 2013226674A JP 2013226674 A JP2013226674 A JP 2013226674A JP 5963732 B2 JP5963732 B2 JP 5963732B2
- Authority
- JP
- Japan
- Prior art keywords
- conductive layer
- length
- chip
- value
- insulating layer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/39—Circuit design at the physical level
- G06F30/394—Routing
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/39—Circuit design at the physical level
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2119/00—Details relating to the type or aim of the analysis or the optimisation
- G06F2119/06—Power analysis or power optimisation
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2119/00—Details relating to the type or aim of the analysis or the optimisation
- G06F2119/08—Thermal analysis or thermal optimisation
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/721—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
- H10W90/722—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between stacked chips
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/721—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
- H10W90/724—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between a chip and a stacked insulating package substrate, interposer or RDL
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Evolutionary Computation (AREA)
- Geometry (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Computer Networks & Wireless Communication (AREA)
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
- Cooling Or The Like Of Electrical Apparatus (AREA)
- Structure Of Printed Boards (AREA)
Description
導電層の電流密度:100mA
許容される電圧降下:100mV
許容される電気抵抗:1Ω
1.68e−8 x Cu配線長さ / Cu配線断面積
理解容易のため、例えば、配線部225を単純に1層で構成し、Cu配線の厚さは配線部225における厚さtの半分であり残り半分が絶縁層の厚さであるとして、上の式から、Cu配線の断面積が10μmx10μm、15μmx15μmおよび20μmx20μmそれぞれの場合の電気抵抗を計算して求めた。それらの電気抵抗と長さの関係を図6にグラフで示す。図6のグラフから、Cu配線の断面積が大きくなると電気抵抗は小さくなることが分かる。許容される求めた抵抗値は1Ωであるので、図6のグラフより、電気抵抗の値が1Ω以下となるようなCu配線の断面積と長さの組を求める。例えば、Cu配線の断面積を15μmx15μmとするときには、Cu配線の長さは15mmまで許容され、従って、配線部225における長さlも15mmまで許容され、断面積15μmx15μmと長さ15mmの組が求まる。
厚さt/(1.98x長さlx長さl)
この式から、Cu配線の断面積が10μmx10μm、15μmx15μmおよび20μmx20μmそれぞれの場合の熱抵抗を計算して求めた。それらの熱抵抗と長さの関係を図7にグラフで示す。図7のグラフから、Cu配線の断面積が大きくなると熱抵抗は大きくなることが分かる。
225 配線部
230 放熱器設置の面領域
240 凹所
250 インターポーザ
410 配線基板
415、425 放熱器
Claims (16)
- チップ支持基板の配線部の裏面において放熱器設置の面領域を設定する方法であって、
前記配線部の導電層に関する電圧降下の許容値から、当該電圧降下の許容値を満たす導電層の断面積と長さの組を求めることと、
前記配線部の導電層と絶縁層に関する熱抵抗の所望値から、前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組の断面積にしたときの導電層と絶縁層が当該熱抵抗の所望値を満たす導電層と絶縁層の長さの組を求めることと、
前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組から、用いる導電層の断面積に対応する導電層の長さを選んで、選んだ導電層の長さにより定まる面積を最大値とし、前記熱抵抗の所望値に関して求めた前記導電層と絶縁層の長さの組から、前記用いる導電層の断面積に対応する導電層と絶縁層の長さを選んで、選んだ導電層と絶縁層の長さにより定まる面積を最小値とする範囲の面積に、前記放熱器設置の面領域を設定することと、
を含む、方法。 - 前記導電層の断面積と長さの組を求めることは、前記電圧降下の許容値および導電層を流れる電流値から導電層の抵抗値を求め、求めた抵抗値となる導電層の断面積と長さの組を求めることを含む、請求項1に記載の方法。
- 前記導電層と絶縁層の長さの組を求めることは、導電層と絶縁層との構成比から前記配線部の実効熱伝導率値を求め、求めた実効熱伝導率値を用いて導電層と絶縁層に関する熱抵抗値を求め、求めた熱抵抗値が前記熱抵抗の所望値となる導電層と絶縁層の長さの組を求めることを含む、請求項1又は2に記載の方法。
- チップ支持基板の製造方法であって、
設けられる配線部の導電層に関する電圧降下の許容値から、当該電圧降下の許容値を満たす導電層の断面積と長さの組を求めることと、
前記配線部の導電層と絶縁層に関する熱抵抗の所望値から、前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組の断面積にしたときの導電層と絶縁層が当該熱抵抗の所望値を満たす導電層と絶縁層の長さの組を求めることと、
前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組から、用いる導電層の断面積に対応する導電層の長さを選んで、選んだ導電層の長さにより定まる面積を最大値とし、前記熱抵抗の所望値に関して求めた前記導電層と絶縁層の長さの組から、前記用いる導電層の断面積に対応する導電層と絶縁層の長さを選んで、選んだ導電層と絶縁層の長さにより定まる面積を最小値とする範囲の面積に、前記配線部の裏面において放熱器設置の面領域を設定することと、
を含む、チップ支持基板の製造方法。 - 前記導電層の断面積と長さの組を求めることは、前記電圧降下の許容値および導電層を流れる電流値から導電層の抵抗値を求め、求めた抵抗値となる導電層の断面積と長さの組を求めることを含む、請求項4に記載のチップ支持基板の製造方法。
- 前記導電層と絶縁層の長さの組を求めることは、導電層と絶縁層との構成比から前記配線部の実効熱伝導率値を求め、求めた実効熱伝導率値を用いて導電層と絶縁層に関する熱抵抗値を求め、求めた熱抵抗値が前記熱抵抗の所望値となる導電層と絶縁層の長さの組を求めることを含む、請求項4又は5に記載のチップ支持基板の製造方法。
- 前記配線部の裏面には、凹所を設けることを含み、当該凹所の底面が前記放熱器設置の面領域を成す、請求項4〜6のいずれか1項に記載のチップ支持基板の製造方法。
- 前記配線部の表面には、チップの平面の大きさの範囲内に導電貫通ビアを有しチップに接続されるインターポーザを設けることを含む、請求項4〜7のいずれか1項に記載のチップ支持基板の製造方法。
- フリップチップを準備することと、
前記フリップチップをチップ支持基板に搭載することであって、
設けられる配線部の導電層に関する電圧降下の許容値から、当該電圧降下の許容値を満たす導電層の断面積と長さの組を求めることと、
前記配線部の導電層と絶縁層に関する熱抵抗の所望値から、前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組の断面積にしたときの導電層と絶縁層が当該熱抵抗の所望値を満たす導電層と絶縁層の長さの組を求めることと、
前記電圧降下の許容値に関して求めた前記導電層の断面積と長さの組から、用いる導電層の断面積に対応する導電層の長さを選んで、選んだ導電層の長さにより定まる面積を最大値とし、前記熱抵抗の所望値に関して求めた前記導電層と絶縁層の長さの組から、前記用いる導電層の断面積に対応する導電層と絶縁層の長さを選んで、選んだ導電層と絶縁層の長さにより定まる面積を最小値とする範囲の面積に、前記配線部の裏面において放熱器設置の面領域を設定することとを含む、前記フリップチップをチップ支持基板に搭載することと、
前記放熱器設置の面領域に放熱器を設けることと、
を含む、チップ実装構造体の製造方法。 - 前記導電層の断面積と長さの組を求めることは、前記電圧降下の許容値および導電層を流れる電流値から導電層の抵抗値を求め、求めた抵抗値となる導電層の断面積と長さの組を求めることを含む、請求項9に記載のチップ実装構造体の製造方法。
- 前記導電層と絶縁層の長さの組を求めることは、導電層と絶縁層との構成比から前記配線部の実効熱伝導率値を求め、求めた実効熱伝導率値を用いて導電層と絶縁層に関する熱抵抗値を求め、求めた熱抵抗値が前記熱抵抗の所望値となる導電層と絶縁層の長さの組を求めることを含む、請求項9又は10に記載のチップ実装構造体の製造方法。
- 前記フリップチップの上に別の放熱器を設けることを含む、請求項9〜11のいずれか1項に記載のチップ実装構造体の製造方法。
- 前記放熱器設置の面領域に対応する位置に開孔が設けられた配線基板を、前記配線部の裏面に半田接続することを含む、請求項9〜12のいずれか1項に記載のチップ実装構造体の製造方法。
- 前記配線基板を、前記配線部の裏面に熱伝導シートを介して半田接続することを含む、請求項13に記載のチップ実装構造体の製造方法。
- 前記配線部の裏面には、凹所を設けることを含み、当該凹所の底面が前記放熱器設置の面領域を成す、請求項9〜14のいずれか1項に記載のチップ実装構造体の製造方法。
- 前記配線部の表面には、チップの平面の大きさの範囲内に導電貫通ビアを有しチップに接続されるインターポーザを設けることを含む、請求項9〜15のいずれか1項に記載のチップ実装構造体の製造方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2013226674A JP5963732B2 (ja) | 2013-10-31 | 2013-10-31 | チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 |
| US14/525,292 US9558311B2 (en) | 2013-10-31 | 2014-10-28 | Surface region selection for heat sink placement |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2013226674A JP5963732B2 (ja) | 2013-10-31 | 2013-10-31 | チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2015088649A JP2015088649A (ja) | 2015-05-07 |
| JP5963732B2 true JP5963732B2 (ja) | 2016-08-03 |
Family
ID=52996967
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2013226674A Expired - Fee Related JP5963732B2 (ja) | 2013-10-31 | 2013-10-31 | チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US9558311B2 (ja) |
| JP (1) | JP5963732B2 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN109417120A (zh) * | 2016-06-23 | 2019-03-01 | 3M创新有限公司 | 柔性热电模块 |
| CN112711847B (zh) * | 2020-12-28 | 2022-02-08 | 西安科技大学 | 一种关键层位于覆岩不同位置的地表下沉系数确定方法 |
| CN113241331B (zh) * | 2021-04-22 | 2022-11-15 | 中国电子科技集团公司第二十九研究所 | 基于阵列散热的三维集成结构及其制备方法和分析方法 |
| US11887908B2 (en) | 2021-12-21 | 2024-01-30 | International Business Machines Corporation | Electronic package structure with offset stacked chips and top and bottom side cooling lid |
| CN116863870B (zh) * | 2023-09-04 | 2023-11-17 | 长春希达电子技术有限公司 | 一种降低显示灯板电源电压降的方法及显示灯板 |
Family Cites Families (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0512362A (ja) | 1991-07-02 | 1993-01-22 | Fujitsu Ltd | 回路シミユレータへの回路網入力方法 |
| EP0552475B1 (de) | 1992-01-23 | 1997-09-10 | Siemens Aktiengesellschaft | Halbleitermodul mit hoher Isolations- und Wärmefähigkeit |
| US5786635A (en) * | 1996-12-16 | 1998-07-28 | International Business Machines Corporation | Electronic package with compressible heatsink structure |
| JP2000228466A (ja) | 1999-02-08 | 2000-08-15 | Hitachi Ltd | 半導体装置及びその製造方法ならびに電子装置 |
| JP2001135753A (ja) | 1999-11-05 | 2001-05-18 | Sumitomo Metal Electronics Devices Inc | 半導体モジュール用基板及びその製造方法 |
| JP3668083B2 (ja) | 1999-12-27 | 2005-07-06 | 京セラ株式会社 | セラミック配線基板 |
| JP3815239B2 (ja) * | 2001-03-13 | 2006-08-30 | 日本電気株式会社 | 半導体素子の実装構造及びプリント配線基板 |
| JP3740116B2 (ja) | 2002-11-11 | 2006-02-01 | 三菱電機株式会社 | モールド樹脂封止型パワー半導体装置及びその製造方法 |
| JP4111187B2 (ja) | 2004-11-30 | 2008-07-02 | 松下電器産業株式会社 | 部品ユニットの製造方法 |
| JP2006165383A (ja) | 2004-12-09 | 2006-06-22 | Renesas Technology Corp | 半導体モジュール及びその製造方法 |
| JP4768024B2 (ja) | 2006-07-28 | 2011-09-07 | 京セラ株式会社 | 電子部品収納用パッケージおよび電子装置 |
| JP2012253167A (ja) | 2011-06-02 | 2012-12-20 | Denki Kagaku Kogyo Kk | 熱伝導性絶縁シート、金属ベース基板及び回路基板 |
-
2013
- 2013-10-31 JP JP2013226674A patent/JP5963732B2/ja not_active Expired - Fee Related
-
2014
- 2014-10-28 US US14/525,292 patent/US9558311B2/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| US20150121331A1 (en) | 2015-04-30 |
| JP2015088649A (ja) | 2015-05-07 |
| US9558311B2 (en) | 2017-01-31 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| CN208608187U (zh) | 固态电子组件 | |
| JP5779042B2 (ja) | 半導体装置 | |
| EP2664228B1 (en) | Devices having anisotropic conductivity heatsinks, and methods of making thereof | |
| JP5190122B2 (ja) | 熱拡散抵抗を低減した半導体アセンブリおよびその製造方法 | |
| TWI757554B (zh) | 半導體封裝裝置 | |
| US9240394B1 (en) | Stacked chips attached to heat sink having bonding pads | |
| JP4086068B2 (ja) | 半導体装置 | |
| JP6891274B2 (ja) | 電子機器 | |
| JP5963732B2 (ja) | チップ支持基板の配線部裏面に放熱器設置の面領域を設定する方法およびチップ支持基板並びにチップ実装構造体 | |
| US9595505B2 (en) | Thermally-enhanced three dimensional system-in-packages and methods for the fabrication thereof | |
| JP2002270743A (ja) | 半導体素子の実装構造 | |
| JP5740903B2 (ja) | 電子装置、半導体装置、サーマルインターポーザ及びその製造方法 | |
| JP2013243263A (ja) | 3次元積層パッケージにおける電力供給と放熱(冷却)との両立 | |
| US9515005B2 (en) | Package mounting structure | |
| CN108417546A (zh) | 电力电子模块 | |
| JP6119111B2 (ja) | 回路基板、回路基板の製造方法、電子装置及び電子装置の製造方法 | |
| JP2010251427A (ja) | 半導体モジュール | |
| CN101322450B (zh) | 具有内部散热结构的ic封装 | |
| JP6477105B2 (ja) | 半導体装置 | |
| JP2011091152A (ja) | パワーモジュール | |
| JP2011192762A (ja) | パワーモジュール | |
| WO2017115627A1 (ja) | インバータ | |
| JP5631100B2 (ja) | 電子部品搭載基板の冷却構造 | |
| JP2017130618A (ja) | 電子部品放熱構造 | |
| JP2009206398A (ja) | 冷却モジュール及び複合実装基板 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20151127 |
|
| A871 | Explanation of circumstances concerning accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A871 Effective date: 20160119 |
|
| A975 | Report on accelerated examination |
Free format text: JAPANESE INTERMEDIATE CODE: A971005 Effective date: 20160225 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20160405 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160426 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20160608 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20160628 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 5963732 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| LAPS | Cancellation because of no payment of annual fees |