JPH01162080A - ディジタルｖｔｒ - Google Patents
ディジタルｖｔｒInfo
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- JPH01162080A JPH01162080A JP62320793A JP32079387A JPH01162080A JP H01162080 A JPH01162080 A JP H01162080A JP 62320793 A JP62320793 A JP 62320793A JP 32079387 A JP32079387 A JP 32079387A JP H01162080 A JPH01162080 A JP H01162080A
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- Japan
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- circuit
- dynamic range
- minimum value
- signal
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- Television Signal Processing For Recording (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、ディジタル画像信号を高能率符号化により
、圧縮し、この圧縮されたデータを記録及び再生するよ
うにしたディジタルＶＴＲに関する。
、圧縮し、この圧縮されたデータを記録及び再生するよ
うにしたディジタルＶＴＲに関する。
この発明では、ディジタル画像信号をブロックに分割し
、ブロック内の画素データの最大値及び最小値を検出す
ると共に、最大値及び最小値の差であるダイナミックレ
ンジを検出し、ダイナミックレンジに応じて元の量子化
ビット数より少ないビット数で、画素データを量子化す
る高能率符号化装置のエンコーダ及びデコーダを有する
ディジタルＶＴＲにおいて、 ダビング時には、代表値に最大値及び最小値を含むよう
に、最大歪みを各量子化レベル間で等しくするものを量
子化方式として、使用することにより、ダビングを繰り
返した時の画質の劣化を防止するようにしたものである
。
、ブロック内の画素データの最大値及び最小値を検出す
ると共に、最大値及び最小値の差であるダイナミックレ
ンジを検出し、ダイナミックレンジに応じて元の量子化
ビット数より少ないビット数で、画素データを量子化す
る高能率符号化装置のエンコーダ及びデコーダを有する
ディジタルＶＴＲにおいて、 ダビング時には、代表値に最大値及び最小値を含むよう
に、最大歪みを各量子化レベル間で等しくするものを量
子化方式として、使用することにより、ダビングを繰り
返した時の画質の劣化を防止するようにしたものである
。
本願出願人は、特願昭５９−２６６４０７号明細書に記
載されているような、２次元ブロック内に含まれる複数
画素の最大値及び最小値により規定されるダイナミック
レンジを求め、このダイナミックレンジに適応した符号
化を行う高能率符号化装置を提案している。また、特願
昭６０−２３２７８９号明細書に記載されているように
、複数フレームに夫々含まれる領域の画素から形成され
た３次元ブロックに関してダイナミックレンジに適応し
た符号化を行う高能率符号化装置が提案されている。更
に、特願昭６０−２６８８１７号明細書に記載されてい
るように、量子化を行った時に生じる最大歪みが一定と
なるように、ダイナミックレンジに応じてビット数が変
化する可変長符号化方法が提案されている。
載されているような、２次元ブロック内に含まれる複数
画素の最大値及び最小値により規定されるダイナミック
レンジを求め、このダイナミックレンジに適応した符号
化を行う高能率符号化装置を提案している。また、特願
昭６０−２３２７８９号明細書に記載されているように
、複数フレームに夫々含まれる領域の画素から形成され
た３次元ブロックに関してダイナミックレンジに適応し
た符号化を行う高能率符号化装置が提案されている。更
に、特願昭６０−２６８８１７号明細書に記載されてい
るように、量子化を行った時に生じる最大歪みが一定と
なるように、ダイナミックレンジに応じてビット数が変
化する可変長符号化方法が提案されている。
上述のダイナミックレンジに適応した高能率符号（ＡＤ
ＲＣと称する）は、伝送すべきデータ量を大幅に圧縮で
きるので、ディジタルＶＴＲに適用して好適である。特
に、可変長ＡＤＲＣは、圧縮率を高くすることができる
。しかし、可変長ＡＤＲＣは、伝送データの量が画像の
内容によって変動するために、所定量のデータを１トラ
ツクとして記録するディジタルＶＴＲのような固定レー
トの伝送路を使用する時には、バッファリングの処理が
必要である０本願出願人は、例えば特願昭６１−２５７
５８６号明細書に記載されているように、ダイナミック
レンジの度数分布を求め、この度数分布を積算形の分布
に変換し、符号化のしきい値を積算形の度数分布に適用
して発生情報量を求め、発生情報量が伝送レートを超え
ないように制御するバッファリング装置を提案している
。
ＲＣと称する）は、伝送すべきデータ量を大幅に圧縮で
きるので、ディジタルＶＴＲに適用して好適である。特
に、可変長ＡＤＲＣは、圧縮率を高くすることができる
。しかし、可変長ＡＤＲＣは、伝送データの量が画像の
内容によって変動するために、所定量のデータを１トラ
ツクとして記録するディジタルＶＴＲのような固定レー
トの伝送路を使用する時には、バッファリングの処理が
必要である０本願出願人は、例えば特願昭６１−２５７
５８６号明細書に記載されているように、ダイナミック
レンジの度数分布を求め、この度数分布を積算形の分布
に変換し、符号化のしきい値を積算形の度数分布に適用
して発生情報量を求め、発生情報量が伝送レートを超え
ないように制御するバッファリング装置を提案している
。
上述のＡＤＲＣが高能率符号として使用されるディジタ
ルＶＴＲの一例を第３図に示す。第３図において、１が
記録側ＶＴＲを示し、２が再生側ＶＴＲを示す。３で示
す入力端子にビデオ信号が供給され、Ａ／Ｄ変換器４に
より、入力アナログビデオ信号が例えば１サンプル８ビ
ツトのディジタルビデオ信号に変換される。Ａ／Ｄ変換
器４の出力信号がブロック化回路５に供給され、テレビ
ジョン走査の順序の信号がブロックの順序に変換される
。
ルＶＴＲの一例を第３図に示す。第３図において、１が
記録側ＶＴＲを示し、２が再生側ＶＴＲを示す。３で示
す入力端子にビデオ信号が供給され、Ａ／Ｄ変換器４に
より、入力アナログビデオ信号が例えば１サンプル８ビ
ツトのディジタルビデオ信号に変換される。Ａ／Ｄ変換
器４の出力信号がブロック化回路５に供給され、テレビ
ジョン走査の順序の信号がブロックの順序に変換される
。
ブロック化回路５の出力信号がＡＤＲＣエンコーダ６に
供給される。ＡＤＲＣエンコーダ６は、例えば第４図に
示す構成を有している。２１で示す入力端子にブロック
化回路５の出力信号が供給される。このブロックの順序
の入力信号が最大値検出回路２２と最小値検出回路２３
と遅延回路２４とに供給される。最大値検出回路２２に
より、１ブロツクのビデオ信号中の最大値ＭＡＸが検出
される。この最大値ＭＡＸが減算回路２５に供給される
。最小値検出回路２３により、１ブロツクのビデオ信号
中の最小値ＭＩＮが検出される。この最小値ＭＩＮが減
算回路２５に供給される。減算回路２５により、（ＭＡ
Ｘ−ＭＩ Ｎ） で表されるブロックのダイナミックレ
ンジＤＲが求められる。
供給される。ＡＤＲＣエンコーダ６は、例えば第４図に
示す構成を有している。２１で示す入力端子にブロック
化回路５の出力信号が供給される。このブロックの順序
の入力信号が最大値検出回路２２と最小値検出回路２３
と遅延回路２４とに供給される。最大値検出回路２２に
より、１ブロツクのビデオ信号中の最大値ＭＡＸが検出
される。この最大値ＭＡＸが減算回路２５に供給される
。最小値検出回路２３により、１ブロツクのビデオ信号
中の最小値ＭＩＮが検出される。この最小値ＭＩＮが減
算回路２５に供給される。減算回路２５により、（ＭＡ
Ｘ−ＭＩ Ｎ） で表されるブロックのダイナミックレ
ンジＤＲが求められる。
遅延回路２４は、最大値ＭＡＸ及び最小値ＭＩＮを検出
するのに必要な時間、入力信号を遅延させるもので、遅
延回路２４の出力信号が減算回路２６に供給される。減
算回路２６により、最小値ＭＩＮが入力信号から減算さ
れ、最小値除去後のデータＰＤＩが形成される。
するのに必要な時間、入力信号を遅延させるもので、遅
延回路２４の出力信号が減算回路２６に供給される。減
算回路２６により、最小値ＭＩＮが入力信号から減算さ
れ、最小値除去後のデータＰＤＩが形成される。
この最小値除去後のデータＰＤＩが量子化回路２７に供
給される。量子化回路２７には、減算回路２５からのダ
イナミックレンジＤＲが供給され、ダイナミックレンジ
ＤＲに適応した量子化がなされる。量子化ビット数とし
ては、元のビット数（８ビツト）より少ないビット数が
使用される。
給される。量子化回路２７には、減算回路２５からのダ
イナミックレンジＤＲが供給され、ダイナミックレンジ
ＤＲに適応した量子化がなされる。量子化ビット数とし
ては、元のビット数（８ビツト）より少ないビット数が
使用される。
簡単のため、量子化ビット数を２ビツトとすると、ダイ
ナミックレンジＤＲが４等分されたレベル範囲が設定さ
れ、入力データがどのレベル範囲に属するかによって、
２ビツトのコード信号が割り当てられる。
ナミックレンジＤＲが４等分されたレベル範囲が設定さ
れ、入力データがどのレベル範囲に属するかによって、
２ビツトのコード信号が割り当てられる。
ブロック毎の最大値ＭＡＸ、最小値ＭＩＮ、ダイナミッ
クレンジＤＲの内の二つのデータと画素毎のコード信号
ＤＴとが記録データとして、出力端子２８．２９及び３
０に取り出される。
クレンジＤＲの内の二つのデータと画素毎のコード信号
ＤＴとが記録データとして、出力端子２８．２９及び３
０に取り出される。
ＡＤＲＣエンコーダ６から得られた付加データとしての
ダイナミックレンジＤＲ及び最小値ＭＩＮとコード信号
ＤＴとがフレーム化回路７に供給される。フレーム化回
路７は、ＡＤＲＣエンコーダ６の出力信号を記録信号の
形態に変換すると共に、エラー訂正符号化の処理を行う
ものである。
ダイナミックレンジＤＲ及び最小値ＭＩＮとコード信号
ＤＴとがフレーム化回路７に供給される。フレーム化回
路７は、ＡＤＲＣエンコーダ６の出力信号を記録信号の
形態に変換すると共に、エラー訂正符号化の処理を行う
ものである。
フレーム化回路７からの記録信号が記録側ＶＴＲ１に供
給され、例えば回転ヘッドにより磁気テープに記録され
る。
給され、例えば回転ヘッドにより磁気テープに記録され
る。
再生側ＶＴＲ２から再生された信号がフレーム分解回路
１１に供給される。フレーム分解回路１１により、エラ
ー訂正符号の復号がされると共に、ダイナミックレンジ
ＤＲ，最小値ＭＩＮ及びコード信号ＤＴが分離され、次
段のＡＤＲＣデコーダ１２に供給される。
１１に供給される。フレーム分解回路１１により、エラ
ー訂正符号の復号がされると共に、ダイナミックレンジ
ＤＲ，最小値ＭＩＮ及びコード信号ＤＴが分離され、次
段のＡＤＲＣデコーダ１２に供給される。
ＡＤＲＣデコーダ１２は、第５図に示す構成を有してい
る。第５図において、３１．３２及び３３で示す入力端
子に再生信号から分離されたダイナミックレンジＤＲ，
最小値ＭＩＮ及びコード信号ＤＴとが供給される。３４
で示すＲＯＭに対して、ダイナミックレンジＤＲ及びコ
ード信号ＤＴがアドレス信号として供給され、ＲＯＭ３
４からコード信号ＤＴの各々と対応する代表値が読み出
される。この代表値が加算回路３５に供給され、加算回
路３５で最小値ＭＩＮが加算される。加算回路３５の出
力端子３６に復元データが得られる。
る。第５図において、３１．３２及び３３で示す入力端
子に再生信号から分離されたダイナミックレンジＤＲ，
最小値ＭＩＮ及びコード信号ＤＴとが供給される。３４
で示すＲＯＭに対して、ダイナミックレンジＤＲ及びコ
ード信号ＤＴがアドレス信号として供給され、ＲＯＭ３
４からコード信号ＤＴの各々と対応する代表値が読み出
される。この代表値が加算回路３５に供給され、加算回
路３５で最小値ＭＩＮが加算される。加算回路３５の出
力端子３６に復元データが得られる。
ＡＤＲＣデコーダ１２からの復元データがブロック分解
回路１３に供給され、ブロックの順序が元のテレビジョ
ン走査の順序に戻される。ブロック分解回路１３の出力
信号がエラー修整回路１４に供給される。図示せずも、
フレーム分解回路１１におけるエラー訂正の結果性じた
エラーフラグがエラー修整回路１４に供給され、エラー
データの周辺の正しいデータの平均値等により、エラー
データが修整される。エラー修整回路１４の出力信号が
Ｄ／Ａ変換器１５に供給され、Ｄ／Ａ変換器１５の出力
に得られたアナログビデオ信号が出力端子１６に取り出
される。
回路１３に供給され、ブロックの順序が元のテレビジョ
ン走査の順序に戻される。ブロック分解回路１３の出力
信号がエラー修整回路１４に供給される。図示せずも、
フレーム分解回路１１におけるエラー訂正の結果性じた
エラーフラグがエラー修整回路１４に供給され、エラー
データの周辺の正しいデータの平均値等により、エラー
データが修整される。エラー修整回路１４の出力信号が
Ｄ／Ａ変換器１５に供給され、Ｄ／Ａ変換器１５の出力
に得られたアナログビデオ信号が出力端子１６に取り出
される。
上述の第３図に示す構成において、再生側ＶＴＲ２の再
生信号を記録側ＶＴＲ１により記録するダビングを行う
場合、再生信号を記録回路に供給する経路として、第３
図において破線で示す経路Ｌｌ、Ｌ２及びＬ３が考えら
れる。
生信号を記録側ＶＴＲ１により記録するダビングを行う
場合、再生信号を記録回路に供給する経路として、第３
図において破線で示す経路Ｌｌ、Ｌ２及びＬ３が考えら
れる。
即ち、Ｌｌの経路は、再生された信号を記録側ＶＴＲ１
の記録端子に供給する経路であり、Ｌ２の経路は、フレ
ーム分解回路１１の出力信号を記録回路のフレーム化回
路７の入力端子に供給する経路であり、Ｌ３の経路は、
エラー修整回路１４の出力信号を記録回路のブロック化
回路５に供給する経路である。これらの３個の経路の中
で、経路Ｌ１及びＬ２は、エラー修整回路１４を含まな
いために、エラーの多いＶＴＲの場合には、適用できな
い。経路Ｌ３は、エラー修整をしたデータを記録回路に
供給するので、良好なダビングが可能である。
の記録端子に供給する経路であり、Ｌ２の経路は、フレ
ーム分解回路１１の出力信号を記録回路のフレーム化回
路７の入力端子に供給する経路であり、Ｌ３の経路は、
エラー修整回路１４の出力信号を記録回路のブロック化
回路５に供給する経路である。これらの３個の経路の中
で、経路Ｌ１及びＬ２は、エラー修整回路１４を含まな
いために、エラーの多いＶＴＲの場合には、適用できな
い。経路Ｌ３は、エラー修整をしたデータを記録回路に
供給するので、良好なダビングが可能である。
（発明が解決しようとする問題点〕
しかしながら、経路Ｌ３を介してダビングを行う場合、
ＡＤＲＣデコーダ１２及びＡＤＲＣエンコーダ６を介す
るために、ノンエツジマツチング（ＮＥＭと略す）の量
子化を使用している場合には、ダビングを繰り返す度に
信号劣化を生じる問題がある。
ＡＤＲＣデコーダ１２及びＡＤＲＣエンコーダ６を介す
るために、ノンエツジマツチング（ＮＥＭと略す）の量
子化を使用している場合には、ダビングを繰り返す度に
信号劣化を生じる問題がある。
量子化ビット数を２ビツトとすると、ＮＥＭは、第６図
に示すように、最大値ＭＡＸ及び最小値ＭＩＮの差であ
るダイナミックレンジＤＲを４等分し、この分割された
レベル範囲のどの範囲に画素データのレベルが属するか
により、２ビツトを割り当て、第６図において、黒丸で
示すように、復元時の代表レベルが各レベル範囲の中央
となる方式である。一方、エツジマツチング（ＥＭと略
す）は、・第７図に示すように、ダイナミックレンジＤ
Ｒを３分割し、一つの分割範囲を更に２分割し、この１
／６の分割範囲を最大値ＭＡＸ及び最小値ＭＩＮの側に
設定し、画素データのレベルがどの範囲に属するかによ
り、２ビツトを割り当て、復元時の代表レベルとして、
最大値ＭＡＸ及び最小値ＭＩＮを含む方式である。
に示すように、最大値ＭＡＸ及び最小値ＭＩＮの差であ
るダイナミックレンジＤＲを４等分し、この分割された
レベル範囲のどの範囲に画素データのレベルが属するか
により、２ビツトを割り当て、第６図において、黒丸で
示すように、復元時の代表レベルが各レベル範囲の中央
となる方式である。一方、エツジマツチング（ＥＭと略
す）は、・第７図に示すように、ダイナミックレンジＤ
Ｒを３分割し、一つの分割範囲を更に２分割し、この１
／６の分割範囲を最大値ＭＡＸ及び最小値ＭＩＮの側に
設定し、画素データのレベルがどの範囲に属するかによ
り、２ビツトを割り当て、復元時の代表レベルとして、
最大値ＭＡＸ及び最小値ＭＩＮを含む方式である。
再生回路のＡＤＲＣデコーダ１２及び記録回路のＡＤＲ
Ｃエンコーダ６がＮＥＭの場合には、ダビングを繰り返
すことにより、第８図に示すように、信号劣化が生じる
。第８図は、簡単のために、１ブロツク内の画素数が５
個で、２ビツトの量子化を行う例に関する。
Ｃエンコーダ６がＮＥＭの場合には、ダビングを繰り返
すことにより、第８図に示すように、信号劣化が生じる
。第８図は、簡単のために、１ブロツク内の画素数が５
個で、２ビツトの量子化を行う例に関する。
第８図において、○印が最初のデータを示し、従って、
このブロックのダイナミックレンジＤＲがＤＲＯである
。ＮＥＭのＡＤＲＣエンコード及びＡＤＲＣデコードを
行うと、得られるデータは、Ｘ印で示すものとなる。次
に、再び、この×印のデータをエンコードする時、ダイ
ナミックレンジＤＲは、ＤＰＩに減少する。従って、×
印のデータをエンコード、デコードすると、Δ印のデー
タが得られる。このΔ印のデータのダイナミックレンジ
ＤＲは、ＤＲ２に減少する。
このブロックのダイナミックレンジＤＲがＤＲＯである
。ＮＥＭのＡＤＲＣエンコード及びＡＤＲＣデコードを
行うと、得られるデータは、Ｘ印で示すものとなる。次
に、再び、この×印のデータをエンコードする時、ダイ
ナミックレンジＤＲは、ＤＰＩに減少する。従って、×
印のデータをエンコード、デコードすると、Δ印のデー
タが得られる。このΔ印のデータのダイナミックレンジ
ＤＲは、ＤＲ２に減少する。
このように、ダビング（即ち、エンコード及びデコード
）をＮ回繰り返した後のダイナミックレンジＤＲｎは、 と減少するので、 となり、同じビット数の割り当てでダビングを繰り返す
と、ダイナミックレンジＤＲがなく・なってしまう。
）をＮ回繰り返した後のダイナミックレンジＤＲｎは、 と減少するので、 となり、同じビット数の割り当てでダビングを繰り返す
と、ダイナミックレンジＤＲがなく・なってしまう。
従って、この発明の目的は、ＡＤＲＣの符号化がされた
画像データをダビングする場合に、ダビングを繰り返し
ても、画質の劣化が生じることを防止できるディジタル
ＶＴＲを提供することにある。
画像データをダビングする場合に、ダビングを繰り返し
ても、画質の劣化が生じることを防止できるディジタル
ＶＴＲを提供することにある。
この発明では、ディジタル画像信号をブロックに分割し
、ブロック内の画素データの最大値及び最小値を検出す
ると共に、最大値及び最小値の差であるダイナミックレ
ンジを検出し、ダイナミックレンジに応じて元の量子化
ビット数より少ないビット数で、画素データを量子化す
る高能率符号化装置のエンコーダ及びデコーダを有する
ディジタルＶＴＲにおいて、 ダビング時には、代表値に最大値及び最小値を含むよう
に、最大歪みを各量子化レベル間で等しくするものが量
子化方式として、使用される。
、ブロック内の画素データの最大値及び最小値を検出す
ると共に、最大値及び最小値の差であるダイナミックレ
ンジを検出し、ダイナミックレンジに応じて元の量子化
ビット数より少ないビット数で、画素データを量子化す
る高能率符号化装置のエンコーダ及びデコーダを有する
ディジタルＶＴＲにおいて、 ダビング時には、代表値に最大値及び最小値を含むよう
に、最大歪みを各量子化レベル間で等しくするものが量
子化方式として、使用される。
通常の記録及び再生ときには、ＮＥＭが量子化方式とし
て使用される。また、ダビングの時には、ＥＭが量子化
方式として使用される。ダビング時に、ＥＭが使用され
ることにより、ダビングを繰り返した時でも、ダイナミ
ックレンジＤＲが減少することが防止され、画質の良好
なダビングを行うことができる。
て使用される。また、ダビングの時には、ＥＭが量子化
方式として使用される。ダビング時に、ＥＭが使用され
ることにより、ダビングを繰り返した時でも、ダイナミ
ックレンジＤＲが減少することが防止され、画質の良好
なダビングを行うことができる。
以下、この発明の一実施例について図面を参照して説明
する。第１図において、１が記録側ＶＴＲを示し、２が
再生側ＶＴＲを示す。３で示す入力端子にビデオ信号が
供給され、Ａ／Ｄ変換器４により、入力アナログビデオ
信号が例えば１サンプル８ビツトのディジタルビデオ信
号に変換される。Ａ／Ｄ変換器４の出力信号がスイッチ
回路８を介してブロック化回路５に供給され、テレビジ
ョン走査の順序の信号がブロックの順序に変換される。
する。第１図において、１が記録側ＶＴＲを示し、２が
再生側ＶＴＲを示す。３で示す入力端子にビデオ信号が
供給され、Ａ／Ｄ変換器４により、入力アナログビデオ
信号が例えば１サンプル８ビツトのディジタルビデオ信
号に変換される。Ａ／Ｄ変換器４の出力信号がスイッチ
回路８を介してブロック化回路５に供給され、テレビジ
ョン走査の順序の信号がブロックの順序に変換される。
ブロック化回路５の出力信号がＡＤＲＣエンコーダ６に
供給される。ＡＤＲＣエンコーダ６は、１ブロツクの最
大値及び最小値を検出し、最大値及び最小値の差である
ダイナミックレンジＤＲを求め、ダイナミックレンジＤ
Ｒに応じて、最小（ｔ１除去後のデータを元の量子化ビ
ット数より少ないビット数で量子化するものである。Ａ
ＤＲＣエンコーダ６は、量子化方式として、ＮＥＭ及び
ＥＭの両者が可能な構成とされている。
供給される。ＡＤＲＣエンコーダ６は、１ブロツクの最
大値及び最小値を検出し、最大値及び最小値の差である
ダイナミックレンジＤＲを求め、ダイナミックレンジＤ
Ｒに応じて、最小（ｔ１除去後のデータを元の量子化ビ
ット数より少ないビット数で量子化するものである。Ａ
ＤＲＣエンコーダ６は、量子化方式として、ＮＥＭ及び
ＥＭの両者が可能な構成とされている。
簡単のため、量子化ビット数を２ビツトとすると、ＮＥ
Ｍの場合には、ダイナミックレンジＤＲが４等分された
レベル範囲が設定され、入力データがどのレベル範囲に
属するかによって、２ビツトのコード信号が割り当てら
れる。ＮＥＭの時には、復元時の代表レベルが各レベル
範囲の中央値とされる。一方、エツジマツチング（ＥＭ
と略す）は、ダイナミックレンジＤＲを３分割し、一つ
の分割範囲を更に２分割し、この１／６の分割範囲を最
大値ＭＡＸ及び最小値ＭＩＮの側に設定し、画素データ
のレベルがどの範囲に属するかにより、２ビツトを割り
当て、復元時の代表レベルとして、最大値ＭＡＸ及び最
小値ＭＩＮを含む方式である。
Ｍの場合には、ダイナミックレンジＤＲが４等分された
レベル範囲が設定され、入力データがどのレベル範囲に
属するかによって、２ビツトのコード信号が割り当てら
れる。ＮＥＭの時には、復元時の代表レベルが各レベル
範囲の中央値とされる。一方、エツジマツチング（ＥＭ
と略す）は、ダイナミックレンジＤＲを３分割し、一つ
の分割範囲を更に２分割し、この１／６の分割範囲を最
大値ＭＡＸ及び最小値ＭＩＮの側に設定し、画素データ
のレベルがどの範囲に属するかにより、２ビツトを割り
当て、復元時の代表レベルとして、最大値ＭＡＸ及び最
小値ＭＩＮを含む方式である。
具体的には、最小値除去後のデータＰＤＩを量子化幅で
除算する割り算回路、又はダイナミックレンジＤＲ及び
最小値除去後のデータＰＤＩが供給されるＲＯＭによっ
て、ＡＤＲＣエンコーダ６の量子化回路が構成される。
除算する割り算回路、又はダイナミックレンジＤＲ及び
最小値除去後のデータＰＤＩが供給されるＲＯＭによっ
て、ＡＤＲＣエンコーダ６の量子化回路が構成される。
ＡＤＲＣエンコーダ６は、何れの量子化方式で動作する
かが、端子９からのモード信号により制御される。通常
の記録時には、ＮＥＭが量子化方式として使用され、ダ
ビング時には、ＥＭが量子化方式として使用される。
かが、端子９からのモード信号により制御される。通常
の記録時には、ＮＥＭが量子化方式として使用され、ダ
ビング時には、ＥＭが量子化方式として使用される。
２次元ブロックに限らず、３次元ブロックのブロック構
造に変換しても良く、また、可変長の符号化を行うよう
にしても良い。可変長の符号化は、複数例えば４個のし
きい値を設定し、このしきい値で区別されるダイナミッ
クレンジＤＲの範囲を夫々０ビツト、１ビツト、２ビツ
ト、３ビツト、４ビツトの異なるビット長でＡ、Ｄ Ｒ
Ｃ符号化するものであり、従って、ブロック毎に量子化
ビット数が決定される。
造に変換しても良く、また、可変長の符号化を行うよう
にしても良い。可変長の符号化は、複数例えば４個のし
きい値を設定し、このしきい値で区別されるダイナミッ
クレンジＤＲの範囲を夫々０ビツト、１ビツト、２ビツ
ト、３ビツト、４ビツトの異なるビット長でＡ、Ｄ Ｒ
Ｃ符号化するものであり、従って、ブロック毎に量子化
ビット数が決定される。
可変長ＡＤＲＣの場合、ダイナミックレンジＤＲの度数
分布を求め、しきい値で定まる総情報量を計算し、この
総情報量が所定の値以下となるように、しきい値を可変
することにより、伝送情報量のデータレートを所定値以
下に制御するバッファリングを行うことができる。この
バッファリングは、フィードフォワード型の構成である
。
分布を求め、しきい値で定まる総情報量を計算し、この
総情報量が所定の値以下となるように、しきい値を可変
することにより、伝送情報量のデータレートを所定値以
下に制御するバッファリングを行うことができる。この
バッファリングは、フィードフォワード型の構成である
。
ＡＤＲＣエンコーダ６から得られた付加データとしての
ダイナミックレンジＤＲ及び最小値ＭｒＮとコード信号
ＤＴとがフレーム化回路７に供給される。フレーム化回
路７は、ＡＤＲＣエンコーダ６の出力信号を記録信号の
形態に変換すると共に、エラー訂正符号化の処理を行う
ものである。
ダイナミックレンジＤＲ及び最小値ＭｒＮとコード信号
ＤＴとがフレーム化回路７に供給される。フレーム化回
路７は、ＡＤＲＣエンコーダ６の出力信号を記録信号の
形態に変換すると共に、エラー訂正符号化の処理を行う
ものである。
フレーム化回路７からの記録信号が記録側ＶＴＲ１に供
給され、例えば回転ヘッドにより磁気テープに記録され
る。
給され、例えば回転ヘッドにより磁気テープに記録され
る。
再生側ＶＴＲ２から再生された信号がフレーム分解回路
１１に供給される。フレーム分解回路１１により、エラ
ー訂正符号の復号がされると共に、ダイナミックレンジ
ＤＲ，最小値ＭＩＮ及びコード信号ＤＴが分離され、次
段のＡＤＲＣデコーダ１２に供給される。
１１に供給される。フレーム分解回路１１により、エラ
ー訂正符号の復号がされると共に、ダイナミックレンジ
ＤＲ，最小値ＭＩＮ及びコード信号ＤＴが分離され、次
段のＡＤＲＣデコーダ１２に供給される。
ＡＤＲＣデコーダ１２は、端子９からのモード信号と再
生信号から分離されたダイナミックレンジＤＲ，最小値
ＭＩＮとコード信号ＤＴとが供給されるＲＯＭにより構
成される。ＲＯＭからコード信号ＤＴの各々と対応する
代表値が読み出される。この代表値が加算回路に供給さ
れ、加算回路で最小値ＭＩＮが加算される。加算回路の
出力端子に復元データが得られる。このＡＤＲＣデコー
ダ１２は、モード信号により、ＮＥＭ及びＥＭの復号が
切り替えられる。ダビング時には、ＥＭの復号が行われ
る。
生信号から分離されたダイナミックレンジＤＲ，最小値
ＭＩＮとコード信号ＤＴとが供給されるＲＯＭにより構
成される。ＲＯＭからコード信号ＤＴの各々と対応する
代表値が読み出される。この代表値が加算回路に供給さ
れ、加算回路で最小値ＭＩＮが加算される。加算回路の
出力端子に復元データが得られる。このＡＤＲＣデコー
ダ１２は、モード信号により、ＮＥＭ及びＥＭの復号が
切り替えられる。ダビング時には、ＥＭの復号が行われ
る。
ＡＤＲＣデコーダ１２からの復元データがブロック分解
回路１３に供給され、ブロックの順序が元のテレビジョ
ン走査の順序に戻される。ブロック分解回路１３の出力
信号がエラー修整回路１４に供給される。図示せずも、
フレーム分解回路１１におけるエラー訂正の結果生じた
エラーフラグがエラー修整回路１４に供給され、エラー
データの周辺の正しいデータの平均値等により、エラー
データが修整される。エラー修整回路１４の出力信号が
Ｄ／Ａ変換器１５に供給され、Ｄ／Ａ変換器１５の出力
に得られたアナログビデオ信号が出力端子１６に取り出
される。
回路１３に供給され、ブロックの順序が元のテレビジョ
ン走査の順序に戻される。ブロック分解回路１３の出力
信号がエラー修整回路１４に供給される。図示せずも、
フレーム分解回路１１におけるエラー訂正の結果生じた
エラーフラグがエラー修整回路１４に供給され、エラー
データの周辺の正しいデータの平均値等により、エラー
データが修整される。エラー修整回路１４の出力信号が
Ｄ／Ａ変換器１５に供給され、Ｄ／Ａ変換器１５の出力
に得られたアナログビデオ信号が出力端子１６に取り出
される。
エラー修整回路１４の出力信号がスイッチ回路８の他方
の入力端子を通じて記録回路のブロック化回路５に供給
される。スイッチ回路８は、端子９からのモード信号に
より制御され、通常の記録時には、Ａ／Ｄ変換器４から
のディジタルビデオ信号を選択し、ダビング時には、エ
ラー修整回路１４の出力信号を選択する。
の入力端子を通じて記録回路のブロック化回路５に供給
される。スイッチ回路８は、端子９からのモード信号に
より制御され、通常の記録時には、Ａ／Ｄ変換器４から
のディジタルビデオ信号を選択し、ダビング時には、エ
ラー修整回路１４の出力信号を選択する。
上述の実施例において、通常の記録又は再生の場合には
、ＡＤＲＣエンコーダ６及びＡＤＲＣデコーダ１２が量
子化方式としてＮＥＭを使用する。
、ＡＤＲＣエンコーダ６及びＡＤＲＣデコーダ１２が量
子化方式としてＮＥＭを使用する。
ＮＥＭを使用するために、ＥＭと比較して最大歪みが小
さい量子化を行うことができる。また、ダビングの場合
には、ＡＤＲＣエンコーダ６及びＡＤＲＣデコーダ１２
が量子化方式としてＥＭを使用して、画質劣化の少ない
ダビングを行うことができる。
さい量子化を行うことができる。また、ダビングの場合
には、ＡＤＲＣエンコーダ６及びＡＤＲＣデコーダ１２
が量子化方式としてＥＭを使用して、画質劣化の少ない
ダビングを行うことができる。
第２図は、この発明の他の実施例を示す。記録側ＶＴＲ
１に関しては、上述の一実施例と同様に、Ａ／Ｄ変換器
４、スイッチ回路８、ブロック化回路５、ＡＤＲＣエン
コーダ６及びフレーム化回路７の構成が設けられている
。
１に関しては、上述の一実施例と同様に、Ａ／Ｄ変換器
４、スイッチ回路８、ブロック化回路５、ＡＤＲＣエン
コーダ６及びフレーム化回路７の構成が設けられている
。
再生側のＶＴＲ２からの再生信号がフレーム分解回路１
１に供給される。フレーム分解回路１１の出力信号がス
イッチ回路１０に供給される。このスイッチ回路１０は
、端子９からのモード信号により制御され、通常の再生
時には、フレーム分解回路１１の出力信号がＡＤＲＣデ
コーダ１２に供給される。ＡＤＲＣデコーダ１２は、Ｎ
ＥＭの量子化方式の復号を行う。このＡＤＲＣデコーダ
１２の出力信号がブロック分解回路１３、エラー修整回
路１４及びＤ／Ａ変換器１５を介して出力端子１６に取
り出される。
１に供給される。フレーム分解回路１１の出力信号がス
イッチ回路１０に供給される。このスイッチ回路１０は
、端子９からのモード信号により制御され、通常の再生
時には、フレーム分解回路１１の出力信号がＡＤＲＣデ
コーダ１２に供給される。ＡＤＲＣデコーダ１２は、Ｎ
ＥＭの量子化方式の復号を行う。このＡＤＲＣデコーダ
１２の出力信号がブロック分解回路１３、エラー修整回
路１４及びＤ／Ａ変換器１５を介して出力端子１６に取
り出される。
ダビング時には、フレーム分解回路１１の出力信号がス
イッチ回路１０により選択されてＡＤＲＣデコーダ１７
に供給される。ＡＤＲＣデコーダ１７は、ＥＭの量子化
方式の復号を行う。ＡＤＲＣデコーダ１７の出力信号が
ブロック分解回路１８に供給され、ブロック分解回路１
Ｂの出力信号がエラー修整回路１９に供給される。エラ
ー修整回路１９の出力信号がスイッチ回路８の他方の入
力端子に供給される。
イッチ回路１０により選択されてＡＤＲＣデコーダ１７
に供給される。ＡＤＲＣデコーダ１７は、ＥＭの量子化
方式の復号を行う。ＡＤＲＣデコーダ１７の出力信号が
ブロック分解回路１８に供給され、ブロック分解回路１
Ｂの出力信号がエラー修整回路１９に供給される。エラ
ー修整回路１９の出力信号がスイッチ回路８の他方の入
力端子に供給される。
上述の第２図に示される他の実施例は、再生回路に設け
られるＡＤＲＣデコーダとして、ＮＥＭ及びＥＭの復号
を行うものを別個に設けるものである。この他の実施例
によれば、ダビング中にモニター受像機で見ることがで
きる画像は、記録時のＮＥＭと一致した復号がされたデ
ータによるものであり、劣化が無いものとできる。
られるＡＤＲＣデコーダとして、ＮＥＭ及びＥＭの復号
を行うものを別個に設けるものである。この他の実施例
によれば、ダビング中にモニター受像機で見ることがで
きる画像は、記録時のＮＥＭと一致した復号がされたデ
ータによるものであり、劣化が無いものとできる。
図示せずも、記録側に設けられるＡＤＲＣエンコーダと
して、ＮＥＭ及びＥＭの各々の量子化方式でエンコード
動作を行う回路を設け、モード信号により切り換えるよ
うにしても良い。
して、ＮＥＭ及びＥＭの各々の量子化方式でエンコード
動作を行う回路を設け、モード信号により切り換えるよ
うにしても良い。
〔発明の効果］
この発明によれば、ダビングされるディジタルビデオ信
号がエラー修整されたものであるため、エラーが多い場
合でも、劣化が少ない信号をダビングすることができる
。また、この発明では、ダビング時の量子化方式として
、ＥＭを使用するので、ダイナミックレンジが減少する
ことが防止でき、ダビングを繰り返し行った時の画質の
劣化を防止することができる。
号がエラー修整されたものであるため、エラーが多い場
合でも、劣化が少ない信号をダビングすることができる
。また、この発明では、ダビング時の量子化方式として
、ＥＭを使用するので、ダイナミックレンジが減少する
ことが防止でき、ダビングを繰り返し行った時の画質の
劣化を防止することができる。
第１図はこの発明の一実施例のブロック図、第２図はこ
の発明の他の実施例のブロック図、第３図はこの発明を
適用することができるディジタルＶＴＲの一例のブロッ
ク図、第４図はＡＤＲＣエンコーダの一例のブロック図
、第５図はＡＤＲＣデコーダの一例のブロック図、第６
図及び第７図は量子化方式の説明のための路線図、第８
図はダビングを繰り返した時の信号劣化の説明に用いる
グラフである。 図面における主要な符号の説明 １：記録側ＶＴＲ１２；再生側ＶＴＲ１３：アナログビ
デオ信号の入力端子、 ６：ＡＤＲＣエンコーダ、 ８．１０：スイッチ回路、 １２ ： ＡＤＲＣテコータ、 １４：エラー修整回路。 代理人 弁理士 杉 浦 正 知 ＮＥＭ Ｅ Ｍ 第６図 第７図 夕′°こ゛〉り°′Ｂ予めイ舊号％イヒー第８図
の発明の他の実施例のブロック図、第３図はこの発明を
適用することができるディジタルＶＴＲの一例のブロッ
ク図、第４図はＡＤＲＣエンコーダの一例のブロック図
、第５図はＡＤＲＣデコーダの一例のブロック図、第６
図及び第７図は量子化方式の説明のための路線図、第８
図はダビングを繰り返した時の信号劣化の説明に用いる
グラフである。 図面における主要な符号の説明 １：記録側ＶＴＲ１２；再生側ＶＴＲ１３：アナログビ
デオ信号の入力端子、 ６：ＡＤＲＣエンコーダ、 ８．１０：スイッチ回路、 １２ ： ＡＤＲＣテコータ、 １４：エラー修整回路。 代理人 弁理士 杉 浦 正 知 ＮＥＭ Ｅ Ｍ 第６図 第７図 夕′°こ゛〉り°′Ｂ予めイ舊号％イヒー第８図
Claims (1)
- 【特許請求の範囲】 ディジタル画像信号をブロックに分割し、上記ブロック
内の画素データの最大値及び最小値を検出すると共に、
上記最大値及び最小値の差であるダイナミックレンジを
検出し、上記ダイナミックレンジに応じて元の量子化ビ
ット数より少ないビット数で、上記画素データを量子化
する高能率符号化装置のエンコーダ及びデコーダを有す
るディジタルＶＴＲにおいて、 ダビング時には、代表値に最大値及び最小値を含むよう
に、最大歪みを各量子化レベル間で等しくするものを上
記量子化方式として、使用することを特徴とするディジ
タルＶＴＲ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62320793A JPH01162080A (ja) | 1987-12-18 | 1987-12-18 | ディジタルｖｔｒ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62320793A JPH01162080A (ja) | 1987-12-18 | 1987-12-18 | ディジタルｖｔｒ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01162080A true JPH01162080A (ja) | 1989-06-26 |
Family
ID=18125305
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62320793A Pending JPH01162080A (ja) | 1987-12-18 | 1987-12-18 | ディジタルｖｔｒ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01162080A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1994009594A1 (fr) * | 1992-10-15 | 1994-04-28 | Sony Corporation | Codeur et decodeur |
| US5850261A (en) * | 1992-10-15 | 1998-12-15 | Sony Corporation | Efficient variable length encoder and decoder |
-
1987
- 1987-12-18 JP JP62320793A patent/JPH01162080A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1994009594A1 (fr) * | 1992-10-15 | 1994-04-28 | Sony Corporation | Codeur et decodeur |
| US5850261A (en) * | 1992-10-15 | 1998-12-15 | Sony Corporation | Efficient variable length encoder and decoder |
| KR100359671B1 (ko) * | 1992-10-15 | 2003-01-14 | 소니 가부시끼 가이샤 | 인코더및디코더 |
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