JPH01172893A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPH01172893A JPH01172893A JP62329908A JP32990887A JPH01172893A JP H01172893 A JPH01172893 A JP H01172893A JP 62329908 A JP62329908 A JP 62329908A JP 32990887 A JP32990887 A JP 32990887A JP H01172893 A JPH01172893 A JP H01172893A
- Authority
- JP
- Japan
- Prior art keywords
- data
- image
- memory
- selector
- character
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Processing Or Creating Images (AREA)
- Digital Computer Display Output (AREA)
- Studio Circuits (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、データの書き込み及び読み出しが可能なメ
モリを使用して画像表示などを行う画像処理装置に関す
るものである。
モリを使用して画像表示などを行う画像処理装置に関す
るものである。
カメラ等から人力された画像を例えばテレビジョンによ
りモニタ表示する場合、その画像データを一旦メモリに
記憶させておくことがあり、また画像をグラフィックデ
ータとキャラクタデータとで区分し、別々に表示させる
場合がある。このような場合、各々の用途に応じたメモ
リを設けるか、あるいは信号の切換えスイッチを設けて
一つのメモリを制御する必要がある。
りモニタ表示する場合、その画像データを一旦メモリに
記憶させておくことがあり、また画像をグラフィックデ
ータとキャラクタデータとで区分し、別々に表示させる
場合がある。このような場合、各々の用途に応じたメモ
リを設けるか、あるいは信号の切換えスイッチを設けて
一つのメモリを制御する必要がある。
従来の画像処理装置にあっては、上記のように一つのメ
モリを多目的に使用する場合１回路構成が複雑になると
いう問題点があった。
モリを多目的に使用する場合１回路構成が複雑になると
いう問題点があった。
この発明は、このような問題点に着目し、簡単な回路構
成で一つのメモリを多目的に使用できる画像処理装置を
提供しようとするものである。
成で一つのメモリを多目的に使用できる画像処理装置を
提供しようとするものである。
この発明の画像処理装置は、画像データの書き換えが可
能なメモリと、このメモリに書き込まれた画像入力部等
からの画像データを表示する画像表示部と、この表示部
に表示する画像データをグラフィックデータとキャラク
タデータとで切り換えるセレクタとを備え、システムデ
ータバスから前記メモリに対して画像データの書き込み
及び読み出しを行う時に前記画像入力部と信号を切り換
えるセレクタを設けたものである。
能なメモリと、このメモリに書き込まれた画像入力部等
からの画像データを表示する画像表示部と、この表示部
に表示する画像データをグラフィックデータとキャラク
タデータとで切り換えるセレクタとを備え、システムデ
ータバスから前記メモリに対して画像データの書き込み
及び読み出しを行う時に前記画像入力部と信号を切り換
えるセレクタを設けたものである。
この発明の画像処理装置においては、信号切換用の各セ
レクタを設けた簡単な回路で、プログラム等により一つ
のメモリに対するデータの書き込み、読み出し等の制御
が行われる。
レクタを設けた簡単な回路で、プログラム等により一つ
のメモリに対するデータの書き込み、読み出し等の制御
が行われる。
（実施例〕
第１図はこの発明の一実施例を示すブロック図であり、
この装置は画像入力部１と、画像データを処理するデー
タ処理部２と、処理された画像データを表示する画像表
示部３とから構成されている。
この装置は画像入力部１と、画像データを処理するデー
タ処理部２と、処理された画像データを表示する画像表
示部３とから構成されている。
上記第１図において、４はカメラ、５はこのカメラ４を
制御するコントローラ、６はカメラ４からの画像信号を
アナログ−ディジタル変換して二値化した信号を出力す
る二値化回路、７は上記コントローラ５の信号に同期し
たアドレス信号を発生するアドレス発生回路、８はその
アドレス信号をグラフィックデータとキャラクタデータ
とで切り換えるアドレス切換回路、９は二値化回路６か
らの信号をパラレル−シリアル変換する変換回路、１０
は画像データの書き換えが可能なメモリ（ＲＡＭ）、１
１はこのメモリ１０と上記アドレス切換回路８からの出
力によりキャラクタデータを生成するキャラクタジェネ
レータ、１２はそのキャラクタジェネレータ１１からの
信号及びメモリ１０からの信号をパラレル−シリアル変
換する変換回路、１３は表示部３に表示する画像データ
をグラフィックデータとキャラクタデータとで切り換え
るセレクタ、１４．１５はシステムデータバス１６から
上記メモリ１０に対して画像データの書き込み及び読み
出しを行う時に画像入力部１と信号を切り換えるセレク
タ、１７は上記変換回路１２の出力信号からビデオ信号
を合成するビデオ信号合成回路、１８はそのビデオ信号
に従って画像表示を行うモニタである。
制御するコントローラ、６はカメラ４からの画像信号を
アナログ−ディジタル変換して二値化した信号を出力す
る二値化回路、７は上記コントローラ５の信号に同期し
たアドレス信号を発生するアドレス発生回路、８はその
アドレス信号をグラフィックデータとキャラクタデータ
とで切り換えるアドレス切換回路、９は二値化回路６か
らの信号をパラレル−シリアル変換する変換回路、１０
は画像データの書き換えが可能なメモリ（ＲＡＭ）、１
１はこのメモリ１０と上記アドレス切換回路８からの出
力によりキャラクタデータを生成するキャラクタジェネ
レータ、１２はそのキャラクタジェネレータ１１からの
信号及びメモリ１０からの信号をパラレル−シリアル変
換する変換回路、１３は表示部３に表示する画像データ
をグラフィックデータとキャラクタデータとで切り換え
るセレクタ、１４．１５はシステムデータバス１６から
上記メモリ１０に対して画像データの書き込み及び読み
出しを行う時に画像入力部１と信号を切り換えるセレク
タ、１７は上記変換回路１２の出力信号からビデオ信号
を合成するビデオ信号合成回路、１８はそのビデオ信号
に従って画像表示を行うモニタである。
次に動作について説明する。
（イ）画像データの書き込みの時は、カメラ４から二値
化回路６を通して出力されたデータを変換回路９でシリ
アル−パラレル変換し、メモリ１０のビット長に合わせ
たパラレルデータとしてメモリ１０内に発生されたアド
レスに従って書き込む。この時、セレクタ１４゜１５は
画像入力側、切換回路８とセレクタ１３はグラフィック
側に切り換えられる。
化回路６を通して出力されたデータを変換回路９でシリ
アル−パラレル変換し、メモリ１０のビット長に合わせ
たパラレルデータとしてメモリ１０内に発生されたアド
レスに従って書き込む。この時、セレクタ１４゜１５は
画像入力側、切換回路８とセレクタ１３はグラフィック
側に切り換えられる。
（ロ）画像データの表示の時は、コントローラ５に同期
して発生されたアドレスでメモリ１０から読み出された
データを変換回路１２でパラレル−シリアル変換し、ビ
デオ信号合成回路１７に出力する。この時、セレクタ１
４゜１５は画像入出力側、切換回路８とセレクタ１３は
グラフティック側に切り換えられる。
して発生されたアドレスでメモリ１０から読み出された
データを変換回路１２でパラレル−シリアル変換し、ビ
デオ信号合成回路１７に出力する。この時、セレクタ１
４゜１５は画像入出力側、切換回路８とセレクタ１３は
グラフティック側に切り換えられる。
（ハ）キャラクタデータの表示の時は、コントローラ５
に同期して発生されたアドレスでメモリｌＯから読み出
されたデータ（キャラクタコード）をキャラクタジェネ
レータ１１に人力し、このキャラクタジェネレータ１１
からのデータを変換回路１２でパラレル−シリアル変換
してビデオ信号合成回路１７へ出力する。
に同期して発生されたアドレスでメモリｌＯから読み出
されたデータ（キャラクタコード）をキャラクタジェネ
レータ１１に人力し、このキャラクタジェネレータ１１
からのデータを変換回路１２でパラレル−シリアル変換
してビデオ信号合成回路１７へ出力する。
この時、セレクタ１４．１５は画像入出力側、切換回路
８とセレクタ１３はキャラクタ側に切り換えられる。
８とセレクタ１３はキャラクタ側に切り換えられる。
（ニ）システムデータバスアクセスの時は、システムデ
ータバス１６からのアドレスに従って画像データの読み
書き及びキャラクタコードの書き込みが行われる。この
時、各セレクタ１４．１５はシステムバス側に切り換え
られる。
ータバス１６からのアドレスに従って画像データの読み
書き及びキャラクタコードの書き込みが行われる。この
時、各セレクタ１４．１５はシステムバス側に切り換え
られる。
このようにして、画像入力部側とシステムデータバス側
からのデータの書き込み及び読み出しが一つのメモリ１
０に対して行われる。
からのデータの書き込み及び読み出しが一つのメモリ１
０に対して行われる。
その際、この一つのメモリ１０を多目的に使用すること
は、プログラム等によって簡単に行うことができる。ま
た、回路構成も簡単であり、キャラクタ表示、グラフィ
ック表示の切り換えが容易に実現できる。
は、プログラム等によって簡単に行うことができる。ま
た、回路構成も簡単であり、キャラクタ表示、グラフィ
ック表示の切り換えが容易に実現できる。
以上説明したように、この発明によれば、簡単な回路構
成で一つのメモリを多目的に使用することができ、また
グラフィック表示とキャラクタ表示の切り換えも容易に
なるという効果が得られる。
成で一つのメモリを多目的に使用することができ、また
グラフィック表示とキャラクタ表示の切り換えも容易に
なるという効果が得られる。
第１図はこの発明の一実施例を示すブロック図である。
１−−−−−−画像入力部
２−−−−−データ処理部
３−−−−−−−−−−−−画像表示部８−−−−−ア
ドレス切換回路 １０−−−−メモリ １１−−−−−−キャラクタジェネレータ１３、 １４
． １５−−−−セレクタ１６−−−−−システムデー
タバス 出願人 スタンレー電機株式会社
ドレス切換回路 １０−−−−メモリ １１−−−−−−キャラクタジェネレータ１３、 １４
． １５−−−−セレクタ１６−−−−−システムデー
タバス 出願人 スタンレー電機株式会社
Claims (1)
- 画像データの書き換えが可能なメモリと、このメモリに
書き込まれた画像入力部等からの画像データを表示する
画像表示部と、この表示部に表示する画像データをグラ
フィックデータとキャラクタデータとで切り換えるセレ
クタとを備え、システムデータバスから前記メモリに対
して画像データの書き込み及び読み出しを行う時に前記
画像入力部と信号を切り換えるセレクタを設けて成る画
像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62329908A JPH01172893A (ja) | 1987-12-28 | 1987-12-28 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62329908A JPH01172893A (ja) | 1987-12-28 | 1987-12-28 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01172893A true JPH01172893A (ja) | 1989-07-07 |
Family
ID=18226605
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62329908A Pending JPH01172893A (ja) | 1987-12-28 | 1987-12-28 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01172893A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5706033A (en) * | 1993-11-09 | 1998-01-06 | Kabushiki Kaisha Toshiba | Display data readout circuit |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5790689A (en) * | 1980-11-28 | 1982-06-05 | Nippon Electric Co | Graphic display controller |
| JPS5995589A (ja) * | 1982-11-25 | 1984-06-01 | シャープ株式会社 | Ｃｒｔ表示装置 |
| JPS59187393A (ja) * | 1983-04-07 | 1984-10-24 | 三洋電機株式会社 | 表示デ−タ出力装置 |
| JPS619687A (ja) * | 1984-06-25 | 1986-01-17 | 三菱電機株式会社 | メモリ制御方式 |
-
1987
- 1987-12-28 JP JP62329908A patent/JPH01172893A/ja active Pending
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5790689A (en) * | 1980-11-28 | 1982-06-05 | Nippon Electric Co | Graphic display controller |
| JPS5995589A (ja) * | 1982-11-25 | 1984-06-01 | シャープ株式会社 | Ｃｒｔ表示装置 |
| JPS59187393A (ja) * | 1983-04-07 | 1984-10-24 | 三洋電機株式会社 | 表示デ−タ出力装置 |
| JPS619687A (ja) * | 1984-06-25 | 1986-01-17 | 三菱電機株式会社 | メモリ制御方式 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5706033A (en) * | 1993-11-09 | 1998-01-06 | Kabushiki Kaisha Toshiba | Display data readout circuit |
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