JPH01177619U - - Google Patents
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- JPH01177619U JPH01177619U JP7426688U JP7426688U JPH01177619U JP H01177619 U JPH01177619 U JP H01177619U JP 7426688 U JP7426688 U JP 7426688U JP 7426688 U JP7426688 U JP 7426688U JP H01177619 U JPH01177619 U JP H01177619U
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- 238000006243 chemical reaction Methods 0.000 claims 2
- 230000003111 delayed effect Effects 0.000 claims 1
- 238000005070 sampling Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 5
- 238000001228 spectrum Methods 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図は本考案の一実施例の回路ブロツク図、
第２図は１例として回路の各部の波形を示す図、
第３図は復元波形の改善効果を示す図、第４図は
本実施例の補間関数を示す図、第５図は補間関数
のスペクトル図である。 １……単位遅延素子、２……減算器、１０……
第１枝路、１１……Ｄ／Ａ変換器、１２……電流
・電圧変換器、２０……第２枝路、２１……Ｄ／
Ａ変換器、２２……チヨツパ放電回路付積分器、
３０……加算器。
第２図は１例として回路の各部の波形を示す図、
第３図は復元波形の改善効果を示す図、第４図は
本実施例の補間関数を示す図、第５図は補間関数
のスペクトル図である。 １……単位遅延素子、２……減算器、１０……
第１枝路、１１……Ｄ／Ａ変換器、１２……電流
・電圧変換器、２０……第２枝路、２１……Ｄ／
Ａ変換器、２２……チヨツパ放電回路付積分器、
３０……加算器。
Claims (1)
- 入力デイジタル信号を１単位遅延した信号を入
力し、Ｄ／Ａ変換器を経て、アナログ電圧として
出力する第１枝路と、入力デイジタル信号から１
単位遅延した信号を減算して得た差分信号を入力
し、Ｄ／Ａ変換器と、その出力を１サンプリング
期間積分し、該期間の始まりに放電させるチヨツ
パ放電回路付積分器とを経て、アナログ電圧とし
て出力する第２枝路と、前記第１枝路、第２枝路
の各出力を合成し、アナログ変換出力として出力
する加算器とからなることを特徴とするＤ／Ａ変
換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7426688U JPH01177619U (ja) | 1988-06-06 | 1988-06-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7426688U JPH01177619U (ja) | 1988-06-06 | 1988-06-06 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01177619U true JPH01177619U (ja) | 1989-12-19 |
Family
ID=31299382
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7426688U Pending JPH01177619U (ja) | 1988-06-06 | 1988-06-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01177619U (ja) |
-
1988
- 1988-06-06 JP JP7426688U patent/JPH01177619U/ja active Pending