JPH01190106A - 発振回路 - Google Patents
発振回路Info
- Publication number
- JPH01190106A JPH01190106A JP63016111A JP1611188A JPH01190106A JP H01190106 A JPH01190106 A JP H01190106A JP 63016111 A JP63016111 A JP 63016111A JP 1611188 A JP1611188 A JP 1611188A JP H01190106 A JPH01190106 A JP H01190106A
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- JP
- Japan
- Prior art keywords
- oscillation
- circuit
- output
- current consumption
- detection circuit
- Prior art date
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- Pending
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- Oscillators With Electromechanical Resonators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、発振回路に係り、特に、低消費電力で動作
する発振回路に関するものである。
する発振回路に関するものである。
第４図、及び第５図は、従来の発振回路を示す回路図で
ある。図において、（１）はＣＭＯＳインバータ、（２
）は帰環抵抗、（３）は水晶振動子、（４）は発振入力
容量、（５）は発振出力容量、（６）は出力端子、（７
）は出力抵抗である。
ある。図において、（１）はＣＭＯＳインバータ、（２
）は帰環抵抗、（３）は水晶振動子、（４）は発振入力
容量、（５）は発振出力容量、（６）は出力端子、（７
）は出力抵抗である。
次に動作について説明する。ＣＭＯＳインバータ（１）
、帰環抵抗（２）よりなる増幅回路に、水晶振動子（３
）、発振人力容量（４）、発振出力容量（５）を接続す
ると、電源投入後、又は発振停止の解除後、発振が開始
し、出力端子（６）には第２図に示すような波形が出力
される。
、帰環抵抗（２）よりなる増幅回路に、水晶振動子（３
）、発振人力容量（４）、発振出力容量（５）を接続す
ると、電源投入後、又は発振停止の解除後、発振が開始
し、出力端子（６）には第２図に示すような波形が出力
される。
第３図に示す直線（１）は従来の発振回路の消費電流（
Ｉｏｓｃ ）と電源電圧（ＶＤＤ）の関係を示す。Ｖｓ
ｔａｒｔは、発振開始電圧、”ｅｎｄは発振停止電圧、
ＶＤＤ−’ＶＢ（ＶＢ＞Ｖｓｔａｒｔ）とした時の消費
電流は、Ｉｏｓｃ １となる。
Ｉｏｓｃ ）と電源電圧（ＶＤＤ）の関係を示す。Ｖｓ
ｔａｒｔは、発振開始電圧、”ｅｎｄは発振停止電圧、
ＶＤＤ−’ＶＢ（ＶＢ＞Ｖｓｔａｒｔ）とした時の消費
電流は、Ｉｏｓｃ １となる。
従来の水晶発振回路は以上のように構成されているので
、発振時の消費電流を小さくするために第５図のように
出力抵抗（７）を挿入すると・ ＩｏｓｃとＶＤＤの関
係は第３図に示す直線（２）のようになるが、Ｖ３ｔａ
ｒｔが大きくなってしまい、ｖＢをＶｓｔａｒｔより大
きくする必要がある。
、発振時の消費電流を小さくするために第５図のように
出力抵抗（７）を挿入すると・ ＩｏｓｃとＶＤＤの関
係は第３図に示す直線（２）のようになるが、Ｖ３ｔａ
ｒｔが大きくなってしまい、ｖＢをＶｓｔａｒｔより大
きくする必要がある。
この発明は、上記のような課題点を解消するため奄こな
されたもので、消費電流の小さい発振回路を得ることを
目的とする。
されたもので、消費電流の小さい発振回路を得ることを
目的とする。
この発明に係る発振回路は、発振波形の検出回路と、そ
の検出回路によって増幅回路に出力抵抗を挿入、あるい
は非挿入するスイッチ回路を備えたものである。
の検出回路によって増幅回路に出力抵抗を挿入、あるい
は非挿入するスイッチ回路を備えたものである。
この発明における発振回路は発振開始時は、出力抵抗を
挿入せず、発振開始後は、出力抵抗を挿入する。
挿入せず、発振開始後は、出力抵抗を挿入する。
第１図はこの発明の一実施例である発振回路の回路図で
ある。図において、（１）ないしく７）は従来例として
説明した第４図、及び第５図に示したものと同等である
ので説明を省略する。（８）は正常な発振が開始したか
を検出する発振動作検出回路、（９）は発振動作検出回
路によって制御されるスイッチ回路である。
ある。図において、（１）ないしく７）は従来例として
説明した第４図、及び第５図に示したものと同等である
ので説明を省略する。（８）は正常な発振が開始したか
を検出する発振動作検出回路、（９）は発振動作検出回
路によって制御されるスイッチ回路である。
また、第６図に、発振動作検出回路（８）とスイッチ回
路（９）の実施例を示す。
路（９）の実施例を示す。
電源投入時、又は発振停止の解除直後は、発振動作検出
回路（８）には、発振動作が検出されておらず、第６図
の発振動作検出回路の出力には°Ｌ”が出力され、スイ
ッチ回路（９）のトランスミッションゲートは、ＯＮし
、スイッチ回路（９）は、閉状態となる。この時消費電
流ｌ０８Ｃと電源電圧ＶＤＤの関係は、第３図に示す直
線（１）のようになり、電源電圧ＶＤＤ ＝ＶＢ （Ｄ
時、ＶＢ＞Ｖｓｔａｒｔ（Ｍ振開始１１Ｅ圧） テア
ルから発振が開始される。発振開始後は、発振動作が発
振動作検出回路（８）によって検出され、第６図の発振
動作検出回路に発振波形が入力されると、出力には”Ｈ
”が出力され、スイッチ回路（９）のトランスミッショ
ンゲートはＯＦＦ ｔ、 、スイッチ回路（９）は、開
の状態となり、出力抵抗（７）が挿入される。
回路（８）には、発振動作が検出されておらず、第６図
の発振動作検出回路の出力には°Ｌ”が出力され、スイ
ッチ回路（９）のトランスミッションゲートは、ＯＮし
、スイッチ回路（９）は、閉状態となる。この時消費電
流ｌ０８Ｃと電源電圧ＶＤＤの関係は、第３図に示す直
線（１）のようになり、電源電圧ＶＤＤ ＝ＶＢ （Ｄ
時、ＶＢ＞Ｖｓｔａｒｔ（Ｍ振開始１１Ｅ圧） テア
ルから発振が開始される。発振開始後は、発振動作が発
振動作検出回路（８）によって検出され、第６図の発振
動作検出回路に発振波形が入力されると、出力には”Ｈ
”が出力され、スイッチ回路（９）のトランスミッショ
ンゲートはＯＦＦ ｔ、 、スイッチ回路（９）は、開
の状態となり、出力抵抗（７）が挿入される。
この時、ｌ０８ＣとＶＤＤの関係は図３に示す直線（２
）のようになり、ＶＤＤ＝ＶＢの時の消費電流は、ｌ０
５Ｃ２となる。また、ＶＢ ＞ Ｖｅｎｄ （発振停止
電圧）であるから発振は停止しない。従って、発振開始
直後の消費電流は、Ｉｏｓｃｒとなるが、発振後には、
消費電流は、Ｉｏｓｃ ｚとなる。
）のようになり、ＶＤＤ＝ＶＢの時の消費電流は、ｌ０
５Ｃ２となる。また、ＶＢ ＞ Ｖｅｎｄ （発振停止
電圧）であるから発振は停止しない。従って、発振開始
直後の消費電流は、Ｉｏｓｃｒとなるが、発振後には、
消費電流は、Ｉｏｓｃ ｚとなる。
上記実施例では、水晶振動子による発振によるものを示
したが、他にセラミックフィルタによる発振回路、ＬＣ
発振回路においても同様の効果がある。
したが、他にセラミックフィルタによる発振回路、ＬＣ
発振回路においても同様の効果がある。
以上のように、この発明によれば発振動作検出回路によ
って制御されるスイッチ回路が、抵抗を挿入、あるいは
非挿入することにより、発振回路の発振時の消費電流を
小さくできる。
って制御されるスイッチ回路が、抵抗を挿入、あるいは
非挿入することにより、発振回路の発振時の消費電流を
小さくできる。
第１図は、この発明の一実施例による発振回路の回路図
、第２図は、出力端子に表れる発振波形を示す図、第３
図は、電源電圧と消費電流の関係を示すグラフ、第４図
及び第５図は、従来の発振回路の回路図である。第６図
は、この発明の実施例における発振動作検出回路と、ス
イッチ回路の具体例の回路図である。 図において（１）はＣＭＯＳインバータ、（２）は帰還
抵抗、（３）は水晶発振子、（４）は発振入力容量、（
５）は発振出力容量、（６）は出力端子、（７）は出力
抵抗、（８）は発振動作検出回路、（９）はスイッチ回
路である。 なお、図中、同一符号は同一、又は相当部分を示す。
、第２図は、出力端子に表れる発振波形を示す図、第３
図は、電源電圧と消費電流の関係を示すグラフ、第４図
及び第５図は、従来の発振回路の回路図である。第６図
は、この発明の実施例における発振動作検出回路と、ス
イッチ回路の具体例の回路図である。 図において（１）はＣＭＯＳインバータ、（２）は帰還
抵抗、（３）は水晶発振子、（４）は発振入力容量、（
５）は発振出力容量、（６）は出力端子、（７）は出力
抵抗、（８）は発振動作検出回路、（９）はスイッチ回
路である。 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (1)
- 相補形ＭＯＳ（ＣＭＯＳ）インバータからなる増幅回路
と、上記増幅回路からの出力を検出する動作検出回路と
、上記検出回路に制御されるスイッチ回路と、上記スイ
ッチ回路によつて増幅回路に挿入あるいは非挿入される
抵抗器を備えた発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63016111A JPH01190106A (ja) | 1988-01-26 | 1988-01-26 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63016111A JPH01190106A (ja) | 1988-01-26 | 1988-01-26 | 発振回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01190106A true JPH01190106A (ja) | 1989-07-31 |
Family
ID=11907403
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63016111A Pending JPH01190106A (ja) | 1988-01-26 | 1988-01-26 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01190106A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7109810B2 (en) * | 2002-01-17 | 2006-09-19 | Intel Corporation | Oscillator with tunable capacitor |
-
1988
- 1988-01-26 JP JP63016111A patent/JPH01190106A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7109810B2 (en) * | 2002-01-17 | 2006-09-19 | Intel Corporation | Oscillator with tunable capacitor |
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