JPH01221253A - プリンタ制御回路 - Google Patents
プリンタ制御回路Info
- Publication number
- JPH01221253A JPH01221253A JP63048042A JP4804288A JPH01221253A JP H01221253 A JPH01221253 A JP H01221253A JP 63048042 A JP63048042 A JP 63048042A JP 4804288 A JP4804288 A JP 4804288A JP H01221253 A JPH01221253 A JP H01221253A
- Authority
- JP
- Japan
- Prior art keywords
- printing
- register
- column
- driven
- pin
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/485—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes
- B41J2/505—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements
Landscapes
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はＯム機器の一つとして利用されているプリンタ
制御回路に関するものである。
制御回路に関するものである。
従来の技術
近年の０ム機器の発達には目を見はるものがあり、その
中の１つであるプリンタも糧々のものが開発、実用化さ
れている。
中の１つであるプリンタも糧々のものが開発、実用化さ
れている。
プリンタには活字ヘッドやデイジ−ホイールヘッドを用
いた活字方式と、ドツトの構成により文字を表現するド
ツトマトリクス方式の２種類があり、現在ではグラフィ
ック表現も自由にでき、印字速度も速いドツトマトリク
ス方式のプリンタが主流である。
いた活字方式と、ドツトの構成により文字を表現するド
ツトマトリクス方式の２種類があり、現在ではグラフィ
ック表現も自由にでき、印字速度も速いドツトマトリク
ス方式のプリンタが主流である。
この様なドツトマトリクス方式プリンタの制御回路とし
て、従来は第４図の様に構成されていた。
て、従来は第４図の様に構成されていた。
すなわち、印字データが並べられているバッファメモリ
１と、印字データをバッファメモリ１から読出し、入出
力回路（以下Ｉ１０回路という）２へ出力するためのレ
ジスタ３と、Ｉ１０回路２からの信号で印字ピンを駆動
するドライバ回路４と、印字ピンの集合である印字ヘッ
ド６より構成されていた。
１と、印字データをバッファメモリ１から読出し、入出
力回路（以下Ｉ１０回路という）２へ出力するためのレ
ジスタ３と、Ｉ１０回路２からの信号で印字ピンを駆動
するドライバ回路４と、印字ピンの集合である印字ヘッ
ド６より構成されていた。
従って、記録紙６への印字動作は、プラテン７に対向す
る印字ヘッド６がプラテン７と平行に摺動し、所定の印
字カラム位置に来ると、バッフ７メモリ１より印字デー
タのドツト情報がレジスタ３へ読出され、さらにその情
報がＩ ／ Ｏ回路２に出力され、その信号がドライバ
回路４を通じて印字ピンを駆動する。更に、印字ヘッド
６が移動し次の印字カラム位置に来ると、次のデータが
読み出され出力されるというサイクルを操り返して文字
または図形を形成してゆく。
る印字ヘッド６がプラテン７と平行に摺動し、所定の印
字カラム位置に来ると、バッフ７メモリ１より印字デー
タのドツト情報がレジスタ３へ読出され、さらにその情
報がＩ ／ Ｏ回路２に出力され、その信号がドライバ
回路４を通じて印字ピンを駆動する。更に、印字ヘッド
６が移動し次の印字カラム位置に来ると、次のデータが
読み出され出力されるというサイクルを操り返して文字
または図形を形成してゆく。
発明が解決しようとする課題
上記の様な構成において、印字ヘッド６がプラテン７と
平行に摺動しつつ、所定のカラム位置で印字ピンを駆動
して文字又は図形を形成しているが、その速度の上限は
印字ヘッド６の応答速度で決まってしまい、装置全体の
性能（印字速度）も押えられてしまうという問題があっ
た。
平行に摺動しつつ、所定のカラム位置で印字ピンを駆動
して文字又は図形を形成しているが、その速度の上限は
印字ヘッド６の応答速度で決まってしまい、装置全体の
性能（印字速度）も押えられてしまうという問題があっ
た。
本発明は上記欠点を除去し、応答速度の遅いヘッドで、
より高速印字を可能にするプリンタ制御回路を提供する
ものである。
より高速印字を可能にするプリンタ制御回路を提供する
ものである。
課題を解決するための手段
本発明は、前々カラム、及び前カラム駆動された印字ピ
ンのドツト情報を記憶する第１．第２のレジスタと、現
カラムの印字ピンのドツト情報を記憶する第３のレジス
タと、上記第１．第２のレジスタの各対応ビットの否定
論理和（Ｎ ＯＢ ）をとる第１の論理ゲートと、この
第１の論理ゲートの出力と上記第３のレジスタの各対応
ビットとの論理積（ムＮＤ）をとりかつその出力で上記
第１゜第２のレジスタの内容を順次更新する第２の論理
ゲートと、この第２の論理ゲート出力により駆動される
ドライバ回路と、このドライバ回路により駆動される印
字ヘッドとを有するものである。
ンのドツト情報を記憶する第１．第２のレジスタと、現
カラムの印字ピンのドツト情報を記憶する第３のレジス
タと、上記第１．第２のレジスタの各対応ビットの否定
論理和（Ｎ ＯＢ ）をとる第１の論理ゲートと、この
第１の論理ゲートの出力と上記第３のレジスタの各対応
ビットとの論理積（ムＮＤ）をとりかつその出力で上記
第１゜第２のレジスタの内容を順次更新する第２の論理
ゲートと、この第２の論理ゲート出力により駆動される
ドライバ回路と、このドライバ回路により駆動される印
字ヘッドとを有するものである。
作用
この様に、本発明では、印字データのドツト情報に処理
を加え、（ｎ−２）、又は（ｎ−１）カラム目で駆動し
た印字ピンは（ｎ）カラム目では駆動しないようにする
事により、印字ヘッド各ビンは連続したカラム駆動され
なくなり、必要応答速度は発でよいことになる。そこで
、印字ヘッドの摺動速度及び制御の処理速度を３倍にし
、印字ヘッドを最大応答速度で駆動することにより、従
来の３＋ｆ！の速度で文字又は図形を出力することが可
能になる。本発明の処理を２４Ｘ２４のドットマｌ−Ｉ
Ｊクスの文字フォントに加え次場合、横方向には最大８
ドツトの点を印字し、文字としても充分識別可能である
。
を加え、（ｎ−２）、又は（ｎ−１）カラム目で駆動し
た印字ピンは（ｎ）カラム目では駆動しないようにする
事により、印字ヘッド各ビンは連続したカラム駆動され
なくなり、必要応答速度は発でよいことになる。そこで
、印字ヘッドの摺動速度及び制御の処理速度を３倍にし
、印字ヘッドを最大応答速度で駆動することにより、従
来の３＋ｆ！の速度で文字又は図形を出力することが可
能になる。本発明の処理を２４Ｘ２４のドットマｌ−Ｉ
Ｊクスの文字フォントに加え次場合、横方向には最大８
ドツトの点を印字し、文字としても充分識別可能である
。
実施例
以下、本発明の一実施例を図面第１図〜第３図を用いて
説明する。第１図に本発明の一実施例によるプリンタ制
御回路を示しており、第１図において、１１はプラテン
であり、このプラテン１１には記録紙１２が巻き付けら
れている。１３はプラテン１１の軸方向に摺動しつつ、
所定カラム位置にて印字ピンを駆動し、この印字ピンに
よりインクリボンを介して記録紙１２を叩くことにより
記録紙１２に文字又は図形を形成する印字ヘッドで、Ｉ
１０回路１４からの出力によりドライバ回路１６を通じ
て駆動される。１６は所望の印字データが格納されてい
るバッフ７メモリ、１７は両前カラムに駆動された印字
ピンのドツト情報を記憶する第１のレジスタ、１８は前
カラムに駆動された印字ピンのドツト情報を記憶する第
２のレジスタ、１９は現カラムの駆動される印字ピンの
ドツト情報を記憶する第３のレジスタである。上記第１
のレジスタ１７と第２のレジスタ１８の各対応ビットは
、論理グー）２０で否定論理和（ＮＯＲ）がとられ、そ
してこの論理グー）２０の出力は、上記第３のレジスタ
１９の各対応ビットと論理ゲート２１で論理積（ムＮＤ
）がとられ、この論理ゲート２１の出力により、Ｉ１０
回路１４及びドライバ回路１５′ｆｔ通じて印字ヘッド
１３を駆動する。′また論理ゲート２１の出力は、第２
のレジスタ１８の情報が第１のレジスタ１７に転送され
た後、第２のレジスタ１８に格納され、第１及び第２の
レジスタ１７．１８の情報が更新される。否定論理和及
び論理積をとった時のビット信号の真理値表を第２図に
示す。上記の様な構成で、ｎカラム目の印字データは、
第３のレジスタ１９に格納され、その各ビットの情報は
、第１のレジスタ１７に記憶されている（ｎ−２）カラ
ム目で駆動された目】字ピンのドツト情報と第２のレジ
スタ１日に記憶されている（ｎ−１）カラム目で駆動さ
れた印字ピンのドツト情報との否定論理和出力との間で
論理項がとられ、印字ヘッド１３を駆動する信号となる
と共に、第１のレジスタ１７及び第２のレジスタ１Ｂの
内容を更新する情報となる。第３図は本実施例により印
字制御された文字の状態を示す図である。すなわち、第
３図ｅ）は本来印字すべき文字の原形である。第３図（
ｂ）は本実施例によりデータ処理された文字である。第
３図（ｂ）のｎがラム目では、２ビツト、８〜１６ビツ
ト、及び２３ビツトのドツト印字が省略されている。こ
の様に、本実施例では、ｎ−２，ｎ−１カラム目で印字
したドツトはｎカラム目では印字しない様にしているの
で、印字ヘッドの各ピンは最大の場合でも２カラムおき
にしか駆動されず、必要とする応答周波数を狛に下げる
こととなる。これはヘッドの摺動速度、すなわち印字速
度を３倍まで早めることが可能であることを意味する。
説明する。第１図に本発明の一実施例によるプリンタ制
御回路を示しており、第１図において、１１はプラテン
であり、このプラテン１１には記録紙１２が巻き付けら
れている。１３はプラテン１１の軸方向に摺動しつつ、
所定カラム位置にて印字ピンを駆動し、この印字ピンに
よりインクリボンを介して記録紙１２を叩くことにより
記録紙１２に文字又は図形を形成する印字ヘッドで、Ｉ
１０回路１４からの出力によりドライバ回路１６を通じ
て駆動される。１６は所望の印字データが格納されてい
るバッフ７メモリ、１７は両前カラムに駆動された印字
ピンのドツト情報を記憶する第１のレジスタ、１８は前
カラムに駆動された印字ピンのドツト情報を記憶する第
２のレジスタ、１９は現カラムの駆動される印字ピンの
ドツト情報を記憶する第３のレジスタである。上記第１
のレジスタ１７と第２のレジスタ１８の各対応ビットは
、論理グー）２０で否定論理和（ＮＯＲ）がとられ、そ
してこの論理グー）２０の出力は、上記第３のレジスタ
１９の各対応ビットと論理ゲート２１で論理積（ムＮＤ
）がとられ、この論理ゲート２１の出力により、Ｉ１０
回路１４及びドライバ回路１５′ｆｔ通じて印字ヘッド
１３を駆動する。′また論理ゲート２１の出力は、第２
のレジスタ１８の情報が第１のレジスタ１７に転送され
た後、第２のレジスタ１８に格納され、第１及び第２の
レジスタ１７．１８の情報が更新される。否定論理和及
び論理積をとった時のビット信号の真理値表を第２図に
示す。上記の様な構成で、ｎカラム目の印字データは、
第３のレジスタ１９に格納され、その各ビットの情報は
、第１のレジスタ１７に記憶されている（ｎ−２）カラ
ム目で駆動された目】字ピンのドツト情報と第２のレジ
スタ１日に記憶されている（ｎ−１）カラム目で駆動さ
れた印字ピンのドツト情報との否定論理和出力との間で
論理項がとられ、印字ヘッド１３を駆動する信号となる
と共に、第１のレジスタ１７及び第２のレジスタ１Ｂの
内容を更新する情報となる。第３図は本実施例により印
字制御された文字の状態を示す図である。すなわち、第
３図ｅ）は本来印字すべき文字の原形である。第３図（
ｂ）は本実施例によりデータ処理された文字である。第
３図（ｂ）のｎがラム目では、２ビツト、８〜１６ビツ
ト、及び２３ビツトのドツト印字が省略されている。こ
の様に、本実施例では、ｎ−２，ｎ−１カラム目で印字
したドツトはｎカラム目では印字しない様にしているの
で、印字ヘッドの各ピンは最大の場合でも２カラムおき
にしか駆動されず、必要とする応答周波数を狛に下げる
こととなる。これはヘッドの摺動速度、すなわち印字速
度を３倍まで早めることが可能であることを意味する。
また、本制御回路はマイクロコンピュータ等ヲ用いたソ
フト処理でも実現可能である。
フト処理でも実現可能である。
発明の効果
以上の様に本発明により、新たな文字フォントデータの
追加なしに、印字速度を上げて３倍の速度を得る３倍速
モード、及び印字速度は従来のままで、印字駆動ピンを
少なくすることによる低騒音モード等の印字が実現でき
る。また、３倍速モード用のフォント作成装置としても
使用可能であり、工業的価値の大なるものである。
追加なしに、印字速度を上げて３倍の速度を得る３倍速
モード、及び印字速度は従来のままで、印字駆動ピンを
少なくすることによる低騒音モード等の印字が実現でき
る。また、３倍速モード用のフォント作成装置としても
使用可能であり、工業的価値の大なるものである。
第１図は本発明のプリンタ制御回路の一実施例を示すブ
ロック図、第２図はビット処理時の真理値表を示す説明
図、第３図（ＩＬ） 、 （ｂ）は元になる印字データ
及び本発明の処理を加えた時に出力される印字状態を示
す説明図、第４図は従来のプリンタ制御回路を示すブロ
ック図である。 １１・・・・・・プラテン、１２・・・・・・記録紙、
１３・・・・・・印字ヘッド、１４・・・・・・Ｉ１０
回路、１６・・・・・・ドライバ回路、１６・・・・・
・バッファメモリ、１７・・・・・・第１のレジスタ、
１８・・・・・・第２のレジスタ、１９・・・・・・第
３のレジスタ、２０．２１・・・・・・論理ゲート。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名ｎ−
−プラテン Ｉ２−詔瞭概 第２図
ロック図、第２図はビット処理時の真理値表を示す説明
図、第３図（ＩＬ） 、 （ｂ）は元になる印字データ
及び本発明の処理を加えた時に出力される印字状態を示
す説明図、第４図は従来のプリンタ制御回路を示すブロ
ック図である。 １１・・・・・・プラテン、１２・・・・・・記録紙、
１３・・・・・・印字ヘッド、１４・・・・・・Ｉ１０
回路、１６・・・・・・ドライバ回路、１６・・・・・
・バッファメモリ、１７・・・・・・第１のレジスタ、
１８・・・・・・第２のレジスタ、１９・・・・・・第
３のレジスタ、２０．２１・・・・・・論理ゲート。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名ｎ−
−プラテン Ｉ２−詔瞭概 第２図
Claims (1)
- 前々カラムで駆動された印字ピンのドット情報を記憶す
る第１のレジスタと、前カラムで駆動された印字ピンの
ドット情報を記憶する第２のレジスタと、現カラムの駆
動される印字ピンのドット情報を記憶する第３のレジス
タと、上記第１、第２のレジスタの各対応ヒットの否定
論理和をとる第１の論理ゲートと、この第１論理ゲート
出力と上記第３のレジスタの各対応ビットとの論理積を
とりかつその出力で上記第１、第２のレジスタの内容を
順次更新する第２の論理ゲートと、この第２論理ゲート
により駆動されるドライバ回路と、このドライバ回路に
より駆動される印字ヘッドとを有するプリンタ制御回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63048042A JPH01221253A (ja) | 1988-03-01 | 1988-03-01 | プリンタ制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63048042A JPH01221253A (ja) | 1988-03-01 | 1988-03-01 | プリンタ制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01221253A true JPH01221253A (ja) | 1989-09-04 |
Family
ID=12792268
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63048042A Pending JPH01221253A (ja) | 1988-03-01 | 1988-03-01 | プリンタ制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01221253A (ja) |
-
1988
- 1988-03-01 JP JP63048042A patent/JPH01221253A/ja active Pending
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