JPH012377A - photo sensor - Google Patents

photo sensor

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JPH012377A
JPH012377A JP62-159123A JP15912387A JPH012377A JP H012377 A JPH012377 A JP H012377A JP 15912387 A JP15912387 A JP 15912387A JP H012377 A JPH012377 A JP H012377A
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JP
Japan
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type semiconductor
semiconductor layer
pin photodiode
photosensor
thin film
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敏一 前川
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Sony Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 以下の順序に従って本発明を説明する。[Detailed description of the invention] The present invention will be described in the following order.

A、産業上の利用分野 B9発明の概要 C1従来技術[第5図乃至第7図1 D0発明が解決しようとする問題点[第8図]E1問題
点を解決するための手段 F1作用 G、実施例[第1図乃至第4図コ H9発明の効果 (A、産業上の利用分野) 本発明はフォトセンサ、特に絶縁基板上にP型半導体層
、真性半導体層及びN型半導体層をラテラルに配置して
なるPINフォトダイオードを形成したフォトセンサに
関する。
A. Industrial field of application B9 Summary of the invention C1 Prior art [Figs. 5 to 7 1 D0 Problems to be solved by the invention [Fig. 8] E1 Means for solving the problems F1 Effects G, Embodiments [Figures 1 to 4] H9 Effects of the invention (A, Industrial application field) The present invention relates to a photosensor, in particular, a photo sensor, in which a P-type semiconductor layer, an intrinsic semiconductor layer, and an N-type semiconductor layer are laterally formed on an insulating substrate. The present invention relates to a photosensor in which a PIN photodiode is formed.

(B、発明の概要) 本発明は、上記フォトセンサにおいて、製造工程を徒ら
に増すことなくダイナミックレンシを広くするため、 
 − P型半導体層とN型半導体層とのうちの一方に一体に形
成された半導体層からなる電極と、他方の半導体層の表
面に絶縁層のコンタクトホールを通して接続され上記電
極上に絶縁層を介して積層された配線膜からなる電極と
によって構成されたキャパシタを設けてPINフォトダ
イオードの逆ハ・rアス容量の増大を図るようにしたも
のである。
(B. Summary of the Invention) The present invention provides the above-mentioned photosensor, in order to widen the dynamic range without unnecessarily increasing the manufacturing process.
- an electrode made of a semiconductor layer integrally formed on one of the P-type semiconductor layer and the N-type semiconductor layer, and an insulating layer connected to the surface of the other semiconductor layer through a contact hole in the insulating layer; A capacitor constituted by an electrode made of a wiring film laminated through the PIN photodiode is provided to increase the reverse ha-r-as capacitance of the PIN photodiode.

(C,従来技術)[第5図乃至第7図]フォトセンサと
して第5図に示すように、石英等からなる透明な絶縁基
板a上にP型半導体薄膜すとN型半導体薄膜Cとを適宜
離間して形成し、該半導体薄膜b−c間上にアモルファ
スの真性(1)半導体薄膜dを形成してラテラル型のP
INフォトダイオードPDを構成し、これを受光素子と
したものがある。第6図はPINフォトタ′イオートP
Dの等価回路図である。このPINフォトダイオードP
Dは第7図に示すようにM0SトランジスタQと直列に
接続されて光検知回路を構成する。尚、図面において、
φはMO3hラントランジスタイッチングするスイッチ
ングパルス、CHはPINフォトグイオートPDの等価
逆バイアス容量である。
(C, Prior Art) [Figures 5 to 7] As shown in Figure 5, as a photosensor, when a P-type semiconductor thin film is deposited on a transparent insulating substrate a made of quartz or the like, an N-type semiconductor thin film C is formed. An amorphous intrinsic (1) semiconductor thin film d is formed between the semiconductor thin films b and c to form a lateral type P.
There is one that constitutes an IN photodiode PD and uses this as a light receiving element. Figure 6 shows the PIN phototype auto P.
It is an equivalent circuit diagram of D. This PIN photodiode P
As shown in FIG. 7, D is connected in series with the M0S transistor Q to form a photodetector circuit. In addition, in the drawing,
φ is a switching pulse for switching the MO3h run transistor, and CH is an equivalent reverse bias capacitance of the PIN photodiode PD.

ラテラル型のPINフォトダイオードPDは、P型半導
体薄膜、真性(I)アモルファス半導体薄膜、N型半導
体薄膜を積層したサンドイッチ構造のPINフォトダイ
オードに比較して製造プロセスが部用で、必要とするフ
ォトマスクのパターンも比較的簡単で済む。従フて、低
コスト化を図ることができる点で優れているといえる。
The lateral type PIN photodiode PD requires a more detailed manufacturing process than a PIN photodiode with a sandwich structure in which a P-type semiconductor thin film, an intrinsic (I) amorphous semiconductor thin film, and an N-type semiconductor thin film are laminated, and the required photodiode The mask pattern is also relatively simple. Therefore, it can be said that it is excellent in that it can reduce costs.

(D、発明が解決しようとする問題点)[第8図] ところで、ラテラル型のPINフォトダイオードPDを
受光素子としたフォトセンサには、上述したように、製
造プロセスが簡単で、フォトマスクパターンも比較的簡
単で済むという利点があるが、その反面においてPIN
フォトダイオードPDの逆バイアス容a CHが小さく
、そのためダイナミックレンジが小さく、信号保持特性
も悪いという問題があった。
(D. Problem to be Solved by the Invention) [Figure 8] By the way, as mentioned above, the manufacturing process is simple and the photomask pattern of the photosensor using the lateral type PIN photodiode PD as the light receiving element is simple. It has the advantage of being relatively easy to use, but on the other hand, the PIN
There were problems in that the reverse bias capacitance aCH of the photodiode PD was small, resulting in a small dynamic range and poor signal retention characteristics.

というのは、通常のサンドイッチ構造のPINフォトダ
イオードに比較してラテラル型のPINフォトダイオー
ドPDはその構造の違いから必然的に逆バイアス容量C
Hが例えば3分の1以下というように非常に小さくなる
。この点について第8図に従って詳しく説明する。
This is because compared to a normal sandwich structure PIN photodiode, the lateral type PIN photodiode PD inevitably has a reverse bias capacitance C due to its structure difference.
H becomes extremely small, for example, one-third or less. This point will be explained in detail with reference to FIG.

第8図は第7図に示す光検知回路のダーク時の出力電圧
を示す特性図であり、スイッチングパルスφによってト
ランジスタQをオンにした状態からトランジスタQをオ
フに変化したときの光検知回路の出力電圧の変化を示す
(横軸は時間t)。
FIG. 8 is a characteristic diagram showing the output voltage of the photodetector circuit shown in FIG. 7 in the dark, and shows the characteristics of the photodetector circuit when the switching pulse φ changes the transistor Q from on to off. It shows the change in output voltage (the horizontal axis is time t).

この図から明らかなように、ラテラルのPINフォトダ
イオードを受光素子として用いたフォトセンサの従来の
ものは、実線で示すようにスイッチングパルスφが立ち
下ると、電源電圧Vvと略等しいレベルにあった出力電
圧Vxはその電源電圧Vvレベルから急速にアースレベ
ルに低下してしまう。そわに対してそのPINフォトダ
イオードと同程度のサイズのサンドイッチ構造のPIN
フォトダイオードの場合には破線で示すようにもっと緩
慢に出力電圧vxが低下する。この違いはPINフォト
ダイオードの逆バイアス容−計の大きさの違いに起因す
るものであり、ラテラルのPINフォトダイオードの方
がサンドイッチ構造のPINフォトダイオードに比較し
て逆バイアス容量が小さいことの現われである。
As is clear from this figure, in the conventional photosensor that uses a lateral PIN photodiode as a light receiving element, when the switching pulse φ falls, it is at a level approximately equal to the power supply voltage Vv, as shown by the solid line. The output voltage Vx rapidly drops from the power supply voltage Vv level to the ground level. A sandwich structure PIN with a size similar to that of the PIN photodiode.
In the case of a photodiode, the output voltage vx decreases more slowly as shown by the broken line. This difference is due to the difference in the size of the reverse bias capacitance of the PIN photodiode, and is an indication that the reverse bias capacitance of the lateral PIN photodiode is smaller than that of the sandwich structure PIN photodiode. It is.

そして、逆バイアス容量が小さいと、僅かな光電流で逆
バイアス容量CHの端子電圧が最大値になる。換言すれ
ば、僅かな光電流で飽和し、ダイナミックレンジが小さ
くなる。そして、信号をある程度の時間保持する保持特
性も悪くなる。これはフォトセンサの特性として好まし
いものではなかフた。
If the reverse bias capacitance is small, the terminal voltage of the reverse bias capacitor CH reaches its maximum value with a small photocurrent. In other words, saturation occurs with a small amount of photocurrent, and the dynamic range becomes small. In addition, the retention characteristic for retaining the signal for a certain period of time also deteriorates. This is not a desirable characteristic of the photosensor.

本発明はこのような問題点を解法すぺ〈為されたもので
あり、ラテラルタイプのPINフォトダイオードを受光
素子とするフォトセンサのタイナミックレンジを広くし
、信号保持特性の向上を図ることを目的とする。
The present invention has been made to solve these problems, and aims to widen the dynamic range of a photosensor that uses a lateral type PIN photodiode as a light receiving element, and to improve signal retention characteristics. shall be.

(E、問題点を解決するための手段) 本発明フォトセンサは上記問題点を解決するため、P型
半導体層とN型半導体層とのうちの一方に一体に形成さ
れた半導体層からなる電極と、他方の半導体層の表面に
絶縁層のコンタクトホールを通して接続され上記電極上
に絶縁層を介して積層された配線膜からなる電極とによ
って構成されたキャパシタを設けたことを特徴とする。
(E. Means for Solving the Problems) In order to solve the above problems, the photosensor of the present invention has an electrode made of a semiconductor layer integrally formed on one of the P-type semiconductor layer and the N-type semiconductor layer. and an electrode made of a wiring film that is connected to the surface of the other semiconductor layer through a contact hole in an insulating layer and laminated on the electrode with an insulating layer interposed therebetween.

(F、作用) 本発明フォトセンサによれば、I’lNフォトダイオー
ドの逆バイアス容量にキャパシタが並列接続されている
ので逆バイアス容量がそのキャパシタによって実質的に
増え、ダイナミックレンジが広くなり、また光検知信号
保持特性が良くなる。
(F. Effect) According to the photosensor of the present invention, since a capacitor is connected in parallel to the reverse bias capacitance of the I'IN photodiode, the reverse bias capacitance is substantially increased by the capacitor, and the dynamic range is widened. Optical detection signal retention characteristics are improved.

そして、上記キャパシタはその一方の電極がPINフォ
トダイオードを構成するP型半導体層とN型半導体層と
の一方と同じ工程で形成することができ、他方の電極が
他方の半導体層を電気的に取り出す配線膜と同じ工程で
形成することができる。従って、フォトセンサの製造工
程を増やすことなくキャパシタを形成することかでき、
コスト増を招くことなくダイナミックレンジの拡大等の
特性向上を図ることができる。
One electrode of the capacitor can be formed in the same process as one of the P-type semiconductor layer and the N-type semiconductor layer constituting the PIN photodiode, and the other electrode can electrically connect the other semiconductor layer. It can be formed in the same process as the wiring film to be taken out. Therefore, the capacitor can be formed without increasing the manufacturing process of the photosensor.
It is possible to improve characteristics such as expanding the dynamic range without increasing costs.

(G、実施例)[第1図乃至第4図] 以下、本発明フォトセンサを図示実施例に従って詳細に
説明する。
(G. Embodiment) [FIGS. 1 to 4] The photosensor of the present invention will be described in detail below according to the illustrated embodiment.

第1図乃至第4図は本発明フォトセンサの一つの実施例
を示すのであり、第1図はフォトセンサの絶縁膜を除く
各層のパターンを示す平面図、第2図は第1図の2−2
線に沿う断面図、第3図は第1図の3−3線に沿う断面
図、第4図は光検知回路図である。
1 to 4 show one embodiment of the photosensor of the present invention, FIG. 1 is a plan view showing the patterns of each layer of the photosensor except for the insulating film, and FIG. -2
3 is a sectional view taken along line 3--3 in FIG. 1, and FIG. 4 is a photodetection circuit diagram.

図面において、■は例えばガラス等からなる透明な絶縁
基板、2はNチャンネルMOSトランジスタQのドレイ
ン、チャンネル及びソースを成す半導体薄膜で、2n、
2nはドレイン、ソースを成すN型半導体領域、3はM
OSトランジスタQのゲート絶縁膜、4はシリコンゲー
ト電極、5は絶縁膜、6はソース電極取出し用窓部、7
はドレイン電極取出し用窓部、8は該窓部7を通してM
oSトランジスタQのドレイン2nに接続されたアルミ
ニウムからなる配線膜である。
In the drawing, ■ is a transparent insulating substrate made of, for example, glass, 2 is a semiconductor thin film forming the drain, channel, and source of an N-channel MOS transistor Q, 2n,
2n is an N-type semiconductor region forming the drain and source, 3 is M
Gate insulating film of OS transistor Q, 4 is a silicon gate electrode, 5 is an insulating film, 6 is a window for taking out the source electrode, 7
8 is a window for taking out the drain electrode, and 8 is a window for taking out the drain electrode.
This is a wiring film made of aluminum connected to the drain 2n of the oS transistor Q.

9はPINフォトダイオードPDを構成するN1型半導
体薄膜で、櫛形に形成されている。
Reference numeral 9 denotes an N1 type semiconductor thin film constituting the PIN photodiode PD, which is formed in a comb shape.

10は同じくPゝ型半導体薄膜で、やはり櫛型に形成さ
れており、N+型半導体薄膜9とP+型半導体薄膜10
とは互いにその一方の間の部分に他方が入り込み、両者
間に略一定の間隔が生じるような位置関係で設けられて
いる。このようにN+型半導体薄膜9とP1型型半体薄
膜10とを櫛型に形成して対向させるのは同じ占有面積
に対する対向面積の比を大きくして大きな光電流を得る
ことにより感度を大きくするためである。
Reference numeral 10 denotes a P-type semiconductor thin film, which is also formed in a comb shape, and includes an N+ type semiconductor thin film 9 and a P+ type semiconductor thin film 10.
The two are arranged in such a positional relationship that the other fits into the space between the two, creating a substantially constant distance between them. Forming the N+ type semiconductor thin film 9 and the P1 type half thin film 10 in a comb shape and making them face each other in this way increases the ratio of the opposing area to the same occupied area to obtain a large photocurrent, thereby increasing the sensitivity. This is to do so.

11はN+型半導体薄膜9とP“型半導体薄膜10との
間の部分上に形成されたアモルファスの真性(1)半導
体薄膜で、該真性(1)半導体薄膜11、半導体薄膜9
及び10によってPINフォトダイオードPDが構成さ
れる。12はP+型半導体薄膜10と一体に形成された
P゛型半導体薄膜で、矩形状に形成されている。13は
アルミニウムからなり上記配線膜8と同時に形成された
配線膜であり、上記コンタクトホール6を通じてMoS
トラジスタQのソースに接続され、また別のコンタクト
ホール14を通じてN3型半導体薄膜9の表面に接続さ
れており、そして、PINフォトダイオードPDを迂回
して上記P+型半導体薄膜12上に絶縁膜5を介して積
層されている。この配線膜13は上記迂回部分において
は細くされているが、半導体薄膜12上方の部分におい
ては該薄11i 12と対向するように広く形成されて
いる。
Reference numeral 11 denotes an amorphous intrinsic (1) semiconductor thin film formed on a portion between the N+ type semiconductor thin film 9 and the P" type semiconductor thin film 10, and the intrinsic (1) semiconductor thin film 11 and the semiconductor thin film 9
and 10 constitute a PIN photodiode PD. Reference numeral 12 denotes a P'' type semiconductor thin film formed integrally with the P+ type semiconductor thin film 10, and is formed in a rectangular shape. Reference numeral 13 denotes a wiring film made of aluminum and formed at the same time as the wiring film 8.
The insulating film 5 is connected to the source of the transistor Q and to the surface of the N3 type semiconductor thin film 9 through another contact hole 14, and bypasses the PIN photodiode PD to form an insulating film 5 on the P+ type semiconductor thin film 12. Laminated through. The wiring film 13 is thin in the detour portion, but is widened in the portion above the semiconductor thin film 12 so as to face the thin film 11i 12.

しかして、P+型半導体薄膜12と、それと絶縁膜5を
介して対向する配線膜13とによってキャパシタCPが
構成される。このキャパシタCPはPINフォトダイオ
ードPDにパラレルに接続されることになり、従って、
第4図に示すような光検知回路が構成されることになる
Thus, the capacitor CP is constituted by the P+ type semiconductor thin film 12 and the wiring film 13 facing the P+ type semiconductor thin film 12 with the insulating film 5 interposed therebetween. This capacitor CP will be connected in parallel to the PIN photodiode PD, thus:
A photodetection circuit as shown in FIG. 4 will be constructed.

即ち、PINフォトタイオードPD自身は固有の逆バイ
アス容量C□を有しているか、それに配線IE213と
P3型型半体薄i1A t 2を電極とするキャパシタ
CPがパラレルに接続されることになり、このキャパシ
タCPによってPINフォトダイオードPDに固有の逆
バイアス容量C,,の容量不足を補うことかできる。従
って、キャパシタCPの容量不足に起因したダイナミッ
クレンジ不足を解消し、また、信号保持特性を向上させ
ることができる。具体的には、キャパシタcpによって
PINフォトダイオードPDの実効的逆バイアス容量を
サンドイッチ構造のPINフォトダイオードの実効的逆
バイアス容量並にすること(第8図破線参照)が容易に
なる。
In other words, the PIN photodiode PD itself has its own reverse bias capacitance C□, or the wiring IE213 and the capacitor CP whose electrodes are the P3 type half-thin i1A t2 are connected in parallel. , this capacitor CP can compensate for the insufficiency of the reverse bias capacitance C, , inherent in the PIN photodiode PD. Therefore, it is possible to solve the problem of insufficient dynamic range due to insufficient capacity of the capacitor CP, and to improve signal retention characteristics. Specifically, the capacitor cp makes it easy to make the effective reverse bias capacitance of the PIN photodiode PD similar to that of the sandwich-structured PIN photodiode (see the broken line in FIG. 8).

そして、キャパシタCPの一方の電極を成すP型ゝ半導
体薄膜12はP1型型半体薄膜10と一体に形成され、
キャパシタCPの他方の電極を成す配線膜13は配線膜
8と同時に形成されており、キャパシタCPを形成する
ために特別の工程を設けることは必要としない。従って
、特別に工程を設けることなく、ダイナミックレンジの
拡大等特性の改善を図ることができる。
The P-type semiconductor thin film 12 forming one electrode of the capacitor CP is formed integrally with the P1-type half thin film 10.
The wiring film 13 forming the other electrode of the capacitor CP is formed at the same time as the wiring film 8, and no special process is required to form the capacitor CP. Therefore, it is possible to improve characteristics such as expanding the dynamic range without providing a special process.

(H,発明の効果) 以上に述べたように、本発明フォトセンサは、絶縁基板
上にP型半導体層、真性半導体層及びN型半導体層をラ
テラルに配置してなるPINフォトダイオードを形成し
たフォトセンサにおいて、上記N型半導体層とP型半導
体層とのうちの一方と一体に形成された半導体層により
構成されたTi極と、上記N型半導体層とP型半導体層
とのうちの他方の表面に絶縁膜の窓開部を通して接続さ
れ上記電極上に絶縁膜を介して積層された配線膜により
構成された電極と、からなるキャパシタを、上記絶縁基
板上の上記PINフォトダイオードの近傍に設けたこと
を特徴とするものである。
(H, Effects of the Invention) As described above, the photosensor of the present invention has a PIN photodiode formed by laterally disposing a P-type semiconductor layer, an intrinsic semiconductor layer, and an N-type semiconductor layer on an insulating substrate. In the photosensor, a Ti pole constituted by a semiconductor layer integrally formed with one of the N-type semiconductor layer and the P-type semiconductor layer, and the other of the N-type semiconductor layer and the P-type semiconductor layer. A capacitor consisting of an electrode connected to the surface of the insulating film through a window opening and formed of a wiring film laminated on the above electrode via an insulating film is placed near the PIN photodiode on the insulating substrate. It is characterized by the fact that it has been provided.

従って、本発明フォトセンサによれば、PINフォトダ
イオードの逆バイアス容量にキャパシタが並列接続され
ているので逆バイアス容量がそのキャパシタによって実
質的に増え、ダイナミックレンジが広くなり、また光検
知信号保持特性が良くなる。
Therefore, according to the photosensor of the present invention, since the capacitor is connected in parallel to the reverse bias capacitance of the PIN photodiode, the reverse bias capacitance is substantially increased by the capacitor, the dynamic range is widened, and the photodetection signal retention characteristic is gets better.

そして、上記キャパシタはその一方の電極がPINフォ
トダイオードを構成するP型半導体層とNjq半導体層
との一方と同じ工程で形成することができ、他方の電極
が他方の半導体層を電気的に取り出す配線膜と同じ工程
で形成することができる。従って、フォトセンサの製造
工程を増やすことなくキャパシタを形成することができ
、コスト増を招くことなくダイナミックレンジの拡大等
の特性向上を図ることができる。
The capacitor can be formed in the same process as one of the P-type semiconductor layer and the Njq semiconductor layer that constitute the PIN photodiode, and the other electrode can electrically take out the other semiconductor layer. It can be formed in the same process as the wiring film. Therefore, the capacitor can be formed without increasing the manufacturing process of the photosensor, and characteristics such as an expansion of the dynamic range can be improved without increasing the cost.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図乃至第4図は本発明フォトセンサの一つの実施例
を説明するためのもので、第1図はフォ[センサの絶縁
膜を除く8膜のパターンを示す平面図、第2図はフォト
センサの断面構造を示すところの第1図の2−2線に沿
う断面図、第3図は同じく3−3線に沿う断面図、第4
図は光検知回路を示す回路図、第5図乃至第7図は従来
技術を示すもので、第5図はフォトセンサの断面図、第
6図は等価回路図、第7図は光検知回路図、第8図は発
明が解決しようとする問題点を説明するためのダーク時
の出力電圧を示す特性図である。 符号の説明 1・・・絶縁基板、5・・・絶縁膜、 9・・・N型半導体層、 10・・・P型半導体層、 11・・・真性半導体層、 12.13・・・電極、 PD・・・PINフォトダイオード、 Cp ・・・キャパシタ。 −。9品2ご へ−」 光検知回路図 第4図 崎 袂
1 to 4 are for explaining one embodiment of the photosensor of the present invention. FIG. 1 is a plan view showing a pattern of eight films excluding the insulating film of the photo sensor, and FIG. A cross-sectional view taken along line 2-2 in Figure 1 showing the cross-sectional structure of the photosensor, Figure 3 is a cross-sectional view taken along line 3-3, and Figure 4 is a cross-sectional view taken along line 3-3.
The figure is a circuit diagram showing a photodetection circuit, and Figures 5 to 7 show conventional technology. Figure 5 is a cross-sectional view of a photosensor, Figure 6 is an equivalent circuit diagram, and Figure 7 is a photodetector circuit. FIG. 8 is a characteristic diagram showing the output voltage in the dark for explaining the problem to be solved by the invention. Explanation of symbols 1... Insulating substrate, 5... Insulating film, 9... N-type semiconductor layer, 10... P-type semiconductor layer, 11... Intrinsic semiconductor layer, 12.13... Electrode , PD...PIN photodiode, Cp...capacitor. −. 9 products 2 items -" Light detection circuit diagram 4th picture

Claims (1)

【特許請求の範囲】[Claims] (1)絶縁基板上にP型半導体層、真性半導体層及びN
型半導体層をラテラルに配置してなるPINフォトダイ
オードを形成したフォトセンサにおいて、 上記N型半導体層とP型半導体層とのうちの一方と一体
に形成された半導体層により構成された電極と、上記N
型半導体層とP型半導体層とのうちの他方の表面に絶縁
膜の窓開部を通して接続され上記電極上に絶縁膜を介し
て積層された配線膜により構成された電極と、からなる
キャパシタを、上記絶縁基板上の上記PINフォトダイ
オードの近傍に設けたことを特徴とするフォトセンサ
(1) P-type semiconductor layer, intrinsic semiconductor layer and N
In a photosensor in which a PIN photodiode is formed by laterally arranging type semiconductor layers, an electrode constituted by a semiconductor layer integrally formed with one of the N-type semiconductor layer and the P-type semiconductor layer; Above N
a capacitor comprising an electrode connected to the other surface of the P-type semiconductor layer and the P-type semiconductor layer through a window opening in an insulating film and formed of a wiring film laminated on the electrode with an insulating film interposed therebetween. , a photosensor provided near the PIN photodiode on the insulating substrate.
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